CN209897174U - 一种基于fpga的视频图像处理装置 - Google Patents

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谈元鹏
蒲天骄
邓春宇
史梦洁
仝杰
陈盛
张玉天
徐会芳
闫冬
杨硕
张树华
赵紫璇
廖坤
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Abstract

本实用新型涉及一种基于FPGA的视频图像处理装置,包括:视频采集器、A/D转换器、显示器、D/A转换器、存储器、FPGA处理器和ARM控制器;FPGA处理器分别与存储器和ARM控制器连接;A/D转换器分别与所述视频采集器、FPGA处理器和ARM控制器连接;D/A转换器分别与所述显示器、FPGA处理器和ARM控制器连接。该装置通过视频采集器采集视频图像,利用FPGA处理器进行数字图像的处理,再通过D/A转换器转换为模拟信号在显示器显示输出,结构简单,使用灵活方便。

Description

一种基于FPGA的视频图像处理装置
技术领域
本实用新型涉及通信技术领域,具体涉及一种基于FPGA的视频图像处理装置。
背景技术
图像处理技术和机器视觉作为一门前沿的技术,为人们的生活和工作带来了极大的便利。目前图像视频在监控、无人机航拍等领域中均得到了极为广泛的应用,对视频采集设备所产生的海量数据进行分析处理的任务日益繁重。视频信号的数据量大,信号较为复杂,难以在实时采集的同时进行大容量存储和实时处理。
发明内容
针对现有技术的不足,本实用新型的目的是提供一种基于FPGA的视频图像处理装置,利用FPGA并行处理快速的特点,辅以图像处理算法,用以获得不同需求的视频图像,并通过显示器进行实时显示。
本发明的目的是采用下述技术方案实现的:
一种基于FPGA的视频图像处理装置,包括:视频采集器、A/D转换器、显示器、D/A转换器、存储器、FPGA处理器和ARM控制器;其改进之处在于:所述FPGA处理器分别与存储器和ARM控制器连接;
所述A/D转换器分别与所述视频采集器、FPGA处理器和ARM控制器连接;
所述D/A转换器分别与所述显示器、FPGA处理器和ARM控制器连接。
优选的,所述视频采集器由相互连接的视频摄像头和视频输入接口组成;
优选的,所述A/D转换器为TW2867解码芯片。
优选的,所述D/A转换器为ADV7123视频编码芯片。
优选的,所述显示器由相互连接的VGA接口和LCD显示器组成。
优选的,所述存储器由第一DDR2存储器和第二DDR2存储器并联组成。
与最接近的现有技术相比,本发明具有的有益效果为:
本实用新型提供的一种基于FPGA的视频图像处理装置,采用FPGA处理器进行目标检测、目标运动追踪等数字图像的处理,具有结构简单,使用灵活方便的特点;并且FPGA处理器与存储器连接增大了总线宽度,扩大了整个系统的带宽,满足了视频处理过程中对高缓冲区的需求。
附图说明
图1是本实用新型实施例提供的系统设计原理框图
图2是本实用新型实施例提供的硬件设计原理示意图
具体实施方式
下面结合附图对本发明的具体实施方式作进一步的详细说明。
为使本实用新型实施例的目的、技术方案和优点更加清楚,下面将结合本实用新型实施例中的附图,对本实用新型实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例是本实用新型一部分实施例,而不是全部的实施例。基于本实用新型中的实施例,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其它实施例,都属于本实用新型保护的范围。
本发明提供了一种基于FPGA的视频图像处理装置,如图1所示,包括:视频采集器、A/D转换器、显示器、D/A转换器、存储器、FPGA处理器和ARM控制器;
所述FPGA处理器分别与存储器和ARM控制器连接;
所述A/D转换器分别与所述视频采集器、FPGA处理器和ARM控制器连接;
所述D/A转换器分别与所述显示器、FPGA处理器和ARM控制器连接;
所述视频采集器由相互连接的视频摄像头和视频输入接口组成;
所述A/D转换器为TW2867解码芯片;
所述D/A转换器为ADV7123视频编码芯片;
所述显示器由相互连接的VGA接口和LCD显示器组成;
所述存储器由第一DDR2存储器和第二DDR2存储器并联组成。
本实用新型提供的实施例的工作过程为:
A/D转换器TW2867将通过视频输入接口连接的视频摄像头拍摄到的视频模拟信号转变为ITU-RBT656格式的数字视频信号,存储在DDR2存储器中作为图像数据信息的缓存,供FPGA处理器和ARM控制器运行视频图像处理算法,进行目标检测识别和目标运动追踪等数字图像的处理,处理的结果再通过D/A转换器ADV7123进行格式转换输出模拟信号,模拟信号输入VGA接口连接的LCD显示器中显示处理后视频信息。
FPGA处理器与两片DDR2连接使总线宽度达到32bit,整个系统的带宽达到10Gb/s,两片DDR2容量达到2Gbit,以满足视频处理过程中对高缓冲区的需求。FPGA处理器使用速度级别最高的C6级别,可以实现FPGA和DDR2之间的时钟频率达到200M,DDR2内部的时钟频率为400M,充分满足了1080P视频处理的需求。
最后应当说明的是:以上实施例仅用以说明本实用新型的技术方案而非对其限制,尽管参照上述实施例对本实用新型进行了详细的说明,所属领域的普通技术人员应当理解:依然可以对本实用新型的具体实施方式进行修改或者等同替换,而未脱离本实用新型精神和范围的任何修改或者等同替换,其均应涵盖在本实用新型的权利要求保护范围之内。

Claims (6)

1.一种基于FPGA的视频图像处理装置,包括:视频采集器、A/D转换器、显示器、D/A转换器、存储器、FPGA处理器和ARM控制器;其特征在于:所述FPGA处理器分别与存储器和ARM控制器连接;
所述A/D转换器分别与所述视频采集器、FPGA处理器和ARM控制器连接;
所述D/A转换器分别与所述显示器、FPGA处理器和ARM控制器连接。
2.如权利要求1所述的装置,其特征在于,所述视频采集器由相互连接的视频摄像头和视频输入接口组成。
3.如权利要求1所述的装置,其特征在于,所述A/D转换器为TW2867解码芯片。
4.如权利要求1所述的装置,其特征在于,所述D/A转换器为ADV7123视频编码芯片。
5.如权利要求1所述的装置,其特征在于,所述显示器由相互连接的VGA接口和LCD显示器组成。
6.如权利要求1所述的装置,其特征在于,所述存储器由第一DDR2存储器和第二DDR2存储器并联组成。
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* Cited by examiner, † Cited by third party
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CN111314710A (zh) * 2020-03-24 2020-06-19 西北工业大学 一种无人机机载多传感器多处理器的视频压缩处理方法和装置
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