CN209248276U - 一种减少soc的功耗同时保持cpu的频率不变的电路 - Google Patents
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Abstract
本实用新型涉及一种减少SOC的功耗同时保持CPU的频率不变的电路,包括电源芯片,电源芯片连接有电流侦测电路,电源芯片还与设备的微处理器连接;电流侦测电路包括第一电阻,通过电流侦测电路中的第一电阻改变电源芯片的电流负载侦测大小,然后通过BIOS设定微处理器的TDP的功耗,从而以避免由于功率过大导致微处理器的频率下降;实现电路简单,成本低,体积小,适用性广泛。
Description
技术领域
本实用新型涉及低功耗电路技术领域,更具体地说,涉及一种减少SOC的功耗同时保持CPU的频率不变的电路。
背景技术
随着人们的生活水平的不断提高,人们对移动终端的使用需求也越来越多,例如:OPS电脑,笔记本,平板电脑,然而现有的移动终端大多存在着SOC功耗过高,致使待机时间短,不能够长时间使用。
实用新型内容
本实用新型要解决的技术问题在于,针对现有技术的上述缺陷,提供一种电路简单,成本低,体积小的减少SOC的功耗同时保持CPU的频率不变的电路。
本实用新型解决其技术问题所采用的技术方案是:
构造一种减少SOC的功耗同时保持CPU的频率不变的电路,包括电源芯片;其特征在于,所述电源芯片连接有电流侦测电路,所述电源芯片还与设备的微处理器连接;所述电流侦测电路包括第一电阻,所述第一电阻与所述电源芯片的ISUMN_B端连接,所述电源芯片的ISUMN_B端还连接有第一电容,所述第一电容的另一端连接有第二电阻,所述第二电阻的另一端与所述第一电阻的另一端连接;所述电源芯片的ISUMP_B端与ISUMN_B端并联有第二电容和第三电容以及第三电阻,所述电源芯片的ISUMP_B端还连接有第四电阻,所述第四电阻的另一端连接有热敏电阻,所述热敏电阻的另一端与所述电源芯片的ISUMN_B端连接;所述电源芯片的ISUMP_B端与ISUMN_B端均与所述微处理器连接。
本实用新型所述的减少SOC的功耗同时保持CPU的频率不变的电路,其中,所述电源芯片的FB_B端连接有第五电阻,所述第五电阻的另一端与外部控制电路连接;所述电源芯片的FB_B端还连接有第六电阻和第七电阻,所述第六电阻的另一端连接有第四电容,所述第四电容的另一端接地,所述第七电阻的另一端连接有第五电容,所述第五电容的另一端与所述第五电阻的另一端连接;所述第五电阻的另一端还连接有第八电阻,所述第八电阻的另一端与电源的正极连接。
本实用新型所述的减少SOC的功耗同时保持CPU的频率不变的电路,其中,所述第五电阻的另一端还连接有第六电容和第七电容,所述第六电容的另一端还连接有第八电容和第九电阻,所述第七电容和所述第八电容以及所述第九电阻的另一端均接地,所述第六电容的另一端还与电源芯片的RTN_B端连接。
本实用新型的有益效果在于:通过电流侦测电路中的第一电阻改变电源芯片的电流负载侦测大小,然后通过BIOS设定微处理器的TDP的功耗,从而以避免由于功率过大导致微处理器的频率下降;实现电路简单,成本低,体积小,适用性广泛。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将结合附图及实施例对本实用新型作进一步说明,下面描述中的附图仅仅是本发明的部分实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他附图:
图1是本实用新型较佳实施例的减少SOC的功耗同时保持CPU的频率不变的电路的电路图。
具体实施方式
为了使本实用新型实施例的目的、技术方案和优点更加清楚,下面将结合本实用新型实施例中的技术方案进行清楚、完整的描述,显然,所描述的实施例是本实用新型的部分实施例,而不是全部实施例。基于本发明的实施例,本领域普通技术人员在没有付出创造性劳动的前提下所获得的所有其他实施例,都属于本实用新型的保护范围。
本实用新型较佳实施例的减少SOC的功耗同时保持CPU的频率不变的电路如图1所示,包括电源芯片UP7,电源芯片UP7连接有电流侦测电路1,电源芯片UP7还与设备的微处理器(图中未显示)连接;电流侦测电路1包括第一电阻RP94,第一电阻RP94与电源芯片UP7的ISUMN_B端连接,电源芯片UP7的ISUMN_B端还连接有第一电容CP76,第一电容CP76的另一端连接有第二电阻RP88,第二电阻RP88的另一端与第一电阻RP94的另一端连接;电源芯片UP7的ISUMP_B端与ISUMN_B端并联有第二电容CP79和第三电容CP75以及第三电阻RP90,电源芯片UP7的ISUMP_B端还连接有第四电阻RP83,第四电阻RP83的另一端连接有热敏电阻RT3,热敏电阻RT3的另一端与电源芯片UP7的ISUMN_B端连接;电源芯片UP7的ISUMP_B端与ISUMN_B端均与微处理器连接。
如图1所示,电源芯片UP7的FB_B端连接有第五电阻RP72,第五电阻RP72的另一端与外部控制电路(图中未显示)连接;电源芯片UP7的FB_B端还连接有第六电阻RP73和第七电阻RP71,第六电阻RP73的另一端连接有第四电容CP67,第四电容CP67的另一端接地,第七电阻RP71的另一端连接有第五电容CP66,第五电容CP66的另一端与第五电阻RP72的另一端连接;第五电阻RP72的另一端还连接有第八电阻RP77,第八电阻RP77的另一端与电源的正极连接;电路点单,成本低,体积小。
如图1所示,第五电阻RP72的另一端还连接有第六电容CP69和第七电容CP72,第六电容CP69的另一端还连接有第八电容CP71和第九电阻RP80,第七电容CP72和第八电容CP71以及第九电阻RP80的另一端均接地,第六电容CP69的另一端还与电源芯片UP7的RTN_B端连接;电路点单,成本低,体积小。
应当理解的是,对本领域普通技术人员来说,可以根据上述说明加以改进或变换,而所有这些改进和变换都应属于本实用新型所附权利要求的保护范围。
Claims (3)
1.一种减少SOC的功耗同时保持CPU的频率不变的电路,包括电源芯片;其特征在于,所述电源芯片连接有电流侦测电路,所述电源芯片还与设备的微处理器连接;所述电流侦测电路包括第一电阻,所述第一电阻与所述电源芯片的ISUMN_B端连接,所述电源芯片的ISUMN_B端还连接有第一电容,所述第一电容的另一端连接有第二电阻,所述第二电阻的另一端与所述第一电阻的另一端连接;所述电源芯片的ISUMP_B端与ISUMN_B端并联有第二电容和第三电容以及第三电阻,所述电源芯片的ISUMP_B端还连接有第四电阻,所述第四电阻的另一端连接有热敏电阻,所述热敏电阻的另一端与所述电源芯片的ISUMN_B端连接;所述电源芯片的ISUMP_B端与ISUMN_B端均与所述微处理器连接。
2.根据权利要求1所述的减少SOC的功耗同时保持CPU的频率不变的电路,其特征在于,所述电源芯片的FB_B端连接有第五电阻,所述第五电阻的另一端与外部控制电路连接;所述电源芯片的FB_B端还连接有第六电阻和第七电阻,所述第六电阻的另一端连接有第四电容,所述第四电容的另一端接地,所述第七电阻的另一端连接有第五电容,所述第五电容的另一端与所述第五电阻的另一端连接;所述第五电阻的另一端还连接有第八电阻,所述第八电阻的另一端与电源的正极连接。
3.根据权利要求2所述的减少SOC的功耗同时保持CPU的频率不变的电路,其特征在于,所述第五电阻的另一端还连接有第六电容和第七电容,所述第六电容的另一端还连接有第八电容和第九电阻,所述第七电容和所述第八电容以及所述第九电阻的另一端均接地,所述第六电容的另一端还与电源芯片的RTN_B端连接。
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