CN207039550U - 一种抗干扰低误码滤波器 - Google Patents
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Abstract
本实用新型公开了一种抗干扰低误码滤波器，主要解决现有技术中存在的无源滤波器带外抑制低，抗干扰能力差的问题。该滤波器包括用于射频输入的输入端口IN，连接在输入端口IN上的抗干扰电路，与抗干扰电路连接的时延均衡电路，以及与时延均衡电路连接、用于射频输出的输出端口OUT。通过上述方案，本实用新型结构简单，成本低廉、运行稳定，具有较高的带外抑制能力，其抗干扰能力强优点，在电子设备领域具有很高的实用价值和推广价值。
Description
技术领域
本实用新型涉及电子设备领域，尤其是一种抗干扰低误码滤波器。
背景技术
LC滤波器即无源滤波器，是利用电感、电容和电阻的组合构成的滤波电路，因电感线圈具有通低频、阻高频特性，可滤除某一次或多次谐波，具有滤除噪声和分离信号的功能，被广泛运用于电子设备传输领域。其中，LC滤波器按照功能可分为：LC低通滤波器、LC带通滤波器、高通滤波器、LC全通滤波器和LC带阻滤波器。
传统的LC滤波器常采用线性低通滤波器原型来进行设计，其不足之处在于，设计的滤波器的带外抑制比较低，对偏离指定频率有限占用频段范围以外的信号抑制能力差，电路中必然存在一部分干扰信号，致使滤波效果差，滤波器抗干扰能力差。
实用新型内容
本实用新型的目的在于提供一种抗干扰低误码滤波器，主要解决现有技术中存在的无源滤波器带外抑制低，抗干扰能力差的问题。
为了实现上述目的，本实用新型采用的技术方案如下：
一种抗干扰低误码滤波器，包括用于射频输入的输入端口IN，连接在输入端口IN上的抗干扰电路，与抗干扰电路连接的时延均衡电路，以及与时延均衡电路连接、用于射频输出的输出端口OUT。
具体地，抗干扰电路包括与输入端口连接的1号节点，一端接1号节点且另一端接地的并联谐振器L1C1，连接在1号节点上的并联谐振器L2C2，设置在并联谐振器L2C2另一端的2号节点，与2号节点连接的并联谐振器L3C3，设置在并联谐振器L3C3另一端的3号节点，一端接3号节点且另一端接地的并联谐振器L4C4，与3号节点连接的并联谐振器L5C5，设置在并联谐振器L5C5另一端的4号节点，与4号节点连接的并联谐振器L6C6，设置在并联谐振器L6C6另一端的5号节点，以及一端接5号节点且另一端接地的并联谐振器L7C7。并联谐振器构成了T型结构，增加电路零点，使带外抑制提高，抗干扰能力增强。
进一步地，时延均衡电路包括分别与5号节点连接的电感L8和电容C8，设置在电容C8另一端的6号节点，一端接6号节点且另一端接地的串联谐振器L10C10，与6号节点连接的电容C9，以及设置在电容C9另一端的7号节点，其中，7号节点与电感L8另一端连接，输出端口OUT与7号节点连接。在电路中，增加了零点，零点在提高带外抑制的同时，也产生了群延时波动，通过设置时延均衡电路，抑制群延时波动，可有效降低误码输出。
与现有技术相比，本实用新型具有以下有益效果：
(1)本实用新型采用抗干扰能力强，滤除多次谐波。通过T型结构的并联谐振，增加零点，通过调整零点位置，使带外抑制得到提高，电路的抗干扰能力明显增强。
(2)不仅如此，增加零点所产生的群延时波动在时延均衡电路得到抑制，降低误码输出。
(3)本实用新型采用成熟的电容和电感构成无源滤波电路，其结构简单，成本低廉、运行稳定，具有较高的带外抑制能力，其抗干扰能力强等优点，在电子设备领域具有很高的实用价值和推广价值。
附图说明
图1为本实用新型的原理图。
具体实施方式
下面结合附图和实施例对本实用新型作进一步说明，本实用新型的实施方式包括但不限于下列实施例。
实施例
如图1所示，一种抗干扰低误码滤波器，包括用于射频输入的输入端口IN，连接在输入端口IN上的抗干扰电路，与抗干扰电路连接的时延均衡电路，以及与时延均衡电路连接、用于射频输出的输出端口OUT。
该抗干扰电路包括与输入端口连接的1号节点，一端接1号节点且另一端接地的并联谐振器L1C1，连接在1号节点上的并联谐振器L2C2，设置在并联谐振器L2C2另一端的2号节点，与2号节点连接的并联谐振器L3C3，设置在并联谐振器L3C3另一端的3号节点，一端接3号节点且另一端接地的并联谐振器L4C4，与3号节点连接的并联谐振器L5C5，设置在并联谐振器L5C5另一端的4号节点，与4号节点连接的并联谐振器L6C6，设置在并联谐振器L6C6另一端的5号节点，以及一端接5号节点且另一端接地的并联谐振器L7C7。
该时延均衡电路包括分别与5号节点连接的电感L8和电容C8，设置在电容C8另一端的6号节点，一端接6号节点且另一端接地的串联谐振器L10C10，与6号节点连接的电容C9，以及设置在电容C9另一端的7号节点，其中，7号节点与电感L8另一端连接，输出端口OUT与7号节点连接。
抗干扰低误码滤波器采用两级T型结构的并联谐振电路，增加电路的零点数进行滤波，提高滤波能力，并通过时延均衡电路抑制群延时波动，有效降低误码输出。该滤波器具有滤波抗干扰能力强，输出误码率低的优点。
上述实施例仅为本实用新型的优选实施例，并非对本实用新型保护范围的限制，但凡采用本实用新型的设计原理，以及在此基础上进行非创造性劳动而作出的变化，均应属于本实用新型的保护范围之内。
Claims (2)
1.一种抗干扰低误码滤波器，其特征在于，包括用于射频输入的输入端口IN，连接在输入端口IN上的抗干扰电路，与抗干扰电路连接的时延均衡电路，以及与时延均衡电路连接、用于射频输出的输出端口OUT；
所述抗干扰电路包括与输入端口连接的1号节点，一端接1号节点且另一端接地的并联谐振器L1C1，连接在1号节点上的并联谐振器L2C2，设置在并联谐振器L2C2另一端的2号节点，与2号节点连接的并联谐振器L3C3，设置在并联谐振器L3C3另一端的3号节点，一端接3号节点且另一端接地的并联谐振器L4C4，与3号节点连接的并联谐振器L5C5，设置在并联谐振器L5C5另一端的4号节点，与4号节点连接的并联谐振器L6C6，设置在并联谐振器L6C6另一端的5号节点，以及一端接5号节点且另一端接地的并联谐振器L7C7；
所述时延均衡电路包括分别与5号节点连接的电感L8和电容C8，设置在电容C8另一端的6号节点，一端接6号节点且另一端接地的串联谐振器L10C10，与6号节点连接的电容C9，以及设置在电容C9另一端的7号节点，其中，7号节点与电感L8另一端连接。
2.根据权利要求1所述的一种抗干扰低误码滤波器，其特征在于，所述输出端口OUT与7号节点连接。
Priority Applications (1)
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|---|---|---|---|
| CN201720873580.4U CN207039550U (zh) | 2017-07-18 | 2017-07-18 | 一种抗干扰低误码滤波器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
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| CN201720873580.4U CN207039550U (zh) | 2017-07-18 | 2017-07-18 | 一种抗干扰低误码滤波器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| CN207039550U true CN207039550U (zh) | 2018-02-23 |
Family
ID=61464327
Family Applications (1)
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| CN201720873580.4U Active CN207039550U (zh) | 2017-07-18 | 2017-07-18 | 一种抗干扰低误码滤波器 |
Country Status (1)
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| CN (1) | CN207039550U (zh) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN112564671A (zh) * | 2020-11-25 | 2021-03-26 | 电子科技大学 | 一种带内超低群时延波动滤波器 |
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2017
- 2017-07-18 CN CN201720873580.4U patent/CN207039550U/zh active Active
Cited By (2)
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|---|---|---|---|---|
| CN112564671A (zh) * | 2020-11-25 | 2021-03-26 | 电子科技大学 | 一种带内超低群时延波动滤波器 |
| CN112564671B (zh) * | 2020-11-25 | 2023-01-31 | 电子科技大学 | 一种带内超低群时延波动滤波器 |
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