CN203872185U - 一种分数阶次不同的含y方的Lorenz型混沌切换系统电路 - Google Patents

Abstract

本实用新型提供一种分数阶次不同的含y方的Lorenz型混沌切换系统电路，利用运算放大器U1、运算放大器U2及电阻和电容构成反相加法器和不同阶次的分数阶反相积分器，利用乘法器U3和乘法器U4实现乘法运算，利用模拟开关U5实现模拟信号的选择输出，所述运算放大器U1和运算放大器U2采用LF347D，所述乘法器U3和乘法器U4采用AD633JN，所述模拟开关U5采用ADG888，所述运算放大器U1连接乘法器U3、乘法器U4和模拟开关U5，所述运算放大器U2连接乘法器U3和模拟开关U5，所述乘法器U3连接运算放大器U1，所述乘法器U4连接运算放大器U2，所述模拟开关U5连接运算放大器U1和运算放大器U2，提出了一个新型的混沌系统的新型切换电路，这对增加混沌系统切换的类型及这种混沌系统应用于工程实践提供了一种新思路。

Description

一种分数阶次不同的含y方的Lorenz型混沌切换系统电路

技术领域

本实用新型涉及一个混沌系统及电路实现，特别涉及一种分数阶次不同的含y方的Lorenz型混沌切换系统电路。 

背景技术

目前，己有的切换混沌系统的电路主要包括混沌系统中不同线性项或非线性项的之间的切换，以及基于这2种切换模式的分数阶形式，关于不同阶次的分数阶混沌系统的切换电路还没有被提出，本实用新型提出了一种分数阶次不同的含y方的Lorenz型混沌切换系统电路，本实用新型提出了一个新型的混沌系统的新型切换电路，这对增加混沌系统切换的类型及这种混沌系统应用于工程实践提供了一种新思路。 

发明内容

本实用新型要解决的技术问题是提供一种分数阶次不同的含y方的Lorenz型混沌切换系统电路，本实用新型采用如下技术手段实现发明目的： 

一种分数阶次不同的含y方的Lorenz型混沌切换系统电路，其特征是在于， 

(1)构造一种分数阶次不同的含y方的Lorenz型混沌切换系统为： 

$\left\{\begin{array}{c}{d}^{q}x/{\mathrm{dt}}^q=a(y-x)\\ d^{q}y/{\mathrm{dt}}^q=\mathrm{bx}+\mathrm{cy}-\mathrm{xz}\\ d^{q}z/{\mathrm{dt}}^q=y^2-\mathrm{hz}\end{array}\right.aa=20,b=14,c=10.6,h=2.8,q=f\left(x\right)=\left\{\begin{array}{cc}0.9& x>0\\ 0.1& x\≤0\end{array}\right.$

(2)根据分数阶次不同的含y方的Lorenz型混沌切换系统构造模拟电路系统，利用运算放大器U1、运算放大器U2及电阻和电容构成反相加法器和不同阶次的分数阶反相积分器，利用乘法器U3和乘法器U4实现乘法运算，利用模拟开关U5实现模拟信号的选择输出，所述运算放大器U1和运算放大器U2采用LF347D，所述乘法器U3和乘法器U4采用AD633JN，所述模拟开关U5采用ADG888，所述运算放大器U1连接乘法器U3、乘法器U4和模拟开关U5，所述运算放大器U2连接乘法器U3和模拟开关U5，所述乘法器U3连接运算放大器U1，所述乘法器U4连接运算放大器U2，所述模拟开关U5连接运算放大器U1和运算放大器U2； 

所述运算放大器U1的第1引脚通过电阻R3与运算放大器U1的第2引脚相接，通过电阻R8与运算放大器U1的第6引脚相接，运算放大器U1的第3、5、10、12引脚接地，第4引脚接VCC，第11引脚接VEE，运算放大器U1的第6引脚通过电阻Ry11与电容Cy11的并联，接电阻Ry12与电容Cy12的并联，再接电阻Ry13与电容Cy13的并联后，再接模拟开关 U5的第7引脚，通过电阻Ry21与电容Cy21的并联，接电阻Ry22与电容Cy22的并联，再接电阻Ry23与电容Cy23的并联后，再接模拟开关U5的第5引脚，运算放大器U1的第7引脚通过电阻R2接运算放大器U1的第13引脚，通过电阻R5接运算放大器U1的第2引脚，接乘法器U4的第1、3引脚，运算放大器U1的第8引脚通过电阻R6接运算放大器U1的第9引脚，通过电阻R4接运算放大器U1的第6引脚，接运算放大器U2的第2引脚,接乘法器U3的第1引脚，运算放大器U1的第9引脚通过电阻Rx11与电容Cx11的并联，接电阻Rx12与电容Cx12的并联，再接电阻Rx13与电容Cx13的并联后，再接模拟开关U5的第2引脚，通过电阻Rx21与电容Cx21的并联，接电阻Rx22与电容Cx22的并联，再接电阻Rx23与电容Cx23的并联后，再接模拟开关U5的第4引脚，运算放大器U1的第14引脚通过电阻R1接运算放大器U1的第13引脚，通过电阻R7接运算放大器U1的第9引脚； 

所述运算放大器U2的第6、7引脚悬空，所述运算放大器U2的第3、5、10、12引脚接地，第4引脚接VCC，第11引脚接VEE，运算放大器U2的第1引脚通过电阻R14和R15的串联接地,通过R14接模拟开关U5的第8、9引脚，运算放大器U2的第8引脚通过电阻R12接运算放大器U2的第9引脚，接乘法器U3的第3引脚,运算放大器U2的第9引脚通过电阻Rz11与电容Cz11的并联，接电阻Rz12与电容Cz12的并联，再接电阻Rz13与电容Cz13的并联后，再接模拟开关U5的第10引脚，通过电阻Rz21与电容Cz21的并联，接电阻Rz22与电容Cz22的并联，再接电阻Rz23与电容Cz23的并联后，再接模拟开关U5的第12引脚，运算放大器U2的第14引脚通过电阻R11接运算放大器U2的第13引脚，通过电阻R13接运算放大器U2的第9引脚； 

所述乘法器U3的第1引脚接运算放大器U1的第8引脚，第3引脚接运算放大器U2的第8引脚，第2、4、6引脚均接地，第5引脚接VEE，第7引脚通过电阻R9接运算放大器U1的第6引脚，第8引脚接VCC； 

所述乘法器U4的第1、3引脚接运算放大器U1的第7引脚，第2、4、6引脚均接地，第5引脚接VEE，第7引脚通过电阻R10接运算放大器U2的第13引脚，第8引脚接VCC； 

所述模拟开关U5的第1引脚接VCC,第16引脚接地，第13、14、15引脚悬空，第3引脚接运算放大器U1的第8引脚,第6引脚接运算放大器U1的第7引脚,第11引脚接运算放大器U2的第8引脚。 

本实用新型的有益效果是：提出了一个新型的混沌系统的新型切换电路，这对增加混沌系统切换的类型及这种混沌系统应用于工程实践提供了一种新思路。 

附图说明

图1为本实用新型优选实施例的电路连接结构示意图。 

图2和图3为本实用新型的电路实际连接图。 

具体实施方式

下面结合附图和优选实施例对本实用新型作更进一步的详细描述，参见图1-图3。 

一种分数阶次不同的含y方的Lorenz型混沌切换系统电路，其特征是在于， 

(1)构造一种分数阶次不同的含y方的Lorenz型混沌切换系统为： 

$\left\{\begin{array}{c}{d}^{q}x/{\mathrm{dt}}^q=a(y-x)\\ d^{q}y/{\mathrm{dt}}^q=\mathrm{bx}+\mathrm{cy}-\mathrm{xz}\\ d^{q}z/{\mathrm{dt}}^q=y^2-\mathrm{hz}\end{array}\right.aa=20,b=14,c=10.6,h=2.8,q=f\left(x\right)=\left\{\begin{array}{cc}0.9& x>0\\ 0.1& x\≤0\end{array}\right.$

(2)根据分数阶次不同的含y方的Lorenz型混沌切换系统构造模拟电路系统，利用运算放大器U1、运算放大器U2及电阻和电容构成反相加法器和不同阶次的分数阶反相积分器，利用乘法器U3和乘法器U4实现乘法运算，利用模拟开关U5实现模拟信号的选择输出，所述运算放大器U1和运算放大器U2采用LF347D，所述乘法器U3和乘法器U4采用AD633JN，所述模拟开关U5采用ADG888，所述运算放大器U1连接乘法器U3、乘法器U4和模拟开关U5，所述运算放大器U2连接乘法器U3和模拟开关U5，所述乘法器U3连接运算放大器U1，所述乘法器U4连接运算放大器U2，所述模拟开关U5连接运算放大器U1和运算放大器U2； 

所述运算放大器U1的第1引脚通过电阻R3与运算放大器U1的第2引脚相接，通过电阻R8与运算放大器U1的第6引脚相接，运算放大器U1的第3、5、10、12引脚接地，第4引脚接VCC，第11引脚接VEE，运算放大器U1的第6引脚通过电阻Ry11与电容Cy11的并联，接电阻Ry12与电容Cy12的并联，再接电阻Ry13与电容Cy13的并联后，再接模拟开关U5的第7引脚，通过电阻Ry21与电容Cy21的并联，接电阻Ry22与电容Cy22的并联，再接电阻Ry23与电容Cy23的并联后，再接模拟开关U5的第5引脚，运算放大器U1的第7引脚通过电阻R2接运算放大器U1的第13引脚，通过电阻R5接运算放大器U1的第2引脚，接乘法器U4的第1、3引脚，运算放大器U1的第8引脚通过电阻R6接运算放大器U1的第9引脚，通过电阻R4接运算放大器U1的第6引脚，接运算放大器U2的第2引脚,接乘法器U3的第1引脚，运算放大器U1的第9引脚通过电阻Rx11与电容Cx11的并联，接电阻Rx12与电容Cx12的并联，再接电阻Rx13与电容Cx13的并联后，再接模拟开关U5的第2引脚，通过电阻Rx21与电容Cx21的并联，接电阻Rx22与电容Cx22的并联，再接电阻Rx23与电容Cx23的并联后，再接模拟开关U5的第4引脚，运算放大器U1的第14引脚通过电阻R1接运算放大器U1的第13引脚，通过电阻R7接运算放大器U1的第9引脚； 

所述运算放大器U2的第6、7引脚悬空，所述运算放大器U2的第3、5、10、12引脚接地，第4引脚接VCC，第11引脚接VEE，运算放大器U2的第1引脚通过电阻R14和R15的串联接地,通过R14接模拟开关U5的第8、9引脚，运算放大器U2的第8引脚通过电阻R12接运算放大器U2的第9引脚，接乘法器U3的第3引脚,运算放大器U2的第9引脚通过电阻Rz11与电容Cz11的并联，接电阻Rz12与电容Cz12的并联，再接电阻Rz13与电容Cz13的并联后，再接模拟开关U5的第10引脚，通过电阻Rz21与电容Cz21的并联，接电阻Rz22与电容Cz22的并联，再接电阻Rz23与电容Cz23的并联后，再接模拟开关U5的第12引脚，运算放大器U2的第14引脚通过电阻R11接运算放大器U2的第13引脚，通过电阻R13接运算放大器U2的第9引脚； 

所述乘法器U3的第1引脚接运算放大器U1的第8引脚，第3引脚接运算放大器U2的第8引脚，第2、4、6引脚均接地，第5引脚接VEE，第7引脚通过电阻R9接运算放大器U1的第6引脚，第8引脚接VCC； 

所述乘法器U4的第1、3引脚接运算放大器U1的第7引脚，第2、4、6引脚均接地，第5引脚接VEE，第7引脚通过电阻R10接运算放大器U2的第13引脚，第8引脚接VCC； 

所述模拟开关U5的第1引脚接VCC,第16引脚接地，第13、14、15引脚悬空，第3引脚接运算放大器U1的第8引脚,第6引脚接运算放大器U1的第7引脚,第11引脚接运算放大器U2的第8引脚。 

电路中电阻R1＝R7＝R3＝R8＝R11＝R13＝10kΩ，R2＝R6＝5kΩ，R4＝9.4kΩ，R5＝7.14kΩ，R9＝R10＝1kΩ，R12＝35.7kΩ，R14＝100kΩ，R15＝80kΩ，Rx11＝Ry11＝Rz11＝62.84MΩ，Rx12＝Ry12＝Rz12＝250kΩ，Rx13＝Ry13＝Rz13＝2.5kΩ，Rx21＝Ry21＝Rz21＝0.636MΩ，Rx22＝Ry22＝Rz22＝0.3815MΩ，Rx23＝Ry23＝Rz23＝0.5672MΩ，Cx11＝Cy11＝Cz11＝1.2μF，Cx12＝Cy12＝Cz13＝1.8μF，Cx13＝Cy13＝Cz13＝1.1μF，Cx21＝Cy21＝Cz21＝15.75μF，Cx22＝Cy22＝Cz22＝0.1575μF，Cx23＝Cy23＝Cz23＝633.5nF。 

Claims (1)

1.一种分数阶次不同的含y方的Lorenz型混沌切换系统电路，其特征是在于， 

(1)构造一种分数阶次不同的含y方的Lorenz型混沌切换系统为： 

(2)根据分数阶次不同的含y方的Lorenz型混沌切换系统构造模拟电路系统，利用运算放大器U1、运算放大器U2及电阻和电容构成反相加法器和不同阶次的分数阶反相积分器，利用乘法器U3和乘法器U4实现乘法运算，利用模拟开关U5实现模拟信号的选择输出，所述运算放大器U1和运算放大器U2采用LF347D，所述乘法器U3和乘法器U4采用AD633JN，所述模拟开关U5采用ADG888，所述运算放大器U1连接乘法器U3、乘法器U4和模拟开关U5，所述运算放大器U2连接乘法器U3和模拟开关U5，所述乘法器U3连接运算放大器U1，所述乘法器U4连接运算放大器U2，所述模拟开关U5连接运算放大器U1和运算放大器U2； 

所述运算放大器U1的第1引脚通过电阻R3与运算放大器U1的第2引脚相接，通过电阻R8与运算放大器U1的第6引脚相接，运算放大器U1的第3、5、10、12引脚接地，第4引脚接VCC，第11引脚接VEE，运算放大器U1的第6引脚通过电阻Ry11与电容Cy11的并联，接电阻Ry12与电容Cy12的并联，再接电阻Ry13与电容Cy13的并联后，再接模拟开关U5的第7引脚，通过电阻Ry21与电容Cy21的并联，接电阻Ry22与电容Cy22的并联，再接电阻Ry23与电容Cy23的并联后，再接模拟开关U5的第5引脚，运算放大器U1的第7引脚通过电阻R2接运算放大器U1的第13引脚，通过电阻R5接运算放大器U1的第2引脚，接乘法器U4的第1、3引脚，运算放大器U1的第8引脚通过电阻R6接运算放大器U1的第9引脚，通过电阻R4接运算放大器U1的第6引脚，接运算放大器U2的第2引脚,接乘法器U3的第1引脚，运算放大器U1的第9引脚通过电阻Rx11与电容Cx11的并联，接电阻Rx12与电容Cx12的并联，再接电阻Rx13与电容Cx13的并联后，再接模拟开关U5的第2引脚，通过电阻Rx21与电容Cx21的并联，接电阻Rx22与电容Cx22的并联，再接电阻Rx23与电容Cx23的并联后，再接模拟开关U5的第4引脚，运算放大器U1的第14引脚通过电阻R1接运算放大器U1的第13引脚，通过电阻R7接运算放大器U1的第9引脚； 

所述运算放大器U2的第6、7引脚悬空，所述运算放大器U2的第3、5、10、12引脚接地，第4引脚接VCC，第11引脚接VEE，运算放大器U2的第1引脚通过电阻R14和R15的串联接地,通过R14接模拟开关U5的第8、9引脚，运算放大器U2的第8引脚通过电阻R12接运算放大器U2的第9引脚，接乘法器U3的第3引脚,运算放大器U2的第9引脚通 过电阻Rz11与电容Cz11的并联，接电阻Rz12与电容Cz12的并联，再接电阻Rz13与电容Cz13的并联后，再接模拟开关U5的第10引脚，通过电阻Rz21与电容Cz21的并联，接电阻Rz22与电容Cz22的并联，再接电阻Rz23与电容Cz23的并联后，再接模拟开关U5的第12引脚，运算放大器U2的第14引脚通过电阻R11接运算放大器U2的第13引脚，通过电阻R13接运算放大器U2的第9引脚； 

所述乘法器U3的第1引脚接运算放大器U1的第8引脚，第3引脚接运算放大器U2的第8引脚，第2、4、6引脚均接地，第5引脚接VEE，第7引脚通过电阻R9接运算放大器U1的第6引脚，第8引脚接VCC； 

所述乘法器U4的第1、3引脚接运算放大器U1的第7引脚，第2、4、6引脚均接地，第5引脚接VEE，第7引脚通过电阻R10接运算放大器U2的第13引脚，第8引脚接VCC； 

所述模拟开关U5的第1引脚接VCC,第16引脚接地，第13、14、15引脚悬空，第3引脚接运算放大器U1的第8引脚,第6引脚接运算放大器U1的第7引脚,第11引脚接运算放大器U2的第8引脚。