CN203241515U - 一种基于pc的逻辑分析仪 - Google Patents
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Abstract
本实用新型涉及一种基于PC的逻辑分析仪，它由上位机和下位机两个部分组成，上位机为PC机，包含数据存储模块和数据分析显示模块；下位机包含USB通信模块、供电模块、时钟模块、数字信号采集模块、FPGA、数据存储模块，其中FPGA分别与USB通信模块、供电模块、时钟模块、数字信号采集模块、数据存储模块相连，USB通信模块分别与FPGA、数据存储模块、供电模块相连；上位机和下位机通过USB接口相连。本实用新型具有结构简单、存储深度大、使用方便、价格低廉等优点，能够对1-Wire、I2C、I2S、SPI总线的数据实现解码。
Description
技术领域
本实用新型涉及数字信号测试和分析领域，尤其是涉及一种基于PC的逻辑分析仪。
背景技术
20世纪70年代以来，大规模集成电路的迅速发展与广泛应用，使得数字系统的复杂程度大大增加，导致其设计、开发、检测和故障诊断越来越复杂，在实际应用中我们常常希望可以对总线上传输的数据进行直观分析，而用传统的双通道示波器等逻辑电平测试设备已经远远不能满足用户的需求。
逻辑分析仪主要用于分析数字系统的逻辑关系、测定逻辑电平之间的时序关系，它已成为目前数字系统设计、开发、检测和故障诊断中不可或缺的工具，一般是将测试软件、运算管理原件整合在一台仪器之中，其结构复杂，价格昂贵，从几万元到几十万元不等，而且其核心技术被国外垄断，这都限制了逻辑分析仪在我国的普及和使用。
发明内容
本发明的目的是设计一种基于PC的逻辑分析仪，能实现对1-Wire、I2C、I2S、SPI总线上传输的数据进行直观分析。
为了达到上述目的，本发明的技术路线是：基于PC的逻辑分析仪，它由包括上位机和下位机两个部分组成，上位机为PC机，包含数据存储模块和数据分析显示模块；下位机包含USB通信模块、供电模块、时钟模块、数字信号采集模块、FPGA、数据存储模块，其中FPGA分别与USB通信模块、供电模块、时钟模块、数字信号采集模块、数据存储模块相连，USB通信模块分别与FPGA、数据存储模块、供电模块相连；上位机和下位机通过USB接口相连；下位机中供电模块的电源由USB通信模块提供；下位机中时钟模块采用有源晶振来提供FPGA的基准时钟。
本发明技术方案提供了一种基于PC的逻辑分析仪，它具有结构简单、存储深度大、使用方便、价格低廉等优点，能够为数字系统设计、开发、检测和故障诊断带来便利。
附图说明
图1是本实用新型的框架示意图。
图2是本实用新型的系统结构框图。
具体实施方式
为了更详细的描述本实用新型，下面结合附图1和附图2进行对本发明作进一步说明。
如图1所示，本实用新型包括上位机1和下位机2两个部分，上位机1和下位机2通过USB接口相连。待测终端3通过信号线连接至本实用新型的下位机2。
如图2所示，本实用新型的上位机1包含数据存储模块101和数据分析显示模块102；本实用新型的下位机2包含USB通信模块201、供电模块202、时钟模块203、数字信号采集模块204、FPGA 205、数据存储模块206，其中FPGA 205分别与USB通信模块201、供电模块202、时钟模块203、数字信号采集模块204、数据存储模块206相连，USB通信模块201分别与FPGA 205、数据存储模块206、供电模块202相连。
下位机2中供电模块202的电源由USB通信模块201提供。
下位机2中时钟模块203采用有源晶振来提供FPGA 205的基准时钟。
Claims (3)
1.一种基于PC的逻辑分析仪，其特征是：逻辑分析仪由上位机和下位机两个部分组成，上位机为PC机，包含数据存储模块和数据分析显示模块；下位机包含USB通信模块、供电模块、时钟模块、数字信号采集模块、FPGA、数据存储模块，其中FPGA分别与USB通信模块、供电模块、时钟模块、数字信号采集模块、数据存储模块相连，USB通信模块分别与FPGA、数据存储模块、供电模块相连；上位机和下位机通过USB接口相连。
2.根据权利要求1所述的一种基于PC的逻辑分析仪，其特征是：下位机中供电模块的电源由USB通信模块提供。
3.根据权利要求1所述的一种基于PC的逻辑分析仪，其特征是：下位机中时钟模块采用有源晶振来提供FPGA的基准时钟。
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