CN201134886Y - 称重数据视频记录控制器 - Google Patents

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张振刚
李晓亮
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Abstract

本实用新型涉及一种称重数据视频记录控制器，它属于一种应用于称重和视频监控领域将经过叠加后的视频图像进行动态实时视频监控的装置。本实用新型主要是解决现有的装置存在的数据记录容易被攥改和被称重物体没有直观的对照关系的技术难点。本实用新型的技术方案是：称重数据视频记录控制器，包括视频信号输入电路、称重数据输入电路、实时时钟电路和供电电路，其中：它还包括数据与视频信号叠加电路、中心控制电路、视频信号输出电路和开关量输出驱动电路；视频信号输入电路与数据与视频信号叠加电路连接，称重数据输入电路与中心控制电路连接，中心控制电路与数据与视频信号叠加电路连接，中心控制电路与开关量输出驱动电路连接。

Description

称重数据视频记录控制器
技术领域
本实用新型涉及一种称重数据视频记录控制器，它属于一种应用于称重和视频监控领域将经过叠加后的视频图像进行动态实时视频监控、录像或进行静态图片抓拍存贮的装置。
背景技术
目前称重仪表设备是将传感器取回的数据经过转换和处理之后通过显示器件显示，并按照一定的数据格式通过RS-232接口发送给计算机，计算机通过软件进行记录，这样生成的数据记录容易被攥改，而且与被称重物体没有直观的一一对照关系。
发明内容
本实用新型的目的是解决现有的装置存在的数据记录容易被攥改和被称重物体没有直观的对照关系的技术难点并提供一种数据记录不易被攥改和被称重物体有直观对照关系的称重数据视频记录控制器。
本实用新型为解决上述技术难点而采用的技术方案是：称重数据视频记录控制器，包括视频信号输入电路、称重数据输入电路、实时时钟电路和供电电路，其中：它还包括数据与视频信号叠加电路、中心控制电路、视频信号输出电路和开关量输出驱动电路；视频信号输入电路与数据与视频信号叠加电路连接，称重数据输入电路与中心控制电路连接，实时时钟电路与中心控制电路连接，中心控制电路与数据与视频信号叠加电路连接，中心控制电路与开关量输出驱动电路连接，数据与视频信号叠加电路与视频信号输出电路连接；数据与视频信号叠加电路能将称重仪表设备输出的称重过程数据与相应视频监控的视频信号相叠加，并将经过叠加后的视频信号输出供视频录像设备录像，利用图像的不可更改性在图像中记录称重过程中称重仪表数据的变化过程，同时依据设定的对比值，开关量输出驱动电路输出开关量联动报警或录像设备产生报警及提示或只对应称重过程录像，同时可以供称重程序图片截取。
由于本实用新型采用了上述技术方案，将称重设备输出的数据叠加于监视称重物体的视频图像信号中，这样在记录视频图像流或抓拍静态图片时，就可以将两种信号源合二为一，利用复合图像的不可更改性，生成的记录文件不可攥改；而且和所监视称重物体形成直观的一一对照关系。还可以在图像中叠加需要的中英文提示信息及实时时间信息。设置开关量输出并设定安全值，在超出阈值范围时产生开关量报警。因此，与背景技术相比，本实用新型具有生成的记录文件不可攥改、所监视称重物体能形成直观的一一对照关系等优点，补充了对于称重过程记录监督的手段，使记录视频与传统的软件记录数据形成相互独立的对应的监督关系。
图2说明
图1是本实用新型电路的方框图；
图2是本实用新型的电路原理图。
具体实时方式
下面结合图2和实施例对本实用新型作进一步的详细描述。
如图1所示，本实施例中的称重数据视频记录控制器，包括视频信号输入电路1、称重数据输入电路4、实时时钟电路7和供电电路8，其中：它还包括数据与视频信号叠加电路2、中心控制电路5、视频信号输出电路3和开关量输出驱动电路6；视频信号输入电路1与数据与视频信号叠加电路2连接，称重数据输入电路4与中心控制电路5连接，实时时钟电路7与中心控制电路5连接，中心控制电路5与数据与视频信号叠加电路2连接，中心控制电路5与开关量输出驱动电路6连接，数据与视频信号叠加电路2与视频信号输出电路3连接；供电电路8与视频信号输入电路1、称重数据输入电路4、实时时钟电路7、数据与视频信号叠加电路2、中心控制电路5、视频信号输出电路3和开关量输出驱动电路6连接；数据与视频信号叠加电路2能将称重仪表设备输出的称重过程数据与相应视频监控的视频信号相叠加，并将经过叠加后的视频信号输出供视频录像设备录像，利用图像的不可更改性在图像中记录称重过程中称重仪表数据的变化过程，同时依据设定的对比值，开关量输出驱动电路6输出开关量联动报警或录像设备产生报警及提示或只对应称重过程录像，同时可以供称重程序图片截取。
如图2所示，上述视频信号输入电路由同步信号分离芯片U6(LM1881)、三极管Q1、二极管D1、电阻R3、R4、R5、R10、电解电容E4和电容C9、C10组成，三极管Q1的发射极经电解电容E4接视频信号输入，三极管Q1的发射极经电阻R3接地，三极管Q1的基极与二极管D1的正极连接，三极管Q1的集电极接电源VCC，电阻R4并接在三极管Q1的基极与集电极之间，二极管D1的负极经电阻R5接地；同步信号分离芯片U6(LM1881)的2脚经电容C9与三极管Q1的发射极连接，电阻R10与电容C10并联后其一端与同步信号分离芯片U6(LM1881)的6脚连接，另一端接地，同步信号分离芯片U6(LM1881)的4脚接地，同步信号分离芯片U6(LM1881)的3脚与字符处理芯片U2(MB90092)的13脚连接，同步信号分离芯片U6(LM1881)的1脚与字符处理芯片U2(MB90092)的12脚连接，同步信号分离芯片U6(LM1881)的8脚接电源VCC。视频信号由P1输入后经电解电容E4、三极管Q1、电阻R3、R4、R5和二极管D1组成的输入电路将信息送到同步信号分离芯片U6(LM1881)中，同步信号分离芯片U6(LM1881)将分离出的同步信号送给字符处理芯片U2(MB90092)的信号输入引端12、13脚。
如图2所示，上述称重数据输入电路由电平转换芯片U4(MAX232)和电容C3、C4、C5、C6组成，电平转换芯片U4(MAX232)的2脚经电容C3接电源VCC，电平转换芯片U4(MAX232)的16脚接电源VCC，电平转换芯片U4(MAX232)的1、3脚接电容C5，电容C6与电平转换芯片U4(MAX232)的4、5脚连接，电容C4的一端与电平转换芯片U4(MAX232)的6脚连接，电容C4的另一端接地，通用异步串行口J1(UART)的5脚接地，电平转换芯片U4(MAX232)的15脚接地，电平转换芯片U4(MAX232)的11脚与单片机U1(STC98C52RC)的10连接，电平转换芯片U4(MAX232)的12脚与单片机U1(STC98C52RC)的11脚连接，电平转换芯片U4(MAX232)的13、14脚与通用异步串行口J1的3、2脚连接。称重仪表设备数据经通用异步串行口J1的3脚输入后经电平转换芯片U4(MAX232)的12脚输出到单片机U1(STC98C52RC)的输入引端10脚。
如图2所示，上述实时时钟电路由时钟芯片U5(DS1302)和时钟晶振X2(32.768K)组成，时钟晶振X2与时钟芯片U5(DS1302)的2、3脚连接，时钟芯片U5(DS1302)的4脚接地，时钟芯片U5(DS1302)的8脚接电池VCC1，时钟芯片U5(DS1302)的1脚接电源VCC，时钟芯片U5(DS1302)的6脚与单片机U1(STC98C52RC)的4脚连接，时钟芯片U5(DS1302)的5脚与单片机U1(STC98C52RC)的3脚连接，时钟芯片U5(DS1302)的7脚与单片机U1(STC98C52RC)的5脚连接。
如图2所示，上述数据与视频信号叠加电路由字符处理芯片U2(MB90092)、字库存贮器U3(M27C801)、晶振X3、电感I1和电容C11、C12、C13、C14组成，晶振X3的两端与字符处理芯片U2(MB90092)的17、18脚连接，电容C11和C12串接后与晶振X3的两端连接，电容C11和C12的连接点接地，电容C13和C14串接后与电感I1并接，电容C13和C14的连接点接地，电感I1的两端与字符处理芯片U2(MB90092)的79、80脚连接，字符处理芯片U2(MB90092)的65、52、23、4、38、36、30、29、24脚接地，字符处理芯片U2(MB90092)的33、41、76、62、42、11、78、1、77脚接电源VCC，字符处理芯片U2(MB90092)的8、9、10脚与单片机U1(STC98C52RC)的8、7、6脚连接，字符处理芯片U2(MB90092)的40脚接视频信号输入，字符处理芯片U2(MB90092)的37脚接视频信号输出，字符处理芯片U2(MB90092)的44～51脚与字库存贮器U3(M27C801)的13～21脚连接，字符处理芯片U2(MB90092)的67、68脚与字库存贮器U3(M27C801)的4、28脚连接，字符处理芯片U2(MB90092)的53～60脚与字库存贮器U3(M27C801)的5～12脚连接，字符处理芯片U2(MB90092)的61、63、64、66脚与字库存贮器U3(M27C801)的27、26、23、25、脚连接，字符处理芯片U2(MB90092)的69～74脚与字库存贮器U3(M27C801)的29、3、2、30、31、1脚连接，字库存贮器U3(M27C801)的22、24脚接地。
如图2所示，上述中心控制电路由单片机U1(STC89C52RC)、晶振X1、电阻R2、电解电容E3和电容C7、C8组成，晶振X1与单片机U1(STC89C52RC)的18、19脚连接，电容C7和C8串接后与晶振X1的两端连接，电容C7和C8的连接点接地，晶振X1和电容C7、C8为单片机U1(STC89C52RC)提供工作时钟；电阻R2的一端与单片机U1(STC89C52RC)的9脚连接，电阻R2的另一端接地，单片机U1(STC89C52RC)的9脚经电解电容E3接电源VCC，单片机U1(STC89C52RC)的31、40脚接电源VCC，单片机U1(STC89C52RC)的20脚接地。
如图2所示，上述视频信号输出电路由三极管Q2、电解电容E5、电阻R6、R7、R8、R9组成，三极管Q2的基极经电解电容E5与字符处理芯片U2(MB90092)的37脚连接，三极管Q2的集电极接电源VCC，三极管Q2的发射极经电阻R8接地，电阻R7串接在三极管Q2的基极和地之间，电阻R6并接在三极管Q2的基极和集电极之间，电阻R9的一端接三极管Q2的发射极，电阻R9的另一端接继电器K1的常开点。
如图2所示，上述开关量输出驱动电路由三极管Q3、Q4、二极管D2、D3、电阻R11、R12、继电器K1、K2和输入输出插座P1、P2组成，三极管Q3的基极经电阻R11与单片机U1(STC89C52RC)的1脚连接，三极管Q3的集电极与二极管D2的正极、继电器K1线圈的一端连接，二极管D2的负极、继电器K1线圈的另一端接电源VCC，三极管Q3的发射极接地，继电器K1的一组转换触点与输入输出插座P1、P2中心连接，输入输出插座P1、P2的外圈接地；三极管Q4的基极经电阻R12与单片机U1(STC89C52RC)的2脚连接，三极管Q4的集电极与二极管D3的正极、继电器K2线圈的一端连接，二极管D3的负极与继电器K2线圈的另一端连接，三极管Q4的发射极接地，继电器K2的常闭点一端与单片机U1(STC89C52RC)的12脚连接，继电器K2的常闭点另一端接地。三极管Q3、二极管D2和电阻R11为驱动继电器K1受单片机U1(STC89C52RC)控制其通断，掉电状态下由P1输入的视频信号经继电器K1的常闭点环出到P2，上电后单片机U1(STC89C52RC)控制继电器K1吸合叠加字符数据之后的视频信号经继电器K1的常开点输出到P2。三极管Q4、二极管D3和电阻R12为驱动继电器K2受单片机U1(STC89C52RC)控制其通断，当接收到的数据在安全值范围内时，继电器K2为闭合状态，当接收到的数据越出安全值范围则继电器K2断开产生报警信号。
如图2所示，上述供电电路由芯片V1(LM7805)、电解电容E1、E2、电容C1、C2、C17、C18、C19、C20、C21、电阻R1、电源提示灯DSI和接口J2组成，芯片V1(LM7805)的1脚与接口J2的1脚连接，芯片V1(LM7805)的2脚接地，芯片V1(LM7805)的3脚接电源VCC，电解电容E1与电容C1并接后其正极一端接芯片V1(LM7805)的1脚，负极一端接地，电解电容E2与电容C2并接后其正极一端接芯片V1(LM7805)的3脚，负极一端接地；电容C17、C18、C19、C20和C21并接构成高频滤波电路，其一端接电源VCC，另一端接地；电阻R1与电源提示灯DSI串接后，电阻R1的一端接电源VCC，电源提示灯DSI的一端接地。

Claims (1)

1、一种称重数据视频记录控制器，包括视频信号输入电路、称重数据输入电路、实时时钟电路和供电电路，其特征是：它还包括数据与视频信号叠加电路、中心控制电路、视频信号输出电路和开关量输出驱动电路；视频信号输入电路与数据与视频信号叠加电路连接，称重数据输入电路与中心控制电路连接，实时时钟电路与中心控制电路连接，中心控制电路与数据与视频信号叠加电路连接，中心控制电路与开关量输出驱动电路连接，数据与视频信号叠加电路与视频信号输出电路连接；数据与视频信号叠加电路能将称重仪表设备输出的称重过程数据与相应视频监控的视频信号相叠加，并将经过叠加后的视频信号输出供视频录像设备录像，利用图像的不可更改性在图像中记录称重过程中称重仪表数据的变化过程，同时依据设定的对比值，开关量输出驱动电路输出开关量联动报警或录像设备产生报警及提示或只对应称重过程录像，同时可以供称重程序图片截取。
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