CN1466123A - 图像显示装置 - Google Patents
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Abstract
一种图像显示装置，其移位寄存器在C1端输出一个定时脉冲至数据寄存器，此定时脉冲只有在移位信号STH作为开始脉冲被接收以后，由同步于时钟CLK的第一个上升沿的时钟而被触发，随后在C2至C64端一个接一个的输出定时脉冲至数据寄存器。并且逻辑乘法门AND2产生SR型的触发器SRFF3的Q端输出和叠加信号的逻辑乘结果，从而产生了反转信号intPOL2。此反转信号被输出至数据寄存器。或门OR1产生逻辑乘法门AND3的输出和D型触发器DFF64的Q端输出的逻辑加结果，从而引起反转信号POL2和将被移位至后一级源极驱动器的移位信号STH的叠加信号的上升沿。
Description
发明的技术领域
本发明涉及一种用于液晶显示装置等平板显示装置的图像显示装置，特别的，涉及一种减少信号线数目的图像显示装置。
相关的现有技术
由于液晶显示装置(LCD)通常需要增加数量的像素和由此而实现高速的驱动，因此需要使用众多的数据总线来满足此要求。
图1是表示传统的液晶显示装置的整体结构的示意图，图2是表示传统的液晶显示装置中源极驱动器和定时控制器等等之间的关系的框图，图3是表示数据总线和数据线之间的关系的示意图，图4是传统的源极驱动器的框图，图5是传统的移位寄存器的电路图，图6是表示传统的数据寄存器和定时控制器之间的关系的框图。
如图1所示，在液晶显示装置中，n块磁带携带包(TCP)102被连接至在液晶面板101中沿垂直方向传送的源极线(未示出)，m块TCP103被连接至在液晶面板101中沿水平方向传送的栅极线(未示出)。液晶面板101是通过将液晶密封在例如玻璃基底之间并结合薄膜晶体管(TFT)等等而制成的。每个TCP102都各自位于104-1至104-n中的一个源极驱动器上，而每个TCP103都各自位于105-1至105-m中的一个栅极驱动器上。每个TCP102都被连接至安装有定时控制器106的信号处理基底107，并且每个TCP103都被连接至垂直侧的连接基底108。信号处理基底107和垂直侧的连接基底108都是通过，例如，印刷电路板制成的。接口连接器109和软性印刷电路板(FPC)110被安置于信号处理基底107上。与接口连接器109相连的是传送像素数据等等的显示电缆(未示出)。信号处理基底107和垂直侧连接基底108分别利用TCP102和103的柔软性向液晶面板101的后侧弯曲，将FPC110与垂直侧连接基底108连接在一起。
如图2所示，从接口连接器109输出的视频信号从定时控制器106通过数据总线组111被分别提供至源极驱动器104-1至104-n。数据总线组111由，例如，两个数据总线构成。并且每个数据总线是由红，绿，蓝各六个数据线构成的，即，如图3所示的十八个数据线是在像素数据为6-比特信号的情况下。因此，当数据总线组111由例如两个数据总线构成时，在定时控制器106和每个源极驱动器之间就有三十六个数据线。在像素数据是8-比特信号的情况下，数据总线各包括二十四个数据线。时钟信号线112，反转信号线113和数据锁存信号线114被连接在定时控制器106和各个源极驱动器之间，在时钟信号线112上给每个源极驱动器提供时钟信号CLK，在反转信号线113上向每个源极驱动器提供反转信号POL2，在数据锁存信号线114上向每个源极驱动器提供数据锁存信号STB。并且，移位信号线115只连接定时控制器106和源极驱动器104-1，级联信号线116连接在相邻的源极驱动器之间。在移位信号线115上向源极驱动器104-1提供移位信号STH，从而该移位信号STH作为一个级联信号在源极驱动器之间一个接一个地传送。
此外，在液晶显示装置中还设置有可向每个源极驱动器提供分级电压的分级电源117。
在像素数据是6-比特信号的情况下，传统源极驱动器中设置有：64-比特的双向移位寄存器121，数据寄存器122，锁存电路123，电平变换器124，数/模(D/A)变换器125和输出缓冲器126，如图4所示。
确定移位信号STH的移位方向的R/L信号提供给移位寄存器121。R/L信号的逻辑确定STHR端和STHL端中的哪一个将作为移位信号的输入端或输出端。移位寄存器121还可接收用于确定加载像素数据时的时钟信号CLK和数据锁存信号STB，当所述的数据锁存信号STB从定时控制器106输出后，在加载等效于一行的数据时，所述数据锁存信号STB对移位寄存器121的内部触发器进行复位。
如图5所示，在移位寄存器121中设置有六十四个彼此之间直接连接的D型触发器DFF101至DFF164。时钟信号CLK提供给每一个D型触发器DFF101至DFF164的CK端。当STHR端作为移位信号STH的输入端时，从逻辑乘法门AND101输出的信号提供给第一级D型触发器DFF101的D端。同时，STHR端和每个D型触发器DFF101至DFF164的QB端被连接至逻辑乘法门AND101的输入端。所述的“QB端”是指通常在小横线(-)标记下面的字母“Q”所表示的终端，并且在图中也表示为在小横线(-)标记下面的字母“Q”。
移位寄存器121中的结构是，从各个D型触发器DFF101至DFF164的Q端输出的信号变为输出信号C1至C64。
数据寄存器122接收(6比特)×(三种颜色)×(两个数据总线)的像素数据，即，从D00至D05，D10至D15，D20至D25，D30至D35，D40至D45，D50至D55，总共六十四比特。并且，数据寄存器122接收反转信号POL21和POL22，所述反转信号作为反转信号POL2的分别提供给两个数据总线。
如图6所示，还设置有反转/非反转电路131，用于接收通过数据总线组111从定时控制器106输出的像素数据，以及寄存器132用于存储从反转/非反转电路131输出的数据。反转信号POL2也提供给反转/非反转电路131，并且当反转信号POL2被触发时，提供给反转/非反转电路131的像素数据被反转并被输出至寄存器132。另一方面，当反转信号POL2没有触发时，提供给反转/非反转电路131的像素数据没有变化地提供给寄存器132。定时控制器106还包括，比特比较器133，用于比较从现在起传送的数据和在此之前刚刚传送的数据，以及一反转/非反转电路134，用于根据来自比特比较器133的输出信号对像素数据进行反转并输出所述像素数据。
在具有这种结构的传统液晶显示装置中，比特比较器133位于定时控制器106中，用于检测从现在起传送的像素数据和在此像素数据之前刚刚传送的像素数据相比有多少比特发生了变化。如果一半或以上的像素数据改变了，则向反转/非反转电路134提供一个信号要求反转/非反转电路134反转并输出像素数据。接到此信号后，反转/非反转电路134将像素数据反转，并通过数据总线组111输出像素数据，同时通过反转信号线113输出触发的反转信号POL2至反转/非反转电路131。
图7是表示传统移位寄存器121的操作的时序图。在STHR端接到移位信号STH时，移位寄存器121在C1至C64端输出定时脉冲，用于从时钟信号CLK的下一上升沿开始，与时钟信号CLK的上升沿同步地加载像素数据至数据寄存器122中。同时在C64端输出时钟脉冲，移位信号STH从STHL端输出至下一级源器驱动器。在图5所示的液晶显示装置中，移位信号STH从定时控制器106输出并作为开始脉冲提供至源极驱动器104-1中的移位寄存器121，而向其他源极驱动器的移位寄存器121提供移位信号STH，该移位信号STH来自前一级源极驱动器，并在级联信号线116上被移位。
与移位寄存器121输出的定时脉冲相同步，数据寄存器122将像素数据D00至D05，D10至D15，D20至D25，D30至D35，D40至D45，D50至D55存储在寄存器132中。然而，当反转信号POL21或POL22被触发时，对应于触发的反转信号，反转/非反转电路131将构成数据总线组111的两个数据总线中的一个数据总线所接收到的像素数据反转，并将所述像素数据存储在寄存器132中。由于这种方法减少了在数据总线上传送的数字信号的变化量，电磁干扰(EMI)被减少了，而且节省了对数据总线充电和放电的电功率。数据寄存器122存储的信号为384比特，即，(六十四比特)×(两个数据总线)×(三种颜色)。
为了向所有的源极驱动器104-1至104-n同时输出等级电压，锁存电路123锁存等效于一行的数据直至输出同样的数据。极性反转信号POL用于反转每一帧信号的极性，这是为了将液晶显示面板的交流驱动提供至锁存电路123和输出缓冲器126。
随后，电平变换器124变换像素数据的逻辑电平，接收等级电平V0至V9的D/A转换器125将数字信号转换为模拟信号。平滑后的等级电平(模拟)随后从输出缓冲器126的S1至S384端提供给液晶面板101的源极线。
在液晶显示面板101中，栅极线由栅极驱动器105-1至105-m逐行的扫描，并且与此扫描相同步，等级电平从各个源极驱动器104-1至104-n被同步地提供至源极线，从而在供有电压的源极线上实现各个像素的显示。
液晶显示装置也可以是这样的液晶显示装置，其中只设置有一个数据总线，并且像素数据同步于时钟信号的上升沿被存储在数据寄存器中(图8A)，或是其中设置有两个数据总线，并且像素数据同步于时钟信号的上升沿一起从两个数据总线被存储在数据寄存器中(图8B)，或是其中设置有两个数据总线，并且像素数据同步于时钟信号的上升/下降沿分别从两个数据总线被存储在数据寄存器中(图8C)，等等。
1996年的日本未审专利公开号No.8-8991中公开了一种涉及在图像显示装置中传送数据的装置，一种减少了切换频率从而减少了电力消耗的数据传送装置。此文献中公开了一种在没有数据变化时时钟信号被隐藏的数据传送装置，和一种在大多数比特变化时数据被反转后传送的数据传送装置。在大多数比特变化时数据被反转后传送的数据传送装置中，类似于如图8所示的在传统液晶显示装置中使用的反转信号POL2的1-比特信号在控制器中产生，并与数据一起传送至接收装置。此1-比特信号通过专用信号线传送。利用这些数据传送装置就可能减少电力消耗。
然而，由于分辨率的提高，传统的液晶显示装置被要求更高频率的时钟信号和像素数据传送速率的提高，从而需使用多于一个的数据总线，如上所述。因此，就必须使用也相应增加数目的反转信号线，从而，在形成定时控制器和源极驱动器的LSI(大规模集成电路)中需设置更多数目的管脚。这将引起LSI块的尺寸增大的问题。此外，由于使用了更多的信号线，信号线之间的间距变得更小，结果增加了它们之间的阻抗和容抗的影响。从而，增加了串音干扰(波形质量的恶化)引起故障的可能性。并且，由于信号线数目的增加，基底模版的设计步骤也增加了。
在上述目的在于减少电力消耗的日本未审专利公开No.8-8991中所描述的数据传送装置中就存在着这些问题。由于传送速率的提高，数据总线数目也增加了，从而也需要相应增加信号线的数目。
发明概述
本发明的目的是提供一种图像显示装置，其能够抑制随着像素数据传送速率的增加而引起的信号线数目的增加。
依据本发明的图像显示装置包括：显示面板；多个驱动电路，用于驱动显示面板并且彼此互相连接；定时控制器，用于以数字信号将视频信号传送至多个驱动电路，同时将指示开始读取视频信号的开始脉冲传送至所述多个驱动电路中的一个。在该图像显示装置中，当两个连续的视频信号之间的数字信号变化量达到或超过预定的值时，定时控制器将两个连续的视频信号中后一个传送的信号进行反转，并将此视频信号传送至驱动电路，并且将指示此视频信号的反转的反转信号传送至驱动电路。此图像显示装置的特征在于开始脉冲通过传送反转信号的信号线传送至一个驱动电路。
根据本发明，由于开始脉冲和反转信号是通过同一个信号线被传送至与其一端连接的驱动电路，即使设置有传送视频信号的多个数据总线，信号线的数目增加也不多。
最好，驱动电路包括一个存储视频信号的数据寄存器，和一个由数据寄存器指示什么时刻存入视频信号的移位寄存器，移位寄存器包括分离装置用于将开始脉冲从反转信号中分离出来，数据寄存器能够将从定时控制器输出的视频信号反转，并在由分离装置分离的反转信号被触发时存储该视频信号。
进一步，其能够在多个驱动电路之间顺序地移位开始脉冲。
更进一步的，在视频信号通过两个数据总线被传送至多个驱动电路，并且为每个数据总线各产生一个反转信号的情况下，两个反转信号都在同一个信号线上传送。这允许将开始脉冲和两个反转信号在一个信号线上传送。
举例说明的液晶显示面板可被用于显示面板。
附图的简要说明
图1是表示传统的液晶显示装置的整体结构的示意图；
图2是表示在传统的液晶显示装置中源极驱动器和定时控制器等等之间关系的示意图；
图3是表示数据总线和数据线之间的关系的示意图；
图4是传统的源极驱动器的框图；
图5是传统的移位寄存器的电路图；
图6是表示传统的数据寄存器和定时控制器之间的关系的框图；
图7是表示传统的移位寄存器121的操作的时序图；
图8A，8B，8C是表示传统的液晶显示装置的驱动方法的时序图；
图9是表示根据本发明实施例的液晶显示装置的源极驱动器和定时控制器等等之间关系的框图；
图10是详细说明本发明实施例中源极驱动器和定时控制器之间的连接关系的框图；
图11是表示本发明实施例中的一个移位寄存器的结构的框图；
图12是表示本发明实施例中的移位寄存器的操作的时序图；
图13是表示本发明实施例中的数据寄存器的操作的时序图。
优选实施例的详细说明
以下将参照附图详细说明根据本发明实施例的液晶显示装置。图9是表示根据本发明实施例的液晶显示装置的源极驱动器和定时控制器等等之间关系的框图，图10是详细说明本发明实施例中源极驱动器和定时控制器之间的连接关系的框图，图11是表示本发明实施例中的一个移位寄存器的结构的框图。
如图9所示，根据实施例，接口连接器9与定时控制器6连接，视频信号从接口连接器9传送至定时控制器6。N块源极驱动器4-1至4-n通过数据总线组11、时钟信号线12和数据锁存信号线14与定时控制器6连接。由例如两个数据总线构成的数据总线组11，也可由四个或更多数据总线来构成，这取决于时钟信号的频率。在数据总线组11由两个数据总线构成的情况下，在其中一个数据总线上传送的是提供给位于从栅极线的一端算起的奇数行像素处的像素数据，而在另一个数据总线上传送的是提供给位于偶数行像素处的像素数据。当像素数据是六比特的数字信号时，每个数据总线，由红，绿，蓝各六个数据线构成，如图1所示。从而，当数据总线组11由上述的两个数据总线构成时，在定时控制器6和每个源极驱动器之间就有三十六个数据线。如果像素数据是8比特数字信号，则每个数据总线都由二十四个数据线构成。
时钟信号CLK通过时钟信号线12提供给每个源极驱动器，数据锁存信号STB通过数据锁存信号线14提供给每个源极驱动器。并且，移位/反转信号线15连接在定时控制器6和每个源极驱动器之间。级联信号线16连接在相邻的源极驱动器之间。将定时控制器6输出的移位信号STH直接提供至第一级源极驱动器4-1，而其它每个源极驱动器4-2至4-n通过级联信号线16接收从直接的前一个源极驱动器输出的移位信号STH，如图10所示。反转信号POL2从定时控制器6直接输出给每个源极驱动器。
此外，在本实施例的液晶显示装置中还设置有向每个源极驱动器提供分级电压的分级电源17。
除了内部设置有移位寄存器的结构以外，每个源极驱动器4-1至4-n都具有与如图3所示传统的源极驱动器类似的结构。根据本实施例设置在每个源极驱动器中的64比特双向移位寄存器21，它包括六十四个相互之间直接连接的D型触发器DFF1至DFF64，如图11所示。时钟信号CLK提供给每个D型触发器DFF1至DFF64的CK端。在STHL端作为移位信号STH的输入端的情况下，来自逻辑乘法门AND1的输出信号提供给第一级D型触发器DFF1的D端。其间，每个D型触发器DFF1至DFF63的QB端被连接至逻辑乘法门AND1的输入端。并且，还设置有一个SR型的触发器SRFF1，其S端接收移位信号STH，其R端接收数据锁存信号STB。SR型的触发器SRFF1的输出信号提供给逻辑乘法门AND1的一个输入端。在第一级源极驱动器4-1中，SR型的触发器SRFF1的S端接收的信号是移位信号STH和反转信号POL2的叠加(以下被称为“叠加信号”)。并且，还设置有用于获得移位信号STH和反转信号POL2的逻辑加结果的或门OR1。提供给各个源极驱动器4-1至4-n的反转信号POL2其实都是叠加的信号。
64比特的双向移位寄存器21包括，SR型的触发器SRFF3，其S端连接D型触发器DFF1的Q端，其R端可接收数据锁存信号STB，以及SR型的触发器SRFF2，其S端连接D型触发器DFF64的Q端，其R端可接收数据锁存信号STB。此外，该64比特的双向移位寄存器21还包括，逻辑乘法门AND2，用于生成或门OR1的输出和SR型触发器SRFF3的Q端输出的逻辑乘结果。将SR型触发器SRFF2的QB端的输出提供给逻辑乘法门AND1的一个输入端。SR型触发器SRFF1、或门OR1、SR型触发器SRFF3和逻辑乘法门AND2构成了滤波电路22作为分离装置，用于从移位信号STH和反转信号POL2中分离出反转信号intPOL2和用于产生定时脉冲的开始脉冲，所述反转信号intPOL2是相关源极驱动器的数据寄存器所必需的。
在具有这种结构的64比特的双向移位寄存器21中，当STHL端作为移位信号STH的输入端时，D型触发器DDF的Q端输出作为级联信号从STHR端提供给位于后一级源极驱动器中的64比特双向移位寄存器21。并且每个D型触发器DFF1至DFF64的Q端输出作为从C1至C64端的定时脉冲分别提供给相关源极驱动器的数据寄存器。此外，逻辑乘法门AND2的输出信号作为反转信号intPOL2提供给该源极驱动器的数据寄存器。反转信号intPOL2对应于构成数据总线组的两个数据总线，并依据时钟信号的上升/下降沿被分离为对应于各数据总线的反转信号intPOL21和intPOL22。
本实施例的液晶显示装置在其他方面都类似于传统的结构。例如，对从定时控制器6输出至数据总线组11的像素数据进行比较，以确定相比于之前输出的像素数据有多少比特发生了变化，如果像素数据的一半或更多比特发生了变化，则将像素数据反转并输出，并且触发反转信号POL2也被一起输出，该像素数据在数据寄存器中基于反转信号intPOL2被再次反转，与原始像素数据相同的像素数据被存储在寄存器中。
现在将说明根据本实施例具有上述结构液晶显示装置的操作。图12是表示本发明实施例中的移位寄存器操作的时序图，图13是表示本发明实施例中的数据寄存器的操作的时序图。在图13中，在构成数据总线组11的两个数据总线中，数据总线DB1接收提供给位于从栅级驱动器一侧最外面的栅级线算起的奇数个源极线处的像素数据，而数据总线DB2是接收提供给位于偶数个源极线处的像素数据。对于包含在反转信号intPOL2中的反转信号intPOL21和intPOL22，对应于数据总线DB1的是intPOL21，而对应于数据总线DB2的是intPOL22。
在此实施例中，首先，在输出有效的像素数据之前，定时控制器6通过移位/反转信号线15将移位信号STH作为开始脉冲输出至源极驱动器4-1。在位于源极驱动器4-1中的移位寄存器21中，SR型触发器SRFF1在接到开始脉冲时触发一个标志。从而能够将像素数据加载到源极驱动器4-1中。并且，像传统的定时控制器一样，定时控制器6依据像素数据的改变量通过数据总线组11来反转像素数据，或者不反转像素数据就将其传送出去，并且当转换像素数据时，通过移位/反转信号线15输出触发的反转信号POL2至源极驱动器4-1。
设置于源极驱动器4-1中的移位寄存器21在C1端输出一个定时脉冲至数据寄存器，此定时脉冲只有在移位信号STH作为开始脉冲被接收以后，由同步于时钟CLK的第一个上升沿的时钟而被触发，随后在C2至C64端一个接一个地输出定时脉冲至数据寄存器。SR型触发器SRFF3响应D型触发器DFF1的Q端输出而触发一个标志，并且逻辑乘法门AND2产生此Q端输出和叠加信号的逻辑乘结果，从而产生了反转信号intPOL2。作为响应最后一级D型触发器DFF64的Q端输出的一个上升沿，作为向下一级源极驱动器4-2的级联信号的移位信号STH在级联信号线16产生一个上升沿。
位于源极驱动器4-1中的数据寄存器，响应在C1至C64端输出的定时脉冲，将像素数据以类似于传统数据寄存器的方式存储起来。在本实施例中的此阶段，如图12所示，数据总线DB1上的像素数据随时钟信号CLK的上升沿而被存储，同时，数据总线DB2上的像素数据随时钟信号CLK的下降沿而被存储。由于位于数据寄存器中的反转/非反转电路不能直接接收从定时控制器6输出的反转信号POL2，像素数据基于移位寄存器21产生的反转信号intPOL2被适时地反转。
在像素数据是8比特数字信号的情况下，当从现在起从定时控制器6传送的数据是FF(h)，并且在此之前传送的数据是00(h)的时候，由于比特的变化量是8比特，是大多数变化量，则定时控制器6传送触发反转信号POL2和通过反转FF(h)得到的像素数据00(h)。从而数据寄存器接收像素数据00(h)和触发反转信号intPOL2并存储对00(h)反转而得到的像素数据FF(h)。
随后进行类似于传统方式的锁存电路、电平切换器、D/A转换器和输出缓冲器的操作。
在源极驱动器4-2中，位于源极驱动器4-2中的移位寄存器21的SR型触发器SRFF1响应位于源极驱动器4-1的移位寄存器21中的D型触发器DFF64的Q端输出的上升沿而触发一个标志，从而将图像数据以类似于源极驱动器4-1的方式存储起来。并且，在随后一级的源极驱动器4-3至4-n也进行类似的处理。
在完成n块源极驱动器4-1至4-n的处理，并且等级电压(模拟)已提供给液晶面板的源极线以后，数据锁存信号STB被触发，并且位于各个移位寄存器21中的SR型触发器SRFF1至SRFF3被复位。
由于根据本发明所述的液晶显示装置中，开始脉冲和反转信号通过一个移位/反转信号线15被传送至源极驱动器4-1，从而抑制了随着传输速率的增加而引起的信号线数目的增加。
像素数据中的比特数，寄存器中的比特数等等可以依据液晶显示面板的分辨率而被适当地调整，并且不必局限于上述实施例所述的内容。
本发明并不局限于液晶显示装置，其还可应用于例如，等离子显示器和有机EL显示器等等。
并且，形成移位寄存器的触发器类型并不局限于D型，其还可以是其它的类型。
或者，作为移位信号在同一个信号线上传送的反转信号并不需要对应于两个数据总线。对应于仅仅一个数据总线的反转信号也可在同一个信号线上传送。
如上所述，根据本发明，由于开始脉冲和反转信号在同一个信号线上传送至连接一端的驱动电路，即使传送视频信号的有多个数据总线，也能够抑制信号线的数量增加。这也抑制了LSI块的管脚数目的增加。并且，由于信号线之间的间距可以变宽，从而能够减少寄生电容，因而抑制了由于互感和电容的影响而引起的串音干扰。此外，由于抑制了信号线数量的增加，从而能够减少设计的步骤。
Claims (6)
1.一种图像显示装置，包括：
显示面板；
多个驱动电路用于驱动所述显示面板并且彼此互相连接；
定时控制器，用于将视频信号以数字信号传送至所述多个驱动电路，同时将指示开始读取所述视频信号的开始脉冲传送至多个驱动电路中的一个，当两个连续的视频信号之间的数字信号变化量达到或超过预定的值时，所述定时控制器将两个连续的视频信号中后一个传送的信号进行反转，并将此视频信号传送至所述驱动电路，并且将指示此视频信号反转的反转信号传送至所述驱动电路，
所述开始脉冲通过传送反转信号的信号线被传送至所述的一个驱动电路。
2.如权利要求1所述的图像显示装置，其特征在于所述驱动电路包括存储视频信号的数据寄存器，和一个由所述数据寄存器指示什么时刻存入所述视频信号的移位寄存器，并且所述移位寄存器包括用于将所述开始脉冲从所述反转信号中分离出来的分离装置。
3.如权利要求2所述的图像显示装置，其特征在于当由所述分离装置分离的反转信号被触发时，所述数据寄存器将从所述定时控制器传送的视频信号反转并存储该视频信号。
4.如权利要求1至3中任一个所述的图像显示装置，其特征在于所述开始脉冲在多个驱动电路之间被顺序地移位。
5.如权利要求1至4中任一个所述的图像显示装置，其特征在于在所述视频信号通过两个数据总线被传送至多个驱动电路，为每个数据总线产生反转信号，并且两个反转信号都在同一个信号线上传送。
6.如权利要求1至5中任一个所述的图像显示装置，其特征在于所述显示面板是液晶面板。
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