CN1171149C - 计算机系统内部间隔时钟的测试方法 - Google Patents

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Abstract

一种计算机系统内部间隔时钟的测试方法，该方法由一计算机系统内部CMOS即时时钟脉冲的周期性中断频率，作为与一在相同时间内该系统间隔时钟中断发生的次数进行测试比较，由于该周期性中断频率最高可达8192Hz，故，可令该间隔时钟的测试误差小于1/8192秒，并据以测出该系统间隔时钟中断是否准确，亦即计算机系统间隔时钟是否为准确。

Description

计算机系统内部间隔时钟 的测试方法
技术领域
本发明涉及一种计算机(PC)系统内部间隔时钟的测试方法，特别涉及一种利用一计算机(PC)系统内部CMOS即时时钟脉冲(R.T.C)的周期性(Periodic)中断，作为与一在相同时间内计算机(PC)系统间隔时钟中断(Interval Timer)发生的次数进行测试比较，以精确地测试出该系统间隔时钟是否为正常与准确。
背景技术
目前一般测试者于一计算机(PC)内部间隔时钟(Interval Timer)所进行的测试方法，往往没有一个方法可以准确地测试该计算机(PC)系统内部间隔时钟(Interval Timer)是否准确。通常只是与该计算机(PC)系统内部CMOS即时时钟脉冲(R.T.C)进行比较，此种测试方法只能令该间隔时钟(Interval Timer)精确到秒；或者是必需借助一另外的设备(如：示波器)，才能精确测定该间隔时钟(Interval Timer)的误差；但是，上述惯用技术的测试方法，并无法满足测试精度高的要求，当由该另外设备测试时，就必需将计算机壳体拆开才能进行测试的工作，因此，在惯用技术无法满足测试精度的要求，或者必需利用将计算机壳体拆开才能进行测试工作的另外设备来讲，都将造成测试者诸多的困扰，因此，若能设计一种方法在不增加任何外部设备的情况下，可方便地测试该计算机(PC)内部间隔时钟(Interval Timer)并达到满足测试精度高的要求。
发明内容
鉴于上述惯用技术的各种缺点，本发明提供一种计算机(PC)系统内部间隔时钟的测试方法。
本发明的目的，是在提供一种计算机(PC)系统内部间隔时钟的测试方法，该方法是利用一计算机(PC)系统内部CMOS即时时钟脉冲(R.T.C)的周期性(Periodic)中断，作为与一在相同时间内计算机(PC)系统间隔时钟中断(Interval Timer)发生的次数进行测试比较，从而可检测出该系统内部间隔时钟是否符合所设定的测试标准，且可令测试误差小于1/8192秒，有效避免惯用技术无法满足测试精度高的要求，或者必需利用将计算机壳体拆开才能进行测试工作等，并避免对测试者所造成的诸多困扰的情事发生。
为实现上述目的，本发明提供一种计算机系统内部间隔时钟的测试方法，该方法是利用一计算机系统内部CMOS即时时钟脉冲的周期性中断，作为与一在相同时间内计算机系统间隔时钟中断发生的次数进行测试比较，该计算机系统内部间隔时钟的测试方法如下：(一)首先，设定该CMOS最大允许周期性中断误差值为p秒，及该间隔时钟要测量的中断发生次数n；(二)设定该CMOS周期性中断频率为x，此时是禁止该CMOS的中断发生；(三)接着，在相同时间内等待该间隔时钟中断的发生，且以一次中断发生的时刻作为开始计数的起始时刻；(四)此时，允许该CMOS周期性中断发生，并开始计数；(五)在CMOS中断处理程序中累计CMOS周期性中断发生的周期次数m；(六)判断该间隔时钟中断是否发生如所设定的该间隔时钟所要测量的中断发生次数n，若是，继续下列步骤(七)，否则，返回步骤(五)；(七)禁止该CMOS周期性的中断发生，并停止计数；(八)计算该CMOS周期性中断发生及间隔时钟中断发生的差，并判断是否在CMOS最大允许周期性中断误差值p秒的范围内，若是，继续下列步骤(九)，若否，则告知使用者该间隔时钟不正常，并至步骤(十)；(九)告知使用者该间隔时钟正常；(十)结束该间隔时钟的测试。
附图说明
为使能对本发明的目的、形状构造装置特征及其功能，作更进一步的认识与了解，兹举实施例结合附图，详细说明如下：
图1是本发明的测试流程示意图。
图2是本发明的实施例示意图。
具体实施方式
现参照图1所示，本发明是一种计算机(PC)系统内部间隔时钟的测试方法，该方法可用于所有符合IBM PC规范的一计算机(PC)系统间隔时钟(Interval Timer)的测试，根据IBM PC兼容机的规范，计算机(PC)系统间隔时钟中断(Interrupt)应每隔55ms产生一次，频率为18.2Hz，而该计算机(PC)内部CMOS即时时钟脉冲(Real Timer Clock，以下简称R.T.C)的周期性中断(Periodic Interrupt)是可由使用者自行设定的，且最高频率可为8192Hz，即每秒产生8192次中断。
本发明的测试方法是利用CMOS即时时钟脉冲(R.T.C)的周期性中断(Periodic Interrupt)，作为与一在相同时间内计算机(PC)系统间隔时钟中断发生的次数进行测试比较，由CMOS即时时钟脉冲(R.T.C)的周期性中断频率可以到8192Hz，因此，可使该间隔时钟(Interval Timer)的测试误差小于1/8192秒，故，只需利用该CMOS即时时钟脉冲(R.T.C)的周期性中断，即可测出该计算机(PC)系统间隔时钟中断是否准确，亦即计算机(PC)系统间隔时钟(Interval Timer)是否为准确。
本发明是依下列步骤测试该计算机(PC)系统内部间隔时钟：
(一)首先，由使用者设定该CMOS最大允许周期性中断误差值为p秒(CMOS周期性中断误差精度值最高可达1/8192秒)，及该间隔时钟总共所要测量的中断发生次数n；
(二)并设定该CMOS周期性(Periodic)中断频率为x，此时是禁止该CMOS的中断发生；
(三)接着，在相同时间内等待该间隔时钟中断(Interval Timer Interrupt)的发生，且以一次中断发生的时刻作为开始计数的起始时刻；
(四)此时，允许该CMOS周期性(Periodic)中断发生，并开始计数；
(五)在CMOS中断处理程序中累计CMOS周期性(Periodic)中断发生的周期次数m；
(六)判断该间隔时钟中断是否发生了如先前所设定的该间隔时钟所要测量的中断发生次数n，若是，继续下列步骤(七)，否则，返回步骤(五)；
(七)则禁止该CMOS周期性(Periodic)的中断发生，并停止计数；
(八)计算CMOS周期性中断发生周期次数m除以原先所设定CMOS周期性中断频率x(即m/x)，与间隔时钟中断发生次数n除以原先间隔时钟中断18.2Hz(即n/18.2)的差，并判断是否在CMOS最大允许周期性中断误差值p秒的范围内，若是，继续下列步骤(九)，若否，则告知使用者该间隔时钟不正常，并至步骤(十)；
(九)告知使用者该间隔时钟正常；
(十)结束该间隔时钟的测试。
参照图2所示，现以一实施例说明依本发明的测试方法对该计算机(PC)系统内部间隔时钟进行测试：
(一)首先，由使用者设定该CMOS最大允许周期性中断误差值为p＝0.1秒，及该间隔时钟总共所要测量的中断发生次数n＝182(即共测试182/18.2＝10秒)；
(二)并设定该CMOS周期性(Periodic)中断频率x为8192Hz，此时是禁止该CMOS的中断发生；
(三)接着，在相同时间内等待该间隔时钟中断(Interval Timer Interrupt)的发生，且以一次中断发生的时刻作为开始计数的起始时刻；
(四)此时，允许该CMOS周期性(Periodic)中断发生，并开始计数；
(五)在CMOS中断处理程序中累计CMOS周期性(Periodic)中断发生的周期次数m＝80281次；
(六)判断该间隔时钟中断(Interval Timer Interrupt)是否发生了如先前所设定的该间隔时钟所要测量的中断发生次数n＝182次，若是，继续下列步骤(七)，否则，返回步骤(五)；
(七)则禁止该CMOS周期性(Periodic)的中断发生，并停止计数；
(八)计算该CMOS周期性中断发生周期次数m＝80281，除以原先所设定CMOS周期性中断频率x为8192Hz(即80281/8192＝9.8)，与间隔时钟中断发生次数n＝182，除以原先间隔时钟中断18.2Hz(即182/18.2＝10)的差，并判断是否在CMOS最大允许周期性中断误差值p＝0.1秒的范围内，若是，继续下列步骤(九)，若否，则告知使用者该间隔时钟不正常，并至步骤(十)，计算得知该差值为0.2秒，即已超出最大允许误差值p＝0.1秒的范围内，告知使用者最后测试结果该间隔时钟不正常；
(九)告知使用者该间隔时钟正常；
(十)结束该间隔时钟的测试。
如此，即可检测出该计算机(PC)系统内部间隔时钟是否符合所设定的测试标准，且可令测试误差小于1/8192秒，有效避免惯用技术无法满足测试精度高的要求，或者必需利用将计算机壳体拆开才能进行测试工作等，对测试者所造成诸多困扰的情事发生。
综上所述，本发明仅用以举例说明本发明的一可行实施例而已，对本领域的技术人员来说，当可对其细部形状进行各种等效的变化，这种变化均应包括在本发明的精神及范围内。

Claims (2)

1.一种计算机系统内部间隔时钟的测试方法，该方法是利用一计算机系统内部CMOS即时时钟脉冲的周期性中断，作为与一在相同时间内计算机系统间隔时钟中断发生的次数进行测试比较，该计算机系统内部间隔时钟的测试方法如下：
(一)首先，设定该CMOS最大允许周期性中断误差值为p秒，及该间隔时钟要测量的中断发生次数n；
(二)设定该CMOS周期性中断频率为x，此时是禁止该CMOS的中断发生；
(三)接着，在相同时间内等待该间隔时钟中断的发生，且以一次中断发生的时刻作为开始计数的起始时刻；
(四)此时，允许该CMOS周期性中断发生，幷开始计数；
(五)在CMOS中断处理程序中累计CMOS周期性中断发生的周期次数m；
(六)判断该间隔时钟中断是否发生如所设定的该间隔时钟所要测量的中断发生次数n，若是，继续下列步骤(七)，否则，返回步骤(五)；
(七)禁止该CMOS周期性的中断发生，幷停止计数；
(八)计算该CMOS周期性中断发生及间隔时钟中断发生的差，并判断是否在CMOS最大允许周期性中断误差值p秒的范围内，若是，继续下列步骤(九)，若否，则告知使用者该间隔时钟不正常，并至步骤(十)，其中，计算该CMOS周期性中断发生及间隔时钟中断发生的差，是以CMOS周期性中断发生周期次数m除以原先所设定CMOS周期性中断频率x，即m/x，与间隔时钟中断发生次数n除以原先间隔时钟中断18.2Hz，即n/18.2的差所得；
(九)告知使用者该间隔时钟正常；
(十)结束该间隔时钟的测试。
2.如权利要求1所述的计算机系统内部间隔时钟的测试方法，其中该CMOS周期性中断频率x可为8192Hz。
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