CN116504184B - 发光驱动电路、时序控制方法和显示面板 - Google Patents
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Abstract
本申请提供一种发光驱动电路、时序控制方法和显示面板,涉及显示技术领域,其中,发光驱动电路的第一上拉控制模块用于在准备和复位阶段上拉第一节点的电位至第一电位;上拉模块用于在第一节为第一电位时,将发光驱动信号输出端输出的发光驱动信号上拉至高电位;第一下拉控制模块用于在准备和复位阶段下拉第二节点的电位至第二电位;第二上拉控制模块用于在输出阶段上拉第二节点的电位至第三电位;下拉模块用于在第二节点为第三电位时,将发光驱动信号下拉至低电位;第二下拉控制模块用于在输出阶段下拉第一节点的电位至第四电位;第一维持模块用于在维持阶段维持第一节点的电位。本申请提供的技术方案能够降低发光驱动电路架构的复杂度。
Description
技术领域
本申请涉及显示技术领域,尤其涉及一种发光驱动电路、时序控制方法和显示面板。
背景技术
有机发光二极管(Organic Light Emitting Diode,OLED)等发光器件因为具备轻薄、节能、色域广、对比度高等特性,而被越来越广泛地应用于电视、手机等产品中。
OLED为主动发光,除了需要行扫描驱动电路提供对应的扫描信号之外,通常还需要发光驱动电路提供对应的发光控制信号。
然而目前的发光驱动电路架构复杂,需要较多的模块或者元器件才能够实现对发光控制信号的控制。
发明内容
有鉴于此,本申请实施例提供一种发光驱动电路、时序控制方法和显示面板,以降低发光驱动电路架构的复杂度。
为了实现上述目的,第一方面,本申请实施例提供一种发光驱动电路,包括:第一上拉控制模块、第二上拉控制模块、上拉模块、第一下拉控制模块、第二下拉控制模块、下拉模块和第一维持模块;
第一上拉控制模块的输入端接入第一电源或时钟信号,控制端接入时钟信号,输出端与第一节点电连接,第一上拉控制模块用于在准备阶段和复位阶段上拉第一节点的电位至第一电位;
上拉模块的输入端接入第一电源,控制端与第一节点电连接,输出端与发光驱动信号输出端电连接,上拉模块用于在第一节点的电位为第一电位的情况下,将发光驱动信号输出端输出的发光驱动信号上拉至高电位;
第一下拉控制模块的输入端接入第二电源,控制端接入所述时钟信号,输出端与第二节点电连接,第一下拉控制模块用于在准备阶段和复位阶段下拉第二节点的电位至第二电位;
第二上拉控制模块的输入端接入扫描信号或第一电源,控制端接入扫描信号,输出端与第二节点电连接,第二上拉控制模块用于在输出阶段上拉第二节点的电位至第三电位;
下拉模块的输入端接入所述时钟信号,控制端与第二节点电连接,输出端与发光驱动信号输出端电连接,下拉模块用于在第二节点的电位为第三电位的情况下,将发光驱动信号输出端输出的发光驱动信号下拉至低电位;
第二下拉控制模块的输入端接入第二电源,控制端与第二节点电连接,输出端与第一节点电连接,第二下拉控制模块用于在输出阶段下拉第一节点的电位至第四电位;
第一维持模块的一端与上拉模块的控制端电连接,另一端与发光驱动信号输出端电连接,第一维持模块用于在维持阶段维持第一节点的高电位。
作为本申请实施例一种可选的实施方式,所述发光驱动电路还包括:电位稳定模块,所述电位稳定模块的第一输入端与所述第一电源电连接,第二输入端与所述第二下拉控制模块的输出端电连接,第一控制端与所述第一节点连接,第二控制端与所述第二节点电连接,输出端与所述第一节点电连接,所述电位稳定模块用于在准备阶段、复位阶段和维持阶段稳定所述第一节点的电位。
作为本申请实施例一种可选的实施方式,所述电位稳定模块包括:第一晶体管和第二晶体管;
所述第一晶体管的第一极接入所述第一电源,控制极与所述第一节点电连接,第二极与所述第二下拉控制模块的输出端电连接;
所述第二晶体管的第一极与所述第二下拉控制模块的输出端电连接,控制极与所述第二节点电连接,第二极与所述第一节点电连接。
作为本申请实施例一种可选的实施方式,所述发光驱动电路还包括:第二维持模块,所述第二维持模块的输入端接入所述第二电源,控制端与所述第一节点电连接,输出端与所述第二节点电连接,所述第二维持模块用于在准备阶段、复位阶段和维持阶段维持所述第二节点的低电位。
作为本申请实施例一种可选的实施方式,所述第二维持模块包括第三晶体管,所述第三晶体管的第一极与所述第二节点电连接,控制极与所述第一节点电连接,第二极接入所述第二电源。
作为本申请实施例一种可选的实施方式,所述第一维持模块包括电容,所述电容的一端与所述上拉模块的控制端电连接,另一端与所述发光驱动信号输出端电连接。
作为本申请实施例一种可选的实施方式,所述下拉模块包括第四晶体管,所述第四晶体管的第一极接入所述时钟信号,控制极与所述第二节点电连接,第二极与所述发光驱动信号输出端电连接。
作为本申请实施例一种可选的实施方式,所述第二上拉控制模块包括第五晶体管,所述第五晶体管的第一极接入所述扫描信号或所述第一电源,控制极接入所述扫描信号,所述第五晶体管的第二极与所述第二节点电连接。第二方面,本申请实施例提供一种时序控制方法,应用于如上述第一方面或第一方面任一项所述的发光驱动电路,所述方法包括:
在准备阶段,控制时钟信号线输出高电位的时钟信号,以使第一上拉控制模块和第一下拉控制模块导通,所述第一节点的电位上拉至第一电位,第一维持模块充电,所述第二节点的电位下拉至第二电位;控制扫描信号线输出低电位的扫描信号,以使第二上拉控制模块关断;
在输出阶段,控制所述时钟信号线输出低电位的时钟信号,以使所述第一上拉控制模块和所述第一下拉控制模块关断;控制所述扫描信号线输出高电位的扫描信号,以使所述第二上拉控制模块导通,所述第二节点的电位上拉至第三电位,所述第二下拉控制模块导通,所述第一节点的电位下拉至第四电位;
在复位阶段,控制所述时钟信号线输出高电位的时钟信号,以使所述第一上拉控制模块和所述第一下拉控制模块导通,所述第一节点的电位上拉至第一电位,所述第二节点的电位下拉至第二电位;控制所述扫描信号线输出低电位的扫描信号,以使所述第二上拉控制模块关断;
在维持阶段,控制所述时钟信号线输出高低电位持续切换的时钟信号,所述第一维持模块放电,维持所述第一节点的高电位。
第三方面,本申请实施例提供一种显示面板,包括如上述第一方面或第一方面任一项所述的发光驱动电路和与所述发光驱动电路连接的像素驱动电路,所述发光驱动电路用于向所述像素驱动电路输出对应的发光驱动信号。
本申请实施例提供的技术方案,包括第一上拉控制模块、第二上拉控制模块、上拉模块、第一下拉控制模块、第二下拉控制模块、下拉模块和第一维持模块;第一上拉控制模块的输入端接入第一电源,控制端接入时钟信号,输出端与第一节点电连接,第一上拉控制模块用于在准备阶段和复位阶段上拉第一节点的电位至第一电位;上拉模块的输入端接入第一电源或时钟信号,控制端与第一节点电连接,输出端与发光驱动信号输出端电连接,上拉模块用于在第一节点的电位为第一电位的情况下,将发光驱动信号输出端输出的发光驱动信号上拉至高电位;第一下拉控制模块的输入端接入第二电源,控制端接入时钟信号,输出端与第二节点电连接,第一下拉控制模块用于在准备阶段和复位阶段下拉第二节点的电位至第二电位;第二上拉控制模块的输入端接入扫描信号或第一电源,控制端接入扫描信号,输出端与第二节点电连接,第二上拉控制模块用于在输出阶段上拉第二节点的电位至第三电位;下拉模块的输入端接入时钟信号,控制端与第二节点电连接,输出端与发光驱动信号输出端电连接,下拉模块用于在第二节点的电位为第三电位的情况下,将发光驱动信号输出端输出的发光驱动信号下拉至低电位;第二下拉控制模块的输入端接入第二电源,控制端与第二节点电连接,输出端与第一节点电连接,第二下拉控制模块用于在输出阶段下拉第一节点的电位至第四电位;第一维持模块的一端与上拉模块的控制端电连接,另一端与发光驱动信号输出端电连接,第一维持模块用于在维持阶段维持第一节点的高电位。上述方案中,发光驱动电路通过第一上拉控制模块、第二上拉控制模块、上拉模块、第一下拉控制模块、第二下拉控制模块、下拉模块和第一维持模块及其对应的连接关系即可调制出所需的发光控制信号,所采用的模块数量少,从而能够简化发光驱动电路的架构,降低发光驱动电路架构的复杂度。
附图说明
图1为本申请实施例提供的一发光驱动电路的电路结构示意图;
图2为本申请实施例提供的另一发光驱动电路的电路结构示意图;
图3为本申请实施例提供的又一发光驱动电路的电路结构示意图;
图4为本申请实施例提供的又一发光驱动电路的电路结构示意图;
图5为本申请实施例提供的时序控制方法控制发光驱动电路的工作时序图;
图6为本申请实施例提供的显示面板中各级发光驱动电路的一种连接关系示意图。
具体实施方式
下面结合本申请实施例中的附图对本申请实施例进行描述。本申请实施例的实施方式部分使用的术语仅用于对本申请的具体实施例进行解释,而非旨在限定本申请。下面这几个具体的实施例可以相互结合,对于相同或相似的概念或过程可能在某些实施例不再赘述。
本申请实施例中的发光器件可以是OLED、量子点发光二极管(Quantum Dot LightEmitting Diodes,QLED)和次毫米发光二极管(Mini Light Emitting Diodes,Mini LED)中的任意一种;本实施例后续以发光器件为OLED为例,进行示例性说明。
图1为本申请实施例提供的一发光驱动电路的电路结构示意图,如图1所示,本申请实施例提供的发光驱动电路可以包括:第一上拉控制模块10、第二上拉控制模块20、上拉模块30、第一下拉控制模块40、第二下拉控制模块50、下拉模块60和第一维持模块70。
第一上拉控制模块10的输入端接入第一电源EVGH,第一上拉控制模块10的控制端接入时钟信号ECK,第一上拉控制模块10到的输出端与第一节点EPU电连接,第一上拉控制模块10用于在准备阶段和复位阶段上拉第一节点EPU的电位至第一电位。第一电源EVGH可以为直流电源,并输出高电位电压,第一电位可以为高电位。
上拉模块30的输入端接入第一电源EVGH,上拉模块30的控制端与第一节点EPU电连接,上拉模块30的输出端与发光驱动信号En输出端电连接,上拉模块30用于在第一节点EPU的电位为第一电位的情况下,将发光驱动信号En输出端输出的发光驱动信号En上拉至高电位。
第一下拉控制模块40的输入端接入第二电源EVGL,第一下拉控制模块40的控制端接入时钟信号ECK,第一下拉控制模块40的输出端与第二节点EPD电连接,第一下拉控制模块40用于在准备阶段和复位阶段下拉第二节点EPD的电位至第二电位。第二电源EVGL可以为直流电源,并输出低电位电压,第二电位可以为低电位。另外,在维持阶段,当时钟信号ECK为高电位时,第八晶体管M8导通,第二节点EPD的电位被第二电源EVGL下拉至低电位,第四晶体管M4关断;当时钟信号ECK为低电位时,可以通过第四晶体管M4的栅极和沟道的寄生电容维持第四晶体管M4的关断状态。
第二上拉控制模块20的输入端和控制端均接入扫描信号Gn,第二上拉控制模块20的输出端与第二节点EPD电连接,第二上拉控制模块20用于在输出阶段上拉第二节点EPD的电位至第三电位。第二电位可以为高电位。
下拉模块60的输入端接入所述时钟信号ECK,下拉模块60的控制端与第二节点EPD电连接,下拉模块60的输出端与发光驱动信号En输出端电连接,下拉模块60用于在第二节点EPD的电位为第三电位的情况下,将发光驱动信号En输出端输出的发光驱动信号En下拉至低电位。
第二下拉控制模块50的输入端接入第二电源EVGL,第二下拉控制模块50的控制端与第二节点EPD电连接,第二下拉控制模块50的输出端与第一节点EPU电连接,第二下拉控制模块50用于在输出阶段下拉第一节点EPU的电位至第四电位。第四电位可以为低电位。
第一维持模块70的一端与上拉模块30的控制端电连接,第一维持模块70的另一端与发光驱动信号En输出端电连接,第一维持模块70用于在维持阶段维持第一节点EPU的高电位,这样在维持阶段,上拉模块30也能够将发光驱动信号En输出端输出的发光驱动信号En上拉至高电位。
发光驱动电路的发光驱动信号En输出端,在准备阶段、复位阶段和维持阶段输出高电位的发光驱动信号En,在输出阶段输出低电位的发光驱动信号En,这样通过第一上拉控制模块10、第二上拉控制模块20、上拉模块30、第一下拉控制模块40、第二下拉控制模块50、下拉模块60和第一维持模块70及其对应的连接关系即可调制出所需的发光控制信号,仅使用7个模块,从而能够简化发光驱动电路的架构,降低发光驱动电路架构的复杂度。
发光驱动电路还可以包括电位稳定模块80,电位稳定模块80的第一输入端与第一电源EVGH电连接,第二输入端与第二下拉控制模块50的输出端电连接,第一控制端与第一节点EPU连接,第二控制端与第二节点EPD电连接,输出端与第一节点EPU电连接,电位稳定模块80用于在准备阶段、复位阶段和维持阶段减小第二下拉控制模块50的漏电流,减弱第二下拉控制模块50的漏电流对第一节点EPU的电位的影响,使第一节点EPU的电位更稳定,从而上拉模块30输出的高电位发光驱动信号En更加稳定。
发光驱动电路还可以包括第二维持模块90,第二维持模块90的输入端接入第二电源EVGL,第二维持模块90的控制端与第一节点EPU电连接,第二维持模块90的输出端与第二节点EPD电连接,第二维持模块90用于在准备阶段、复位阶段和维持阶段维持第二节点EPD的低电位,使得下拉模块60持续关断,让发光驱动信号En输出端只输出高电位的发光驱动信号En。
可以理解的是,在本申请的另一个实施例中,发光驱动电路还可以包括第二维持模块90,而不包括第一下拉控制模块40,这样通过第二维持模块90在准备阶段、复位阶段和维持阶段维持第二节点EPD的低电位,使得下拉模块60持续关断,让发光驱动信号En输出端只输出高电位的发光驱动信号En。本申请的实施例后续以发光驱动电路既包括第二维持模块90又包括第一下拉控制模块40为例,进行示例性说明。
具体地,电位稳定模块80可以包括第一晶体管M1和第二晶体管M2。第一晶体管M1的第一极接入第一电源EVGH,第一晶体管M1的控制极与第一节点EPU电连接,第一晶体管M1的第二极与第二下拉控制模块50的输出端电连接。
第二晶体管M2的第一极与第二下拉控制模块50的输出端电连接,第二晶体管M2的控制极与第二节点EPD电连接,第二晶体管M2的第二极与第一节点EPU电连接。
第二维持模块90可以包括第三晶体管M3,第三晶体管M3的第一极与第二节点EPD电连接,第三晶体管M3的控制极与第一节点EPU电连接,第三晶体管M3的第二极接入第二电源EVGL。
下拉模块60可以包括第四晶体管M4,第四晶体管M4的第一极接入时钟信号ECK,第四晶体管M4的控制极与第二节点EPD电连接,第四晶体管M4的第二极与发光驱动信号En输出端电连接。
第二上拉控制模块20可以包括第五晶体管M5,第五晶体管M5的第一极和控制极均均接入扫描信号Gn,第五晶体管M5的第二极与第二节点EPD电连接。
第一上拉控制模块10可以包括第六晶体管M6,第六晶体管M6的第一极接入第一电源EVGH,第六晶体管M6的第二极与第一节点EPU电连接,第六晶体管M6的控制极接入时钟信号ECK。
上拉模块30可以包括第七晶体管M7,第七晶体管M7的第一极接入第一电源EVGH,第七晶体管M7的控制极与第一节点EPU电连接,第七晶体管M7的第二极与发光驱动信号En输出端电连接。
第一下拉控制模块40可以包括第八晶体管M8,第八晶体管M8的第二极接入第二电源EVGL,第八晶体管M8的控制极接入时钟信号ECK,第八晶体管M8的第一极与第二节点EPD电连接。
第二下拉控制模块50可以包括第九晶体管M9,第九晶体管M9的第二极接入第二电源EVGL,第九晶体管M9的控制极与第二节点EPD电连接,第九晶体管M9的第一极与第一晶体管M1第二极和第二晶体管M2的第一极电连接。
第一维持模块70可以包括电容C1,电容C1的一端与第七晶体管M7的控制极电连接,电容C1的另一端与发光驱动信号En输出端电连接。
在本申请的一些实施例中,第一上拉控制模块10的输入端还可以与控制端均接入时钟信号ECK,如图2所示,第一上拉控制模块10可以包括第十晶体管M10,第十晶体管M10的第一极和控制极均接入时钟信号ECK,第十晶体管M10的第二极与第一节点EPU电连接。
在本申请的另一些实施例中,第二上拉控制模块20的输入端还可以接入第一电源EVGH,如图3所示,第二上拉控制模块20可以包括第十一晶体管M11,第十一晶体管M11的第一极接入第一电源EVGH,第十一晶体管M11的控制极接入扫描信号Gn,第十一晶体管M11的第二极与第二节点EPD电连接。
本申请的驱动控制电路还可以如图4所示,既包括第十晶体管M10,又包括第十一晶体管M11。本申请后需以驱动控制电路如图1所示,进行示例性说明。
本申请实施例中的晶体管可以是NMOS管也可以是其他类型的晶体管,本申请对此不作具体限定。当本申请实施例中的晶体管为NMOS管时,第一极为漏极,第二极为源极,控制极为栅极。
本申请实施例还提供一种时序控制方法,应用于上述发光驱动电路,该方法在准备阶段,控制时钟信号ECK线输出高电位的时钟信号ECK,以使第一上拉控制模块10和第一下拉控制模块40导通,第一节点EPU的电位上拉至第一电位,第一维持模块70充电,第二节点EPD的电位下拉至第二电位;控制扫描信号Gn线输出低电位的扫描信号Gn,以使第二上拉控制模块20关断。
在输出阶段,控制时钟信号ECK线输出低电位的时钟信号ECK,以使第一上拉控制模块10和第一下拉控制模块40关断;控制扫描信号Gn线输出高电位的扫描信号Gn,以使第二上拉控制模块20导通,第二节点EPD的电位上拉至第三电位,第二下拉控制模块50导通,第一节点EPU的电位下拉至第四电位。
在复位阶段,控制时钟信号ECK线输出高电位的时钟信号ECK,以使第一上拉控制模块10和第一下拉控制模块40导通,第一节点EPU的电位上拉至第一电位,第二节点EPD的电位下拉至第二电位;控制扫描信号Gn线输出低电位的扫描信号Gn,以使第二上拉控制模块20关断。
在维持阶段,控制时钟信号ECK线输出高低电位持续切换的时钟信号ECK,第一维持模块70放电,维持第一节点EPU的高电位。
图5为本申请实施例提供的时序控制方法控制发光驱动电路的工作时序图,如图5所示,在准备阶段T1,扫描信号Gn为低电位,第五晶体管M5关断;时钟信号ECK为高电位,第六晶体管M6导通,第一电源EVGH的高电位通过第六晶体管M6写入第一节点EPU并向电容C1充电,将第一节点EPU的电位上拉至第一电位,使第七晶体管M7导通,第一电源EVGH的高电位通过第七晶体管M7写入发光驱动信号En输出端,发光驱动信号En输出端输出高电位的发光驱动信号En。同时由于第一节点EPU的高电位使第三晶体管M3导通,并且高电位的时钟信号ECK使第八晶体管M8也导通,第二电源EVGL的低电位通过第三晶体管M3和第八晶体管M8写入第二节点EPD,使第四晶体管M4关断。另外,第二节点EPD的低电位使第二晶体管M2和第九晶体管M9均处于关断状态,此时第九晶体管M9的源极电位为VGL,漏极电位为VGH,会产生漏电流,而第一节点EPU的高电位使第一晶体管M1导通,这样第二晶体管M2的漏极和源极的电位均为VGH,无电流通过第二晶体管M2,这样就能够阻挡第九晶体管M9的漏电流流向第一节点EPU,使第九晶体管M9的漏电流不会对第一节点EPU的电位产生影响。
在输出阶段T2,时钟信号ECK由高电位切换为低电位,第六晶体管M6和第八晶体管M8关断;扫描信号Gn切换为高电位,第五晶体管M5导通,第二节点EPD的电位被上拉至第三电位,使第四晶体管M4导通,时钟信号ECK的低电位通过第四晶体管M4写入发光驱动信号En输出端,发光驱动信号En输出端输出低电位的发光驱动信号En。同时第二节点EPD的高电位使第二晶体管M2和第九晶体管M9导通,第二电源EVGL通过第二晶体管M2和第九晶体管M9写入第一节点EPU,第一节点EPU的电位被下拉至第四电位,使第一晶体管M1、第三晶体管M3和第七晶体管M7关断。
在复位阶段T3,扫描信号Gn切换为低电位,第五晶体管M5关断;时钟信号ECK切换为高电位,第六晶体管M6导通,第一电源EVGH的高电位通过第六晶体管M6写入第一节点EPU并向电容C1充电,将第一节点EPU的电位上拉至第一电位,使第七晶体管M7导通,第一电源EVGH的高电位通过第七晶体管M7写入发光驱动信号En输出端,发光驱动信号En输出端输出高电位的发光驱动信号En。同时由于第一节点EPU的高电位使第三晶体管M3导通,并且高电位的时钟信号ECK使第八晶体管M8也导通,第二电源EVGL的低电位通过第三晶体管M3和第八晶体管M8写入第二节点EPD,使第四晶体管M4关断。另外,第二节点EPD的低电位使第二晶体管M2和第九晶体管M9均处于关断状态,此时第九晶体管M9的源极电位为VGL,漏极电位为VGH,会产生漏电流,而第一节点EPU的高电位使第一晶体管M1导通,这样第二晶体管M2的漏极和源极的电位均为VGH,无电流通过第二晶体管M2,这样就能够阻挡第九晶体管M9的漏电流流向第一节点EPU,使第九晶体管M9的漏电流不会对第一节点EPU的电位产生影响。
在维持阶段T4,扫描信号Gn维持低电位,第九晶体管M9维持关断状态,第二节点EPD维持低电位,第四晶体管M4维持关断状态。时钟信号ECK的高低电位持续切换,当时钟信号ECK为高电位时,第六晶体管M6导通,第一节点EPU写入高电位,第七晶体管M7导通,发光驱动信号En输出端输出高电位的发光驱动信号En;当时钟信号ECK为低电位时,电容C1放电维持第一节点EPU的高电位,第七晶体管M7仍旧导通,发光驱动信号En输出端依然输出高电位的发光驱动信号En。
本申请实施例还提供一种显示面板,包括如上述发光驱动电路和与发光驱动电路连接的像素驱动电路,发光驱动电路用于向像素驱动电路输出对应的发光驱动信号。
本申请实施例提供的显示面板中可以包括多个发光驱动电路,图6为本申请实施例提供的显示面板中各级发光驱动电路的一种连接关系示意图,如图6所示,每级发光驱动电路接入一个时钟信号,每级发光驱动电路可以向相邻的两个像素提供同一发光驱动信号,每个像素接入对应行的发光驱动电路输出的发光驱动信号,并复用下一行的发光驱动电路输出的发光驱动信号,这样可以减少发光驱动电路的数量和时钟信号线的数量,从而能够缩小显示面板的横向排版尺寸,实现显示面板的窄边框。
另外,显示面板中的各像素也可以仅接入对应行的发光驱动电路输出的发光驱动信号,或者复用更多其他行的发光驱动电路输出的发光驱动信号,本申请对此不作具体限制。
可以理解的是,本申请实施例示意的电路模块并不构成对发光驱动电路的具体限定。在本申请另一些实施例中,发光驱动电路可以包括比图示更多或更少的电路模块,或者组合某些电路模块,或者拆分某些电路模块;每个电路模块可以包括比图示更多或更少的器件。图示的电路模块可以以硬件,软件或软件和硬件的组合实现。
本申请实施例提供的技术方案,包括第一上拉控制模块、第二上拉控制模块、上拉模块、第一下拉控制模块、第二下拉控制模块、下拉模块和第一维持模块;第一上拉控制模块的输入端接入第一电源,控制端接入时钟信号,输出端与第一节点电连接,第一上拉控制模块用于在准备阶段和复位阶段上拉第一节点的电位至第一电位;上拉模块的输入端接入第一电源或时钟信号,控制端与第一节点电连接,输出端与发光驱动信号输出端电连接,上拉模块用于在第一节点的电位为第一电位的情况下,将发光驱动信号输出端输出的发光驱动信号上拉至高电位;第一下拉控制模块的输入端接入第二电源,控制端接入时钟信号,输出端与第二节点电连接,第一下拉控制模块用于在准备阶段和复位阶段下拉第二节点的电位至第二电位;第二上拉控制模块的输入端接入扫描信号或第一电源,控制端接入扫描信号,输出端与第二节点电连接,第二上拉控制模块用于在输出阶段上拉第二节点的电位至第三电位;下拉模块的输入端接入时钟信号,控制端与第二节点电连接,输出端与发光驱动信号输出端电连接,下拉模块用于在第二节点的电位为第三电位的情况下,将发光驱动信号输出端输出的发光驱动信号下拉至低电位;第二下拉控制模块的输入端接入第二电源,控制端与第二节点电连接,输出端与第一节点电连接,第二下拉控制模块用于在输出阶段下拉第一节点的电位至第四电位;第一维持模块的一端与上拉模块的控制端电连接,另一端与发光驱动信号输出端电连接,第一维持模块用于在维持阶段维持第一节点的高电位。上述方案中,发光驱动电路通过第一上拉控制模块、第二上拉控制模块、上拉模块、第一下拉控制模块、第二下拉控制模块、下拉模块和第一维持模块及其对应的连接关系即可调制出所需的发光控制信号,所采用的模块数量少,从而能够简化发光驱动电路的架构,降低发光驱动电路架构的复杂度。
在上述实施例中,对各个实施例的描述都各有侧重,某个实施例中没有详述或记载的部分,可以参见其它实施例的相关描述。
另外,附图中各部件之间的尺寸比例关系仅是示意性的,其并不反映各部件之间的实际尺寸比例关系。
在本申请的描述中,术语“中心”、“纵向”、“横向”、“上”、“下”、“前”、“后”、“左”、“右”、“竖直”、“水平”、“顶”、“底”、“内”、“外”等指示的方位或位置关系为基于附图所示的方位或位置关系,仅是为了便于描述本发明和简化描述,而不是指示或暗示所指的设备或元件必须具有特定的方位、以特定的方位构造和操作,因此不能理解为对本发明的限制。
在本申请的描述中,需要说明的是,除非另有明确的规定和限定,术语“安装”、“相连”、“连接”应做广义理解,例如,可以是固定连接,也可以是可拆卸连接,或一体地连接;可以是机械连接,也可以是电连接;可以是直接相连,也可以通过中间媒介间接相连,可以是两个元件内部的连通。对于本领域的普通技术人员而言,可以通过具体情况理解上述术语在本发明中的具体含义。
应当理解,当在本申请说明书和所附权利要求书中使用时,术语“包括”指示所描述特征、整体、步骤、操作、元素和/或组件的存在,但并不排除一个或多个其它特征、整体、步骤、操作、元素、组件和/或其集合的存在或添加。
在本申请的描述中,除非另有说明,“/”表示前后关联的对象是一种“或”的关系,例如,A/B可以表示A或B;本申请中的“和/或”仅仅是一种描述关联对象的关联关系,表示可以存在三种关系,例如,A和/或B,可以表示:单独存在A,同时存在A和B,单独存在B这三种情况,其中A,B可以是单数或者复数。
并且,在本申请的描述中,除非另有说明,“多个”是指两个或多于两个。“以下至少一项”或其类似表达,是指的这些项中的任意组合,包括单项或复数项的任意组合。例如,a,b,或c中的至少一项,可以表示:a,b,c,a-b,a-c,b-c,或a-b-c,其中a,b,c可以是单个,也可以是多个。
另外,在本申请说明书和所附权利要求书的描述中,术语“第一”、“第二”、“第三”等是用于区别类似的对象,而不必用于描述特定的顺序或先后次序。应该理解这样使用的数据在适当情况下可以互换,以便这里描述的实施例能够以除了在这里图示或描述的内容以外的顺序实施。
在本申请说明书中描述的参考“一个实施例”或“一些实施例”等意味着在本申请的一个或多个实施例中包括结合该实施例描述的特定特征、结构或特点。由此,在本说明书中的不同之处出现的语句“在一个实施例中”、“在一些实施例中”、“在其他一些实施例中”、“在另外一些实施例中”等不是必然都参考相同的实施例,而是意味着“一个或多个但不是所有的实施例”,除非是以其他方式另外特别强调。
最后应说明的是:以上各实施例仅用以说明本申请的技术方案,而非对其限制;尽管参照前述各实施例对本申请进行了详细的说明,本领域的普通技术人员应当理解:其依然可以对前述各实施例所记载的技术方案进行修改,或者对其中部分或者全部技术特征进行等同替换;而这些修改或者替换,并不使相应技术方案的本质脱离本申请各实施例技术方案的范围。
Claims (9)
1.一种发光驱动电路,其特征在于,包括:第一上拉控制模块、第二上拉控制模块、上拉模块、第一下拉控制模块、第二下拉控制模块、下拉模块和第一维持模块;
第一上拉控制模块的输入端接入第一电源或时钟信号,控制端接入时钟信号,输出端与第一节点电连接,第一上拉控制模块用于在准备阶段和复位阶段上拉第一节点的电位至第一电位;
上拉模块的输入端接入第一电源,控制端与第一节点电连接,输出端与发光驱动信号输出端电连接,上拉模块用于在第一节点的电位为第一电位的情况下,将发光驱动信号输出端输出的发光驱动信号上拉至高电位;
第一下拉控制模块的输入端接入第二电源,控制端接入所述时钟信号,输出端与第二节点电连接,第一下拉控制模块用于在准备阶段和复位阶段下拉第二节点的电位至第二电位;
第二上拉控制模块的输入端接入扫描信号或第一电源,控制端接入扫描信号,输出端与第二节点电连接,第二上拉控制模块用于在输出阶段上拉第二节点的电位至第三电位;
下拉模块的输入端接入所述时钟信号,控制端与第二节点电连接,输出端与发光驱动信号输出端电连接,下拉模块用于在第二节点的电位为第三电位的情况下,将发光驱动信号输出端输出的发光驱动信号下拉至低电位;
第二下拉控制模块的输入端接入第二电源,控制端与第二节点电连接,输出端与第一节点电连接,第二下拉控制模块用于在输出阶段下拉第一节点的电位至第四电位;
第一维持模块的一端与上拉模块的控制端电连接,另一端与发光驱动信号输出端电连接,第一维持模块用于在维持阶段维持第一节点的高电位;
在准备阶段,所述时钟信号为高电位,所述第一上拉控制模块和所述第一下拉控制模块导通,所述第一节点的电位上拉至第一电位,所述第一维持模块充电,所述第二节点的电位下拉至第二电位;所述扫描信号为低电位,所述第二上拉控制模块关断;
在输出阶段,所述时钟信号为低电位,所述第一上拉控制模块和所述第一下拉控制模块关断;所述扫描信号为高电位,所述第二上拉控制模块导通,所述第二节点的电位上拉至第三电位,所述第二下拉控制模块导通,所述第一节点的电位下拉至第四电位;
在复位阶段,所述时钟信号为高电位,所述第一上拉控制模块和所述第一下拉控制模块导通,所述第一节点的电位上拉至第一电位,所述第二节点的电位下拉至第二电位;所述扫描信号为低电位,所述第二上拉控制模块关断;
在维持阶段,所述时钟信号线的电位在高电位和低电位之间持续切换,所述第一维持模块放电,所述第一节点维持高电位。
2.根据权利要求1所述的发光驱动电路,其特征在于,所述发光驱动电路还包括:电位稳定模块,所述电位稳定模块的第一输入端与所述第一电源电连接,第二输入端与所述第二下拉控制模块的输出端电连接,第一控制端与所述第一节点连接,第二控制端与所述第二节点电连接,输出端与所述第一节点电连接,所述电位稳定模块用于在准备阶段、复位阶段和维持阶段稳定所述第一节点的电位。
3.根据权利要求2所述的发光驱动电路,其特征在于,所述电位稳定模块包括:第一晶体管和第二晶体管;
所述第一晶体管的第一极接入所述第一电源,控制极与所述第一节点电连接,第二极与所述第二下拉控制模块的输出端电连接;
所述第二晶体管的第一极与所述第二下拉控制模块的输出端电连接,控制极与所述第二节点电连接,第二极与所述第一节点电连接。
4.根据权利要求1所述的发光驱动电路,其特征在于,所述发光驱动电路还包括:第二维持模块,所述第二维持模块的输入端接入所述第二电源,控制端与所述第一节点电连接,输出端与所述第二节点电连接,所述第二维持模块用于在准备阶段、复位阶段和维持阶段维持所述第二节点的低电位。
5.根据权利要求4所述的发光驱动电路,其特征在于,所述第二维持模块包括第三晶体管,所述第三晶体管的第一极与所述第二节点电连接,控制极与所述第一节点电连接,第二极接入所述第二电源。
6.根据权利要求1所述的发光驱动电路,其特征在于,所述第一维持模块包括电容,所述电容的一端与所述上拉模块的控制端电连接,另一端与所述发光驱动信号输出端电连接。
7.根据权利要求1所述的发光驱动电路,其特征在于,所述下拉模块包括第四晶体管,所述第四晶体管的第一极接入所述时钟信号,控制极与所述第二节点电连接,第二极与所述发光驱动信号输出端电连接。
8.根据权利要求1-7任一项所述的发光驱动电路,其特征在于,所述第二上拉控制模块包括第五晶体管,所述第五晶体管的第一极接入所述扫描信号或所述第一电源,控制极接入所述扫描信号,所述第五晶体管的第二极与所述第二节点电连接。
9.一种显示面板,其特征在于,包括如权利要求1-8任一项所述的发光驱动电路和与所述发光驱动电路连接的像素驱动电路,所述发光驱动电路用于向所述像素驱动电路输出对应的发光驱动信号。
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