CN115102568A - 射频电路、控制方法、装置、射频读写设备及存储介质 - Google Patents

射频电路、控制方法、装置、射频读写设备及存储介质 Download PDF

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CN115102568A CN202210816225.9A CN202210816225A CN115102568A CN 115102568 A CN115102568 A CN 115102568A CN 202210816225 A CN202210816225 A CN 202210816225A CN 115102568 A CN115102568 A CN 115102568A
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Abstract

本申请提供了一种射频电路、控制方法、装置、射频读写设备及存储介质。该射频电路包括：基带单元，用于输出基带信号；射频收发器，与基带单元电连接，用于基于预设的载波信号对基带信号进行调制，输出射频信号；射频PA单元，与射频收发器电连接，用于对射频信号进行放大处理后输出至天线；PA控制单元，与基带单元电连接，用于根据基带信号生成基带同步信号，并根据预设时延对基带信号进行调制生成包络同步信号，根据基带同步信号及包络同步信号输出PA控制信号；PA驱动单元，分别与PA控制单元、射频PA单元电连接，用于根据PA控制信号输出PA驱动信号至射频PA单元；PA驱动信号用于驱动射频PA单元开启和关闭。能够降低射频功率放大器的静态功耗。

Description

射频电路、控制方法、装置、射频读写设备及存储介质
技术领域
本申请涉及射频技术领域，尤其涉及一种射频电路、控制方法、装置、射频读写设备及存储介质。
背景技术
随着RFID技术的发展，射频识别技术的应用愈发广泛。射频读写设备根据盘存指令，通过发送射频载波和调制信号给标签提供能量和交互数据。射频读写设备工作时的功耗主要来自于射频功率放大器，即使在不进行盘存时，射频功率放大器仍会产生静态功耗。
发明内容
本申请实施例提供了一种射频电路、控制方法、装置、射频读写设备、存储介质及计算机设备，能够降低射频功率放大器的静态功耗。
第一方面，本申请提供了一种射频电路，包括：
基带单元，用于输出基带信号；
射频收发器，与所述基带单元电连接，用于基于预设的载波信号对所述基带信号进行调制，输出射频信号；
射频PA单元，与所述射频收发器电连接，用于对所述射频信号进行放大处理后输出至天线；
PA控制单元，与所述基带单元电连接，用于根据所述基带信号生成基带同步信号，并根据预设时延对所述基带信号进行调制生成包络同步信号，根据所述基带同步信号及所述包络同步信号输出PA控制信号；所述基带同步信号用于反映所述基带信号的输出状态；
PA驱动单元，分别与所述PA控制单元、所述射频PA单元电连接，用于根据所述PA控制信号输出PA驱动信号至所述射频PA单元；所述PA驱动信号用于驱动所述射频PA单元开启和关闭。
在其中一个实施例中，所述PA控制单元包括：
第一信号生成电路，与所述基带单元电连接，用于检测所述基带信号，并生成所述基带同步信号；其中，在检测到所述基带信号输出时，所述基带同步信号为高电平，在未检测到所述基带信号输出时，所述基带同步信号为低电平；
第二信号生成电路，与所述基带单元电连接，用于接收所述基带信号，并根据预设时延对所述基带信号进行调制，生成所述包络同步信号；
与门电路，分别与所述第一信号生成电路、所述第二信号生成电路、所述PA驱动单元电连接，用于对所述基带同步信号和所述包络同步信号进行与运算，输出所述PA控制信号。
在其中一个实施例中，所述预设时延包括上升沿时延和下降沿时延；
所述第二信号生成电路用于接收所述基带信号，根据所述上升沿时延及所述下降沿时延调节所述基带信号的占空比，生成所述包络同步信号。
在其中一个实施例中，所述PA驱动单元包括：
稳压模块，用于提供偏置电压；
驱动开关，所述驱动开关的第一输入端与所述稳压模块电连接，所述驱动开关的第二输入端接地，所述驱动开关的输出端与所述射频PA单元电连接，所述驱动开关的控制端与所述PA控制单元电连接，所述驱动开关用于根据所述PA控制信号切换导通所述输出端与所述第一输入端之间的第一通路，或所述输入端与所述第二输入端之间的第一通路，输出所述PA驱动信号至所述射频PA单元；
其中，在所述第一通路导通时，所述PA驱动信号用于驱动所述射频PA单元开启；在所述第二通路导通时，所述PA驱动信号用于驱动所述射频PA单元关闭。
在其中一个实施例中，所述稳压模块包括：低压差线性稳压器及保护电阻；
所述保护电阻的第一端与所述低压差线性稳压器电连接，所述保护电阻的第二端与所述驱动开关的第一输入端电连接。
第二方面，本申请提供了一种射频读写设备，包括：天线及如上述任一项实施例所述的射频电路，所述天线与所述射频电路中的射频PA单元电连接。
第三方面，本申请提供了一种射频电路控制方法，应用于如上述任一项实施例所述的射频电路的PA控制单元，所述方法包括：
检测基带单元输出的基带信号生成基带同步信号；
获取所述基带信号；
根据预设时延对所述基带信号进行调制生成包络同步信号；
根据所述基带同步信号及所述包络同步信号输出PA控制信号至PA驱动单元。
第四方面，本申请提供了一种射频电路控制装置，应用于如上述任一项实施例所述的射频电路的PA控制单元，所述装置包括：
第一信号生成模块，用于检测基带单元输出的基带信号生成基带同步信号；
信号获取模块，用于获取所述基带信号；
第一信号生成模块，用于根据预设时延对所述基带信号进行调制生成包络同步信号；
控制信号输出模块，用于根据所述基带同步信号及所述包络同步信号输出PA控制信号至PA驱动单元。
第五方面，本申请提供了一种存储介质，所述存储介质中存储有计算机可读指令，所述计算机可读指令被一个或多个处理器执行时，使得一个或多个处理器执行如上述实施例所述射频电路控制方法的步骤。
第六方面，本申请提供了一种计算机设备，包括：一个或多个处理器，以及存储器；
所述存储器中存储有计算机可读指令，所述计算机可读指令被所述一个或多个处理器执行时，执行上述实施例所述射频电路控制方法的步骤。
从以上技术方案可以看出，本申请实施例具有以下优点：
本申请提供的射频电路、控制方法、装置、射频读写设备、存储介质及计算机设备，通过增设PA控制单元基于基带信号生成基带同步信号和包络同步信号，其中基带同步信号能够反映基带信号的输出状态，包络同步信号是根据预设时延对基带信号进行调制生成的；根据基带同步信号和包络同步信号输出PA控制信号控制PA驱动单元输出PA驱动信号，利用PA驱动信号驱动射频PA单元开启和关闭，由于基带同步信号能够反映基带信号的输出状态，因此PA控制信号可以对应在有基带信号输出时驱动射频PA单元开启，让射频PA单元不会在无基带信号输出时开启，进而降低静态功耗；另外，由于包络同步信号是根据预设时延对基带信号调制生成的，可以克服由于时延导致的射频PA单元无法及时开启的问题，并且预设时延可以根据需要进行配置，可以根据通信协议要求配置预设时延，使最终输出的PA控制信号能够满足通信协议要求，并且达到降低静态功耗的目的。
附图说明
为了更清楚地说明本申请实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本申请的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动性的前提下，还可以根据这些附图获得其它的附图。
图1为一个实施例中，射频电路的结构示意图之一；
图2为一个实施例中，射频电路的结构示意图之二；
图3为一个实施例中，射频电路的结构示意图之三；
图4为一个实施例中，射频电路的结构示意图之四；
图5为一个实施例中，射频电路控制方法的流程示意图；
图6为一个实施例中，射频电路控制装置的结构框图；
图7为一个实施例中，计算机设备的内部结构示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
本申请实施例提供了一种射频电路100，如图1所示，射频电路100包括基带单元110、射频收发器120、射频PA(PowerAmplifier，功率放大器)单元130、PA控制单元140及PA驱动单元150。其中，射频收发器120分别与基带单元110、射频PA单元130电连接，射频PA单元130用于电连接天线200，PA控制单元140分别与基带单元110、PA驱动单元150电连接。
基带单元110用于合成基带信号输出至射频收发器120，在一些实施例中，基带单元110还用于对接收到的基带信号进行解码。射频收发器120用于基于预设的载波信号对基带信号进行调制生成射频信号，并将射频信号经射频PA单元130放大处理后输出至天线200进行发射，在一些实施例中，射频收发器120还与接收链路电连接，用于对接收链路经天线接收的射频信号进行解调得到基带信号输出至基带单元110。射频PA单元130用于在开启时对射频信号进行放大处理，输出放大后的射频信号至天线200；在关闭时则不对射频信号进行放大处理，进而也不输出射频信号至天线200。
PA控制单元140用于根据基带单元110输出的基带信号生成基带同步信号，基带同步信号能够反映基带信号的输出状态，即在每个时刻基带信号是否有输出；PA控制单元140还用于根据预设时延对基带单元110输出的基带信号进行调制，生成包络同步信号，并根据基带同步信号和包络同步信号输出PA控制信号至PA驱动单元150。PA驱动单元150用于根据PA控制信号输出PA驱动信号至射频PA单元130，驱动射频PA单元130开启和关闭。
本实施例通过增设PA控制单元140基于基带信号生成基带同步信号和包络同步信号，其中基带同步信号能够反映基带信号的输出状态，包络同步信号是根据预设时延对基带信号进行调制生成的；根据基带同步信号和包络同步信号输出PA控制信号控制PA驱动单元150输出PA驱动信号，利用PA驱动信号驱动射频PA单元130开启和关闭，由于基带同步信号能够反映基带信号的输出状态，因此PA控制信号可以对应在有基带信号输出时驱动射频PA单元130开启，让射频PA单元130不会在无基带信号输出时开启，进而降低静态功耗；另外，由于包络同步信号是根据预设时延对基带信号调制生成的，可以克服由于时延导致的射频PA单元130无法及时开启的问题，并且预设时延可以根据需要进行配置，可以根据通信协议要求配置预设时延，使最终输出的PA控制信号能够满足通信协议要求，并且达到降低静态功耗的目的。
在其中一个实施例中，如图2所示，PA控制单元140包括第一信号生成电路141、第二信号生成电路142及与门电路143。其中：
第一信号生成电路141与基带单元110电连接，用于检测基带信号，并生成基带同步信号；其中，在检测到基带信号输出时，基带同步信号为高电平，在未检测到基带信号输出时，基带同步信号为低电平。第二信号生成电路142与基带单元110电连接，用于接收基带信号，并根据预设时延对基带信号进行调制，生成包络同步信号。与门电路143分别与第一信号生成电路141、第二信号生成电路142、PA驱动单元150电连接，用于对基带同步信号和包络同步信号进行与运算，输出PA控制信号。
本实施例通过与门电路143对基带同步信号和包络同步信号进行与运算，在基带同步信号与包络同步信号均为高电平时，PA控制信号为高电平，即在有基带信号输出时，通过包络同步信号对基带同步信号进行调制，进而使得在基带单元110有基带信号输出时，射频PA单元130开启，且开启时间满足预设时延，使射频PA单元130输出的射频信号满足通信协议的频谱模板要求。
在其中一个实施例中，PA控制单元140可以采用集成芯片实现第一信号生成模块141、第二信号生成模块142及与门电路143的功能。
在其中一个实施例中，预设时延包括上升沿时延和下降沿时延；第二信号生成电路142用于接收基带信号，根据上升沿时延及下降沿时延调节基带信号的占空比，生成包络同步信号，进而使射频PA单元130输出的射频信号满足通信协议的频谱模板要求。
如图3所示，在其中一个实施例中，PA驱动单元150包括：稳压模块151和驱动开关152。其中，稳压模块151用于提供偏置电压；驱动开关152的第一输入端与稳压模块151电连接，驱动开关152的第二输入端接地，驱动开关152的输出端与射频PA单元130电连接，驱动开关152的控制端与PA控制单元140电连接，驱动开关152用于根据PA控制信号切换导通输出端与第一输入端之间的第一通路，或输入端与第二输入端之间的第一通路，输出PA驱动信号至射频PA单元130。在第一通路导通时，PA驱动信号用于驱动射频PA单元130开启；在第二通路导通时，PA驱动信号用于驱动射频PA单元130关闭。在一个实施例中，为了保证电路可靠性，驱动开关152的第二输出端经电阻R接地。
本实施例中，在第一通路导通时，即稳压模块与射频PA单元导通，此时PA驱动信号即为稳压模块输出的偏置电压，射频PA单元在偏置电压的驱动下开启；在第二通路导通时，即射频PA单元接地，此时PA驱动信号即为低电平，射频PA单元关闭。稳压模块持续提供偏置电压，通过PA控制信号控制驱动开关，输出PA驱动信号，响应速度较快，仅取决于驱动开关的开关响应速度，进而能够实现射频PA单元需要满足包络同步信号的占空比进行开启和控制的时间要求。
在其中一个实施例中，如图4所示，稳压模块151包括：低压差线性稳压器LDO及保护电阻R1；保护电阻R1的第一端与低压差线性稳压器LDO电连接，保护电阻R1的第二端与驱动开关152的第一输入端电连接。
本申请实施例还提供了一种射频读写设备，包括天线及如上述任一项实施例所述的射频电路，天线与射频电路中的射频PA单元电连接。
如图5所示，本申请实施例还提供了一种射频电路控制方法，应用于如上述任一项实施例所述的射频电路的PA控制单元，方法包括：
步骤S501，检测基带单元输出的基带信号生成基带同步信号；
步骤S502，获取基带信号；
步骤S503，根据预设时延对基带信号进行调制生成包络同步信号；
步骤S504，根据基带同步信号及包络同步信号输出PA控制信号至PA驱动单元。
本实施例通过PA控制单元基于基带信号生成基带同步信号和包络同步信号，其中基带同步信号能够反映基带信号的输出状态，包络同步信号是根据预设时延对基带信号进行调制生成的；根据基带同步信号和包络同步信号输出PA控制信号控制PA驱动单元输出PA驱动信号，利用PA驱动信号驱动射频PA单元开启和关闭，由于基带同步信号能够反映基带信号的输出状态，因此PA控制信号可以对应在有基带信号输出时驱动射频PA单元开启，让射频PA单元不会在无基带信号输出时开启，进而降低静态功耗；另外，由于包络同步信号是根据预设时延对基带信号调制生成的，可以克服由于时延导致的射频PA单元无法及时开启的问题，并且预设时延可以根据需要进行配置，可以根据通信协议要求配置预设时延，使最终输出的PA控制信号能够，满足通信协议要求，并且达到降低静态功耗的目的。
应该理解的是，虽然如上所述的各实施例所涉及的流程图中的各个步骤按照箭头的指示依次显示，但是这些步骤并不是必然按照箭头指示的顺序依次执行。除非本文中有明确的说明，这些步骤的执行并没有严格的顺序限制，这些步骤可以以其它的顺序执行。而且，如上所述的各实施例所涉及的流程图中的至少一部分步骤可以包括多个步骤或者多个阶段，这些步骤或者阶段并不必然是在同一时刻执行完成，而是可以在不同的时刻执行，这些步骤或者阶段的执行顺序也不必然是依次进行，而是可以与其它步骤或者其它步骤中的步骤或者阶段的至少一部分轮流或者交替地执行。
下面对本申请实施例提供的文本处理装置进行描述，下文描述的文本处理装置与上文描述的文本处理方法可相互对应参照。
如图6所示，本申请实施例还提供了一种射频电路控制装置600，应用于如上述任一项实施例所述的射频电路的PA控制单元，所述装置包括：
第一信号生成模块601，用于检测基带单元输出的基带信号生成基带同步信号；
信号获取模块602，用于获取基带信号；
第一信号生成模块603，用于根据预设时延对基带信号进行调制生成包络同步信号；
控制信号输出模块604，用于根据基带同步信号及包络同步信号输出PA控制信号至PA驱动单元。
上述射频电路控制装置中各个模块的划分仅仅用于举例说明，在其他实施例中，可将射频电路控制装置按照需要划分为不同的模块，以完成上述射频电路控制装置的全部或部分功能。上述射频电路控制装置中的各个模块可全部或部分通过软件、硬件及其组合来实现。上述各模块可以硬件形式内嵌于或独立于计算机设备中的处理器中，也可以以软件形式存储于计算机设备中的存储器中，以便于处理器调用执行以上各个模块对应的操作。
在一个实施例中，本申请还提供了一种存储介质，所述存储介质中存储有计算机可读指令，所述计算机可读指令被一个或多个处理器执行时，使得一个或多个处理器执行如上述实施例中任一项所述射频电路控制方法的步骤。
在一个实施例中，本申请还提供了一种计算机设备，所述计算机设备中存储有计算机可读指令，所述计算机可读指令被一个或多个处理器执行时，使得一个或多个处理器执行如上述实施例中任一项所述射频电路控制方法的步骤。
在一个实施例中，提供了一种计算机设备，该计算机设备可以是终端，其内部结构图可以如图7所示。该计算机设备包括通过系统总线连接的处理器、存储器、通信接口、显示屏和输入装置。其中，该计算机设备的处理器用于提供计算和控制能力。该计算机设备的存储器包括非易失性存储介质、内存储器。该非易失性存储介质存储有操作系统和计算机可读介质。该内存储器为非易失性存储介质中的操作系统和计算机可读介质的运行提供环境。该计算机设备的通信接口用于与外部的终端进行有线或无线方式的通信，无线方式可通过WIFI、移动蜂窝网络、NFC(近场通信)或其他技术实现。该计算机可读介质被处理器执行时以实现一种射频电路控制方法。该计算机设备的显示屏可以是液晶显示屏或者电子墨水显示屏，该计算机设备的输入装置可以是显示屏上覆盖的触摸层，也可以是计算机设备外壳上设置的按键、轨迹球或触控板，还可以是外接的键盘、触控板或鼠标等。
本领域技术人员可以理解，图7中示出的结构，仅仅是与本申请方案相关的部分结构的框图，并不构成对本申请方案所应用于其上的计算机设备的限定，具体的计算机设备可以包括比图中所示更多或更少的部件，或者组合某些部件，或者具有不同的部件布置。
本领域普通技术人员可以理解实现上述实施例方法中的全部或部分流程，是可以通过计算机可读介质来指令相关的硬件来完成，所述的计算机可读介质可存储于一非易失性计算机可读取存储介质中，该计算机可读介质在执行时，可包括如上述各方法的实施例的流程。其中，本申请所提供的各实施例中所使用的对存储器、数据库或其它介质的任何引用，均可包括非易失性和易失性存储器中的至少一种。非易失性存储器可包括只读存储器(Read-Only Memory，ROM)、磁带、软盘、闪存、光存储器、高密度嵌入式非易失性存储器、阻变存储器(ReRAM)、磁变存储器(Magnetoresistive Random Access Memory，MRAM)、铁电存储器(Ferroelectric Random Access Memory，FRAM)、相变存储器(Phase Change Memory，PCM)、石墨烯存储器等。易失性存储器可包括随机存取存储器(Random Access Memory，RAM)或外部高速缓冲存储器等。作为说明而非局限，RAM可以是多种形式，比如静态随机存取存储器(Static Random Access Memory，SRAM)或动态随机存取存储器(Dynamic RandomAccess Memory，DRAM)等。本申请所提供的各实施例中所涉及的数据库可包括关系型数据库和非关系型数据库中至少一种。非关系型数据库可包括基于区块链的分布式数据库等，不限于此。本申请所提供的各实施例中所涉及的处理器可为通用处理器、中央处理器、图形处理器、数字信号处理器、可编程逻辑器、基于量子计算的数据处理逻辑器等，不限于此。
最后，还需要说明的是，在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括一个……”限定的要素，并不排除在包括所述要素的过程、方法、物品或者设备中还存在另外的相同要素。
此外，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括至少一个该特征。在本申请的描述中，“多个”的含义是至少两个，例如两个，三个等，除非另有明确具体的限定。
本说明书中各个实施例采用递进的方式描述，每个实施例重点说明的都是与其他实施例的不同之处，各个实施例之间可以根据需要进行组合，且相同相似部分互相参见即可。
对所公开的实施例的上述说明，使本领域专业技术人员能够实现或使用本申请。对这些实施例的多种修改对本领域的专业技术人员来说将是显而易见的，本文中所定义的一般原理可以在不脱离本申请的精神或范围的情况下，在其它实施例中实现。因此，本申请将不会被限制于本文所示的这些实施例，而是要符合与本文所公开的原理和新颖特点相一致的最宽的范围。

Claims (10)

1.一种射频电路，其特征在于，包括：
基带单元，用于输出基带信号；
射频收发器，与所述基带单元电连接，用于基于预设的载波信号对所述基带信号进行调制，输出射频信号；
射频PA单元，与所述射频收发器电连接，用于对所述射频信号进行放大处理后输出至天线；
PA控制单元，与所述基带单元电连接，用于根据所述基带信号生成基带同步信号，并根据预设时延对所述基带信号进行调制生成包络同步信号，根据所述基带同步信号及所述包络同步信号输出PA控制信号；所述基带同步信号用于反映所述基带信号的输出状态；
PA驱动单元，分别与所述PA控制单元、所述射频PA单元电连接，用于根据所述PA控制信号输出PA驱动信号至所述射频PA单元；所述PA驱动信号用于驱动所述射频PA单元开启和关闭。
2.根据权利要求1所述的射频电路，其特征在于，所述PA控制单元包括：
第一信号生成电路，与所述基带单元电连接，用于检测所述基带信号，并生成所述基带同步信号；其中，在检测到所述基带信号输出时，所述基带同步信号为高电平，在未检测到所述基带信号输出时，所述基带同步信号为低电平；
第二信号生成电路，与所述基带单元电连接，用于接收所述基带信号，并根据预设时延对所述基带信号进行调制，生成所述包络同步信号；
与门电路，分别与所述第一信号生成电路、所述第二信号生成电路、所述PA驱动单元电连接，用于对所述基带同步信号和所述包络同步信号进行与运算，输出所述PA控制信号。
3.根据权利要求2所述的射频电路，其特征在于，所述预设时延包括上升沿时延和下降沿时延；
所述第二信号生成电路用于接收所述基带信号，根据所述上升沿时延及所述下降沿时延调节所述基带信号的占空比，生成所述包络同步信号。
4.根据权利要求1所述的射频电路，其特征在于，所述PA驱动单元包括：
稳压模块，用于提供偏置电压；
驱动开关，所述驱动开关的第一输入端与所述稳压模块电连接，所述驱动开关的第二输入端接地，所述驱动开关的输出端与所述射频PA单元电连接，所述驱动开关的控制端与所述PA控制单元电连接，所述驱动开关用于根据所述PA控制信号切换导通所述输出端与所述第一输入端之间的第一通路，或所述输入端与所述第二输入端之间的第一通路，输出所述PA驱动信号至所述射频PA单元；
其中，在所述第一通路导通时，所述PA驱动信号用于驱动所述射频PA单元开启；在所述第二通路导通时，所述PA驱动信号用于驱动所述射频PA单元关闭。
5.根据权利要求4所述的射频电路，其特征在于，所述稳压模块包括：低压差线性稳压器及保护电阻；
所述保护电阻的第一端与所述低压差线性稳压器电连接，所述保护电阻的第二端与所述驱动开关的第一输入端电连接。
6.一种射频读写设备，其特征在于，包括：天线及如权利要求1至5任一项所述的射频电路，所述天线与所述射频电路中的射频PA单元电连接。
7.一种射频电路控制方法，其特征在于，应用于如权利要求1至5任一项所述的射频电路的PA控制单元，所述方法包括：
检测基带单元输出的基带信号生成基带同步信号；
获取所述基带信号；
根据预设时延对所述基带信号进行调制生成包络同步信号；
根据所述基带同步信号及所述包络同步信号输出PA控制信号至PA驱动单元。
8.一种射频电路控制装置，其特征在于，应用于如权利要求1至5任一项所述的射频电路的PA控制单元，所述装置包括：
第一信号生成模块，用于检测基带单元输出的基带信号生成基带同步信号；
信号获取模块，用于获取所述基带信号；
第一信号生成模块，用于根据预设时延对所述基带信号进行调制生成包络同步信号；
控制信号输出模块，用于根据所述基带同步信号及所述包络同步信号输出PA控制信号至PA驱动单元。
9.一种存储介质，其特征在于：所述存储介质中存储有计算机可读指令，所述计算机可读指令被一个或多个处理器执行时，使得一个或多个处理器执行如权利要求7所述射频电路控制方法的步骤。
10.一种计算机设备，其特征在于，包括：一个或多个处理器，以及存储器；
所述存储器中存储有计算机可读指令，所述计算机可读指令被所述一个或多个处理器执行时，执行如权利要求7所述射频电路控制方法的步骤。
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