CN114745340A - 一种报文处理方法及装置 - Google Patents

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Abstract

本申请提供了一种报文处理方法和装置。该方法包括：接入控制模块、二层交换模块以及三层路由模块基于各待软件处理报文的协议类型识别各处理器标识；接入控制模块、二层交换模块以及三层路由模块将各待软件处理报文缓存在识别的各处理器标识对应的各芯片接口队列；处理器接口模块根据各芯片接口队列缓存的各待软件处理报文的协议类型的限速器的发送速率，向处理器发送各芯片接口队列缓存的各待软件处理报文。

Description

一种报文处理方法及装置
技术领域
本申请涉及通信技术，特别涉及一种报文处理方法及装置。
背景技术
报文由通信设备的端口进入交换芯片后，由交换芯片先进行安全检查，然后将符合安全的包进行二层(L2)交换或者三层(L3)路由。交换芯片对到达的包进行安全检查时，ACL(Access Control List，安全检查列表)模块等模块通过连接CPU的芯片接口发送需要软件处理的包至CPU；交换芯片中通过安全检查后的包由L2交换模块进行L2交换或者由L3路由模块进行L3路由查找时，也通过芯片接口将需要软件处理的包发送至CPU。
交换芯片连接CPU的芯片接口对应8个队列，每个队列被分配了一个CPU Code，每个CPU Code绑定一个限速器；但是，交换芯片的不同模块基于不同机制为需要软件处理的报文分配的CPU Code，譬如ACL模块根据芯片接口的各队列的CPU Code，为存储在同一个队列的不同协议类型的包分配相同的CPU Code；L2交换模块根据协议类型分配CPU code；L3路由模块根据四层协议的端口号分配CPU端口号，同一类型的协议报文会通过芯片接口的不同队列发往CPU。但是该方式存在问题在于，首先，同一队列不同协议类型报文存在相互冲击的不确定性，当某个队列向CPU发送报文的速率超过其限速器的限速门限时，需要丢掉该队列缓存的低优先级协议类型和高优先级协议类型的报文，各队列中导致了低优先级协议类型的报文对高优先级协议类型报文的冲击；其次，相同协议类型报文通过不同的队列发送会导致CPU受冲击的风险，因为不同队列虽然未超过各队列限速器的限速门限，而CPU从不同队列收到的大量相同协议类型报文会对CPU的处理性能造成冲击。
发明内容
本申请的目的在于提供一种报文处理方法，避免需要软件处理的报文对CPU的冲击风险。
为实现上述目的，本申请提供了一种报文处理方法，该方法包括：接入控制模块、二层交换模块以及三层路由模块基于各待软件处理报文的协议类型识别各处理器标识；接入控制模块、二层交换模块以及三层路由模块将各待软件处理报文缓存在识别的各处理器标识对应的各芯片接口队列；处理器接口模块根据各芯片接口队列缓存的各待软件处理报文的协议类型的限速器的发送速率，向处理器发送各芯片接口队列缓存的各待软件处理报文。
为实现上述目的，本申请还提供了一种报文处理装置，giant装置应用于交换芯片，该装置至少包括接入控制模块、二层交换模块、三层路由模块、处理器接口模块；接入控制模块、二层交换模块以及三层路由模块基于各待软件处理报文的协议类型识别各处理器标识；接入控制模块、二层交换模块以及三层路由模块将各待软件处理报文缓存在识别的各处理器标识对应的各芯片接口队列；处理器接口模块根据各芯片接口队列缓存的各待软件处理报文的协议类型的限速器的发送速率，向处理器发送各芯片接口队列缓存的各待软件处理报文。
本申请的有益效果避免通过芯片接口的每个队列发送到CPU的同种协议类型报文过多导致的CPU冲击风险。
附图说明
图1所示本申请提供的报文处理方法实施例的流程图；
图2所示为本申请提供的定义CPU Code和限速器的实施例一的示意图；
图3所示为本申请提供的定义CPU Code和限速器的实施例二的示意图；
图4所示为本申请提供的报文处理装置的实施例的示意图。
具体实施方式
将以多个附图所示的多个例子进行详细说明。在以下详细描述中，多个具体细节用于提供对本申请的全面理解。实例中没有详细地描述已知的方法、步骤、组件以及电路，以免使这些例子的难于理解。
使用的术语中，术语“包括”表示包括但不限于；术语“含有”表示包括但不限于；术语“以上”、“以内”以及“以下”包含本数；术语“大于”、“小于”表示不包含本数。术语“基于”表示至少基于其中一部分。
图1所示本申请提供的报文处理方法实施例的流程图；该方法包括：
步骤101，接入控制模块、二层交换模块以及三层路由模块基于各待软件处理报文的协议类型识别各处理器标识；
步骤102，接入控制模块、二层交换模块以及三层路由模块将各待软件处理报文缓存在识别的各处理器标识对应的各芯片接口队列；
步骤103，处理器接口模块根据各芯片接口队列缓存的各待软件处理报文的协议类型的限速器的发送速率，向处理器发送各芯片接口队列缓存的各待软件处理报文。
本申请的有益效果在于避免通过芯片接口的每个队列发送到CPU的同种协议类型报文过多导致的CPU冲击风险。
本申请中，交换芯片为同一个协议类型的报文设置一个CPU code作为处理器标识，将每个CPU Code与芯片接口的8个队列中的一个关联，为同一个协议类型的报文设置一个限速器。在交换芯片自定义CPU Code基址DRV_CPU CODE_BASE_ADDR，定义限速器基址DRV_LIMITER_BASE_ADDR，统一定义统一ACL模块、L2交换模块、L3路由模块分配给同一个协议类型的CPU Code迁移以及限速器迁移，还可以对每个限速器的发送速率设置速率门限，如下表1所示：
协议类型名称 CPU Code偏移 限速器偏移 限速器速率门限
BFD 0 0 5000
IS-IS 1 1 420
… … … …
TELNET 63 63 420
表1
基于表1统一定义的ACL模块、L2交换模块、L3路由模块分配给同一个协议类型的CPU Code以及限速器如图2所示。
通过统一定义的ACL模块、L2交换模块、L3路由模块分配给同一个协议类型的CPUCode以及限速器，每个协议类型的报文被缓存在芯片接口的同一个队列中，按照该协议类型的限速器的速率门限发往CPU进行软件处理；这样同一队列内报文发往CPU的进行软件处理的速率门限不同，不会造成同一队列内的不同协议类型报文间的冲击，而且也不会通过不同的队列将同一个协议类型报文大量发往CPU导致CPU冲击风险。此外，本申请需要调整某个协议类型的报文发往CPU的速率门限时，可以直接修改该协议类型的速率门限，而不需要使用ACL表项等其他额外的硬件表项。
由于交换芯片可用于分配CPU Code的地址是有限的，是一种有限的硬件资源，但是用于分配限速器的地址数目大于可用于分配CPU Code的地址数目。本申请定义ACL模块、L2交换模块、L3路由模块分别给同一个协议类型的分配CPU Code迁移、限速器迁移，但是定义ACL模块、L2交换模块、L3路由模块分配的限速器迁移不同，如表2-1、2-2、2-3所示：
协议类型名称 CPU Code偏移 限速器偏移 限速器速率门限
BFD 0 0 5000
IS-IS 1 1 420
… … … …
TELNET 63 63 420
表2-1
协议类型名称 CPU Code偏移 限速器偏移 限速器速率门限
BGPv4 0 64 820
BGPv6 1 65 420
… … … …
IGMP 63 127 420
表2-2
协议类型名称 CPU Code偏移 限速器偏移 限速器速率门限
DHCPv4 0 128 5000
DHCPv6 1 129 420
… … … …
STP T 63 193 420
表2-3
基于表2-1、2-2、2-3ACL模块、L2交换模块、L3路由模块分配给同一个协议类型的CPU Code以及限速器如图2所示。图3所示为本申请提供的分配CPU Code的实施例二的示意图，CPU Code0-63可以被3种协议类型复用，相比图2所示分配方式扩展了CPU Code的支持的协议类型。
图4所示为本申请提供的报文处理装置的实施例的示意图。图4所示为本申请提供的报文转发设备实施例的流程图，图4为本申请提供的修改策略路由的路由信息的设备实施例的示意图，该设备40至少包括：网络接口，交换芯片，CPU以及存储器。交换芯片至少包括ACL模块、二层交换模块、三层路由模块。处理器通过运行存储器中的处理器可执行指令用以执行设置模块。
ACL模块、二层交换模块以及三层路由模块基于各待软件处理报文的协议类型识别各处理器标识；ACL模块、二层交换模块以及三层路由模块将各待软件处理报文缓存在识别的各处理器标识对应的各芯片接口队列；
处理器接口模块根据各芯片接口队列缓存的各待软件处理报文的协议类型的限速器的发送速率，向处理器发送各芯片接口队列缓存的各待软件处理报文。
设置模块，设置ACL模块、二层交换模块以及三层路由模块分配给各协议类型的处理器标识；将设置的每个处理标识关联芯片接口的一个芯片接口队列；设置ACL模块、二层交换模块以及三层路由模块分配给各协议类型的限速器。
设置模块设置ACL模块、二层交换模块以及三层路由模块分配给各协议类型的处理器标识包括，定义处理器标识基址；统一定义ACL模块、二层交换模块以及三层路由模块分配给同一种协议类型的处理器标识偏移；设置模块设置ACL模块、二层交换模块以及三层路由模块分配给各协议类型的限速器包括：定义限速器基址；统一定义ACL模块、二层交换模块以及三层路由模块分配给同一种协议类型的限速器偏移。
设置模块设置ACL模块、二层交换模块以及三层路由模块分配给各协议类型的处理器标识包括，定义处理器标识基址；分别定义ACL模块、定义二层交换模块以及三层路由模块分配给同一种协议类型的处理器标识偏移；设置模块设置ACL模块、二层交换模块以及三层路由模块分配给各协议类型的限速器包括，定义限速器基址；分别定义ACL模块、二层交换模块以及三层路由模块分配给各个协议类型的限速器偏移；其中，ACL模块、二层交换模块以及三层路由模块分配给同一种协议类型的限速器偏移不同。
以上所述仅为本申请的较佳实施例而已，并不用以限制本申请，凡在本申请的精神和原则之内，所做的任何修改、等同替换、改进等，均应包含在本申请保护的范围之内。

Claims (8)

1.一种报文处理方法，其特征在于，所述方法包括：
接入控制模块、二层交换模块以及三层路由模块基于各待软件处理报文的协议类型识别各处理器标识；
所述接入控制模块、所述二层交换模块以及所述三层路由模块将所述各待软件处理报文缓存在所述识别的各处理器标识对应的各芯片接口队列；
处理器接口模块根据所述各芯片接口队列缓存的所述各待软件处理报文的协议类型的限速器的发送速率，向处理器发送所述各芯片接口队列缓存的所述各待软件处理报文。
2.根据权利要求1所述的方法，其特征在于，所述接入控制模块、所述二层交换模块以及所述三层路由模块基于各待软件处理报文的协议类型识别各处理器标识之前，所述方法还包括：
设置所述接入控制模块、二层交换模块以及三层路由模块分配给各协议类型的处理器标识；
将所述设置的每个处理标识关联所述芯片接口的一个芯片接口队列；
设置所述接入控制模块、所述二层交换模块以及所述三层路由模块分配给所述各协议类型的限速器。
3.根据权利要求2所述的方法，其特征在于，设置所述接入控制列表模块、二层交换模块以及三层路由模块分配给各协议类型的处理器标识包括：定义处理器标识基址；统一定义所述接入控制模块、二层交换模块以及三层路由模块分配给同一种协议类型的处理器标识偏移；
设置所述接入控制模块、所述二层交换模块以及所述三层路由模块分配给所述各协议类型的限速器包括：定义限速器基址；统一定义所述接入控制模块、二层交换模块以及三层路由模块分配给同一种协议类型的限速器偏移。
4.根据权利要求2所述的方法，其特征在于，设置所述接入控制模块、所述二层交换模块以及所述三层路由模块分配给所述各协议类型的限速器包括：定义限速器基址；分别定义所述接入控制模块、二层交换模块以及三层路由模块分配给同一种协议类型的限速器偏移；
设置所述接入控制模块、所述二层交换模块以及所述三层路由模块分配给所述各协议类型的限速器包括：定义限速器基址；分别定义所述接入控制模块、二层交换模块以及三层路由模块分配给各个协议类型的限速器偏移；其中，所述接入控制模块、二层交换模块以及三层路由模块分配的限速器偏移不同。
5.一种报文处理装置，其特征在于，所述装置应用于交换芯片，该装置至少包括接入控制模块、二层交换模块、三层路由模块、处理器接口模块；
所述接入控制模块、所述二层交换模块以及所述三层路由模块基于各待软件处理报文的协议类型识别各处理器标识；
所述接入控制模块、所述二层交换模块以及所述三层路由模块将所述各待软件处理报文缓存在所述识别的各处理器标识对应的各芯片接口队列；
所述处理器接口模块根据所述各芯片接口队列缓存的所述各待软件处理报文的协议类型的限速器的发送速率，向处理器发送所述各芯片接口队列缓存的所述各待软件处理报文。
6.根据权利要求5所述的装置，其特征在于，所述装置还包括设置模块；
所述设置模块，设置所述接入控制模块、二层交换模块以及三层路由模块分配给各协议类型的处理器标识；将所述设置的每个处理标识关联所述芯片接口的一个芯片接口队列；设置所述接入控制模块、所述二层交换模块以及所述三层路由模块分配给所述各协议类型的限速器。
7.根据权利要求6所述的装置，其特征在于，所述设置模块设置所述接入控制模块、二层交换模块以及三层路由模块分配给各协议类型的处理器标识包括：定义处理器标识基址；统一定义所述接入控制模块、二层交换模块以及三层路由模块分配给同一种协议类型的处理器标识偏移；
所述设置模块设置所述接入控制模块、所述二层交换模块以及所述三层路由模块分配给所述各协议类型的限速器包括：定义限速器基址；统一定义所述接入控制模块、二层交换模块以及三层路由模块分配给同一种协议类型的限速器偏移。
8.根据权利要求7所述的装置，其特征在于，所述设置模块设置所述接入控制模块、二层交换模块以及三层路由模块分配给各协议类型的处理器标识包括：定义处理器标识基址；分别定义所述接入控制模块、二层交换模块以及三层路由模块分配给同一种协议类型的处理器标识偏移；
所述设置模块设置所述接入控制模块、所述二层交换模块以及所述三层路由模块分配给所述各协议类型的限速器包括：定义限速器基址；分别定义所述接入控制模块、二层交换模块以及三层路由模块分配给各个协议类型的限速器偏移；其中，所述接入控制模块、二层交换模块以及三层路由模块分配的限速器偏移不同。
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