CN114301568B - 一种实时跟踪瞄准式无人机干扰方法 - Google Patents
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Abstract
本发明提出了一种实时跟踪瞄准式无人机干扰方法，基于一种实时跟踪瞄准式无人机干扰器，所述实时跟踪瞄准式无人机干扰器包括接收天线、发射天线、功放模块、捷变频模块、FPGA单元、参考时钟信号模块；所述FPGA单元包括数据处理单元、切换控制模块、接收模块、发射模块、本地干扰信号生成模块、转发干扰信号模块；本发明通过上述设置，利用接收到的无人机与遥控器之间一般为跳频信号的通信信号，快速检测出信号在频谱中的位置，根据检测到的情况选择本地干扰信号生成模块或转发干扰信号模块产生带宽较小且针对性强的干扰压制信号，对跳频信号在保持载波的时间内迅速实施干扰压制。
Description
技术领域
本发明属于反无人机技术领域，具体地说，涉及一种实时跟踪瞄准式无人机干扰方法。
背景技术
反无人机技术是利用无线电技术对无人机的通讯信号进行跟踪监测并采取相应的反制措施，通过使无人机的导航系统、定位系统、控制系统或通信系统中的一个或者多个失效，最终使无人机失去作战功能的技术。
无人机跟踪监测的手段主要有雷达监测、无线电信号监测、光电跟踪和声波识别等。
无人机反制措施主要有定向大功率干扰信号压制、激光打击和物理反制等。
无线电信号监测识别包括分析信号的频率、带宽、调制方式、跳频图样等参数，提取信号特征，利用接收到的信号分析出无人机的通信方式甚至识别出无人机的型号，但是监测一般是通过计算机软件对采集的数据进行分析，时间比较久，无法跟踪跳频。
定向大功率干扰信号压制所需发射的干扰压制信号干扰带宽较大，发射功率较高，干扰效率较低。
发明内容
本发明针对现有技术的上述缺陷和需求，提出了一种实时跟踪瞄准式无人机干扰方法，基于一种实时跟踪瞄准式无人机干扰器，所述实时跟踪瞄准式无人机干扰器包括接收天线、发射天线、功放模块、捷变频模块、FPGA单元、参考时钟信号模块；所述FPGA单元包括数据处理单元、切换控制模块、接收模块、发射模块、本地干扰信号生成模块、转发干扰信号模块；本发明通过上述设置，利用接收到的无人机与遥控器之间一般为跳频信号的通信信号，快速检测出信号在频谱中的位置，根据检测到的情况选择本地干扰信号生成模块或转发干扰信号模块产生带宽较小且针对性强的干扰压制信号，对跳频信号在保持载波的时间内迅速实施干扰压制。
本发明具体实现内容如下：
本发明提出了一种实时跟踪瞄准式无人机干扰方法，基于实时跟踪瞄准式无人机干扰器；所述实时跟踪瞄准式无人机干扰器包括接收天线、发射天线、功放模块、捷变频模块、FPGA单元、参考时钟信号模块；
所述FPGA单元包括数据处理模块、切换控制模块、接收模块、发射模块、本地干扰信号生成模块、转发干扰信号模块；
所述数据处理模块连接接收模块、本地干扰信号生成模块、转发干扰信号模块、切换控制模块、捷变频模块；所述数据处理模块通过本地干扰信号生成模块、转发干扰信号模块与发射模块连接；所述数据处理模块通过切换控制模块与所述接收模块、发射模块控制连接；
所述接收模块和发射模块与所述捷变频模块连接；
所述参考时钟信号模块、功放模块、接收天线分别与所述捷变频模块连接；所述捷变频模块通过功放模块与所述发射天线连接；
所述实时跟踪瞄准式无人机干扰方法具体包括以下步骤：
步骤1：将捷变频模块的发射端关闭，接收端打开，通过接收天线接收射频信号；
步骤2：通过捷变频模块将接收到的射频信号下变频至基带并进行采样率为h MHz的数据采集；
步骤3：使用捷变频模块将采样后的数据通过FPGA单元的接收模块发送到FPGA单元的数据处理模块中；
步骤4：FPGA单元的数据处理模块将接收到的采样数据进行长度为D的快速傅里叶变换FFT处理；对经过快速傅里叶变换FFT处理后得到的频谱信息，进行分析、筛选，得到当前无人机通信信号的信号信息；所述信号信息包括载波值、带宽大下；
步骤5：根据获取得到的信号信息结合实际情况分析，选择本地干扰信号生成模块或者转发干扰信号模块进行干扰信号的基带信号的生成；并将选择的本地干扰信号生成模块或转发干扰信号模块生成的干扰信号的基带信号通过FPGA单元的发射模块发送到捷变频模块中进行上变频，通过上变频生成干扰信号的射频信号，并通过功放模块、发射天线发送到空中。
为了更好地实现本发明，进一步地，所述本地干扰信号生成模块中包括两路并行设置的DDS芯片；
在所述步骤5中，所述本地干扰信号生成模块生成的干扰信号为一个线性调频信号的具体生成方法为：采用两路并行的DDS芯片进行所需的线性调频信号的生成；两片DDS芯片的参数设置方法具体如下：
对于单独的一个DDS芯片，定义生成一个线性调频信号的瞬时频率为Freq[n]，起始频率为f0，频率改变的步进为fΔ，步长为t，采样率记为fs；所述瞬时频率为Freq[n]的计算公式如下：
Freq[n] = f0+ fΔ*mod(n,t)；
其中mod(n,t)表示对n整除t取余数；
则单独的一个DDS芯片的归一化瞬时频率Freqnorm[n]的具体计算公式如下：
Freqnorm[n] = [f0+ fΔ*mod(n,t)]/ fs
则当采用两个并行的DDS芯片进行线性射频信号的生成时：
定义两片DDS芯片分别为DDS0芯片和DDS1芯片，对应的归一化瞬时频率分别定义为Freqnorm_0[n]和Freqnorm_1[n]，具体计算公式如下：
Freqnorm_0[n]=Freqnorm_1[n-1] + [f0 + fΔ*mod(2*n-1 , t)] / fs
Freqnorm_1[n]=Freqnorm_0[n] + [f0 + fΔ*mod(2*n , t)] / fs
其中n > 0，且
Freqnorm_0[0] = 0
Freqnorm_1[0] = f0 / fs
此时两个DDS芯片对应的采样率为fs /2；
设FPGA中DDS芯片的总的相位控制字位宽为N比特，那么DDS0芯片对应的相位控制字PhyN_0[n]表示为
PhyN_0[n] = mod[round(Freqnorm_0[n]*2^N) , 2^N]
其中round(a)表示最接近a的整数；
同理，DDS1芯片的相位控制字PhyN_1[n]可表示为：
PhyN_1[n] = mod[round(Freqnorm_1[n]*2^N) , 2^N]。
为了更好地实现本发明，进一步地，所述转发干扰信号模块中设置有一个RAM芯片；
所述步骤5中，采用转发干扰信号模块生成干扰信号的基带信号的具体操作为：在FPGA单元的数据处理模块进行步骤4的快速傅里叶变换FFT时，使用RAM芯片对当前处理数据进行同步存储，并对当前接收的信号数据是否为无人机通信信号进行判断；若判断为当前接收的信号数据为无人机通信信号，则停止对RAM芯片内数据的修改，并将RAM芯片内存储的数据作为干扰信号通过发射天线发送到空中。
为了更好地实现本发明，进一步地，对于FPGA单元的数据处理模块进行快速傅里叶变换FFT的延时DFFT进行计算，具体计算公式为：
DFFT = S + D / h；
其中：h为捷变频模块的采样率，D为快速傅里叶变换FFT的长度，S为数据处理模块进行快速傅里叶变换FFT的运算延时。
本发明还提出了一种实时跟踪瞄准式无人机干扰器，包括接收天线、发射天线、功放模块、捷变频模块、FPGA单元、参考时钟信号模块；
所述FPGA单元包括数据处理单元、切换控制模块、接收模块、发射模块、本地干扰信号生成模块、转发干扰信号模块；
所述数据处理单元连接接收模块、本地干扰信号生成模块、转发干扰信号模块、切换控制模块、捷变频模块；所述数据处理单元通过本地干扰信号生成模块、转发干扰信号模块与发射模块连接；所述数据处理单元通过切换控制模块与所述接收模块、发射模块控制连接；
所述接收模块和发射模块与所述捷变频模块连接；
所述参考时钟信号模块、功放模块、接收天线分别与所述捷变频模块连接；所述捷变频模块通过功放模块与所述发射天线连接。
为了更好地实现本发明，进一步地，所述FPGA单元采用Zynq7045芯片。
为了更好地实现本发明，进一步地，所述捷变频模块采用ADRV9009捷变频子卡。
为了更好地实现本发明，进一步地，所述FPGA单元中的数据处理单元与所述捷变频模块之间采用SPI串口进行配置连接。
为了更好地实现本发明，进一步地，所述FPGA单元中的接收模块、发射模块与所述捷变频模块之间采用JESD204B接口进行连接。
为了更好地实现本发明，进一步地，所述捷变频模块的Rx接口与所述接收天线连接。
为了更好地实现本发明，进一步地，所述捷变频模块的Tx接口与所述功放模块连接，并通过功放模块与所述发射天线连接。
为了更好地实现本发明，进一步地，所述本地干扰信号生成模块中包括两路并行设置的DDS芯片。
为了更好地实现本发明，进一步地，所述转发干扰信号模块中设置有一个RAM芯片。
本发明与现有技术相比具有以下优点及有益效果：
（1）本发明可以实时跟踪处理接收信号，快速监测到无人机通信信号后立即瞄准干扰压制，发射所需的发射功率也较小；
（2）本发明同时具备了监测和干扰压制的功能；
（3）本发明体积小，重量轻。
附图说明
图1为本发明的模块示意简图；
图2为本发明系统的运行流程示意图；
图3为本发明选择发送干扰模式的示意图；
图4为本发明的归一化视频图；
图5为本发明最终参数也能的干扰信号的I路时域波形示例图；
图6为本发明产生的正交信号对应的频谱示意图；
图7为本发明切换收发干扰的示意图；
图8为本发明的设备机箱及接口的正向立体示意图；
图9为本发明的设备机箱及接口的背向立体示意图。
其中：1、电源开关，2、ADRV9009外供参考时钟口，3、ADRV9009发射口，4、ADRV9009备用发射口，5、ADRV9009接收口，6、ADRV9009第一备用观测接收口，7、ADRV9009外部本振输入口，8、ADRV9009第二备用观测接收口，9、ADRV9009备用接收口，10、JTAG接口，11、串口接口，12、网线，13、电源线插口。
具体实施方式
为了更清楚地说明本发明实施例的技术方案，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，应当理解，所描述的实施例仅仅是本发明的一部分实施例，而不是全部的实施例，因此不应被看作是对保护范围的限定。基于本发明中的实施例，本领域普通技术工作人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
在本发明的描述中，需要说明的是，除非另有明确的规定和限定，术语“设置”、“相连”、“连接”应做广义理解，例如，可以是固定连接，也可以是可拆卸连接，或一体地连接；可以是机械连接，也可以是电连接；也可以是直接相连，也可以是通过中间媒介间接相连，可以是两个元件内部的连通。对于本领域的普通技术人员而言，可以具体情况理解上述术语在本发明中的具体含义。
实施例1：
本实施例提出了一种实时跟踪瞄准式无人机干扰方法，基于实时跟踪瞄准式无人机干扰器；如图1、图2所示，所述实时跟踪瞄准式无人机干扰器包括接收天线、发射天线、功放模块、捷变频模块、FPGA单元、参考时钟信号模块；
所述FPGA单元包括数据处理模块、切换控制模块、接收模块、发射模块、本地干扰信号生成模块、转发干扰信号模块；
所述数据处理模块连接接收模块、本地干扰信号生成模块、转发干扰信号模块、切换控制模块、捷变频模块；所述数据处理模块通过本地干扰信号生成模块、转发干扰信号模块与发射模块连接；所述数据处理模块通过切换控制模块与所述接收模块、发射模块控制连接；
所述接收模块和发射模块与所述捷变频模块连接；
所述参考时钟信号模块、功放模块、接收天线分别与所述捷变频模块连接；所述捷变频模块通过功放模块与所述发射天线连接；
所述实时跟踪瞄准式无人机干扰方法具体包括以下步骤：
步骤1：将捷变频模块的发射端关闭，接收端打开，通过接收天线接收射频信号；
步骤2：通过捷变频模块将接收到的射频信号下变频至基带并进行采样率为h MHz的数据采集；
步骤3：使用捷变频模块将采样后的数据通过FPGA单元的接收模块发送到FPGA单元的数据处理模块中；
步骤4：FPGA单元的数据处理模块将接收到的采样数据进行长度为D的快速傅里叶变换FFT处理；对经过快速傅里叶变换FFT处理后得到的频谱信息，进行分析、筛选，得到当前无人机通信信号的信号信息；所述信号信息包括载波值、带宽大下；
步骤5：根据获取得到的信号信息结合实际情况分析，选择本地干扰信号生成模块或者转发干扰信号模块进行干扰信号的基带信号的生成；并将选择的本地干扰信号生成模块或转发干扰信号模块生成的干扰信号的基带信号通过FPGA单元的发射模块发送到捷变频模块中进行上变频，通过上变频生成干扰信号的射频信号，并通过功放模块、发射天线发送到空中。
工作原理：通过上述设置，利用接收到的无人机与遥控器之间一般为跳频信号的通信信号，快速检测出信号在频谱中的位置，根据检测到的情况选择本地干扰信号生成模块或转发干扰信号模块产生带宽较小且针对性强的干扰压制信号，对跳频信号在保持载波的时间内迅速实施干扰压制。
实施例2：
本实施例在上述实施例1的基础上，为了更好地实现本发明，进一步地，所述本地干扰信号生成模块中包括两路并行设置的DDS芯片；
在所述步骤5中，所述本地干扰信号生成模块生成的干扰信号为一个线性调频信号的具体生成方法为：采用两路并行的DDS芯片进行所需的线性调频信号的生成；两片DDS芯片的参数设置方法具体如下：
对于单独的一个DDS芯片，定义生成一个线性调频信号的瞬时频率为Freq[n]，起始频率为f0，频率改变的步进为fΔ，步长为t，采样率记为fs；所述瞬时频率为Freq[n]的计算公式如下：
Freq[n] = f0+ fΔ*mod(n,t)；
其中mod(n,t)表示对n整除t取余数；
则单独的一个DDS芯片的归一化瞬时频率Freqnorm[n]的具体计算公式如下：
Freqnorm[n] = [f0+ fΔ*mod(n,t)]/ fs
则当采用两个并行的DDS芯片进行线性射频信号的生成时：
定义两片DDS芯片分别为DDS0芯片和DDS1芯片，对应的归一化瞬时频率分别定义为Freqnorm_0[n]和Freqnorm_1[n]，具体计算公式如下：
Freqnorm_0[n]=Freqnorm_1[n-1] + [f0 + fΔ*mod(2*n-1 , t)] / fs
Freqnorm_1[n]=Freqnorm_0[n] + [f0 + fΔ*mod(2*n , t)] / fs
其中n > 0，且
Freqnorm_0[0] = 0
Freqnorm_1[0] = f0 / fs
此时两个DDS芯片对应的采样率为fs /2；
设FPGA中DDS芯片的总的相位控制字位宽为N比特，那么DDS0芯片对应的相位控制字PhyN_0[n]表示为
PhyN_0[n] = mod[round(Freqnorm_0[n]*2^N) , 2^N]
其中round(a)表示最接近a的整数；
同理，DDS1芯片的相位控制字PhyN_1[n]可表示为：
PhyN_1[n] = mod[round(Freqnorm_1[n]*2^N) , 2^N]。
本实施例的其他部分与上述实施例1相同，故不再赘述。
实施例3：
本实施例在上述实施例1-2任一项的基础上，为了更好地实现本发明，进一步地，所述转发干扰信号模块中设置有一个RAM芯片；
所述步骤5中，采用转发干扰信号模块生成干扰信号的基带信号的具体操作为：在FPGA单元的数据处理模块进行步骤4的快速傅里叶变换FFT时，使用RAM芯片对当前处理数据进行同步存储，并对当前接收的信号数据是否为无人机通信信号进行判断；若判断为当前接收的信号数据为无人机通信信号，则停止对RAM芯片内数据的修改，并将RAM芯片内存储的数据作为干扰信号通过发射天线发送到空中。
本实施例的其他部分与上述实施例1-2任一项相同，故不再赘述。
实施例4：
本实施例在上述实施例1-3任一项的基础上，为了更好地实现本发明，进一步地，对于FPGA单元的数据处理模块进行快速傅里叶变换FFT的延时DFFT进行计算，具体计算公式为：
DFFT = S + D / h；
其中：h为捷变频模块的采样率，D为快速傅里叶变换FFT的长度，S为数据处理模块进行快速傅里叶变换FFT的运算延时。
本实施例的其他部分与上述实施例1-3任一项相同，故不再赘述。
实施例5：
本实施例在上述实施例1-4任一项的基础上，本实施例在上述实施例1-4任一项的基础上，如图2、图3、图4、图5、图6、图7、图8、图9所示，给出一个实施举例：
如图2所示，上电初始化干扰器中先运行FPGA的逻辑部分，初始化所有数字模块，然后通过SPI配置ADRV9009捷变频子卡，等待进入工作模式；
进入工作模式：
ADRV9009的发射端关闭，接收端打开，ADRV9009将接收天线接收的射频信号下变频至基带并进行数据采集，采样率为245.76MHz；
数据处理实现FPGA对ADRV9009采集数据的接收，并对数据进行FFT(快速傅里叶变换)处理，使用了长度为512点的FFT；
对FFT得到的频谱信息进行分析、筛选，得到当前无人机通信信号的载波值，带宽大小等信息；
ADRV9009的接收端关闭，发射端打开，将对应发射干扰模式的基带信号上变频至射频，通过发射天线发送到空中；
手动控制或者自动控制发射持续时间，发射持续时间结束后再次进入ADRV9009发射端关闭，接收端打开。
工作原理：
无人机与遥控器间的通信信号属于跳频信号，需要在很短的时间内完成监测和干扰压制。本发明能够快速跟踪当前通信信号，识别出载波及带宽等信息，并根据所识别出的信息发射干扰信号，本发明干扰信号产生干扰的本质是让无人机无法正确解析通信信号，最终导致功能失灵。
本发明工作原理分为两部分：接收部分和发射部分。
接收部分利用天线接收空中的射频信号，利用ADRV9009对射频信号进行下变频处理，内部本振配置为2.45GHz(可根据实际情况修改)，下变频后得到基带的正交数据，采样率为245.76MHz，对该数据实时进行512点的FFT，FPGA中FFT的IP核此时的运算延时为6.548us，则512点数据长度产生的延时DFFT为:
DFFT = 6.584 + 512 / 245.76 = 8.6673 (us)
对FFT的结果进行分析、筛选、选择干扰信号等处理过程的总耗时小于512个时钟周期，另外，ADRV9009关闭接收打开发射至最终射频信号稳定时间小于5us，最终可以预计，接收无人机的通信信号到发射出干扰信号的用时小于16us。
发射部分主要是控制干扰信号播放延时，另外，ADRV9009发射关闭接收打开至接收数据稳定同样也小于5us。
实际发送的干扰信号可以有两种选择。如图3所示，目前本干扰设备的干扰信号模式分为本地干扰源干扰模式和转发式干扰模式，每种模式都需要利用频谱分析后的结果进行配置。
本地干扰源模式的干扰信号产生方式如下：
本地干扰源生成的干扰信号为一个线性调频信号，由于ADRV9009的输入数据结构要求，需要通过两路并行DDS产生所需的线性调频信号
单独一个DDS生成一个线性调频信号的瞬时频率记为Freq[n]，起始频率记为f0，频率改变的步进为fΔ，步长为t，采样率记为fs，若线性调频信号的时频图为锯齿波，那么
Freq[n] = f0+ fΔ*mod(n,t)
其中mod(n,t)表示对n整除t取余数。
归一化瞬时频率Freqnorm[n]为：
Freqnorm[n] = [f0+ fΔ*mod(n,t)]/ fs
对应的归一化时频图如图4所示，此时t = 200，fΔ= 0.5，fs = 245.76MHz，f0=10MHz。
将上述Freqnorm[n]用两片并行DDS产生，不妨记两片DDS为DDS0和 DDS1，对应的归一化瞬时频率分别记为Freqnorm_0[n]和Freqnorm_1[n]，那么
Freqnorm_0[n]=Freqnorm_1[n-1] + [f0 + fΔ*mod(2*n-1 , t)] / fs
Freqnorm_1[n]=Freqnorm_0[n] + [f0 + fΔ*mod(2*n , t)] / fs
其中n > 0，且
Freqnorm_0[0] = 0
Freqnorm_1[0] = f0 / fs
此时两个DDS对应的采样率为fs /2。设FPGA中DDS的相位控制字位宽为N比特，那么DDS0对应的相位控制字PhyN_0[n]可以表示为
PhyN_0[n] = mod[round(Freqnorm_0[n]*2^N) , 2^N]
其中round(a)表示最接近a的整数，同理，DDS1的相位控制字PhyN_1[n]可表示为
PhyN_1[n] = mod[round(Freqnorm_1[n]*2^N) , 2^N]
最终产生的干扰信号的I路时域波形如图5所示，正交信号对应的频谱如图6所示，图6中对应的基带干扰信号频率范围为15MHz~100MHz。图5为ADRV9009采集的干扰信号的I路信号，横坐标表示按照245.76MHz采样的得到样本的编号，纵坐标表示ADRV9009实际采集的信号的数字化幅度，其为标量值，没有单位。Q路信号与I路信号正交，有一定的类似，以图5关于I路信号的作为参考即可。图6为ADRV9009采集的图5的I路信号以及与图5相关的Q路信号利用FFT计算后得到的频谱。横坐标为频率，单位为MHz，纵坐标为数字化的幅度，幅度同样也是标量，没有单位。
转发式干扰模式的干扰信号产生方式如下：
在FPGA接收数据进行FFT处理时，同时使用一个存储大小合适的RAM对当前数据进行同步存储，存储大小根据不同使用情景可以调整，当算法判决得到此时接收数据为无人机通信信号时，停止对RAM数据的修改，并循环播放此时RAM中的数据作为干扰信号。
本发明通过收发切换完成实时跟踪瞄准式干扰，实时切换收发干扰的过程如图7所示。图中不同的跳频时隙对应了不同段的频带。如果使用大功率干扰压制，由于大功率干扰压制需要覆盖跳频的所有频带，假设跳频频带的个数为L，跳频频带的带宽大小均为B，那么大功率干扰压制需要的扫频带宽为B*L，当扫频功率相同，扫频步进相同，在相同时间内，本发明干扰的效率E可以表示为
E = (B*L) / B = L
即干扰效率提高了L倍。
图8和图9为为实时跟踪瞄准式无人机干扰器设备的整体结构图。机箱设备上包括如下接口：电源开关1，ADRV9009外供参考时钟口2，ADRV9009发射口3，ADRV9009备用发射口4，ADRV9009接收口5，ADRV9009第一备用观测接收口6，ADRV9009外部本振输入口7，ADRV9009第二备用观测接收口8，ADRV9009备用接收口9，JTAG接口10，串口接口11，网线12，电源线插口13。
本实施例的其他部分与上述实施例1-4任一项相同，故不再赘述。
实施例6：
本实施例还提出了一种实时跟踪瞄准式无人机干扰器，如图1所示，包括接收天线、发射天线、功放模块、捷变频模块、FPGA单元、参考时钟信号模块；
所述FPGA单元包括数据处理单元、切换控制模块、接收模块、发射模块、本地干扰信号生成模块、转发干扰信号模块；
所述数据处理单元连接接收模块、本地干扰信号生成模块、转发干扰信号模块、切换控制模块、捷变频模块；所述数据处理单元通过本地干扰信号生成模块、转发干扰信号模块与发射模块连接；所述数据处理单元通过切换控制模块与所述接收模块、发射模块控制连接；
所述接收模块和发射模块与所述捷变频模块连接；
所述参考时钟信号模块、功放模块、接收天线分别与所述捷变频模块连接；所述捷变频模块通过功放模块与所述发射天线连接。
工作原理：FPGA(现场可编辑逻辑门阵列)选用了Xilinx公司生产的Zynq7045芯片；
接收模块、发射模块、切换控制模块均在FPGA中实现；
ADRV9009是由ADI公司生产的一款捷变频子卡，可以实现将接收的射频信号下变频至基带，也可以实现将基带信号直接上变频为射频信号；
ADRV9009中内置本振支持范围从75MHz至6GHz，支持200MHz收发带宽；
ADRV9009捷变频子卡通过SPI(串行外设接口)配置，SPI通过Zynq7045实现；
ADRV9009与Zynq7045之间数据交互使用JESD204B协议；
ADRV9009需要外供一个30.72MHz的时钟信号作为参考时钟；
ADRV9009的接收口Rx口需要外接一个接收天线；
ADRV9009的发射口Tx口需要外接功放和发射天线。
以上所述，仅是本发明的较佳实施例，并非对本发明做任何形式上的限制，凡是依据本发明的技术实质对以上实施例所作的任何简单修改、等同变化，均落入本发明的保护范围之内。
Claims (8)
1.一种实时跟踪瞄准式无人机干扰方法，基于实时跟踪瞄准式无人机干扰器，其特征在于，所述实时跟踪瞄准式无人机干扰器包括接收天线、发射天线、功放模块、捷变频模块、FPGA单元、参考时钟信号模块；
所述FPGA单元包括数据处理模块、切换控制模块、接收模块、发射模块、本地干扰信号生成模块、转发干扰信号模块；
所述数据处理模块连接接收模块、本地干扰信号生成模块、转发干扰信号模块、切换控制模块、捷变频模块；所述数据处理模块通过本地干扰信号生成模块、转发干扰信号模块与发射模块连接；所述数据处理模块通过切换控制模块与所述接收模块、发射模块控制连接；
所述接收模块和发射模块与所述捷变频模块连接；
所述参考时钟信号模块、功放模块、接收天线分别与所述捷变频模块连接；所述捷变频模块通过功放模块与所述发射天线连接；
所述实时跟踪瞄准式无人机干扰方法具体包括以下步骤：
步骤1：将捷变频模块的发射端关闭，接收端打开，通过接收天线接收射频信号；
步骤2：通过捷变频模块将接收到的射频信号下变频至基带并进行采样率为h MHz的数据采集；
步骤3：使用捷变频模块将采样后的数据通过FPGA单元的接收模块发送到FPGA单元的数据处理模块中；
步骤4：FPGA单元的数据处理模块将接收到的采样数据进行长度为D的快速傅里叶变换FFT处理；对经过快速傅里叶变换FFT处理后得到的频谱信息，进行分析、筛选，得到当前无人机通信信号的信号信息；所述信号信息包括载波值、带宽大下；
步骤5：根据获取得到的信号信息结合实际情况分析，选择本地干扰信号生成模块或者转发干扰信号模块进行干扰信号的基带信号的生成；并将选择的本地干扰信号生成模块或转发干扰信号模块生成的干扰信号的基带信号通过FPGA单元的发射模块发送到捷变频模块中进行上变频，通过上变频生成干扰信号的射频信号，并通过功放模块、发射天线发送到空中；
所述本地干扰信号生成模块中包括两路并行设置的DDS芯片；
在所述步骤5中，所述本地干扰信号生成模块生成的干扰信号为一个线性调频信号的具体生成方法为：采用两路并行的DDS芯片进行所需的线性调频信号的生成；两片DDS芯片的参数设置方法具体如下：
对于单独的一个DDS芯片，定义生成一个线性调频信号的瞬时频率为Freq[n]，起始频率为f0，频率改变的步进为fΔ，步长为t，采样率记为fs；所述瞬时频率为Freq[n]的计算公式如下：
Freq[n] = f0+ fΔ*mod(n,t)；
其中mod(n,t)表示对n整除t取余数；
则单独的一个DDS芯片的归一化瞬时频率Freqnorm[n]的具体计算公式如下：
Freqnorm[n] = [f0+ fΔ*mod(n,t)]/ fs
则当采用两个并行的DDS芯片进行线性射频信号的生成时：
定义两片DDS芯片分别为DDS0芯片和DDS1芯片，对应的归一化瞬时频率分别定义为Freqnorm_0[n]和Freqnorm_1[n]，具体计算公式如下：
Freqnorm_0[n]=Freqnorm_1[n-1] + [f0 + fΔ*mod(2*n-1 , t)] / fs
Freqnorm_1[n]=Freqnorm_0[n] + [f0 + fΔ*mod(2*n , t)] / fs
其中n > 0，且
Freqnorm_0[0] = 0
Freqnorm_1[0] = f0 / fs
此时两个DDS芯片对应的采样率为fs /2；
设FPGA中DDS芯片的总的相位控制字位宽为N比特，那么DDS0芯片对应的相位控制字PhyN_0[n]表示为
PhyN_0[n] = mod[round(Freqnorm_0[n]*2^N) , 2^N]
其中round(a)表示最接近a的整数；
同理，DDS1芯片的相位控制字PhyN_1[n]可表示为：
PhyN_1[n] = mod[round(Freqnorm_1[n]*2^N) , 2^N]；
所述转发干扰信号模块中设置有一个RAM芯片；
所述步骤5中，采用转发干扰信号模块生成干扰信号的基带信号的具体操作为：在FPGA单元的数据处理模块进行步骤4的快速傅里叶变换FFT时，使用RAM芯片对当前处理数据进行同步存储，并对当前接收的信号数据是否为无人机通信信号进行判断；若判断为当前接收的信号数据为无人机通信信号，则停止对RAM芯片内数据的修改，并将RAM芯片内存储的数据作为干扰信号通过发射天线发送到空中。
2.如权利要求1所述的一种实时跟踪瞄准式无人机干扰方法，其特征在于，对于FPGA单元的数据处理模块进行快速傅里叶变换FFT的延时DFFT进行计算，具体计算公式为：
DFFT = S + D / h；
其中：h为捷变频模块的采样率，D为快速傅里叶变换FFT的长度，S为数据处理模块进行快速傅里叶变换FFT的运算延时。
3.如权利要求1所述的一种实时跟踪瞄准式无人机干扰方法，其特征在于，所述FPGA单元采用Zynq7045芯片。
4.如权利要求3所述的一种实时跟踪瞄准式无人机干扰方法，其特征在于，所述捷变频模块采用ADRV9009捷变频子卡。
5.如权利要求4所述的一种实时跟踪瞄准式无人机干扰方法，其特征在于，所述FPGA单元中的数据处理模块与所述捷变频模块之间采用SPI串口进行配置，等待进入工作模式。
6.如权利要求4所述的一种实时跟踪瞄准式无人机干扰方法，其特征在于，所述FPGA单元中的接收模块、发射模块与所述捷变频模块之间采用JESD204B接口进行连接。
7.如权利要求4所述的一种实时跟踪瞄准式无人机干扰方法，其特征在于，所述捷变频模块的Rx接口与所述接收天线连接。
8.如权利要求4所述的一种实时跟踪瞄准式无人机干扰方法，其特征在于，所述捷变频模块的Tx接口与所述功放模块连接，并通过功放模块与所述发射天线连接。
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