CN113917435A - 一种基于逐点比较和数值比较被动雷达副瓣抑制方法 - Google Patents

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吴卫
肖飞
王平安
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Abstract

本发明公开了一种基于逐点比较和数值比较被动雷达副瓣抑制方法，主要适用于在复杂电磁环境中有效对从副瓣进来的虚假信号进行抑制，同时保证主波束正常输出。处理流程是：首先在FPGA中进行第一级副瓣抑制处理，将主通道和副瓣通道的求模结果进行逐点幅度比较：将主通道幅度大于副瓣通道幅度对应的主通道IQ数据送入后端，同时统计这些点主通道和副瓣通道脉内部分幅值信息，并将其以数值形式传入后端；将主通道小于副瓣通道部分置0；在PowerPC中进行第二级副瓣抑制处理：将前面传入的主通道和副瓣通道的脉内幅值进行幅度比较，并将主通道脉内幅值小于副瓣通道所对应的主通道目标抑制掉；从而实现副瓣抑制。

Description

一种基于逐点比较和数值比较被动雷达副瓣抑制方法
技术领域
本发明应用于被动雷达信号处理领域。
背景技术
随着电波工作环境的日益恶化，被动雷达接收信号中的虚警严重影响了测向精度同时加重了后端信号处理的负担，因此抑制虚警，引起了广泛的重视，成为了被动雷达信号处理中研究的一个重点。被动雷达不但要能够在理想环境中表现出优良的性能，更要自如的应对虚警比较多的情况。于是对被动雷达的抑制虚警的要求越来越迫切。阵列天线输出的信号并非是完全从主瓣输出理想的信号，同时还存在一些来自旁瓣的虚警。在复杂外部环境下，来自旁瓣虚警过多就有可能造成检测概率的降低或者测向精度的降低，同时也加重了后续被动信号处理的负担。要提高被动雷达检测性能，需要寻找理想的旁瓣抑制技术，从而最大程度的消除来自旁瓣的虚警。以往的副瓣抑制方法采用仅在FPGA中将主波束和副瓣门限进行直接“逐点比较”的方式进行，这样带来的弊端是，副瓣门限过高，很容易将“比幅测向”所必需的次大波束也抑制掉，给后续“比幅测向”带来困难；副瓣门限过低，信号和门限容易产生因交叠引起的小脉冲，从而导致没有抑制干净的小脉宽副瓣信号，形成虚假目标，副瓣抑制效果不好。
发明内容
为解决雷达、通信密集交叠的复杂电磁环境下副瓣进入数据多，虚假目标、数据流使后端数据处理压力大的问题，本发明提出一种基于逐点比较和数值比较被动雷达副瓣抑制方法。
实现本发明目的的技术解决方案为：
采用FPGA进行第一级副瓣抑制处理，将主通道和副瓣通道求模后结果进行逐点幅度比较：当主通道幅度大于副瓣通道幅度时，将对应点的主通道IQ数据送入后端，同时统计这些点主通道和副瓣通道脉内部分的PDW(脉冲描述字)的幅值信息，将主通道和副瓣通道脉内部分幅值信息随PDW(脉冲描述字)传入后端；将主通道小于副瓣通道部分置0；采用PowerPC进行第二级副瓣抑制处理：利用前面传入的PDW中的主通道和副瓣通道的脉内幅值，进行幅度比较，将主通道脉内幅值小于副瓣通道所对应的主通道目标抑制掉；经过上述两步实现副瓣抑制的目的。
本发明提出的基于逐点比较和数值比较被动雷达副瓣抑制方法，用于在复杂电磁环境中有效对从副瓣进来的虚假信号进行抑制，同时降低了数据流，缓解了后端分选处理的压力。
下面结合附图对本发明作进一步详细描述。
附图说明
图1是基于逐点比较和数值比较被动雷达副瓣抑制方法工作流程示意图。
图2是统计主通道和副瓣通道脉内部分幅值信息示意图。
具体实施方式
下面结合附图对本发明技术方案做进一步的解释说明。
本发明提出的一种基于逐点比较和数值比较被动雷达副瓣抑制方法，首先在FPGA中正常进行副瓣抑制功能作为第一级副瓣抑制，将主通道和副瓣通道求模后结果进行逐点比较并将主通道大于副瓣通道部分送入后端，否则加以抑制，第一级副瓣抑制只是减少后端数据处理的压力，同时统计主通道和副瓣通道脉内部分幅值信息，将主通道和副瓣通道脉内部分幅值信息传入PowerPC中进行后续处理。在PowerPC进行第二级副瓣抑制处理，将主通道和副瓣通道的脉内幅值比较，由于只是数值比较，因此能有效避免因为主通道和副瓣通道数据“交叠”而生成抑制不干净的小脉宽副瓣信号。
本发明具体实施步骤参见图1，具体描述为：
步骤1、同时将DBF后信号作为主通道信号和一路阵元信号作为副瓣通道信号进行求模；
步骤2、将主通道信号同副瓣通道信号先进行前后沿相应延时对齐再进行逐点比较，若主通道信号幅值大于副瓣通道信号，则将该通道的IQ信号送往后端进行进一步处理，否则将IQ信号强制置为0，将其抑制掉；
步骤3、同时统计主通道和副瓣通道脉内部分的PDW的幅值信息，并随PDW送往PowerPC中进行后续数据数据处理；
步骤4、数据处理端收到PDW并解析出主通道和副瓣通道脉内部分幅值，将两者进行比较，如果当前波束的主通道幅值大于副瓣通道幅值，则认为是主波束，并将该PDW继续送往后端进行数据处理，否则认为是副瓣加以抑制，直接将该PDW进行丢弃。

Claims (1)

1.一种基于逐点比较和数值比较被动雷达副瓣抑制方法，其特征在于：采用FPGA进行第一级副瓣抑制处理，将主通道和副瓣通道求模后结果进行逐点幅度比较：当主通道幅度大于副瓣通道幅度时，将对应点的主通道IQ数据送入后端，同时统计所述对应点主通道和副瓣通道脉内部分的PDW的幅值信息，将主通道和副瓣通道脉内部分幅值信息随PDW传入后端；将主通道小于副瓣通道部分置0；采用PowerPC进行第二级副瓣抑制处理：利用前面传入的主通道和副瓣通道的PDW中的脉内幅值，进行幅度比较，将主通道脉内幅值小于副瓣通道所对应的主通道目标抑制掉；经过上述两步实现副瓣抑制的目的。
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