CN113823210B - 显示面板及显示装置 - Google Patents

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Abstract

本发明公开了一种显示面板及显示装置，显示面板包括功能附加区和围绕功能附加区的主显示区，显示面板包括多个像素行、多个辅像素驱动电路、多个主像素驱动电路和多级栅极驱动电路，多级栅极驱动电路通过多条扫描信号线分别连接于多个辅像素驱动电路及多个主像素驱动电路，每一级扫描信号线包括P条主扫描信号线和Q条辅扫描信号线，本发明通过将Q条辅扫描信号线中的Z条第一辅扫描信号线与对应的栅极驱动电路连接，其余第二辅扫描信号线断开，无需设置连接两条辅扫描信号线的连接走线，从而避免连接走线与像素驱动电路之间易出现耦合作用。

Description

显示面板及显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种显示面板及显示装置。
背景技术
采用屏下摄像头(Camera Under Panel,CUP)技术时，为降低驱动CUP区像素发光的像素驱动电路对CUP区的影响，会使一个像素驱动电路同时驱动多个CUP区的子像素。在主显示区与CUP区交界处，至少两条扫描信号线通过连接走线合并成一条走线并与CUP区的像素驱动电路相连接，此连接走线与像素驱动电路之间易出现耦合作用，从而影响正常显示。
发明内容
本发明实施例提供一种显示面板及显示装置，以解决现有的显示面板在主显示区与CUP区交界处，至少两条扫描信号线通过连接走线合并成一条走线并与CUP区的像素驱动电路相连接，此连接走线与像素驱动电路之间易出现耦合作用，从而影响正常显示的技术问题。
为解决上述问题，本发明提供的技术方案如下：
本发明提供一种显示面板，包括功能附加区和围绕所述功能附加区的主显示区；所述显示面板包括：
多个像素行，多个所述像素行包括多个复合像素行，每一所述复合像素行包括位于所述功能附加区内的多个辅子像素和位于所述主显示区的多个主子像素；
多个辅像素驱动电路，每一所述辅像素驱动电路连接于多个所述辅子像素以驱动对应的多个所述辅子像素发光；
多个主像素驱动电路，每一所述主像素驱动电路连接于对应的所述主子像素以驱动对应的所述主子像素发光；以及
多级栅极驱动电路，通过多条扫描信号线分别连接于多个所述辅像素驱动电路及多个所述主像素驱动电路，每一级所述扫描信号线包括P条主扫描信号线和Q条辅扫描信号线，Q条所述辅扫描信号线包括Z条第一辅扫描信号线和(Q-Z)条第二辅扫描信号线，每一所述主像素驱动电路通过对应的所述主扫描信号线连接于对应的所述栅极驱动电路，每一所述辅像素驱动电路通过所述第一辅扫描信号线连接于对应的所述主扫描信号线以连接于对应的所述栅极驱动电路，每一条所述第二辅扫描信号线的一端连接于对应的所述主扫描信号线，另一端浮置；其中，P≥Q，P≥2，Q≥1，Q≥Z，Z≥1，P、Q、Z均为整数。
根据本发明提供的显示面板，Z＝1。
根据本发明提供的显示面板，P＝2，Q＝2或1。
根据本发明提供的显示面板，所述功能附加区包括显示透光区及位于所述显示透光区外围的过渡显示区，多个所述主像素驱动电路位于所述主显示区内，多个所述辅像素驱动电路位于所述过渡显示区内。
根据本发明提供的显示面板，每一条所述第二辅扫描信号线的一端在所述主显示区连接于对应的所述主扫描信号线，另一端在所述过渡显示区内浮置。
根据本发明提供的显示面板，所述第一辅扫描信号线包括位于所述过渡显示区的过渡扫描段，所述过渡扫描段包括：
第一过渡部，与对应的所述主扫描信号线连接；
第二过渡部，与对应的所述辅像素驱动电路连接；以及
第三过渡部，连接所述第一过渡部和所述第二过渡部；
其中，所述第二过渡部相对于所述第一过渡部、所述第三过渡部是倾斜的。
根据本发明提供的显示面板，第M+1个像素行为多个所述复合像素行中的第1个复合像素行，在和位于第i个复合像素行中的多个所述辅子像素连接的所述辅像素驱动电路相连接的多条所述第一辅扫描信号线中，对应于第Ni级所述扫描信号线中的所述第一辅扫描信号线连接于位于第i个复合像素行中的多个所述主子像素连接的所述主像素驱动电路；其中，Ni＝M+i，i≥1。
根据本发明提供的显示面板，和位于第p个～第q个所述复合像素行中的多个所述辅子像素连接的所述辅像素驱动电路连接于第Np级扫描信号线、第Np+Y级扫描信号线及第Nq级扫描信号线，位于第i个所述复合像素行中的所述主子像素对应的所述主像素驱动电路与第Ni级扫描信号线、第Ni+1级扫描信号线连接；其中，Np＝M+p，Nq＝M+q，Ni＝M+i；0<Y<Nq-Np；p≤i≤q。
根据本发明提供的显示面板，每一所述主像素驱动电路连接于X1个所述栅极驱动电路，每一所述辅像素驱动电路连接于X2个所述栅极驱动电路；其中，X1≥2，X2≥2，X2≥X1。
根据本发明提供的显示面板，第M个像素行为多个所述复合像素行中的第1个复合像素行，与位于第p个～第q个所述复合像素行中的多个所述辅子像素连接的所述辅像素驱动电路包括：
第一驱动模块，包括辅驱动晶体管；
第一初始化模块，连接于第一复位电压端与所述辅驱动晶体管的栅极之间，以用于根据第Np级扫描信号将第一复位信号传输至所述辅驱动晶体管的栅极，初始化所述辅驱动晶体管的栅极电压；
第一数据写入模块，连接于第一数据信号线与所述辅驱动晶体管的源极或漏极中的一者之间，以用于根据第Np+Y级扫描信号将第一数据信号传输至所述辅驱动晶体管的源极或漏极中的一者；
第一复位模块，连接于所述第一复位电压端与对应的多个所述辅子像素的阳极之间，以用于根据第Nq级扫描信号将所述第一复位信号传输至多个所述辅子像素的阳极，对多个所述辅子像素的阳极电压进行复位；
第一补偿模块，连接于所述辅驱动晶体管的所述栅极与所述辅驱动晶体管的所述源极或所述漏极中的一者之间，以用于根据所述第Np+Y级扫描信号将所述第一数据信号传输至所述辅驱动晶体管的栅极，补偿所述辅驱动晶体管的阈值电压；
第一存储模块，串联在所述辅驱动晶体管的所述栅极与第一电压端之间，用于维持所述辅驱动晶体管的栅极电压；以及
第一发光控制模块，与所述辅驱动晶体管串联，以用于根据第一发光控制信号控制多个所述辅子像素发光；
其中，Np＝M+p，Nq＝M+q；0<Y<Nq-Np，p≥1，q>p。
根据本发明提供的显示面板，第M个像素行为多个所述复合像素行中的第1个复合像素行，与位于第p个～第q个所述复合像素行中的多个所述主子像素连接的所述主像素驱动电路包括：
第二驱动模块，包括主驱动晶体管；
第二初始化模块，连接于第二复位电压端与所述主驱动晶体管的栅极之间，以用于根据第Ni级扫描信号将第二复位信号传输至所述主驱动晶体管的栅极，初始化所述主驱动晶体管的栅极电压；
第二数据写入模块，连接于第二数据信号线与所述主驱动晶体管的源极或漏极中的一者之间，以用于根据第Ni+1级扫描信号将第二数据信号传输至所述主驱动晶体管的源极或漏极中的一者；
第二复位模块，连接于所述第二复位电压端与所述主子像素的阳极之间，以用于根据第Ni级扫描信号将所述第二复位信号传输至所述主子像素的阳极，对所述主子像素的阳极电压进行复位；
第二补偿模块，连接于所述主驱动晶体管的所述栅极与所述主驱动晶体管的所述源极或所述漏极中的一者之间，以用于根据所述第Ni+1级扫描信号将所述第二数据信号传输至所述主驱动晶体管的栅极，补偿所述主驱动晶体管的阈值电压；
第二存储模块，串联在所述主驱动晶体管的所述栅极与第二电压端之间，用于维持所述主驱动晶体管的栅极电压；以及
第二发光控制模块，与所述主驱动晶体管串联，以用于根据第二发光控制信号控制所述主子像素发光；
其中，Ni＝M+p，Nq＝M+q；0<Y<Nq-Np，p≥1，q>p。
本发明提供一种显示装置，包括上述显示面板。
本发明的有益效果为：本发明提供的显示面板及显示装置，每一辅像素驱动电路连接于多个辅子像素以驱动对应的多个所述辅子像素发光，每一主像素驱动电路连接于对应的主子像素以驱动对应的主子像素发光，多级栅极驱动电路通过多条扫描信号线分别连接于多个辅像素驱动电路及多个主像素驱动电路。每一级扫描信号线包括P条主扫描信号线和Q条辅扫描信号线，Q条所述辅扫描信号线包括Z条第一辅扫描信号线和(Q-Z)条第二辅扫描信号线，每一主像素驱动电路通过对应的主扫描信号线连接于对应的栅极驱动电路，本发明通过将每一辅像素驱动电路通过Q条辅扫描信号线中的Z条第一辅扫描信号线与对应的栅极驱动电路连接，其余第二辅扫描信号线浮置，无需设置将两条扫描信号线合并成一条走线的连接走线，从而避免连接走线与像素驱动电路之间易出现耦合作用，避免影响正常显示。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本发明实施例提供的显示面板的平面结构示意图；
图2是图1中A处的局部放大图；
图3A～图3B是本发明的实施例提供的辅子像素和主子像素的排布结构示意图；
图4A～图4C是本发明实施例提供的栅极驱动电路与主像素驱动电路、辅像素驱动电路的连接示意图；
图5是本发明实施例提供的辅像素驱动电路的结构示意图；
图6是本发明实施例提供的主像素驱动电路的结构示意图；
图7是本发明的实施例提供的栅极驱动电路与辅像素驱动电路连接的局部示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。此外，应当理解的是，此处所描述的具体实施方式仅用于说明和解释本发明，并不用于限制本发明。在本发明中，在未作相反说明的情况下，使用的方位词如“上”和“下”通常是指装置实际使用或工作状态下的上和下，具体为附图中的图面方向；而“内”和“外”则是针对装置的轮廓而言的。
请参阅图1，本发明实施例提供一种显示面板，所述显示面板包括功能附加区100a、主显示区100b及非显示区100c，所述主显示区100b位于所述功能附加区100a外围，所述非显示区100c位于所述主显示区100b外围。所述功能附加区100a包括显示透光区1001a及位于所述显示透光区1001a外围的过渡显示区1001b。
可选地，所述显示面板可包括多个所述功能附加区100a，每一所述功能附加区100a在俯视视角下的形状不限于圆形、矩形、圆角矩形。
请参阅图1、图2、图3A～图3B和图4A～图4C，所述显示面板包括多个像素行、多个辅像素驱动电路100、多个主像素驱动电路200和多级栅极驱动电路300。多个所述像素行包括多个复合像素行101和多个主像素行201。每一所述复合像素行101包括位于所述功能附加区100a的多个辅子像素102和位于所述主显示区100b内的多个主子像素202。每一所述主像素行201包括位于所述主显示区100b内的多个所述主子像素202。
每一所述辅像素驱动电路100连接于多个所述辅子像素102，以用于驱动多个所述辅子像素102发光。多个辅像素驱动电路100位于所述功能附加区100a内，进一步地，多个辅像素驱动电路100位于所述过渡显示区1001b内，所述过渡显示区1001b设置有多个像素驱动电路岛110，多个所述像素驱动电路岛110沿所述显示透光区1001a的边缘设置，每一所述像素驱动电路岛110包括多个辅像素驱动电路100，以将驱动位于所述功能附加区100a内的多个所述辅子像素102发光的多个辅像素驱动电路100集成作为所述像素驱动电路岛分布于所述过渡显示区1001b内，从而提高所述显示透光区1001a的光透过率。
多个所述主像素驱动电路200位于所述主显示区100b内，每一所述主像素驱动电路200连接于对应的所述主子像素202，以用于驱动对应的所述主子像素202发光。
多级所述栅极驱动电路300位于所述非显示区100c内，多级所述栅极驱动电路300通过多条扫描信号线400分别连接于多个所述辅像素驱动电路100和多个所述主像素驱动电路200，以用于为所述辅像素驱动电路100和多个所述主像素驱动电路200提供扫描信号。
其中，每一所述扫描信号线400包括P条主扫描信号线401和Q条辅扫描信号线402，Q条所述辅扫描信号线402包括Z条第一辅扫描信号线4021和(Q-Z)条第二辅扫描信号线4022；每一所述主像素驱动电路200通过对应的所述主扫描信号线401连接于对应的所述栅极驱动电路300，每一所述辅像素驱动电路100通过所述第一辅扫描信号线4021连接于对应的所述主扫描信号线401以连接于对应的所述栅极驱动电路300，所述第二辅扫描信号线4022的一端连接于对应的所述主扫描信号线401，另一端浮置；其中，P≥Q，P≥2，Q≥1，Q≥Z，Z≥1，P、Q、Z均为整数。
可以理解的是，对于每一所述扫描信号线400中的多条所述辅扫描信号线402，所述辅扫描信号线402中的所述第一辅扫描信号线4021连接于对应的所述辅像素驱动电路100，所述辅扫描信号线402中的所述第二辅扫描信号线4022连接于对应的所述主扫描信号线401，另一端浮置设置，而不与任何所述第一辅扫描信号线4021和所述辅像素驱动电路100连接，也就是说，所述第二辅扫描信号线4022的其中一端断开，从而在所述显示面板的主显示区100b与功能附加区100a交界处，对于断开的所述第二辅扫描信号线4022，无需设置连接相邻两条或多条所述辅扫描信号线402的连接走线，从而改善连接走线与像素驱动电路之间易出现耦合作用。
可选地，所述辅子像素102及所述主子像素202包括有机发光二极管、微型发光二极管、次毫米发光二极管。
可选地，位于同一所述像素行中的多个所述主子像素202，或多个所述主子像素202和多个所述辅子像素102可位于同一水平线上。即如图3A所示，位于同一所述主像素行201的多个所述主子像素202位于同一水平线上，位于同一所述复合像素行101的多个所述主子像素202和多个所述辅子像素102位于同一水平线上。
可选地，位于同一所述像素行中的多个所述主子像素202中的部分主子像素，或多个所述主子像素202中的部分主子像素和多个所述辅子像素102中的部分辅子像素位于同一水平线上。即如图3B所示，位于同一所述主像素行201中的多个所述主子像素202中的部分主子像素位于同一水平线上，位于同一所述复合像素行101的多个所述主子像素202中的部分主子像素和多个所述辅子像素102中的部分辅子像素位于同一水平线上。
具体地，请继续参阅图3B，多个所述主子像素202包括发光颜色不同的多个所述第一主子像素2021、多个所述第二主子像素2022及多个所述第三主子像素2023。多个所述辅子像素102包括多个与所述第一主子像素2021发光颜色相同的第一辅子像素1021、多个与所述第二主子像素2022发光颜色相同的第二辅子像素1022及多个与所述第三主子像素2023发光颜色相同的第三辅子像素1023。其中，位于同一所述主像素行201的多个所述第一主子像素2021、多个所述第二主子像素2022位于同一水平线上，多个所述第三主子像素2023位于另一水平线上。位于同一所述复合像素行101的多个所述第一主子像素2021、多个所述第二主子像素2022与多个所述第一辅子像素1021、多个第二辅子像素1022位于同一水平线上，多个所述第三主子像素2023与多个第三辅子像素1023位于另一水平线上。
可选地，所述第一主子像素2021、第二主子像素2022及第三主子像素2023的发光颜色包括红色、蓝色、绿色、黄色、白色等。进一步地，所述第一主子像素2021的发光颜色为蓝色，所述第二主子像素2022的发光颜色为红色，所述第三主子像素2023的发光颜色为绿色。
进一步地，请继续参阅图3A～图3B，位于所述功能附加区100a内的多个所述辅子像素102与位于所述主显示区100b内的多个所述主子像素202的排布结构相同，可在不增加制程难度的同时，能够进一步降低所述主显示区100b和所述功能附加区100a的显示差异，进一步改善所述显示面板显示不匹配的问题。
具体地，所述显示面板包括多个主像素单元202a和多个辅像素单元102a，每一所述主像素单元202a包括多个所述主子像素202，每一所述辅像素单元102a包括多个所述辅子像素102。其中，每一所述主像素单元202a内包括的所述主子像素202的个数及多个所述主子像素202的排布形式与每一所述辅像素单元102a内包括的所述辅子像素102的个数及多个所述辅子像素102的排布形式相同。
可选地，每一所述主像素单元202a包括所述第一主子像素2021、所述第二主子像素2022及所述第三主子像素2023；每一所述辅像素单元102a包括所述第一辅子像素1021、所述第二辅子像素1022及所述第三辅子像素1023。相邻的两所述主像素单元202a在所述主显示区100b内以镜像、对称等形式排布，相邻的两所述辅像素单元102a在所述功能附加区100a内对应的以镜像、对称等形式排布。
进一步地，所述第一主子像素2021、第二主子像素2022及第三主子像素2023可采用标准RGB排列，也可采用pearl排布等排布形式，与之相应的，所述第一辅子像素1021、第二辅子像素1022及第三辅子像素1023采用标准RGB排列，或采用pearl排布等排布形式。
可选地，位于同一所述主像素单元202a内的至少一所述第一主子像素2021与至少一所述第二主子像素2022及至少一第三主子像素2023位于同一所述主像素行201。位于同一所述辅像素单元102a内的至少一所述第一辅子像素1021与至少一所述第二辅子像素1022及至少一第三辅子像素1023位于同一所述复合像素行101。
可选地，所述主像素单元202a还可包括第四主子像素等，所述辅像素单元102a还可包括第四辅子像素等。
请继续参阅图2及图3A～图3B，所述主显示区100b与所述功能附加区100a之间具有折线边界100d，所述折线边界100d包括多条垂直相交的第一折边1001d和第二折边1002d，所述功能附加区100a具有与所述第一折边1001d平行的第一对称轴a1和与所述第二折边1002d平行且与所述第一对称轴a1相交的第二对称轴a2，所述第一对称轴a1与所述第二对称轴a2的交点O位于所述功能附加区100a的中心处。每一垂直相交的所述第一折边1001d和所述第二折边1002d对应至少一所述辅像素单元102a，以保证靠近所述折线边界100d的所述辅像素单元102a结构的完整性，降低所述主显示区100b与所述功能附加区100a在靠近所述折线边界100d处的显示差异性。
进一步，每一所述第一折边1001d具有第一长度，多个所述第一折边1001d的所述第一长度沿远离所述第二对称轴a2的方向依次减小，每一所述第二折边1002d具有第一高度，多个所述第二折边1002d的所述第一高度沿远离所述第一对称轴a1的方向依次减小。
请继续参阅图1、图2及图3A～图3B，位于所述主像素行201中的多个所述主子像素202可由对应的所述主像素驱动电路200驱动发光，多个所述复合像素行101与多个所述主像素行201相邻。具体地，多个所述主像素行201可位于多个所述复合像素行101的至少一侧；进一步地，多个所述复合像素行101可位于多个所述主像素行201之间，如图3A～图3B所示。即多个所述复合像素行101可位于多个所述主像素行201中的第一个主像素行之前；或，多个所述复合像素行101可位于多个所述主像素行201中的最后一个主像素行之后；或，多个所述复合像素行101可位于多个所述主像素行201中的某一个主像素行之前。
具体地，每一条所述第二辅扫描信号线4022的一端在所述主显示区100b连接于对应的所述主扫描信号线401，另一端在所述过渡显示区1001b内浮置。
请参阅图4A～图4C，在一种实施方式中，Z＝1，即，Q条所述辅扫描信号线402包括1条第一辅扫描信号线4021和(Q-1)条第二辅扫描信号线4022，每一所述辅像素驱动电路100通过1条所述第一辅扫描信号线4021连接于对应的所述主扫描信号线401以连接于对应的所述栅极驱动电路300，(Q-1)条所述第二辅扫描信号线4022的一端连接于对应的所述主扫描信号线401，另一端浮置。也就是说，对于同一级所述扫描信号线400中的所述辅扫描信号线402中，仅有1条所述第一辅扫描信号线4021与所述辅像素驱动电路100电连接，其余的所述第一辅扫描信号线4021浮置，不与所述辅像素驱动电路100电连接，因此，无需设置用于连接浮置的所述第二辅扫描信号线4022与正常设置的所述第一辅扫描信号线4021的连接走线，从而能够避免连接走线与像素驱动电路之间易出现耦合作用，有利于提升显示效果。
请参阅图4A和4C，在一种实施方式中，P＝2，Q＝2，即，每一级所述扫描信号线400包括2条所述主扫描信号线401和2条所述辅扫描信号线402，2条所述辅扫描信号线402包括1条第一辅扫描信号线4021和1条第二辅扫描信号线4022，每一所述辅像素驱动电路100通过1条所述第一辅扫描信号线4021连接于对应的所述主扫描信号线401以连接于对应的所述栅极驱动电路300，1条所述第二辅扫描信号线4022的一端连接于对应的所述主扫描信号线401，另一端浮置。也就是说，对于同一级所述扫描信号线400中的2条所述辅扫描信号线402，其中1条所述辅扫描信号线402与所述辅像素驱动电路100电连接，另外一条所述第一辅扫描信号线4021浮置，不与所述辅像素驱动电路100电连接，则显然地，无需设置用于连接浮置的所述第二辅扫描信号线4022与正常设置的所述第一辅扫描信号线4021的连接走线，从而能够避免连接走线与像素驱动电路之间易出现耦合作用，有利于提升显示效果。
请参阅图4B，在一种实施方式中，P＝2，Q＝1，即，每一级所述扫描信号线400包括2条所述主扫描信号线401和1条所述辅扫描信号线402，1条所述辅扫描信号线402为所述第一辅扫描信号线4021，每一所述辅像素驱动电路100通过1条所述第一辅扫描信号线4021连接于对应的所述主扫描信号线401以连接于对应的所述栅极驱动电路300。也就是说，同一级所述扫描信号线400中仅包括1条所述第一辅扫描信号线4021，则显然地，无需设置用于连接浮置的所述第二辅扫描信号线4022与正常设置的所述第一辅扫描信号线4021的连接走线，从而能够避免连接走线与像素驱动电路之间易出现耦合作用，有利于提升显示效果。
由于所述栅极驱动电路300根据所述主像素行201和所述复合像素行101的位置不同，会对应为驱动位于所述主像素行201中多个所述主子像素202发光的多个所述主像素驱动电路200、驱动位于所述复合像素行101中多个所述主子像素202发光的所述主像素驱动电路200及驱动位于所述复合像素行101中多个所述辅子像素102发光的所述辅像素驱动电路100提供不同的所述扫描信号。因此，为方便表述，以多个所述复合像素行101位于多个所述主像素行201中的第M个主像素行之后(即第1个像素行～第M个像素行为所述主像素行201，第M+1个像素行为第1个复合像素行)为例对所述显示面板的工作原理进行解释说明。多个所述复合像素行101位于多个所述主像素行201中的最后一个主像素行之后；或，多个所述复合像素行101位于多个所述主像素行201中的第一个主像素行或某一个主像素行之前时的所述显示面板的工作原理可参照多个所述复合像素行101位于多个所述主像素行201中的第M个主像素行之后的所述显示面板的工作原理得到，在此不再进行赘述。
具体地，若以第M+1个像素行为多个所述复合像素行101中的第1个复合像素行，则在和位于第i个复合像素行中的多个所述辅子像素102连接的所述辅像素驱动电路100相连接的多条所述第一辅扫描信号线4021中，对应于第Ni级所述扫描信号线中的所述第一辅扫描信号线4021连接于位于第i个复合像素行中的多个所述主子像素202连接的所述主像素驱动电路200；其中，Ni＝M+i，i≥1。
例如，若第1个像素行为多个所述复合像素行101中的第1个复合像素行，在和位于第1个复合像素行中的多个所述辅子像素102连接的所述辅像素驱动电路100相连接的多条所述第一辅扫描信号线4021中，对应于第1级所述扫描信号线400中的所述第一辅扫描信号线4021连接于位于第1个复合像素行中的多个所述主子像素202连接的所述主像素驱动电路200。在和位于第2个复合像素行中的多个所述辅子像素102连接的所述辅像素驱动电路100相连接的多条所述第一辅扫描信号线4021中，对应于第2级所述扫描信号线400中的所述第一辅扫描信号线4021连接于位于第2个复合像素行中的多个所述主子像素202连接的所述主像素驱动电路200。
进一步地，若第M+1个像素行为多个所述复合像素行101中的第1个复合像素行，则位于第p个～第q个所述复合像素行101中的多个所述辅子像素即为位于第Np个～第Nq个所述像素行中的多个所述辅子像素。和位于第p个～第q个所述复合像素行中的多个所述辅子像素102连接的所述辅像素驱动电路100连接于第Np级扫描信号线、第Np+Y级扫描信号线及第Nq级扫描信号线，位于第i个所述复合像素行中的所述主子像素202对应的所述主像素驱动电路200与第Ni级扫描信号线、第Ni+1级扫描信号线连接；其中，Np＝M+p，Nq＝M+q，Ni＝M+i；0<Y<Nq-Np；p≤i≤q。
与位于第Ni个像素行的所述主子像素202对应的主像素驱动电路200即为与位于第i个复合像素行的所述主子像素202对应的主像素驱动电路200，则与位于第i个复合像素行的所述主子像素202对应的主像素驱动电路200与第Ni级扫描信号线S(Ni)和第Ni+1级扫描信号线S(Ni+1)连接。
位于所述功能附加区100a的一个所述辅像素驱动电路100均可与多个复合像素行101的多个所述辅子像素102连接。例如，请参阅图4A和图4B，位于所述功能附加区100a的一个所述辅像素驱动电路100与位于两个所述复合像素行101中的多个所述辅子像素102连接；再如，请参阅图4C，每一所述辅像素驱动电路100与位于三个所述复合像素行101中的多个所述辅子像素102连接。
为便于理解，请参阅图4A和图4B，以位于所述功能附加区100a的一个所述辅像素驱动电路100与位于两个所述复合像素行101中的多个所述辅子像素102连接、且第4个像素行为多个所述复合像素行101中的第1个复合像素行(即M＝3)为例进行说明。
具体地，若位于所述功能附加区100a的一个所述辅像素驱动电路100与位于第1个复合像素行1011至第2个复合像素行1012(即p＝1，q＝2)的多个所述辅子像素102连接(即为与位于第4个像素行至第5个像素行的多个所述辅子像素102连接，即N1＝M+1＝4，N2＝M+2＝5，0<Y<N2-N1)，则所述辅像素驱动电路100连接于第N1级扫描信号线、第N1+Y级扫描信号线及第N2级扫描信号线即为连接于第4级扫描信号线S(4)和第5级扫描信号线S(5)。
若多位于所述功能附加区100a的一个所述辅像素驱动电路100与位于第3个复合像素行至第4个复合像素行(即p＝3，q＝4)的多个所述辅子像素102连接(即为与位于第6个像素行至第7个像素行的多个所述辅子像素102连接，即N3＝M+3＝6，N4＝M+4＝7，0<Y<N4-N3)，则所述辅像素驱动电路100连接于第N3级扫描信号线、第N3+Y级扫描信号线及第N4级扫描信号线即为连接于第6级扫描信号线S(6)和第7级扫描信号线S(7)。
即与位于第1个复合像素行1011至第2个复合像素行1012(即p＝1，q＝2)的多个所述辅子像素102连接的辅像素驱动电路所连接的扫描信号线为：S(4)、S(5)；与位于第3个复合像素行至第4个复合像素行(即p＝3，q＝4)的多个所述辅子像素102连接的辅像素驱动电路所连接的扫描信号线为：S(6)、S(6)、S(7)。
可以理解的是，若位于所述功能附加区100a的一个所述辅像素驱动电路100与位于第p个复合像素行至第q个复合像素行的多个所述辅子像素102连接(即为与位于第Np个像素行至第Nq个像素行的多个所述辅子像素102连接)，则所述辅像素驱动电路100连接于第Np级扫描信号线、第Np+Y级扫描信号线及第Nq级扫描信号线，其中，Np＝M+p，Nq＝M+q，0<Y<Nq-Np。
与之相似地，请参阅图4C，以位于所述功能附加区100a的一个所述辅像素驱动电路100与位于三个所述复合像素行101中的多个所述辅子像素102连接进行说明。
具体地，若多个所述辅像素驱动电路100中的一所述辅像素驱动电路100与位于第1个复合像素行1011至第3个复合像素行1013(即p＝1，q＝3)的多个所述辅子像素102连接(即为与位于第4个像素行至第6个像素行的多个所述辅子像素102连接，即N1＝M+1＝4，N3＝M+3＝6，0<Y<N3-N1得到Y＝1)，则所述辅像素驱动电路100连接于第N1级扫描信号线、第N1+Y级扫描信号线及第N3级扫描信号线即为连接于第4级扫描信号线S(4)、第5级扫描信号线S(5)及第6级扫描信号线S(6)。
若位于所述功能附加区100a的一个所述辅像素驱动电路100与位于第4个复合像素行至第6个复合像素行(即p＝4，q＝6)的多个所述辅子像素102连接(即为与位于第7个像素行至第9个像素行的多个所述辅子像素102连接，即N4＝M+4＝7，N6＝M+6＝9，0<Y<N6-N4得到Y＝1)，则所述辅像素驱动电路100连接于第N4级扫描信号线、第N4+Y级扫描信号线及第N6级扫描信号线即为连接于第7级扫描信号线S(7)、第8级扫描信号线S(8)及第9级扫描信号线S(9)。
即与位于第1个复合像素行1011至第3个复合像素行1012(即p＝1，q＝3)的多个所述辅子像素102连接的辅像素驱动电路所连接的扫描信号线为：S(4)、S(5)、S(6)；与位于第4个复合像素行至第6个复合像素行(即p＝4，q＝6)的多个所述辅子像素102连接的辅像素驱动电路所连接的扫描信号线为：S(7)、S(8)、S(9)。
基于上述分析可得：若多个所述辅像素驱动电路100中的一所述辅像素驱动电路100与位于第p个复合像素行至第q个复合像素行的多个所述辅子像素102连接(即为与位于第Np个像素行至第Nq个像素行的多个所述辅子像素102连接)，则所述辅像素驱动电路100连接于第Np级扫描信号线、第Np+Y级扫描信号线及第Nq级扫描信号线，其中，Np＝M+p，Nq＝M+q，0<Y<Nq-Np。
与之相似地，还可得到多个所述辅像素驱动电路100中的一所述辅像素驱动电路100与位于多个所述复合像素行101(如q-p+1≥4)中的多个所述辅子像素102连接的实施方案，在此不再进行赘述。
如图4A和图4B所示，每一所述辅像素驱动电路100均驱动两个所述复合像素行(即q-p+1＝2)的多个所述辅子像素102发光，则所述栅极驱动电路300为驱动位于第1个～第2个所述复合像素行101(即p＝1，q＝2，N1＝M+1，N2＝M+2，0<Y<q-p)的多个所述辅子像素102发光的所述辅像素驱动电路100提供第M+1级扫描信号Scan(M+1)及第M+2级扫描信号Scan(M+2)。所述栅极驱动电路300为驱动位于第3个～第4个所述复合像素行101(即p＝3，q＝4，N3＝M+3，N4＝M+4)的多个所述辅子像素102发光的所述辅像素驱动电路100提供第M+3级扫描信号Scan(M+3)及第M+4级扫描信号Scan(M+4)；以此类推得到，所述栅极驱动电路300为驱动位于第p个～第q个所述复合像素行101(即Np＝M+p，Nq＝M+q)的多个所述辅子像素102发光的所述辅像素驱动电路100提供第M+p级扫描信号Scan(M+p)、第M+p+Y级扫描信号Scan(M+p+Y)及第M+q级扫描信号Scan(M+q)。
如图4C所示，若每一所述辅像素驱动电路100均驱动三个所述复合像素行(即q-p+1＝3)的多个所述辅子像素102发光，则所述栅极驱动电路300为驱动位于第1个～第3个所述复合像素行101(即p＝1，q＝3，Np＝M+1，Nq＝M+3，Y<q-p)的多个所述辅子像素102发光的所述辅像素驱动电路100提供第M+1级扫描信号Scan(M+1)、第M+2级扫描信号Scan(M+2)、第M+3级扫描信号Scan(M+3)。所述栅极驱动电路300为驱动位于第4个～第6个所述复合像素行101(即p＝4，q＝6，Np＝M+4，Nq＝M+6)的多个所述辅子像素102发光的所述辅像素驱动电路100提供第M+4级扫描信号Scan(M+4)、第M+5级扫描信号Scan(M+5)、第M+6级扫描信号Scan(M+6)；以此类推得到，所述栅极驱动电路300为驱动位于第p个～第q个所述复合像素行101(即Np＝M+p，Nq＝M+q)的多个所述辅子像素102发光的所述辅像素驱动电路100提供第M+p级扫描信号Scan(M+p)、第M+p+Y级扫描信号Scan(M+p+Y)及第M+q级扫描信号Scan(M+q)。
具体的，每一所述主像素驱动电路连接于X1个所述栅极驱动电路，每一所述辅像素驱动电路连接于X2个所述栅极驱动电路；其中，X1≥2，X2≥2，X2≥X1。
请参阅图5，仍以第M+1个像素行为多个所述复合像素行中的第1个复合像素行为例进行说明，与位于第p个～第q个所述复合像素行中的多个所述辅子像素连接的所述辅像素驱动电路包括：第一驱动模块、第一初始化模块、第一数据写入模块、第一复位模块及第一补偿模块。
第一驱动模块，包括辅驱动晶体管Tsd；
第一初始化模块，连接于第一复位电压端VI1与所述辅驱动晶体管Tsd的栅极之间，以用于根据第Np级扫描信号Scan(Np)将第一复位信号传输至所述辅驱动晶体管Tsd的栅极，初始化所述辅驱动晶体管Tsd的栅极电压；
第一数据写入模块，连接于第一数据信号线与所述辅驱动晶体管Tsd的源极或漏极中的一者之间，以用于根据第Np+Y级扫描信号Scan(Np+Y)将第一数据信号Vdata传输至所述辅驱动晶体管Tsd的源极或漏极中的一者；
第一复位模块，连接于所述第一复位电压端VI1与对应的多个所述辅子像素102的阳极之间，以用于根据第Nq级扫描信号Scan(Nq+Y)将所述第一复位信号传输至多个所述辅子像素102的阳极，对多个所述辅子像素102的阳极电压进行复位；
第一补偿模块，连接于所述辅驱动晶体管Tsd的所述栅极与所述辅驱动晶体管Tsd的所述源极或所述漏极中的一者之间，以用于根据所述第Np+Y级扫描信号Scan(Np+Y)将所述第一数据信号Vdata传输至所述辅驱动晶体管的栅极，补偿所述辅驱动晶体管Tsd的阈值电压；
第一存储模块，串联在所述辅驱动晶体管Tsd的所述栅极与第一电压端VDD之间，用于维持所述辅驱动晶体管Tsd的栅极电压；以及
第一发光控制模块，与所述辅驱动晶体管Tsd串联，以用于根据第一发光控制信号EM1控制多个所述辅子像素102发光；
其中，Np＝M+p，Nq＝M+q；0<Y<Nq-Np，p≥1，q>p。
具体的，所述第一初始化模块包括第一初始化晶体管Ts1和第二初始化晶体管Ts2，所述第一初始化晶体管Ts1的栅极与第Np级扫描信号线Scan(Np)连接，所述第二初始化晶体管Ts2的栅极与第Np级扫描信号线Scan(Np)连接，所述第一初始化晶体管Ts1的源极或漏极的一者与所述辅驱动晶体管Tsd的所述栅极连接，所述第二初始化晶体管Ts2的源极或漏极的一者与第一复位电压端VI1连接，所述第一初始化晶体管Ts1的所述源极或所述漏极的另一者与所述第二初始化晶体管Ts2的所述源极或所述漏极的另一者连接；
所述第一数据写入模块包括第一数据晶体管Ts3，所述第一数据晶体管Ts3的栅极与第Np+Y级扫描信号线Scan(Np+Y)连接，所述第一数据晶体管Ts3的源极或漏极中的一者与第一数据线Vdata1连接，所述第一数据晶体管Ts3的所述源极或所述漏极中的另一者与所述辅驱动晶体管Tsd的源极或漏极中的一者连接；
所述第一补偿模块包括第一补偿晶体管Ts4和第二补偿晶体管Ts5，所述第一补偿晶体管Ts4的栅极与所述第Np+Y级扫描信号线Scan(Np+Y)连接，所述第二补偿晶体管Ts5的栅极与所述第Np+Y级扫描信号线Scan(Np+Y)连接，所述第一补偿晶体管Ts4的源极或漏极中的一者与所述辅驱动晶体管Tsd的栅极电性连接，所述第二补偿晶体管Ts5的源极或漏极中的一者与所述辅驱动晶体管Tsd的源极或漏极中的另一者连接，所述第一补偿晶体管Ts2的所述源极或所述漏极中的另一者与所述第二补偿晶体管Ts5的源极或漏极中的另一者连接；
所述第一复位模块包括第一复位晶体管Ts6，所述第一复位晶体管Ts6的栅极与第Nq级扫描信号线Scan(Np)连接，所述第一复位晶体管Ts6的源极或漏极中的一者与所述第一复位电压端VI1连接，所述第一复位晶体管Ts6的所述源极或所述漏极中的另一者与对应的多个所述辅子像素102的所述阳极连接；
所述第一发光控制模块包括第一开关晶体管Ts7和第二开关晶体管Ts8，所述第一开关晶体管Ts7的栅极与第一发光信号控制线EM1连接，所述第一开关晶体管Ts7的源极或漏极中的一者与所述辅驱动晶体管Tsd的所述源极或所述漏极中的另一者、所述第二补偿晶体管Ts8中的所述源极或所述漏极中的另一者连接，所述第一开关晶体管Ts7的所述源极或所述漏极中的另一者与对应的多个所述辅子像素102的所述阳极连接；所述第二开关晶体管Ts8的栅极与所述第一发光信号控制线EM1连接，所述第二开关晶体管Ts8的源极或漏极中的一者与所述第一电压端VDD连接，所述第二开关晶体管Ts8的所述源极或所述漏极中的另一者与所述辅驱动晶体管Tsd的所述源极或所述漏极中的一者、所述第一数据晶体管Ts7中的所述源极或所述漏极中的一者连接；
所述第一存储模块包括第一存储电容Cs1，所述第一存储电容Cs1串联在所述第一电压端VDD与所述辅驱动晶体管Tsd的所述栅极之间；
每一所述辅子像素102的阴极与第二电压端VSS连接。
请继续参阅图6，仍以第M+1个像素行为多个所述复合像素行中的第1个复合像素行为例进行说明，与位于第p个～第q个所述复合像素行中的多个所述主子像素连接的所述主像素驱动电路包括：第二驱动模块、第二初始化模块、第二数据写入模块、第二复位模块及第二补偿模块。
第二驱动模块，包括主驱动晶体管Tmd；
第二初始化模块，连接于第二复位电压端VI2与所述主驱动晶体管Tmd的栅极之间，以用于根据第Ni级扫描信号Scan(Ni)将第二复位信号传输至所述主驱动晶体管Tmd的栅极，初始化所述主驱动晶体管Tmd的栅极电压；
第二数据写入模块，连接于第二数据信号线Vdata2与所述主驱动晶体管Tmd的源极或漏极中的一者之间，以用于根据第Ni+1级扫描信号Scan(Ni+1)将第二数据信号Vdata2传输至所述主驱动晶体管Tmd的源极或漏极中的一者；
第二复位模块，连接于所述第二复位电压端VI2与对应的多个所述主子像素的阳极之间，以用于根据第Ni级扫描信号Scan(Ni)将所述第二复位信号VI2传输至所述主子像素202的阳极，对所述主子像素202的阳极电压进行复位；
第二补偿模块，连接于所述主驱动晶体管Tmd的所述栅极与所述主驱动晶体管Tmd的所述源极或所述漏极中的一者之间，以用于根据所述第Ni+1级扫描信号Scan(Ni+1)将所述第二数据信号Vdata2传输至所述主驱动晶体管Tmd的栅极，补偿所述主驱动晶体管Tmd的阈值电压；
第二存储模块，串联在所述主驱动晶体管Tmd的所述栅极与第一电压端VDD之间，用于维持所述主驱动晶体管Tmd的栅极电压；以及
第二发光控制模块，与所述主驱动晶体管Tmd串联，以用于根据第二发光控制信号EM2控制所述主子像素202发光；
其中，Ni＝M+p，Nq＝M+q；0<Y<Nq-Np，p≥1，q>p。
具体的，所述第二初始化模块包括第三初始化晶体管Tm1和第四初始化晶体管Tm2，所述第三初始化晶体管Tm1的栅极与第Ni级扫描信号线Scan(Ni)连接，所述第四初始化晶体管Tm2的栅极与第Ni级扫描信号线Scan(Ni)连接，所述第三初始化晶体管Tm1的源极或漏极的一者与所述主驱动晶体管Tmd的所述栅极连接，所述第二初始化晶体管Ts2的源极或漏极的一者与第一复位电压端VI1连接，所述第三初始化晶体管Tm1的所述源极或所述漏极的另一者与所述第四初始化晶体管Tm2的所述源极或所述漏极的另一者连接；
所述第二数据写入模块包括第二数据晶体管Tm3，所述第二数据晶体管Tm3的栅极与第Ni+1级扫描信号线Scan(Ni+1)连接，所述第二数据晶体管Tm3的源极或漏极中的一者与第二数据线Vdata2连接，所述第二数据晶体管Tm3的所述源极或所述漏极中的另一者与所述主驱动晶体管Tmd的源极或漏极中的一者连接；
所述第二补偿模块包括第三补偿晶体管Tm4和第四补偿晶体管Tm5，所述第三补偿晶体管Tm4的栅极与所述第Ni+1级扫描信号线Scan(Ni+1)连接，所述第四补偿晶体管Tm5的栅极与所述第Ni+1级扫描信号线Scan(Ni+1)连接，所述第三补偿晶体管Tm4的源极或漏极中的一者与所述主驱动晶体管Tmd的栅极电性连接，所述第四补偿晶体管Tm5的源极或漏极中的一者与所述主驱动晶体管Tmd的源极或漏极中的另一者连接，所述第三补偿晶体管Tm4的所述源极或所述漏极中的另一者与所述第四补偿晶体管Tm5的源极或漏极中的另一者连接；
所述第二复位模块包括第二复位晶体管Tm6，所述第二复位晶体管Tm6的栅极与第Ni级扫描信号线Scan(Ni)连接，所述第二复位晶体管Tm6的源极或漏极中的一者与所述第二复位电压端VI2连接，所述第二复位晶体管Tm6的所述源极或所述漏极中的另一者与对应的所述主子像素202的所述阳极连接；
所述第二发光控制模块包括第三开关晶体管Tm7和第四开关晶体管Tm8，所述第三开关晶体管Tm7的栅极与第二发光信号控制线EM2连接，所述第三开关晶体管Tm7的源极或漏极中的一者与所述主驱动晶体管Tmd的所述源极或所述漏极中的另一者、所述第四开关晶体管Tm8中的所述源极或所述漏极中的另一者连接，所述第三开关晶体管Tm7的所述源极或所述漏极中的另一者与对应的所述主子像素202的所述阳极连接；所述第二开关晶体管Ts8的栅极与所述第二发光信号控制线EM2连接，所述第四开关晶体管Tm8，的源极或漏极中的一者与所述第一电压端VDD连接，所述第四开关晶体管Tm8，的所述源极或所述漏极中的另一者与所述主驱动晶体管Tmd的所述源极或所述漏极中的一者、所述第二数据晶体管Tm3中的所述源极或所述漏极中的一者连接；
所述第二存储模块包括第二存储电容Cs2，所述第二存储电容Cs2串联在所述第一电压端VDD与所述主驱动晶体管Tmd的所述栅极之间；
所述主子像素202的阴极与第二电压端VSS连接。
请继续参阅图7，多条所述扫描信号线包括主扫描信号线SL1和辅扫描信号线SL2，所述辅扫描信号线SL2包括第一辅扫描信号线SL21和第二辅扫描信号线SL22，每一所述主像素驱动电路200通过对应的所述主扫描信号线SL1连接于对应的所述栅极驱动电路300，每一所述辅像素驱动电路100通过对应的所述第一辅扫描信号线SL21连接于对应的所述主扫描信号线SL1以连接于对应的所述栅极驱动电路300，每一条所述第二辅扫描信号线SL21的一端连接于对应的所述主扫描信号线SL1，另一端浮置；其中，所述第一辅扫描信号线SL21与对应的所述主扫描信号线SL1在所述过渡显示区1001b内电性连接。
进一步地，所述第一辅扫描信号线SL21包括位于所述过渡显示区1001b的过渡扫描段，所述过渡扫描段包括第一过渡部SL211、第二过渡部SL212、第三过渡部SL213。其中，所述第一过渡部SL211与对应的所述主扫描信号线SL1连接；所述第二过渡部SL212与对应的所述辅像素驱动电路100连接；所述第三过渡部SL213连接所述第一过渡部SL211和所述第二过渡部SL212。其中，所述第二过渡部SL212相对于所述第一过渡部SL211、所述第三过渡部SL213是倾斜的，以连接位于不同水平线上的所述主像素驱动电路200及所述辅像素驱动电路100，实现扫描信号的传输。
其中，所述第一数据信号线Data1、所述第二数据信号线Data2及与所述第一电压端VDD连接的电源信号线沿第二方向y延伸，所述主扫描信号线SL1、所述辅扫描信号线SL2、所述第一发光信号控制线EM1和所述第二发光信号控制线EM2沿与所述第二方向y相交的第一方向x延伸。
本发明的实施例还提供一种显示装置，包括上述的所述显示面板。所述显示装置还包括传感器，所述传感器正对所述显示面板的显示透光区。所述传感器包括指纹识别传感器、摄像头、结构光传感器、飞行时间传感器、距离传感器、光线传感器等，以使所述传感器可以通过所述显示透光区采集信号，从而使所述显示装置实现屏下指纹识别、屏下摄像头、屏下面部识别、屏下距离感知等屏下传感方案。
有益效果为：本发明提供的显示面板及显示装置，每一辅像素驱动电路连接于多个辅子像素以驱动对应的多个所述辅子像素发光，每一主像素驱动电路连接于对应的主子像素以驱动对应的主子像素发光，多级栅极驱动电路通过多条扫描信号线分别连接于多个辅像素驱动电路及多个主像素驱动电路。每一级扫描信号线包括P条主扫描信号线和Q条辅扫描信号线，Q条所述辅扫描信号线包括Z条第一辅扫描信号线和(Q-Z)条第二辅扫描信号线，每一主像素驱动电路通过对应的主扫描信号线连接于对应的栅极驱动电路，本发明通过将每一辅像素驱动电路通过Q条辅扫描信号线中的Z条第一辅扫描信号线与对应的栅极驱动电路连接，其余第二辅扫描信号线浮置，无需设置将两条扫描信号线合并成一条走线的连接走线，从而避免连接走线与像素驱动电路之间易出现耦合作用，避免影响正常显示。
综上所述，虽然本发明已以优选实施例揭露如上，但上述优选实施例并非用以限制本发明，本领域的普通技术人员，在不脱离本发明的精神和范围内，均可作各种更动与润饰，因此本发明的保护范围以权利要求界定的范围为准。

Claims (11)

1.一种显示面板，其特征在于，包括功能附加区和围绕所述功能附加区的主显示区；所述显示面板包括：
多个像素行，多个所述像素行包括多个复合像素行，每一所述复合像素行包括位于所述功能附加区内的多个辅子像素和位于所述主显示区的多个主子像素；
多个辅像素驱动电路，每一所述辅像素驱动电路连接于多个所述辅子像素以驱动对应的多个所述辅子像素发光；
多个主像素驱动电路，每一所述主像素驱动电路连接于对应的所述主子像素以驱动对应的所述主子像素发光；以及
多级栅极驱动电路，通过多条扫描信号线分别连接于多个所述辅像素驱动电路及多个所述主像素驱动电路，每一级所述扫描信号线包括P条主扫描信号线和Q条辅扫描信号线，Q条所述辅扫描信号线包括Z条第一辅扫描信号线和(Q-Z)条第二辅扫描信号线，每一所述主像素驱动电路通过对应的所述主扫描信号线连接于对应的所述栅极驱动电路，每一所述辅像素驱动电路通过所述第一辅扫描信号线连接于对应的所述主扫描信号线以连接于对应的所述栅极驱动电路，每一条所述第二辅扫描信号线的一端连接于对应的所述主扫描信号线，另一端浮置；其中，P≥Q，P≥2，Q≥1，Q≥Z，Z≥1，P、Q、Z均为整数；
第M+1个像素行为多个所述复合像素行中的第1个复合像素行，在和位于第i个复合像素行中的多个所述辅子像素连接的所述辅像素驱动电路相连接的多条所述第一辅扫描信号线中，对应于第Ni级所述扫描信号线中的所述第一辅扫描信号线连接于位于第i个复合像素行中的多个所述主子像素连接的所述主像素驱动电路；其中，Ni＝M+i，i≥1。
2.根据权利要求1所述的显示面板，其特征在于，Z＝1。
3.根据权利要求2所述的显示面板，其特征在于，P＝2，Q＝2或1。
4.根据权利要求1所述的显示面板，其特征在于，所述功能附加区包括显示透光区及位于所述显示透光区外围的过渡显示区，多个所述主像素驱动电路位于所述主显示区内，多个所述辅像素驱动电路位于所述过渡显示区内。
5.根据权利要求4所述的显示面板，其特征在于，每一条所述第二辅扫描信号线的一端在所述主显示区连接于对应的所述主扫描信号线，另一端在所述过渡显示区内浮置。
6.根据权利要求4所述的显示面板，其特征在于，所述第一辅扫描信号线包括位于所述过渡显示区的过渡扫描段，所述过渡扫描段包括：
第一过渡部，与对应的所述主扫描信号线连接；
第二过渡部，与对应的所述辅像素驱动电路连接；以及
第三过渡部，连接所述第一过渡部和所述第二过渡部；
其中，所述第二过渡部相对于所述第一过渡部、所述第三过渡部是倾斜的。
7.根据权利要求1所述的显示面板，其特征在于，和位于第p个～第q个所述复合像素行中的多个所述辅子像素连接的所述辅像素驱动电路连接于第Np级扫描信号线、第Np+Y级扫描信号线及第Nq级扫描信号线，位于第i个所述复合像素行中的所述主子像素对应的所述主像素驱动电路与第Ni级扫描信号线、第Ni+1级扫描信号线连接；其中，Np＝M+p，Nq＝M+q，Ni＝M+i；0<Y<Nq-Np；p≤i≤q。
8.根据权利要求1所述的显示面板，其特征在于，每一所述主像素驱动电路连接于X1个所述栅极驱动电路，每一所述辅像素驱动电路连接于X2个所述栅极驱动电路；其中，X1≥2，X2≥2，X2≥X1。
9.根据权利要求1所述的显示面板，其特征在于，第M个像素行为多个所述复合像素行中的第1个复合像素行，与位于第p个～第q个所述复合像素行中的多个所述辅子像素连接的所述辅像素驱动电路包括：
第一驱动模块，包括辅驱动晶体管；
第一初始化模块，连接于第一复位电压端与所述辅驱动晶体管的栅极之间，以用于根据第Np级扫描信号将第一复位信号传输至所述辅驱动晶体管的栅极，初始化所述辅驱动晶体管的栅极电压；
第一数据写入模块，连接于第一数据信号线与所述辅驱动晶体管的源极或漏极中的一者之间，以用于根据第Np+Y级扫描信号将第一数据信号传输至所述辅驱动晶体管的源极或漏极中的一者；
第一复位模块，连接于所述第一复位电压端与对应的多个所述辅子像素的阳极之间，以用于根据第Nq级扫描信号将所述第一复位信号传输至多个所述辅子像素的阳极，对多个所述辅子像素的阳极电压进行复位；
第一补偿模块，连接于所述辅驱动晶体管的所述栅极与所述辅驱动晶体管的所述源极或所述漏极中的一者之间，以用于根据所述第Np+Y级扫描信号将所述第一数据信号传输至所述辅驱动晶体管的栅极，补偿所述辅驱动晶体管的阈值电压；
第一存储模块，串联在所述辅驱动晶体管的所述栅极与第一电压端之间，用于维持所述辅驱动晶体管的栅极电压；以及
第一发光控制模块，与所述辅驱动晶体管串联，以用于根据第一发光控制信号控制多个所述辅子像素发光；
其中，Np＝M+p，Nq＝M+q；0<Y<Nq-Np，p≥1，q>p。
10.根据权利要求1所述的显示面板，其特征在于，第M个像素行为多个所述复合像素行中的第1个复合像素行，与位于第p个～第q个所述复合像素行中的多个所述主子像素连接的所述主像素驱动电路包括：
第二驱动模块，包括主驱动晶体管；
第二初始化模块，连接于第二复位电压端与所述主驱动晶体管的栅极之间，以用于根据第Ni级扫描信号将第二复位信号传输至所述主驱动晶体管的栅极，初始化所述主驱动晶体管的栅极电压；
第二数据写入模块，连接于第二数据信号线与所述主驱动晶体管的源极或漏极中的一者之间，以用于根据第Ni+1级扫描信号将第二数据信号传输至所述主驱动晶体管的源极或漏极中的一者；
第二复位模块，连接于所述第二复位电压端与所述主子像素的阳极之间，以用于根据第Ni级扫描信号将所述第二复位信号传输至所述主子像素的阳极，对所述主子像素的阳极电压进行复位；
第二补偿模块，连接于所述主驱动晶体管的所述栅极与所述主驱动晶体管的所述源极或所述漏极中的一者之间，以用于根据所述第Ni+1级扫描信号将所述第二数据信号传输至所述主驱动晶体管的栅极，补偿所述主驱动晶体管的阈值电压；
第二存储模块，串联在所述主驱动晶体管的所述栅极与第二电压端之间，用于维持所述主驱动晶体管的栅极电压；以及
第二发光控制模块，与所述主驱动晶体管串联，以用于根据第二发光控制信号控制所述主子像素发光；
其中，Ni＝M+p，Nq＝M+q；0<Y<Nq-Np，p≥1，q>p。
11.一种显示装置，其特征在于，包括权利要求1～10任一项所述的显示面板。
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