CN113031746A - 显示屏区域刷新方法、存储介质及电子设备 - Google Patents

显示屏区域刷新方法、存储介质及电子设备 Download PDF

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Abstract

本申请实施例提供一种电子设备，包括：包括主处理芯片、协处理芯片以及显示屏，协处理芯片的运行功耗小于主处理芯片的运行功耗，协处理芯片包括：处理器，用于对待显示图像进行处理，以获取所述待显示图像每一像素点的像素值；存储器，包括帧缓冲器，所述帧缓冲器用于存储所述像素值；显示驱动电路，用于在所述显示屏上确定待刷新的显示区域，并从所述帧缓冲器中加载所述像素值至所述显示区域以对所述显示区域进行刷新。所述电子设备中，控制待刷新的显示区域刷新时，所需的存储容量远小于控制整个显示屏刷新时所需的存储容量，从而可以节省存储资源，并且相比于控制整个显示屏刷新而言，所需的功耗也更低，从而可以降低电子设备的功耗。

Description

显示屏区域刷新方法、存储介质及电子设备
技术领域
本申请涉及电子技术领域，特别涉及一种显示屏区域刷新方法、存储介质及电子设备。
背景技术
随着电子技术的发展，各式各样的电子设备已成为用户生活工作中不可或缺的工具，电子设备能够支持的功能也越来越多。例如，用户可以通过电子设备实现通话功能、网购功能、导航功能、游戏功能等。
然而，电子设备支持的功能越来越多的同时，电子设备的功耗也越来越高。如何降低电子设备的功耗，延长电子设备的续航时间，成为当前亟待解决的问题。
发明内容
本申请实施例提供一种显示屏区域刷新方法、存储介质及电子设备，可以节省电子设备的存储资源，降低电子设备的功耗。
本申请实施例提供一种电子设备，包括主处理芯片、协处理芯片以及显示屏，所述主处理芯片、所述协处理芯片均与所述显示屏电连接，所述协处理芯片的运行功耗小于所述主处理芯片的运行功耗，所述协处理芯片包括：
处理器，用于对待显示图像进行处理，以获取所述待显示图像每一像素点的像素值；
存储器，包括帧缓冲器，所述帧缓冲器用于存储所述像素值；
显示驱动电路，用于在所述显示屏上确定待刷新的显示区域，并从所述帧缓冲器中加载所述像素值至所述显示区域以对所述显示区域进行刷新。
本申请实施例还提供一种显示屏区域刷新方法，应用于电子设备，所述电子设备包括主处理芯片、协处理芯片以及显示屏，所述主处理芯片、所述协处理芯片均与所述显示屏电连接，所述协处理芯片的运行功耗小于所述主处理芯片的运行功耗，所述显示屏区域刷新方法由所述协处理芯片执行，所述显示屏区域刷新方法包括：
对待显示图像进行处理，以获取所述待显示图像每一像素点的像素值；
将所述像素值写入帧缓冲器；
在所述显示屏上确定待刷新的显示区域；
从所述帧缓冲器中加载所述像素值至所述显示区域以对所述显示区域进行刷新。
本申请实施例还提供一种存储介质，所述存储介质中存储有计算机程序，当所述计算机程序在计算机上运行时，使得所述计算机执行上述显示屏区域刷新方法。
本申请实施例还提供一种电子设备，用于执行上述显示屏区域刷新方法。
本申请实施例提供的电子设备中，由于显示屏待刷新的显示区域的分辨率远小于整个显示屏的分辨率，因此控制所述待刷新的显示区域刷新时，所需的存储容量远小于控制整个显示屏刷新时所需的存储容量，从而可以节省协处理芯片的存储资源，也即节省电子设备的存储资源。此外，只控制待刷新的显示区域刷新时，对待显示图像进行处理时需要处理的数据量更少，相应的运算次数也会更少，并且驱动显示屏上进行切换的像素点数量也会更少，相比于控制整个显示屏刷新而言，所需的功耗也更低，从而可以降低电子设备的功耗。
附图说明
为了更清楚地说明本申请实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍。显而易见地，下面描述中的附图仅仅是本申请的一些实施例，对于本领域技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本申请实施例提供的电子设备的第一种结构示意图。
图2为本申请实施例提供的电子设备处于亮屏显示模式时的示意图。
图3为本申请实施例提供的电子设备处于熄屏显示模式时的示意图。
图4为本申请实施例提供的电子设备的协处理芯片的第一种结构示意图。
图5为本申请实施例提供的电子设备的协处理芯片的第二种结构示意图。
图6为本申请实施例提供的电子设备的第二种结构示意图。
图7为本申请实施例提供的电子设备的显示屏的结构示意图。
图8为本申请实施例提供的显示屏区域刷新方法的第一种流程示意图。
图9为本申请实施例提供的显示屏区域刷新方法的第二种流程示意图。
图10为本申请实施例提供的显示屏区域刷新方法中确定待刷新的显示区域的第一种示意图。
图11为本申请实施例提供的显示屏区域刷新方法中确定待刷新的显示区域的第二种示意图。
图12为本申请实施例提供的显示屏区域刷新方法的第三种流程示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
本申请实施例提供一种电子设备。所述电子设备可以是智能手机、智能手表、平板电脑等设备，还可以是游戏设备、AR(Augmented Reality，增强现实)设备、汽车装置、数据存储装置、音频播放装置、视频播放装置、笔记本电脑、桌面计算设备等，还可以是诸如电子头盔、电子眼镜、电子衣物等可穿戴式电子设备。
参考图1，图1为本申请实施例提供的电子设备100的第一种结构示意图。
其中，电子设备100包括主处理芯片10、协处理芯片20、显示屏30。所述主处理芯片10与所述显示屏30电连接，所述协处理芯片20与所述主处理芯片10、所述显示屏30均电连接，所述显示屏30用于显示诸如文本、图像等信息。可以理解的，电连接可以是直接连接以实现电信号的传递，也可以是间接连接，例如通过开关等其它电子器件间接连接以实现电信号的传递。例如，所述主处理芯片10可以直接与所述显示屏30电连接，也可以通过诸如协处理芯片20中的开关等电子器件实现与显示屏30的电连接。
所述主处理芯片10可以作为电子设备100的主控SOC(System on Chip，系统级芯片)。所述主处理芯片10上可以集成有处理器和存储器，诸如第一处理器和第一存储器。所述第一处理器诸如为CPU(Central Processing Unit，中央处理器)，所述第一处理器可以进行数据处理。所述第一存储器可以存储数据，例如存储第一操作系统和应用程序。其中，所述主处理芯片10可运行所述第一操作系统及所述第一存储器上存储的应用程序。
其中，所述主处理芯片10用于输出第一显示数据。例如，所述主处理芯片10可以对待显示的图像进行处理，以生成第一显示数据，并输出所述第一显示数据。所述主处理芯片10可以将所述第一显示数据输出至所述显示屏30，以控制所述显示屏30以第一显示模式显示所述第一显示数据对应的信息，也即控制电子设备100以第一显示模式显示信息。例如，所述主处理芯片10可以控制所述显示屏30显示图像、文本等信息。可以理解的，所述主处理芯片10可以运行所述第一操作系统，以控制所述显示屏30在所述第一操作系统下以第一显示模式显示所述第一显示数据对应的信息。
其中，所述第一显示模式可以理解为电子设备100的正常显示模式，或者标准功耗显示模式。电子设备100处于所述第一显示模式时，电子设备100的功耗为标准功耗，也即正常功耗。其中，所述第一显示模式可以包括亮屏显示模式，或者亮屏工作模式。在所述亮屏显示模式下，所述显示屏30点亮，所述显示屏30上可以显示多个应用的图标和名称，如图2所示，图2为本申请实施例提供的电子设备100处于亮屏显示模式时的示意图。当用户点击应用图标时，电子设备100即可启动对应的应用。此外，可以理解的，所述显示屏30上还可以显示诸如时间、日期、天气、温度等信息。
所述协处理芯片20为一个低功耗的SOC。所述协处理芯片20的运行功耗小于所述主处理芯片10的运行功耗。所述协处理芯片20上也可以集成有处理器和存储器，诸如第二处理器和第二存储器。其中，所述第二处理器可以进行数据处理。所述第二存储器可以存储数据，例如存储第二操作系统和应用程序。其中，所述协处理芯片20可运行所述第二操作系统及所述第二存储器上存储的应用程序。
其中，所述协处理芯片20用于输出第二显示数据。例如，所述协处理芯片20可以对待显示的图像进行处理，以生成第二显示数据，并输出所述第二显示数据。所述协处理芯片20可以将所述第二显示数据输出至所述显示屏30，以控制所述显示屏30以第二显示模式显示所述第二显示数据对应的信息，也即控制电子设备100以第二显示模式显示信息。例如，所述协处理芯片20也可以控制所述显示屏30显示图像、文本等信息。可以理解的，所述协处理芯片20可以运行所述第二操作系统，以控制所述显示屏30在所述第二操作系统下以第二显示模式显示所述第二显示数据对应的信息。
其中，所述第二显示模式可以理解为电子设备100的低功耗显示模式。电子设备100处于所述第二显示模式时，电子设备100的功耗较低，此时电子设备100的功耗低于标准功耗，也即低于正常功耗。也即，电子设备100处于所述第二显示模式时的功耗低于所述电子设备100处于所述第一显示模式时的功耗。其中，所述第二显示模式可以包括熄屏显示模式，或者简易操作模式。熄屏显示模式(Always On Display，AOD)是指电子设备100在熄屏状态下由显示屏30显示信息的一种显示模式，如图3所示，图3为本申请实施例提供的电子设备100处于熄屏显示模式时的示意图。在一种可能的实施方式中，电子设备100能够在熄屏显示模式下通过具备自发光能力的像素点进行发光，在熄屏显示模式下，电子设备100的功耗较低且能够实现显示相应的信息。
需要说明的是，在所述第二显示模式下，电子设备100的部分功能锁定，其他部分功能仍可使用。例如，在所述熄屏显示模式下，电子设备100的显示屏30锁定并熄屏，但是所述显示屏30可以以熄屏显示的方式显示部分信息，例如显示屏30上可以显示时间、锁屏标识、快捷应用图标等信息，其中快捷应用图标可以包括计算器、游戏机、便签、照相机、手电筒等。当用户点击快捷应用图标时，电子设备100即可启动对应的快捷应用。
可以理解的，在所述协处理芯片20将所述第二显示数据输出至所述显示屏30，以控制所述显示屏30以第二显示模式显示所述第二显示数据对应的信息时，所述主处理芯片10可以进入休眠状态，以节省所述主处理芯片10的功耗，从而降低电子设备100的功耗。
其中，由于所述第一显示模式为标准功耗显示模式，所述第二显示模式为低功耗显示模式，因此所述第一操作系统可以理解为标准功耗操作系统，所述第二操作系统可以理解为低功耗操作系统。因此，在电子设备100中，也可以理解为所述主处理芯片10用于控制显示屏30在电子设备100运行标准功耗操作系统时以第一显示模式显示信息，所述协处理芯片20用于控制显示屏30在电子设备100运行低功耗操作系统时以第二显示模式显示信息。其中，所述主处理芯片10控制显示屏30在电子设备100运行标准功耗操作系统时以第一显示模式显示信息时，所述协处理芯片20处于休眠状态。所述协处理芯片20控制显示屏30在电子设备100运行低功耗操作系统时以第二显示模式显示信息时，所述主处理芯片10处于休眠状态。
此外，可以理解的，由于所述协处理芯片20的运行功耗小于所述主处理芯片10的运行功耗，因此所述协处理芯片20的处理能力小于所述主处理芯片10的处理能力。也即，所述主处理芯片10的处理能力较强，而所述协处理芯片20的处理能力较弱。在电子设备100处于所述第一显示模式时，所述主处理芯片10可以基于所述第一操作系统进行所有的数据处理以及控制显示屏30显示信息。在电子设备100处于所述第二显示模式时，所述协处理芯片20只能基于所述第二操作系统进行部分数据处理以及控制显示屏30显示信息。
在本申请的描述中，需要理解的是，诸如“第一”、“第二”等术语仅用于区分类似的对象，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。
同时参考图4和图5，图4为本申请实施例提供的电子设备的协处理芯片20的第一种结构示意图，图5为本申请实施例提供的电子设备的协处理芯片20的第二种结构示意图。
其中，协处理芯片20包括图像数据处理模块21、控制模块22、通信接口模块23、寄存器模块24、音频数据检测模块25、常开模块26、音频数据处理模块27、存储模块28以及通信总线29。
图像数据处理模块21诸如VOP&DSC，用于进行图像处理，例如进行图层的合成和图像的渲染。其中，图像数据处理模块21支持4路图像数据的MIPI-DSI，支持3路图层合成，支持VESADSC。需要说明的是，通常的电子设备中，需要通过GPU(Graphics Processing Unit，图形处理器)进行图像渲染，而本申请的协处理芯片20可以通过图像数据处理模块21直接进行图像渲染，在协处理芯片20工作时无需GPU参与图像的渲染，因此可以节省GPU的功耗，进一步降低电子设备100的功耗。
控制模块22诸如控制单元MCU(Micro Control Unit，微控制单元)，控制单元MCU用于对整个协处理芯片20进行控制以及进行数据运算，例如在协处理芯片20开始工作时对协处理芯片20进行初始化，以及在协处理芯片20工作时进行数据运算等。其中，MCU可以理解为协处理芯片20的控制核，或者MCU也可以理解为协处理芯片20中集成的第二处理器。MCU的处理频率可以达到300MHz，可以用于控制与逻辑处理。
通信接口模块23用于与主处理芯片10进行通信。其中，通信接口模块23可以包括SPISLV接口和I2CSLV接口，SPISLV接口和I2CSLV接口都可以用于与主处理芯片10进行通信。
寄存器模块24用于存储协处理芯片20的配置信息。所述配置信息用于在协处理芯片20进行初始化时，由MCU读取这些配置信息，并由MCU根据这些配置信息对协处理芯片20进行初始化。其中，所述配置信息例如可以包括PWM、DSI Host slv、SPISLV、I2C mst0…n、UART0…n、ROM、VOP slv、WDT0、Timer、SPI mst、Mailbox0…n等端口或模块的配置信息。
音频数据检测模块25用于进行音频数据的采集和音量大小的判断。其中，音频数据检测模块25包括Codec ADC和VAD，Codec ADC与VAD电连接。Codec ADC用于进行音频数据采样。VAD用于对采样后的音频数据进行音量大小的判断，当音量大小未达到预设音量大小时，则认为采样后的音频数据是无效的音频数据，随后丢弃采样后的音频数据；当音量大小达到预设音量大小时，则认为采样后的音频数据为有效的音频数据，随后可以存储采集到的音频数据。
常开模块26始终处于上电工作状态，无论协处理芯片20处于工作状态或者休眠状态，常开模块26一直处于上电工作状态，也即常开模块26不会断电。其中，常开模块26包括图像数据传输通路261、切换开关262、时钟供给子模块263、控制子模块264以及存储子模块265。
其中，图像数据传输通路261诸如为MIPI DPHY TX，切换开关262诸如为MIPISwitch。MIPI DPHY TX与MIPI Switch电连接，MIPI Switch用于与显示屏电连接。VOP&DSC进行图像处理后产生的图像数据经由MIPI DPHY TX发送到MIPI Switch，再由MIPI Switch发送到显示屏进行显示。其中，MIPI DPHY TX可以支持2.5Gbps的数据传输速率。
需要说明的是，MIPI Switch还与主处理芯片10电连接。主处理芯片10进行图像处理后产生的图像数据也可以发送到MIPI Switch，再由MIPI Switch发送到显示屏进行显示。
其中，MIPI Switch还与MCU电连接，由MCU对MIPI Switch进行控制。当需要由主处理芯片10控制显示屏显示时，MCU控制MIPI Switch切换为与主处理芯片10接通，从而主处理芯片10产生的第一显示数据可以通过MIPI Switch发送到显示屏进行显示。当需要由协处理芯片20控制显示屏显示时，MCU控制MIPI Switch切换为与MIPI DPHY TX接通，从而协处理芯片20的VOP&DSC产生的第二显示数据可以通过MIPI Switch发送到显示屏进行显示。
时钟供给子模块263诸如为PLL*3。其中，PLL*3用于为协处理芯片20提供时钟信号。
控制子模块264也可以用于对协处理芯片20进行控制。需要说明的是，控制子模块264对协处理芯片20的控制功能与MCU对协处理芯片20的控制功能不同。其中，控制子模块264可以包括多个控制端口和通信端口，例如PMU、CRU、GRF、GPIO0…n、INTC0…n等多个端口。其中，PMU端口用于进行电源管理，CRU端口用于进行时钟控制，GRF端口用于进行寄存器控制，GPIO0…n、INTC0…n等端口用于进行通信。
存储子模块265诸如为Memory。Memory可以用于存储音频数据检测模块25检测到的音频数据，也可以用于存储其它数据，例如VOP&DSC产生的第二显示数据。
音频数据处理模块27用于进行音频数据处理。其中，音频数据处理模块27可以包括DSP和WDT1。DSP用于对音频数据进行关键字提取，提取出的关键字可以用于对协处理芯片20进行控制，以实现用户对协处理芯片20的语音控制。此外，在一种可能的实施方式中，还可以通过DSP进行声纹识别，从而通过DSP的声纹识别对用户的语音控制进行鉴权。其中，DSP的处理频率可以达到400MHz，可以更加高效地处理语音算法。由此，协处理芯片20即可对采样后的音频数据进行三次处理，也即第一次处理由VAD进行音量判断，第二次处理由DSP进行关键字提取，第三次处理由DSP进行声纹识别。此外，WDT1可以用于进行通信或者对DSP进行配置。
需要说明的是，通常的电子设备中，Memory与DSP设置在同一个模块中，也即Memory通常设置在音频处理模块中，Memory只用于存储音频数据，而不能用于存储其它的数据。而本申请的协处理芯片20中，将Memory从音频数据处理模块27中独立出来，将Memory设置在常开模块26中，Memory不仅可以用于存储音频数据，还可以用于存储其它数据，从而可以实现Memory的共享，提高Memory的利用率。
存储模块28诸如为Share Memory。Share Memory可以用于存储数据，例如存储音频数据或者图像数据。其中，Share Memory可以配置为1.5MB的存储容量。
通信总线29诸如为NOC。其中，VOP&DSC、MCU、SPISLV、I2CSLV、寄存器模块24、VAD、MIPI DPHY TX、Memory、DSP、Share Memory都可以与NOC电连接，以实现彼此之间的通信。
同时参考图6，图6为本申请实施例提供的电子设备100的第二种结构示意图。
所述协处理芯片20中，所述图像数据处理模块21包括存储单元211、数据传输单元212、图像处理单元213，所述存储单元211、所述数据传输单元212、所述图像处理单元213依次电连接。其中，所述协处理芯片20的控制单元22，诸如控制单元MCU，用于进行数据运算，例如可以用于对待显示的图像进行处理，以产生显示数据。从而，所述控制单元22，诸如MCU，可以理解为协处理芯片20的处理器。所述存储单元211与所述控制单元22电连接。其中，所述存储单元211，诸如存储单元SRAM，可以理解为协处理芯片20的存储器。其中，所述存储器SRAM可以配置为诸如1.5MB或者2MB的存储容量。所述存储单元211可以用于存储所述控制单元22产生的显示数据，例如将所述控制单元22产生的显示数据存储为所述第二显示数据。此外，所述存储单元211还与所述协处理芯片20的切换开关262电连接，从而所述存储单元211存储的第二显示数据可以通过所述切换开关262输出至显示屏30，从而通过显示屏30显示所述第二显示数据对应的信息。所述数据传输单元212诸如为VOP，所述数据传输单元212用于将所述存储单元211存储的第二显示数据传输到所述图像处理单元213。所述图像处理单元213诸如为DSC，所述图像处理单元213用于进行图像处理，例如对所述第二显示数据对应的图像的尺寸进行调整，以使得调整后的图像适于在显示屏30上进行显示。
所述图像数据传输通路261包括显示接口标准单元2611以及显示接口2612，所述显示接口标准单元2611与所述显示接口2612电连接。其中，所述显示接口标准单元2611还与所述图像处理单元213电连接，所述显示接口2612还与所述切换开关262电连接，从而实现所述存储单元211与所述切换开关262的电连接。所述显示接口标准单元2611诸如为DSI，用于根据MIPI Switch规定的显示接口标准进行配置，以使得所述图像数据传输通路261符合MIPI Switch规定的显示接口标准。所述显示接口2612诸如为DPHY，为显示接口的物理层实现，以通过物理介质实现所述图像数据传输通路261与所述切换开关262的电连接。
所述切换开关262诸如为MIPI Switch，所述切换开关262与所述显示接口2612、电子设备100的显示屏30电连接。从而，所述切换开关262可以将所述存储单元211存储的第二显示数据输出至所述显示屏30，也即将所述协处理芯片20输出的第二显示数据输出至所述显示屏30进行显示。
可以理解的，所述协处理芯片20中，控制单元MCU，也即处理器MCU，可以用于对待显示的图像进行处理，以产生显示数据；存储单元SRAM，也即存储器SRAM，可以用于存储处理器MCU产生的显示数据；数据传输单元VOP、图像处理单元DSC、显示接口标准单元DSI、显示接口DPHY以及切换开关MIPI Switch共同用于将存储器SRAM存储的显示数据传输到显示屏30进行显示，因此数据传输单元VOP、图像处理单元DSC、显示接口标准单元DSI、显示接口DPHY以及切换开关MIPI Switch可以共同理解为协处理芯片20的显示驱动电路，通过显示驱动电路可以驱动显示屏30显示信息。
此外，所述主处理芯片10包括第一处理器11、显示接口标准单元12、显示接口13，其中所述第一处理器11、所述显示接口标准单元12、所述显示接口13依次电连接。此外，所述显示接口13还与协处理芯片20的切换开关262电连接，以实现所述主处理芯片10与所述切换开关262的电连接。从而，所述主处理芯片10可以将产生的显示数据，诸如第一显示数据，输出至所述切换开关262，并通过所述切换开关262将所述第一显示数据输出至所述显示屏30进行显示。其中，所述第一处理器11诸如为CPU，所述第一处理器11用于进行数据运算，以产生显示数据。所述显示接口标准单元12诸如为DSI，与协处理芯片20的显示接口标准单元2611类似，所述显示接口标准单元12也用于根据MIPI Switch规定的显示接口标准进行配置，以使得主处理芯片10的图像数据传输符合MIPI Switch规定的显示接口标准。所述显示接口13诸如为DPHY，与协处理芯片20的显示接口2612类似，所述显示接口13也为显示接口的物理层实现，以通过物理介质实现所述主处理芯片10与所述切换开关262的电连接。
此外，所述主处理芯片10还可以包括通信接口单元14。所述通信接口单元14诸如为SPI。所述通信接口单元14与所述协处理芯片20的存储单元211电连接，从而可以实现所述主处理芯片10与所述协处理芯片20的存储单元211的电连接。因此，所述主处理芯片10产生的显示数据还可以通过所述通信接口单元14发送到所述存储单元211进行存储。需要说明的是，当所述主处理芯片10产生的显示数据通过显示接口13输出至所述切换开关262，并通过所述切换开关262输出至显示屏30时，所述主处理芯片10输出的显示数据为第一显示数据；当所述主处理芯片10产生的显示数据通过所述通信接口单元14发送到所述存储单元211进行存储，并通过所述存储单元211传输到所述切换开关262，最后通过所述切换开关262输出至显示屏30时，此时所述存储单元211存储的所述主处理芯片10产生的显示数据为第二显示数据。也即，所述存储单元211用于将所述主处理芯片10发送的显示数据存储为第二显示数据，并由协处理芯片20通过所述切换开关262将所述第二显示数据输出至显示屏30进行显示。
其中，所述协处理芯片20的切换开关262用于根据所述协处理芯片20的控制将所述主处理芯片10输出的第一显示数据输出至所述显示屏30，以使得所述主处理芯片10控制所述显示屏30以第一显示模式显示信息，或者将所述协处理芯片20输出的第二显示数据输出至所述显示屏30，以使得所述协处理芯片20控制所述显示屏30以第二显示模式显示信息。
其中，在所述切换开关262将所述协处理芯片20输出的第二显示数据输出至所述显示屏30时，也即在所述协处理芯片20控制所述显示屏30以第二显示模式显示信息时，所述主处理芯片10可以进入休眠状态，以节省所述主处理芯片10的功耗，从而降低电子设备100的功耗。同理，在所述切换开关262将所述主处理芯片10输出的第一显示数据输出至所述显示屏30时，也即在所述主处理芯片10控制所述显示屏30以第一显示模式显示信息时，所述协处理芯片20可以进入休眠状态，以节省所述协处理芯片20的功耗，从而降低电子设备100的功耗。需要说明的是，在所述协处理芯片20进入休眠状态时，所述协处理芯片20的常开模块26仍然处于上电工作状态，而所述切换开关262设置在所述常开模块26中，因此所述切换开关262也可以处于工作状态，依然可以进行显示数据的输出。
可以理解的，所述协处理芯片20可以用于：在所述电子设备100处于第一显示模式时，控制所述切换开关262将所述主处理芯片10输出的第一显示数据输出至所述显示屏30；以及在所述电子设备100处于第二显示模式时，控制所述切换开关262将所述协处理芯片20输出的第二显示数据输出至所述显示屏30。
继续参考图6，其中，所述协处理芯片20中，所述控制单元22还与所述切换开关262电连接，从而所述控制单元22可以对所述切换开关262的切换进行控制，以实现所述协处理芯片20对所述切换开关262的控制。其中，所述控制单元22控制所述切换开关262接通所述主处理芯片10或者接通所述协处理芯片20的存储单元211，以使得所述切换开关262将所述主处理芯片10输出的第一显示数据输出至所述显示屏30或者将所述协处理芯片20输出的第二显示数据输出至所述显示屏30。
当所述控制单元22控制所述切换开关262接通所述主处理芯片10时，所述切换开关262将所述主处理芯片10输出的第一显示数据输出至所述显示屏30，此时所述主处理芯片10控制所述显示屏30以第一显示模式显示信息。当所述控制单元22控制所述切换开关262接通所述协处理芯片20的存储单元211时，所述切换开关262将所述协处理芯片20输出的第二显示数据输出至所述显示屏30，此时所述协处理芯片20控制所述显示屏30以第二显示模式显示信息。
所述电子设备100中，协处理芯片20可以显示通过驱动电路驱动显示屏30显示信息，也即通过数据传输单元VOP、图像处理单元DSC、显示接口标准单元DSI、显示接口DPHY以及切换开关MIPI Switch共同组成的显示驱动电路驱动显示屏30显示信息，因此协处理芯片20可以控制显示屏30刷新所显示的信息。可以理解的，控制显示屏30刷新所显示的信息时，显示屏30的分辨率越高、所显示信息的色彩越丰富时，存储显示数据所需要的存储容量越大。例如，当显示屏30的分辨率为1080*2340，所显示信息的色深为1位时，所需要的存储容量大约为1080*2340/8＝315KB；当显示屏30的分辨率为1080*2340，所显示信息的色深为8位时，所需要的存储容量大约为1080*2340＝2.4MB；当显示屏30的分辨率为1080*2340，所显示信息的色深为16位时，所需要的存储容量大约为1080*2340*2＝4.8MB。其中，色深位数越大，能够显示的色彩就越丰富，常用的色深即为1位、8位、16位等。
因此，在协处理芯片20的存储器SRAM的存储容量有限的情况下，例如存储器SRAM的存储容量为2MB，想要在显示屏30上整屏刷新色彩较为丰富的图像时，就存在问题了。因此，可以在显示屏30上采用区域刷新的方法来实现。
参考图7，图7为本申请实施例提供的电子设备的显示屏30的结构示意图。其中，显示屏30可以划分为多个显示区域，例如划分为显示区域A、显示区域B、显示区域C。当协处理芯片20控制显示屏30刷新时，可以分别控制显示区域A、显示区域B、显示区域C刷新。由于每个显示区域的分辨率都要远小于整个显示屏30的分辨率，因此协处理芯片20每次控制一个显示区域刷新时，所需的存储容量都要远小于控制整个显示屏30刷新时所需的存储容量，从而可以节省协处理芯片20的存储资源。此外，协处理芯片20每次控制一个显示区域刷新时，对待显示图像进行处理时需要处理的数据量更少，相应的运算次数也会更少，并且驱动显示屏30上进行切换的像素点数量也会更少，相比于控制整个显示屏30刷新而言，所需的功耗也更低，从而可以降低电子设备100的功耗。
以下从协处理芯片20控制显示屏30进行区域刷新的方法的角度进一步进行说明。
参考图8，图8为本申请实施例提供的显示屏区域刷新方法的第一种流程示意图。其中，所述显示屏区域刷新方法包括以下步骤：
110，对待显示图像进行处理，以获取所述待显示图像每一像素点的像素值。
协处理芯片20的处理器，诸如处理器MCU，可以用于对待显示图像进行处理，以获取待显示图像每一像素点的像素值。其中，待显示图像即为需要刷新在显示屏30上的某个显示区域进行显示的图像。待显示图像可以为图片对应的显示图像，也可以为文本信息对应的显示图像。可以理解的，像素点的像素值可以包括R(Red，红色)值、G(Green，绿色)值、B(Blue，蓝色)值，也即包括了像素点所需要显示的颜色信息。
120，将所述像素值写入帧缓冲器。
协处理芯片20的存储器，诸如存储器SRAM，可以包括帧缓冲器framebuffer。其中，帧缓冲器framebuffer可以理解为包含了位图信息的一块内存缓冲区。帧缓冲器framebuffer可以用于存储处理器获取到的像素值。协处理芯片20的处理器对待显示图像进行处理，获取到待显示图像每一像素点的像素值后，即可将所述像素值写入所述存储器的帧缓冲器framebuffer。
130，在显示屏上确定待刷新的显示区域。
协处理芯片20可以通过显示驱动电路在显示屏30上确定待刷新的显示区域，例如确定为显示区域A或者显示区域B或者显示区域C。需要说明的是，协处理芯片20通过显示驱动电路在显示屏30上确定待刷新的显示区域时，确定的是显示屏30上需要刷新的像素点的范围。对于显示屏30上预先划分的多个显示区域而言，只要确定了显示区域，显示驱动电路就可以确定需要刷新的像素点的范围。
140，从所述帧缓冲器中加载所述像素值至所述显示区域以对所述显示区域进行刷新。
在显示屏30上确定出待刷新的显示区域后，协处理芯片20即可通过显示驱动电路从帧缓冲器framebuffer中加载存储的像素值至所述待刷新的显示区域以对所述显示区域进行刷新，从而即可实现显示屏30的区域刷新。
可以理解的，所述显示屏区域刷新方法中，由于待刷新的显示区域的分辨率远小于整个显示屏的分辨率，因此控制所述待刷新的显示区域刷新时，所需的存储容量远小于控制整个显示屏刷新时所需的存储容量，从而可以节省协处理芯片的存储资源，也即节省电子设备的存储资源。此外，只控制待刷新的显示区域刷新时，对待显示图像进行处理时需要处理的数据量更少，相应的运算次数也会更少，并且驱动显示屏上进行切换的像素点数量也会更少，相比于控制整个显示屏刷新而言，所需的功耗也更低，从而可以降低电子设备的功耗。
参考图9，图9为本申请实施例提供的显示屏区域刷新方法的第二种流程示意图。其中，步骤130、在显示屏上确定待刷新的显示区域，包括以下步骤：
131，在所述显示屏上确定待刷新的显示区域的至少一个边界点；
132，获取对所述待刷新的显示区域的预设尺寸信息；
133，根据所述至少一个边界点以及所述预设尺寸信息确定所述待刷新的显示区域。
协处理芯片20通过显示驱动电路在显示屏30上确定待刷新的显示区域时，可以首先确定待刷新的显示区域的至少一个边界点。其中，边界点可以理解为待刷新的显示区域边缘的一个点。例如，当待刷新的显示区域为矩形、三角形、菱形等形状时，边界点可以为矩形的顶点、三角形的顶点、菱形的顶点；当待刷新的显示区域为圆形、椭圆形等形状时，边界点可以为圆形边缘上的一个点、椭圆形边缘上的一个点，等等。
确定出至少一个边界点后，协处理芯片20再通过显示驱动电路获取对待刷新的显示区域预先设置的尺寸信息。其中，预设尺寸信息可以是将显示屏30划分为多个显示区域时设置的。预设尺寸信息可以为矩形、三角形、菱形等形状的边长，或者也可以为圆形的半径或者直径，或者也可以为椭圆形的长轴长度和短轴长度。
随后，显示驱动电路便可以根据所确定的至少一个边界点以及预设尺寸信息来确定待刷新的显示区域。
例如，如图10所示，图10为本申请实施例提供的显示屏区域刷新方法中确定待刷新的显示区域的第一种示意图。
其中，待刷新的显示区域可以为矩形区域，矩形区域包括P1、P2、P3、P4四个边界点。其中，P1与P3之间的距离为a，也可以理解为矩形区域的宽度为a。P1与P2之间的距离为b，也可以理解为矩形区域的高度为b。可以理解的，矩形区域的宽度和高度，也即a和b，可以是将显示屏划分为多个显示区域时即预先设置好的。
协处理芯片20通过显示驱动电路在显示屏30上确定待刷新的显示区域时，可以首先在矩形区域的四个边界点中确定出一个边界点，例如确定出边界点P1，随后获取矩形区域的宽度a和高度b，然后即可在显示屏30上确定出待刷新的显示区域。
参考图11，图11为本申请实施例提供的显示屏区域刷新方法中确定待刷新的显示区域的第二种示意图。
其中，待刷新的显示区域为矩形区域时，例如显示屏30上预先划分的多个显示区域都为矩形区域，此时可以在显示屏30上建立预设坐标系。例如，预设坐标系可以为以显示屏30的一个角部为原点建立的直角坐标系，原点的坐标即为(0，0)，直角坐标系包括横轴(x轴)和纵轴(y轴)。通过显示屏30上的每一个像素点在预设坐标系中的坐标即可确定每一个像素点的位置。
协处理芯片20通过显示驱动电路在显示屏30上确定待刷新的显示区域时，可以首先基于建立的预设坐标系在显示屏30上确定待刷新的显示区域的至少一个边界点的横坐标和纵坐标。例如，在显示屏30上确定的边界点为P1，P1的坐标为(x1，y1)，则可以确定边界点P1的横坐标为x1，纵坐标为y1。
显示屏30上划分多个显示区域时，可以设置每个显示区域的宽度尺寸信息和高度尺寸信息。例如，对于待刷新的矩形区域，预先设置的宽度尺寸信息为a，预先设置的高度尺寸信息为b。显示驱动电路在获取待刷新的显示区域的预设尺寸信息时，即可获取矩形区域的宽度尺寸信息a和高度尺寸信息b。
随后，根据所述横坐标x1、纵坐标y1、宽度尺寸信息a以及高度尺寸信息b即可确定出待刷新的显示区域，也即确定出待刷新的矩形区域在显示屏30上的范围。
参考图12，图12为本申请实施例提供的显示屏区域刷新方法的第三种流程示意图。其中，步骤110、对待显示图像进行处理，以获取所述待显示图像每一像素点的像素值之前，还包括：
151，依次获取每一预设显示区域的尺寸信息和色深信息；
152，依次根据每一预设显示区域的尺寸信息和色深信息计算每一预设显示区域进行刷新时所需的缓存容量；
153，从多个所述缓存容量中确定出缓存容量最大的作为目标缓存容量；
154，从存储器中分配出缓冲区域，并将所述缓冲区域确定为帧缓冲器，其中所述缓冲区域的缓存容量为所述目标缓存容量。
可以理解的，协处理芯片20的存储器，诸如存储器SRAM，可以一部分作为帧缓冲器framebuffer用来存储像素点的像素值，另一部分可以作为处理器进行运算时的内存区域，用来存储运算时所需的数据。因此，需要对存储器的存储容量进行分配。
其中，由于显示屏30预先划分为多个显示区域，也即显示屏30包括多个预设显示区域，每一预设显示区域在刷新时都需要使用帧缓冲器framebuffer来存储像素点的像素值，也即所述多个预设显示区域需要共用帧缓冲器framebuffer，因此帧缓冲器framebuffer的存储容量需要满足每一预设显示区域的存储需求。
协处理芯片20的处理器，诸如处理器MCU，在对待显示图像进行处理之前，可以依次获取每一预设显示区域的尺寸信息和色深信息，并依次根据每一预设显示区域的尺寸信息和色深信息计算每一预设显示区域进行刷新时所需的缓存容量，并从计算得到的多个缓存容量中确定出缓存容量最大的作为目标缓存容量。
例如，显示屏30上，预设显示区域A的尺寸信息为440*440，色深信息为8位色深；预设显示区域B的尺寸信息为440*440，色深信息为1位色深；预设显示区域C的尺寸信息为600*600，色深信息为1位色深。那么，处理器即可计算得到预设显示区域A进行刷新时所需的缓存容量约为440*440＝190KB，预设显示区域B进行刷新时所需的缓存容量约为440*440/8＝24KB，预设显示区域C进行刷新时所需的缓存容量约为600*600/8＝44KB。随后，将190KB、24KB、44KB中最大的190KB确定为目标缓存容量。
随后，处理器从存储器中分配出缓冲区域，并将所述缓冲区域确定为帧缓冲器framebuffer。其中，所述缓冲区域的缓存容量为所述目标缓存容量。例如，处理器从存储器中分配出190KB的缓冲区域，并将分配出的190KB缓冲区域确定为帧缓冲器framebuffer。从而，即可实现从存储器中分配出一部分存储区域作为帧缓冲器framebuffer。
步骤110、对待显示图像进行处理，以获取所述待显示图像每一像素点的像素值之后，还包括：
161，对所述像素值进行压缩，以得到压缩数据包；
162，将所述压缩数据包加载到内存区域中；
步骤120、将所述像素值写入帧缓冲器，包括：
121，从所述内存区域中读取所述压缩数据包，并对所述压缩数据包进行解压，以得到所述像素值；
122，将解压得到的所述像素值写入帧缓冲器。
可以理解的，由于处理器对待显示图像进行处理，得到每一像素点的像素值之后，需要把得到的像素值编译到镜像中，镜像也会占用内存区域。其中，所述内存区域也为存储器上的一部分存储区域，例如可以为存储器SRAM上除了帧缓冲器framebuffer之外的存储区域。因此，为了进一步节省对存储区域的占用，可以在得到每一像素点的像素值后，对所述像素值进行压缩，以得到压缩数据包，随后将所述压缩数据包加载到内存区域中，将所述压缩数据包编译到镜像中。由于对像素值进行了压缩，压缩后得到的压缩数据包会大幅减小对存储区域的占用，因此可以进一步节省协处理芯片20的存储资源，也即节省电子设备100的存储资源。由于协处理芯片20的存储资源非常有限，任何节省存储资源的处理都具有重大意义，使协处理芯片20在有限的存储容量下可以进行更多的数据处理。
随后，处理器将像素值写入帧缓冲器framebuffer时，先从内存区域中读取所述压缩数据包，并对所述压缩数据包进行解压以得到所述像素值，随后将解压得到的所述像素值写入帧缓冲器framebuffer。
本申请实施例还提供一种存储介质，所述存储介质中存储有计算机程序，当所述计算机程序在计算机上运行时，所述计算机执行上述任一实施例所述的显示屏区域刷新方法。
需要说明的是，本领域普通技术人员可以理解上述实施例的各种方法中的全部或部分步骤是可以通过计算机程序来指令相关的硬件来完成，所述计算机程序可以存储于计算机可读存储介质中，所述存储介质可以包括但不限于：只读存储器(ROM，Read OnlyMemory)、随机存取存储器(RAM，Random Access Memory)、磁盘或光盘等。
以上对本申请实施例提供的显示屏区域刷新方法、存储介质及电子设备进行了详细介绍。本文中应用了具体个例对本申请的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本申请。同时，对于本领域的技术人员，依据本申请的思想，在具体实施方式及应用范围上均会有改变之处，综上所述，本说明书内容不应理解为对本申请的限制。

Claims (12)

1.一种电子设备，其特征在于，包括主处理芯片、协处理芯片以及显示屏，所述主处理芯片、所述协处理芯片均与所述显示屏电连接，所述协处理芯片的运行功耗小于所述主处理芯片的运行功耗，所述协处理芯片包括：
处理器，用于对待显示图像进行处理，以获取所述待显示图像每一像素点的像素值；
存储器，包括帧缓冲器，所述帧缓冲器用于存储所述像素值；
显示驱动电路，用于在所述显示屏上确定待刷新的显示区域，并从所述帧缓冲器中加载所述像素值至所述显示区域以对所述显示区域进行刷新。
2.根据权利要求1所述的电子设备，其特征在于，所述显示驱动电路用于：
在所述显示屏上确定待刷新的显示区域的至少一个边界点；
获取对所述待刷新的显示区域的预设尺寸信息；
根据所述至少一个边界点以及所述预设尺寸信息确定所述待刷新的显示区域；
从所述帧缓冲器中加载所述像素值至所述显示区域以对所述显示区域进行刷新。
3.根据权利要求2所述的电子设备，其特征在于，所述待刷新的显示区域为矩形区域；
在所述显示屏上确定待刷新的显示区域的至少一个边界点时，所述显示驱动电路用于：基于预设坐标系在所述显示屏上确定待刷新的显示区域的至少一个边界点的横坐标和纵坐标；
获取对所述待刷新的显示区域的预设尺寸信息时，所述显示驱动电路用于：获取所述矩形区域的宽度尺寸信息和高度尺寸信息；
根据所述至少一个边界点以及所述预设尺寸信息确定所述待刷新的显示区域时，所述显示驱动电路用于：根据所述横坐标、所述纵坐标、所述宽度尺寸信息、所述高度尺寸信息确定所述待刷新的显示区域。
4.根据权利要求1至3任一项所述的电子设备，其特征在于，所述显示屏包括多个预设显示区域，对待显示图像进行处理，以获取所述待显示图像每一像素点的像素值之前，所述处理器还用于：
依次获取每一所述预设显示区域的尺寸信息和色深信息；
依次根据每一所述预设显示区域的尺寸信息和色深信息计算每一所述预设显示区域进行刷新时所需的缓存容量；
从多个所述缓存容量中确定出缓存容量最大的作为目标缓存容量；
从所述存储器中分配出缓冲区域，并将所述缓冲区域确定为帧缓冲器，其中所述缓冲区域的缓存容量为所述目标缓存容量。
5.根据权利要求1至3任一项所述的电子设备，其特征在于，对待显示图像进行处理，以获取所述待显示图像每一像素点的像素值之后，所述处理器还用于：
对所述像素值进行压缩，以得到压缩数据包；
将所述压缩数据包加载到所述存储器的内存区域中；
从所述内存区域中读取所述压缩数据包，并对所述压缩数据包进行解压，以得到所述像素值；
所述帧缓冲器用于存储所述处理器解压得到的所述像素值。
6.一种显示屏区域刷新方法，应用于电子设备，其特征在于，所述电子设备包括主处理芯片、协处理芯片以及显示屏，所述主处理芯片、所述协处理芯片均与所述显示屏电连接，所述协处理芯片的运行功耗小于所述主处理芯片的运行功耗，所述显示屏区域刷新方法由所述协处理芯片执行，所述显示屏区域刷新方法包括：
对待显示图像进行处理，以获取所述待显示图像每一像素点的像素值；
将所述像素值写入帧缓冲器；
在所述显示屏上确定待刷新的显示区域；
从所述帧缓冲器中加载所述像素值至所述显示区域以对所述显示区域进行刷新。
7.根据权利要求6所述的显示屏区域刷新方法，其特征在于，所述在所述显示屏上确定待刷新的显示区域，包括：
在所述显示屏上确定待刷新的显示区域的至少一个边界点；
获取对所述待刷新的显示区域的预设尺寸信息；
根据所述至少一个边界点以及所述预设尺寸信息确定所述待刷新的显示区域。
8.根据权利要求7所述的显示屏区域刷新方法，其特征在于，所述待刷新的显示区域为矩形区域；
所述在所述显示屏上确定待刷新的显示区域的至少一个边界点，包括：基于预设坐标系在所述显示屏上确定待刷新的显示区域的至少一个边界点的横坐标和纵坐标；
所述获取对所述待刷新的显示区域的预设尺寸信息，包括：获取所述矩形区域的宽度尺寸信息和高度尺寸信息；
所述根据所述至少一个边界点以及所述预设尺寸信息确定所述待刷新的显示区域，包括：根据所述横坐标、所述纵坐标、所述宽度尺寸信息、所述高度尺寸信息确定所述待刷新的显示区域。
9.根据权利要求6至8任一项所述的显示屏区域刷新方法，其特征在于，所述显示屏包括多个预设显示区域，所述协处理芯片包括存储器，所述对待显示图像进行处理，以获取所述待显示图像每一像素点的像素值之前，还包括：
依次获取每一所述预设显示区域的尺寸信息和色深信息；
依次根据每一所述预设显示区域的尺寸信息和色深信息计算每一所述预设显示区域进行刷新时所需的缓存容量；
从多个所述缓存容量中确定出缓存容量最大的作为目标缓存容量；
从所述存储器中分配出缓冲区域，并将所述缓冲区域确定为帧缓冲器，其中所述缓冲区域的缓存容量为所述目标缓存容量。
10.根据权利要求6至8任一项所述的显示屏区域刷新方法，其特征在于，所述对待显示图像进行处理，以获取所述待显示图像每一像素点的像素值之后，还包括：
对所述像素值进行压缩，以得到压缩数据包；
将所述压缩数据包加载到内存区域中；
所述将所述像素值写入帧缓冲器，包括：
从所述内存区域中读取所述压缩数据包，并对所述压缩数据包进行解压，以得到所述像素值；
将解压得到的所述像素值写入帧缓冲器。
11.一种存储介质，其特征在于，所述存储介质中存储有计算机程序，当所述计算机程序在计算机上运行时，使得所述计算机执行权利要求6至10任一项所述的显示屏区域刷新方法。
12.一种电子设备，其特征在于，用于执行权利要求6至10任一项所述的显示屏区域刷新方法。
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