CN112905376B - 一种错误上报的方法、装置及介质 - Google Patents

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Abstract

本发明公开了一种错误上报的方法，应用于服务器BIOS，包括以下步骤：进行硬件拓扑连接，将所述服务器中CPU与PCH的输入输出引脚连接，并通过所述CPU的错误处理信号控制输入输出引脚的状态；设置错误信息的阈值和漏错机制以及配置寄存器及输入输出引脚；根据所述输入输出引脚判断是否产生中断，若产生中断则执行中断策略；发送中断信息至BMC以及服务器的系统中；通过上述方式，本发明能够当出现内存错误时不会使用SMI进行内存CE错误信息上报，采用SCI通知OS的ACPI驱动，调用BIOS的ASL方法进行内存错误信息上报，取消了服务器系统进入SMM进行CE处理，可以解决影响系统性能问题。

Description

一种错误上报的方法、装置及介质
技术领域
本发明涉及固件技术领域，特别是涉及一种错误上报的方法、装置及介质。
背景技术
随着服务器技术的快速发展，易用性，性能及功能都在不断增强。随着功能增多，服务器稳定性与可靠性可能会随之下降，而稳定性和可靠性是用户对服务器系统的基本要求。 BIOS（Basic Input Output System）基本输入输出系统，作为服务器主板最底层的、最直接的硬件设置和控制的管理者，能为服务器提供更多简单的易用性功能。BIOS是一组固化到主板上一个ROM芯片上的程序，它保存着计算机最重要的基本输入输出的程序、系统设置信息、开机后自检程序和系统自启动程序，其主要功能是为计算机提供最底层的、最直接的硬件设置和控制，以及检测硬件错误进行错误处理及错误上报。当前服务器系统当检测到硬件错误时，最常用的是通过触发SMI，让BIOS进入SMM，然后进行错误处理及上报。但是由于SMM进入退出都是会产生一些延时，且进入SMM后会影响系统性能，而有的时候客户业务运行是对系统性能有很高的要求。
发明内容
本发明主要解决是服务器现有错误处理机制中通过调用SMI进行错误信息上报时会占用大量系统资源，严重影响服务器系统性能的问题。
为解决上述技术问题，本发明采用的一个技术方案是：提供一种错误上报的方法，应用于服务器中BIOS，包括以下步骤：
部署环境：进行硬件拓扑连接，将所述服务器中CPU与PCH的输入输出引脚连接，并通过所述CPU的错误处理信号控制所述输入输出引脚的状态；
设置条件：设置错误信息的阈值和漏错机制以及配置寄存器和配置所述输入输出引脚；
判断是否产生中断：根据所述输入输出引脚的状态判断是否产生中断，若产生中断则执行中断策略；
执行中断策略：发送错误信息至BMC以及服务器的系统中。
优选的，所述配置寄存器的步骤进一步包括：将服务器中设备产生的错误信息的数据值与所述错误信息的阈值进行比较；
当所述错误信息的数据值不小于所述阈值时，所述错误处理信号控制所述输入输出引脚改变状态，且所述CPU不产生系统中断信息。
优选的，所述配置输入输出引脚的步骤进一步包括：当所述输入输出引脚的状态改变时，进行使能并产生中断。
优选的，所述发送错误信息至BMC以及服务器的系统中的步骤进一步包括：
读取所述服务器中设备产生的错误信息，并进行存储；
将所述错误信息发送至BMC；
设置系统中断信号；
将所述错误信息写入平台错误接口中；
当所述系统中断信号触发时，通知所述系统，所述服务器中设备产生所述错误信息；
所述服务器的系统接收所述平台错误接口中的所述错误信息，并保存至系统日志。
优选的，所述漏错机制为：设置存储数据的阈值，当所述服务器中设备存储的数据大于所述存储数据的阈值时，将所述服务器中设备存储的数据等于所述存储数据的阈值的数据记为第一数据，其余数据为第二数据；所述第二数据为所述错误信息。
本发明还提供一种错误上报的装置，包括：BMC、CPU、PCH、上报系统；
所述CPU分别与所述PCH、所述上报系统和所述BMC连接；
所述上报系统和所述BMC连接；
所述上报系统包括中断条件设置模块、判断模块和中断策略模块；
所述中断条件设置模块用于设置错误信息的阈值和漏错机制以及配置寄存器以及配置输入输出引脚；
所述判断模块用于根据所述输入输出引脚的状态判断是否产生中断；
所述中断策略模块用于创建中断策略，执行中断策略。
作为本发明一种错误上报的装置的进一步改进：所述中断策略模块包括存储模块和写入模块；
所述存储模块用于存储服务器产生的错误信息；
所述写入模块用于将所述错误信息写入至所述BMC以及平台错误接口中。
本发明还提供一种计算机可读存储介质，所述计算机可读存储介质存储有计算机程序，所述计算机程序被处理器执行时，实现所述的一种错误上报的方法的步骤。
本发明的有益效果是：
1、本发明所述的错误上报的方法，当出现内存错误时不会使用SMI进行内存CE错误信息上报，而是采用SCI通知OS的ACPI驱动，调用BIOS的ASL方法进行内存错误信息上报，取消了服务器系统进入SMM进行CE处理，从而可以解决影响系统性能问题。
2、本发明所述的错误上报的系统，可以解决Intel架构服务器现有内存CE处理机制中通过调用SMI进行内存CE错误信息上报时会占用大量系统资源，严重影响服务器系统性能的问题。
3、本发明所述的计算机可读存储介质，可以实现能够通过漏错机制进行过滤多余的内存，并且通过设置好的CE阈值进行判断是否进行保存，当达到阈值时，使用中断策略进行报错，从而节省系统资源，使服务器更快响应。
附图说明
为了更清楚地说明本发明具体实施方式或现有技术中的技术方案，下面将对具体实施方式或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图是本发明的一些实施方式，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本发明实施例1所述的一种错误上报的方法示意图；
图2是本发明实施例2所述的一种错误上报的系统架构示意图。
具体实施方式
下面将结合附图对本发明的技术方案进行清楚、完整地描述，显然，所描述的实施例是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
在本发明的描述中，需要说明的是，除非另有明确的规定和限定，术语“安装”、“相连”、“连接”应做广义理解，例如，可以是固定连接，也可以是可拆卸连接，或一体地连接；可以是机械连接，也可以是电连接；可以是直接相连，也可以通过中间媒介间接相连，还可以是两个元件内部的连通，可以是无线连接，也可以是有线连接。对于本领域的普通技术人员而言，可以具体情况理解上述术语在本发明中的具体含义。
需要说明的是，在本发明的描述中
CPU（Central Processing Unit）是中央处理器；
ACPI（Advanced Configuration and Power Interface）是高级配置和电源接口；
APEI（ACPI Platform Error Interface ACPI）是平台错误接口，用于将错误信息传给OS；
OS （Operating System）是操作系统；
BMC（Board Management Controller）是基板管理控制器；
CE （Correctable Error）可修复错误；
ERR#0是 Intel CPU中的一个Error处理信号；
GPIO（General Purpose Input/Output）是通用输入输出接口；
IPMI（Intelligent Platform Management Interface）是智能平台管理接口；
PCH（Platform Controller Hub）是平台控制器中枢，Intel架构服务器中的南桥芯片；
ASL的全称是ACPI Source language，它是用来描述硬件信息以及相关硬件操作给OS使用的表达式。
SMI（System Management Interrupt）是系统管理中断，CPU提供了SMI系统管理中断。使用时CPU要进入系统管理模式System Management Mode(SMM)中，CPU需要一块内存区域SMRAM。CPU在进入SMM前，会把寄存器的值存储SMRAM中，再将程序跳转到SMI ENTRYPOINT去执行，处理完后再利用RSM指令跳转回原来的地方继续执行，同时恢复CPU寄存器的值；
SMM（System Management Mode）是系统管理模式，CPU进入SMM模式后，执行BIOS的SMI代码；SMM模式通过调用SMI进入，进入之后，SMI就会disable，不过系统会暂存一个且只有一个SMI，当SMM模式退出时，检测到这个SMI会再次进入SMM模式。
SCI（Serial Communication Interface），即串行通信接口，是一个双线的异步串口，即具有接收和发送两根信号线的异步串口，一般可以看作是 UART （通用异步接收/发送装置）
实施例1
本发明实施例提供一种错误上报的方法，应用于服务器中BIOS，请参阅图1，包括以下步骤：
S100，部署环境，进行硬件拓扑连接，将CPU与PCH连接，使CPU传输的ERR#0信号连接到PCH上的一个GPIO上，并用来控制GPIO的电平；
S200，在BIOS开机过程中设置CE的阈值以及漏错机制，
在BIOS开机过程中配置寄存器，配置寄存器具体步骤为：
根据CPU中或者其他设备的CE错误信息的数据值并与阈值进行比较，当CE错误信息数据值达到阈值时，下拉ERR#0信号并控制GPIO电平变化，并且CPU不产生SMI；
漏错机制为设置内存或者其他设备中的存储数据的阈值，当内存中存储的数据大于阈值时，将大于阈值部分的数据从内存中溢出，溢出部分的数据为第二数据，第二数据就是CE错误信息；
配置PCH上的GPIO，使GPIO能够使能SCI功能，当GPIO的电信号改变时产生SCI中断；
S300，设置中断策略，当产生SCI中断时执行中断策略；
中断策略为：进行读取系统产生的CE错误信息，并进行存储，并通过IPMI将CE错误信息发送至BMC；并且将错误信息填充至APEI中，设置OS中断信号，当OS中断信号触发时，通知OS的ACPI驱动产生了CE错误信息，并且通知OS接收APEI中的信息，并将APEI中信息保存至系统日志中；中断策略使用ASL语言进行编写。
本实施例以Intel平台的服务器架构做说明，但该方法不限于Intel平台的服务器，也不仅限于服务器系统，在其它平台的服务器系统或者其他计算机系统上仍然具有通用的应用价值，本实施例也不仅仅局限于内存CE，如PCIE的CE等也是可以采用类似方法处理。
实施例2
本发明实施例还提供一种错误上报的装置，请参阅图2，包括：BMC、CPU、PCH、上报系统；
所述CPU分别与所述PCH、所述上报系统和所述BMC连接；
所述上报系统和所述BMC连接；
所述上报系统包括中断条件设置模块、判断模块和中断策略模块；
所述中断条件设置模块用于设置错误信息的阈值和漏错机制以及配置寄存器以及配置输入输出引脚；
所述判断模块用于根据所述输入输出引脚判断是否产生中断；
所述中断策略模块用于创建中断策略，执行中断策略。
所述中断策略模块包括存储模块和写入模块；
存储模块用于存储服务器产生的错误信息；
写入模块用于将所述错误信息写入至所述BMC以及平台错误接口中。
基于与前述实施例中方法同样的发明构思，本说明书实施例还提供一种计算机可读存储介质，计算机可读存储介质上存储有计算机程序，计算机程序被处理器执行时实现如前述公开的一种错误上报的方法的步骤。
上述本发明实施例公开实施例序号仅仅为了描述，不代表实施例的优劣。
本领域普通技术人员可以理解实现上述实施例的全部或部分步骤可以通过硬件来完成，也可以通过程序来指令相关的硬件完成的程序可以存储于一种计算机可读存储介质中，上述提到的存储介质可以是只读存储器，磁盘或光盘等。
以上所述仅为本发明的实施例，并非因此限制本发明的专利范围，凡是利用本发明说明书及附图内容所作的等效结构或等效流程变换，或直接或间接运用在其他相关的技术领域，均同理包括在本发明的专利保护范围内。

Claims (3)

1.一种错误上报的方法，应用于服务器中BIOS，其特征在于，包括以下步骤：
部署环境：进行硬件拓扑连接，将所述服务器中CPU与PCH的输入输出引脚连接，并通过所述CPU的错误处理信号控制所述输入输出引脚的状态；
设置条件：设置错误信息的阈值和漏错机制以及配置寄存器和配置所述输入输出引脚；
判断是否产生中断：根据所述输入输出引脚的状态判断是否产生中断，若产生中断则执行中断策略；
执行中断策略：发送错误信息至BMC以及所述服务器的系统中；
所述配置寄存器的步骤进一步包括：将服务器中设备产生的错误信息的数据值与所述错误信息的阈值进行比较；
当所述错误信息的数据值不小于所述阈值时，所述错误处理信号控制所述输入输出引脚改变状态，且所述CPU不产生SMI；
所述配置输入输出引脚的步骤进一步包括：当所述输入输出引脚的状态改变时，进行使能并产生SCI中断；
所述发送错误信息至BMC以及服务器的系统中的步骤进一步包括：
进行读取系统产生的CE错误信息，并进行存储，并通过IPMI将CE错误信息发送至BMC；并且将CE错误信息填充至APEI中，设置OS中断信号，当OS中断信号触发时，通知OS的ACPI驱动产生了CE错误信息，并且通知OS接收APEI中的信息，并将APEI中的信息保存至系统日志中；
所述漏错机制为：设置存储数据的阈值，当所述服务器中设备存储的数据大于所述存储数据的阈值时，将所述服务器中设备存储的数据等于所述存储数据的阈值的数据记为第一数据，其余数据为第二数据；所述第二数据为CE错误信息。
2.一种错误上报的装置，其特征在于，包括：BMC、CPU、PCH、上报系统；
所述CPU分别与所述上报系统和所述BMC连接；所述CPU与PCH的输入输出引脚连接，并通过所述CPU的错误处理信号控制所述输入输出引脚的状态；
所述上报系统和所述BMC连接；
所述上报系统包括中断条件设置模块、判断模块和中断策略模块；
所述中断条件设置模块用于设置错误信息的阈值和漏错机制以及配置寄存器以及配置输入输出引脚；
所述判断模块用于根据所述输入输出引脚的状态判断是否产生中断；
所述中断策略模块用于创建中断策略，执行中断策略；
所述中断策略模块包括存储模块和写入模块；
所述存储模块用于存储服务器产生的错误信息；
所述写入模块用于将所述错误信息写入至所述BMC以及平台错误接口中；
所述配置寄存器包括：将服务器中设备产生的错误信息的数据值与所述错误信息的阈值进行比较；当所述错误信息的数据值不小于所述阈值时，所述错误处理信号控制所述输入输出引脚改变状态，且所述CPU不产生SMI；
所述配置输入输出引脚包括：当所述输入输出引脚的状态改变时，进行使能并产生SCI中断；
所述将所述错误信息写入至所述BMC以及平台错误接口中包括：进行读取系统产生的CE错误信息，并进行存储，并通过IPMI将CE错误信息发送至BMC；并且将CE错误信息填充至APEI中，设置OS中断信号，当OS中断信号触发时，通知OS的ACPI驱动产生了CE错误信息，并且通知OS接收APEI中的信息，并将APEI中的信息保存至系统日志中；
所述漏错机制为：设置存储数据的阈值，当所述服务器中设备存储的数据大于所述存储数据的阈值时，将所述服务器中设备存储的数据等于所述存储数据的阈值的数据记为第一数据，其余数据为第二数据；所述第二数据为CE错误信息。
3.一种计算机可读存储介质，所述计算机可读存储介质存储有计算机程序，其特征在于，所述计算机程序被处理器执行时，实现权利要求1所述的一种错误上报的方法的步骤。
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