CN112492748A - 一种弹载、机载、车载数据处理印制板 - Google Patents

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Abstract

本发明公开了一种弹载、机载、车载数据处理印制板，数据处理印制板设置于整机地壳内，包括设置有FPGA的第一PCB板，第一PCB板设置有镂空区，镂空区设置有第二PCB板，第二PCB板与第一PCB板之间填充有隔离带；第二PCB板上设置有ADC芯片、射频连接头座和连接模块；ADC芯片的模拟地通过第一跳线导接至整机地壳；ADC芯片的数字地通过第二跳线与第一PCB板的接地位导接；第二跳线为跨越隔离带并桥接于第二PCB板和第一PCB板的连接模块；FPGA的数字地与第一PCB板的接地位连通，且第一PCB板的接地位导接至整机地壳。本发明的目的在于提供一种弹载、机载、车载数据处理印制板，通过将ADC芯片的模拟地单独导接至整机，有效的降低了底噪毛刺信号。

Description

一种弹载、机载、车载数据处理印制板
技术领域
本发明涉及中频处理模块技术领域，尤其涉及一种弹载、机载、车载数据处理印制板。
背景技术
中频处理模块用于雷达目标模拟信号处理，主要特点为高速数据采样和储存、单边调制技术以及瞬时AGC技术。
现有技术中，如图1所示， FPGA的数字地、ADC芯片的数字地以及ADC芯片的模拟地通过金属化孔连在一起，即：FPGA的数字地、ADC芯片的数字地以及ADC芯片的模拟地共地设置，由于外界的信号会对模拟信号产生干扰，因此，在中频处理模块的PCB板上增设有屏蔽盒，并使得共地设置的FPGA的数字地、ADC芯片的数字地以及ADC芯片的模拟地能够通过屏蔽盒导给整机。
但是在具体使用的过程中会存在少量的底噪，底噪的出现不仅会导致信号识别错误，还会对基准信号的判定带来影响。
发明内容
本发明的目的在于提供一种弹载、机载、车载数据处理印制板，通过将ADC芯片的模拟地单独导接至整机，有效的降低了底噪毛刺信号。
本发明通过下述技术方案实现：
一种弹载、机载、车载数据处理印制板，所述数据处理印制板设置于整机地壳内，其特征在于，包括设置有FPGA的第一PCB板，所述第一PCB板设置有镂空区，所述镂空区设置有第二PCB板，且所述第二PCB板与所述第一PCB板之间填充设置有隔离带；
所述第二PCB板上设置有ADC芯片和射频连接头座；
所述ADC芯片的模拟地通过第一跳线导接至所述整机地壳；其中，所述第一跳线为与所述射频连接头座连接的射频连接线的外屏蔽层；
还包括跨越所述隔离带并桥接于所述第二PCB板和所述第一PCB板的连接模块，所述ADC芯片的数字地通过所述连接模块与所述第一PCB板的接地位导接；
所述FPGA的数字地与所述第一PCB板的接地位连通，且所述第一PCB板的接地位导接至所述整机地壳。
优选地，所述连接模块包括相互连通的第一接地位和第二接地位，所述第一接地位设置于所述第一PCB板，所述第二接地位设置于所述第二PCB板，且所述第二接地位与所述ADC芯片的数字地连接，所述第一接地位与所述第一PCB板的接地位连通。
优选地，所述整机地壳上设置有第一连接器，所述射频连接线的外屏蔽层连接于所述射频连接头座和所述第一连接器。
优选地，所述第一PCB板上还设置有时钟模块，所述时钟模块通过第三跳线与所述整机地壳连接。
优选地，所述第三跳线为同轴信号线缆。
优选地，所述整机地壳上设置有第二连接器，所述同轴信号线缆连接于所述时钟模块和所述第二连接器。
优选地，所述第一PCB板的接地位与所述时钟模块连通，所述第一PCB板的接地位通过所述同轴信号线缆的屏蔽层导接至所述整机地壳。
优选地，所述隔离带的材质为环氧树脂。
优选地，所述隔离带的宽度为1.5cm-3.5cm。
本发明与现有技术相比，具有如下的优点和有益效果：
1、FPGA所在的第一PCB板和ADC芯片所在的第二PCB板隔离设置，可有效避免第一PCB板的信号对ADC芯片的模拟信号带来的干扰；
2、将ADC芯片的模拟地单独导接至整机，有效的降低了底噪毛刺信号；
3、设置有一个连接模块，用于将ADC芯片的数字地与第一PCB板的接地位导接，从而使得一个接地位便可以将ADC芯片的数字地与FPGA的数字地导接至整机地壳，优化数据处理印制板的布局。
附图说明
在附图中：
图1为现有技术的连接结构示意图；
图2为本发明的电路结构原理图；
图3为本发明的连接结构示意图；
图4为现有技术测试效果示意图；
图5为本发明测试效果示意图；
附图中标记及对应的零部件名称：
1、第一PCB板；2、第二PCB板；3、隔离带；4、ADC芯片；5、连接模块；6、射频连接头座；7、整机地壳；8、第一跳线；9、接地位；10、第三跳线；11、金属化孔；12、地线；13、屏蔽盒；501、第一接地位；502、第二接地位。
具体实施方式
为使本发明的目的、技术方案和优点更加清楚明白，下面结合实施例和附图，对本发明作进一步的详细说明，本发明的示意性实施方式及其说明仅用于解释本发明，并不作为对本发明的限定。
一种弹载、机载、车载数据处理印制板，如图2和图3所示，数据处理印制板设置于整机地壳7内，其中，数据处理印制板包括设置有FPGA的第一PCB板1，第一PCB板1设置有镂空区，镂空区固定设置有第二PCB板2，且第二PCB板2与第一PCB板1之间填充设置有环氧树脂，用于将第一PCB板1和第二PCB板2隔离开，从而避免第一PCB板1的信号对ADC芯片4的模拟信号造成干扰；
第二PCB板2上设置有ADC芯片4和射频连接头座6；
ADC芯片4的模拟地通过第一跳线8导接至整机地壳7；其中，第一跳线8为与射频连接头座6连接的射频连接线的外屏蔽层；
还包括跨越隔离带3并桥接于所述第二PCB板2和所述第一PCB板1的连接模块5，ADC芯片4的数字地通过连接模块5与第一PCB板1的接地位9导接。
本实施例的连接模块5包括相互连通的第一接地位501和第二接地位502，其中，第一接地位501设置于第一PCB板1，第二接地位502设置于第二PCB板2，且第二接地位502与ADC芯片4的数字地连接，第一接地位501与第一PCB板1的接地位9连通。
FPGA的数字地与第一PCB板1的接地位9连通，且第一PCB板1的接地位9导接至整机地壳7
现有技术中，如图1所示，FPGA的数字地、ADC芯片4的数字地以及ADC芯片4的模拟地通过金属化孔11连在一起，即：FPGA的数字地、ADC芯片4的数字地以及ADC芯片4的模拟地共地设置，由于外界的干扰信号会对模拟信号产生干扰，因此，在中频处理模块的PCB板上增设有屏蔽盒13，并使得共地设置的FPGA的数字地、ADC芯片4的数字地以及ADC芯片4的模拟地能够通过屏蔽盒13导给整机。但是这种结构的印制板在使用中存在0db左右的底噪毛刺信号，如图4所示，虽然这个底噪毛刺信号的强度不大，只有0db左右，在通用领域不会产生多大影响，但是在军工行业中，0db左右的干扰信号会对基准信号的判定带来影响，一旦基准信号判定错误，将会导致信息接收或判定的不准确，从而在军事演练或军事作战中错失先机，造成不可挽回的损失。
基于此，在发明人在排除更换信号源、电缆线等外围仪器设备后，认为底噪毛刺干扰问题可能是由于将FPGA的数字地、ADC芯片4的数字地以及ADC芯片4的模拟地通过金属化孔11连通在一起导致的。因此，发明人尝试采用以ADC芯片4的模拟地、ADC芯片4的数字地以及FPGA的数字地隔离设置的方式代替现有的共地设置的方式，同时为了简化PCB板的整体结构，优化布局。增设了一个连接模块5，用于将ADC芯片4的数字地与第一PCB板1的接地位9导接，从而使得一个接地位9便可以将ADC芯片4的数字地与FPGA的数字地导接至整机地壳7。同时为了防止外界的信号会对模拟信号产生干扰，在第二PCB板2上还设置有屏蔽罩。基于这种结构进行测试时，底噪毛刺信号虽有所降低，但效果并不明显。因此发明人又认为屏蔽罩对底噪毛刺干扰问题的产生有一定影响，基于此，发明人在上述结构的基础上对整体结构又一步做了改进，舍弃了传统用于屏蔽作用的屏蔽罩，采用在第一PCB板1和第二PCB板2之间填充一层隔离带3的方式将第一PCB板1和第二PCB板2隔离开，从而防止第一PCB板1的信号对ADC芯片4的模拟信号造成干扰，基于这种结构再测试，发现底噪信号可有效降低至-20db左右，如图5所示。
进一步地，在本实施例中，整机地壳7上设置有第一连接器，射频连接线的外屏蔽层连接于射频连接头座6和第一连接器，从而使得ADC芯片4的模拟地通过射频连接线的外屏蔽层导接至整机地壳7。
进一步地，在本实施例中，整机地壳7上设置有第二连接器，第一PCB板1上还设置有时钟模块，时钟模块通过同轴信号线缆与第二连接器连接，用于将外部时钟信号传输至时钟传输模块，从而可以对时钟模块进行校正。
进一步地，在本实施例中，第一PCB板1的接地位9与时钟模块连通，从而使得ADC芯片4的数字地与FPGA芯片的数字地可以通过同轴信号线缆的屏蔽层导接至整机地壳7。
进一步地，在本实施例中，隔离带3的宽度为1.5cm-3.5cm。
在本技术方案中，隔离带3是用于将第一PCB板1和第二PCB板2隔离开，从而避免第一PCB板1上的信号对ADC芯片4的模拟信号带来干扰。如果隔离带3的宽度设置过窄，则不能很好的起到隔离作用，会给模拟信号带来干扰；如果设置过宽，不仅会造成浪费，还会对整体的板体结构布局带来影响。因此发明人通过多次尝试得出，隔离带3的宽度设置为1.5cm-3.5cm时，整体效果最佳。作为优选地，隔离带3的宽度设置为2cm。
以上所述的具体实施方式，对本发明的目的、技术方案和有益效果进行了进一步详细说明，所应理解的是，以上所述仅为本发明的具体实施方式而已，并不用于限定本发明的保护范围，凡在本发明的精神和原则之内，所做的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (9)

1.一种弹载、机载、车载数据处理印制板，所述数据处理印制板设置于整机地壳(7)内，其特征在于，包括设置有FPGA的第一PCB板(1)，所述第一PCB板(1)设置有镂空区，所述镂空区设置有第二PCB板(2)，且所述第二PCB板(2)与所述第一PCB板(1)之间填充设置有隔离带(3)；
所述第二PCB板(2)上设置有ADC芯片(4)和射频连接头座(6)；
所述ADC芯片(4)的模拟地通过第一跳线(8)导接至所述整机地壳(7)；其中，所述第一跳线(8)为与所述射频连接头座(6)连接的射频连接线的外屏蔽层；
还包括跨越所述隔离带(3)并桥接于所述第二PCB板(2)和所述第一PCB板(1)的连接模块(5)，所述ADC芯片(4)的数字地通过所述连接模块(5)与所述第一PCB板(1)的接地位(9)导接；
所述FPGA的数字地与所述第一PCB板(1)的接地位(9)连通，且所述第一PCB板(1)的接地位(9)导接至所述整机地壳(7)。
2.根据权利要求1所述的一种弹载、机载、车载数据处理印制板，其特征在于，所述连接模块(5)包括相互连通的第一接地位(501)和第二接地位(502)，所述第一接地位(501)设置于所述第一PCB板(1)，所述第二接地位(502)设置于所述第二PCB板(2)，且所述第二接地位(502)与所述ADC芯片(4)的数字地连接，所述第一接地位(501)与所述第一PCB板(1)的接地位(9)连通。
3.根据权利要求1所述的一种弹载、机载、车载数据处理印制板，其特征在于，所述整机地壳(7)上设置有第一连接器，所述射频连接线的外屏蔽层连接于所述射频连接头座(6)和所述第一连接器。
4.根据权利要求1所述的一种弹载、机载、车载数据处理印制板，其特征在于，所述第一PCB板(1)上还设置有时钟模块，所述时钟模块通过第三跳线(10)与所述整机地壳(7)连接。
5.根据权利要求4所述的一种弹载、机载、车载数据处理印制板，其特征在于，所述第三跳线(10)为同轴信号线缆。
6.根据权利要求5所述的一种弹载、机载、车载数据处理印制板，其特征在于，所述整机地壳(7)上设置有第二连接器，所述同轴信号线缆连接于所述时钟模块和所述第二连接器。
7.根据权利要求6所述的一种弹载、机载、车载数据处理印制板，其特征在于，所述第一PCB板(1)的接地位(9)与所述时钟模块连通，所述第一PCB板(1)的接地位(9)通过所述同轴信号线缆的屏蔽层导接至所述整机地壳(7)。
8.根据权利要求1-7中任意一项所述的一种弹载、机载、车载数据处理印制板，其特征在于，所述隔离带(3)的材质为环氧树脂。
9.根据权利要求8所述的一种弹载、机载、车载数据处理印制板，其特征在于，所述隔离带(3)的宽度为1.5cm-3.5cm。
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