CN112447230A - 显示装置、电子系统以及控制方法 - Google Patents
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Abstract
本发明提供一种显示装置、电子系统以及控制方法。显示装置包含有一存储器装置。存储器装置包含有一存储器阵列、一输入输出逻辑电路以及一控制逻辑电路。存储器阵列包含有多个子阵列，且每一子阵列存储有一延伸显示能力识别数据。输入输出逻辑电路用来接收来自一主机端装置的一识别数据请求，并根据该识别数据请求决定是否执行一识别数据存取程序。控制逻辑电路用来根据一存储器位址信息读取出该存储器阵列的该多个子阵列中的一目标子阵列中所存储的延伸显示能力识别数据，以响应于决定执行该识别数据存取程序。
Description
技术领域
本发明涉及一种显示装置、电子系统以及控制方法，特别涉及一种可简化电路设计且可避免电容效应所导致的错误异常的显示装置、电子系统以及控制方法。
背景技术
一般来说，当影像来源端与显示装置连接后，影像来源端会去读取显示装置中的延伸显示能力识别数据(Extended Display Identification Data，EDID)以取得显示装置的原始分辨率(native resolution)，并根据所取得的延伸显示能力识别数据来将分辨率相符的显示影像提供至显示装置。延伸显示能力识别数据通常是存储在电子抹除式可复写只读存储器(Electrically-Erasable Programmable Read-Only Memory，EEPROM)中。
依据使用者的使用需求，在不同的显示模式下需要切换不同原始分辨率。传统显示装置通常将具有不同原始分辨率的延伸显示能力识别数据存储在多个存储器装置中，再依据需求不同呼叫存取各存储器装置来取得相应原始分辨率的延伸显示能力识别数据。请参考图1，图1为传统电子系统1的示意图。电子系统1包含有一主机端装置10以及一显示装置12。显示装置12包含有一控制器120以及存储器装置122、124、126、128。存储器装置122、124、126、128为电子抹除式可复写只读存储器。存储器装置122存储有延伸显示能力识别数据EDID1，存储器装置124存储有延伸显示能力识别数据EDID2，存储器装置126存储有延伸显示能力识别数据EDID3以及存储器装置128存储有延伸显示能力识别数据EDID4。主机端装置10与存储器装置122、124、126、128通过内部集成电路总线接口来进行通信。在不同的显示模式下，主机端装置10通过I2C总线命令去存取相应存储器装置上的一固定装置位址上所存储的延伸显示能力识别数据。也就是说，主机端装置10会通过I2C总线命令去呼叫相应存储器装置并提供一固定装置位址以存取延伸显示能力识别数据。然而，设置多个存储器装置将造成电路设计变得非常复杂，而且电路基板与多个存储器装置之间存在的杂散电容效应很容易使传输信号产生错误而导致传输接口测试异常或功能失效的问题。因此，现有技术实有改善的必要。
发明内容
为了解决上述的问题，本发明提供一种可简化电路设计且可避免电容效应所导致的错误异常的显示装置、电子系统以及控制方法，以解决上述问题。
本发明提供一种显示装置，包含有：一存储器装置，包含有：一存储器阵列，包含有多个子阵列，每一子阵列存储有一延伸显示能力识别数据；一输入输出逻辑电路，用来接收来自一主机端装置的一识别数据请求，并根据该识别数据请求决定是否执行一识别数据存取程序；以及一控制逻辑电路，用来根据一存储器位址信息读取出该存储器阵列的该多个子阵列中的一目标子阵列中所存储的延伸显示能力识别数据，以响应于决定执行该识别数据存取程序。
本发明另提供一种控制方法，用于一显示装置，该显示装置包含有一存储器装置，该存储器装置包含有一存储器阵列，该存储器阵列包含有多个子阵列，每一子阵列存储有一延伸显示能力识别数据，该控制方法包含有：接收来自一主机端装置的一识别数据请求；根据该识别数据请求决定是否执行一识别数据存取程序；以及响应于决定执行该识别数据存取程序，根据一存储器位址信息读取出该存储器阵列的该多个子阵列中的一目标子阵列中所存储的延伸显示能力识别数据。
本发明另提供一种电子系统，包含有：一主机端装置，用来传送出一识别数据请求；以及一显示装置，包含有：一存储器装置，包含有：一存储器阵列，包含有多个子阵列，每一子阵列存储有一延伸显示能力识别数据；一输入输出逻辑电路，用来接收该识别数据请求，并根据该识别数据请求决定是否执行一识别数据存取程序；以及一控制逻辑电路，用来根据一存储器位址信息读取出该存储器阵列的该多个子阵列中的一目标子阵列中所存储的延伸显示能力识别数据，以响应于决定执行该识别数据存取程序；以及一控制器，用来提供该存储器位址信息。
附图说明
图1为传统电子系统的示意图。
图2为本发明实施例的一电子系统的示意图。
图3为本发明实施例的一流程的示意图。
图4为图2的存储器装置的一实施例示意图。
附图标记说明：
1、2 电子系统
10、20 主机端装置
12、22 显示装置
120、24 控制器
122、124、126、128、26 存储器装置
260 输入输出逻辑电路
262 控制逻辑电路
264 存储器阵列
2640、2642、2644、2646 子阵列
266 防写保护电路
268 读写控制电路
270、272 位址解码器
274 高压产生器
3 流程
A0～A2、SDA、SCL 引脚
EDID1～EDID4 延伸显示能力识别数据
S300、S302、S304、S306 步骤
具体实施方式
在说明书及权利要求当中使用了某些词汇来指称特定的元件。所属领域中技术人员应可理解，硬件制造商可能会用不同的名词来称呼同一个元件。本说明书及权利要求并不以名称的差异来做为区分元件的方式，而是以元件在功能上的差异来做为区分的准则。在通篇说明书及权利要求当中所提及的“包含”为一开放式的用语，故应解释成“包含但不限定于”。以外，“耦接”一词在此是包含任何直接及间接的电气连接手段。因此，若文中描述一第一装置耦接于一第二装置，则代表该第一装置可直接电气连接于该第二装置，或通过其他装置或连接手段间接地电气连接至该第二装置。
请参考图2，图2为本发明实施例的一电子系统2的示意图。电子系统2包含有一主机端装置20以及一显示装置22。主机端装置20可为台式电脑、服务器电脑、笔记本电脑、存储装置、移动通信装置、嵌入式系统产品、穿戴式装置，但不以此为限。主机端装置20与显示装置22可通过数据传输接口进行通信传输。例如主机端装置20可利用内部集成电路总线(Inter-Integrated Circuit，I2C)、通用异步收发器(Universal AsynchronousReceiver/Transmitter，UART)、序列周边接口(Serial Peripheral Interface Bus，.SPI)、通用序列总线(Universal Serial Bus，USB)、控制器区域网络总线(ControllerArea Network bus，CAN bus)或其他传输接口标准所规范的传输技术来与显示装置22进行通信以传输数据，但本发明并不以此为限。在一实施例中，电子系统2可应用于一I2C总线传输接口的信号传输。I2C总线上的每一个装置都有唯一的装置地址(device address)。主机端装置20与显示装置22可通过I2C总线接口来进行通信。
显示装置22包含有一控制器24以及一存储器装置26。控制器24用来提供一存储器位址信息。控制器24可为一缩放控制器(scalar)或一时序控制器(Timing controller，T-con)，但不以此为限。存储器位址信息包含存取位址、存取位址的相关索引、存取位址的相关偏移量、存取长度当中的至少一者。存储器位址信息可用以指示存储器阵列264的子阵列存储相应延伸显示能力识别数据的位置。控制器24可依据目前应用的显示模式来决定选用子阵列所存储的延伸显示能力识别数据，以提供相应存储器位址信息。
存储器装置26包含有一输入输出逻辑电路260、一控制逻辑电路262以及一存储器阵列264。存储器阵列264包含子阵列2640、2642、2644、2646。每一子阵列存储有一延伸显示能力识别数据。例如子阵列2640存储有一延伸显示能力识别数据EDID1，子阵列2642存储有一延伸显示能力识别数据EDID2，子阵列2644存储有一延伸显示能力识别数据EDID3，子阵列2646存储有一延伸显示能力识别数据EDID4。每一子阵列具有一对应阵列位址与阵列索引。延伸显示能力识别数据可包含显示装置22的基本参数，例如制造厂商名称、产品序列号、产品型号、标准显示模式及其参数、可支援的分辨率，但不以此为限。存储器装置26可为非易失性存储器(Non-volatile memory)，但不以此为限。例如存储器装置26可为电子抹除式可复写只读存储器、快闪只读存储器(Flash Read Only Memory，Flash ROM)等。输入输出逻辑电路260用来接收来自主机端装置20的一识别数据请求，并根据识别数据请求决定是否执行一识别数据存取程序。控制逻辑电路262耦接于输入输出逻辑电路260与存储器阵列264。于决定执行识别数据存取程序时，控制逻辑电路262根据一存储器位址信息读取出存储器阵列264的子阵列2640、2642、2644与2646当中的一目标子阵列中所存储的延伸显示能力识别数据，以提供至主机端装置20。
控制器24与存储器装置26可分别为一独立集成电路装置。控制器24与存储器装置26亦可是设置于单一集成电路之中。也就是说，控制器24与存储器装置26整合在同一封装结构之中。此外，控制逻辑电路262另包含输入引脚(未示出于图中)，以供输入存储器位址信息。如此一来，使用者可依据需求来设定欲存取延伸显示能力识别数据的存储器，并通过输入引脚输入存储器位址信息而得以更灵活弹性运用各种显示模式的设定。
关于电子系统2的运行方式，请参考图3，图3为本发明实施例的一流程3的示意图。图3所示流程主要是对应于图2的电子系统2的操作。
流程3包含以下步骤：
步骤S300：开始。
步骤S302：接收识别数据请求。
步骤S304：根据存储器位址信息读取出目标子阵列中所存储的延伸显示能力识别数据。
步骤S306：结束。
根据流程3，于步骤S302中，电子系统2应用于一I2C总线传输接口的信号传输。主机端装置20与显示装置22可通过I2C总线接口来进行通信。例如，主机端装置20与存储器装置26可通过I2C总线接口来进行通信。控制器24与存储器装置26可通过I2C总线接口来进行通信。I2C总线上的每一个装置都有唯一的装置地址。依据不同需求，连接至I2C总线上的每一个装置可为传送器或接收器。显示装置22可支援显示数据通道(Display Data Channel，DDC)标准。于主机端装置20连接至显示装置22时，主机端装置20传送出一识别数据请求。当显示装置22的电源开启、显示装置22的显示数据通道接口电路有电源供应(例如+5伏特的电源)或执行一显示数据通道功能时，输入输出逻辑电路260接收来自主机端装置20的一识别数据请求，并根据识别数据请求决定是否执行一识别数据存取程序。
识别数据请求包含一装置选择地址。输入输出逻辑电路260接收来自主机端装置20的一识别数据请求，并比对识别数据请求中的装置选择地址与存储器装置26的装置地址。于识别数据请求中的装置选择地址符合存储器装置26的装置地址时，输入输出逻辑电路260决定执行一识别数据存取程序。例如，若存储器装置26的装置地址为10100000。如图2所示，输入输出逻辑电路260包含引脚SDA与引脚SCL，引脚SDA与引脚SCL可用以接收来自于主机端装置20的信号或传送信号至主机端装置20。若经由输入输出逻辑电路260的引脚SDA与引脚SCL收到的识别数据请求中的装置选择地址为10100000，输入输出逻辑电路260比对所收到的装置选择地址与存储器装置26的装置地址并且判断出结果相符。这表示存储器装置26被选定，主机端装置20要与存储器装置26进行通信。此外，当判断出所收到的装置选择地址与存储器装置26的装置地址相符时，输入输出逻辑电路260可传送一确认信号以回应主机端装置20。
另一方面，当经由输入输出逻辑电路260的引脚SDA与引脚SCL收到的装置选择地址不为10100000，输入输出逻辑电路260比对所收到的装置选择地址与存储器装置26的装置地址而判断出结果不相符。在此情况下，存储器装置26忽略此次所收到的识别数据请求而不进一步动作。此外，如图2所示，输入输出逻辑电路260包含引脚A0、A1、A2。引脚A0、A1、A2可用以设定装置位址，以提供使用者依据需求进行弹性调整。
于步骤S304中，于输入输出逻辑电路260决定执行识别数据存取程序后，控制逻辑电路262根据一存储器位址信息读取出存储器阵列264的子阵列2640、2642、2644与2646当中的一目标子阵列中所存储的延伸显示能力识别数据。其中存储器位址信息指示出目标子阵列中存储延伸显示能力识别数据的位置。具体而言，控制器24可依据使用者的显示模式来决定选用子阵列所存储的延伸显示能力识别数据，以提供相应存储器位址信息至控制逻辑电路262。
更具体而言，控制器24可由存储器阵列264的子阵列2640、2642、2644与2646当中的一选择出一目标子阵列的延伸显示能力识别数据，再将存储此目标子阵列的延伸显示能力识别数据的位置信息(即存储器位址信息)提供至控制逻辑电路262。如此一来，控制器24可依据不同的显示模式设定相应存储器位址信息，以使控制逻辑电路262读取存储器阵列264的子阵列2640、2642、2644与2646当中的一目标子阵列的延伸显示能力识别数据。此外，显示装置22另包含一存储装置(未示出于图中)，控制器24可于显示装置22前次关机之前，依据所需显示模式设定相应延伸显示能力识别数据并将相应存储器位址信息存放至上述存储装置。如此一来，当主机端装置20连接至显示装置22且控制器24尚未开启而未能运行时，控制逻辑电路262可检测上述存储装置并由上述存储装置读取出存储器位址信息，以进行延伸显示能力识别数据的读取程序。
进一步地，于输入输出逻辑电路260决定执行识别数据存取程序后，控制逻辑电路262可检测并取得控制器24所提供的存储器位址信息并根据存储器位址信息由存储器阵列264的子阵列2640、2642、2644与2646当中选择出目标子阵列，并读取出目标子阵列中所存储的延伸显示能力识别数据。当存储器装置26读取子阵列2640、2642、2644与2646当中的一目标子阵列中所存储的延伸显示能力识别数据后会将由目标子阵列中所读取出的延伸显示能力识别数据传送至主机端装置20。如此一来，主机端装置20将可依据由目标子阵列中所读取出的延伸显示能力识别数据进行影像处理并据以产生相应显示影像信号，进而提供至显示装置22进行显示。
例如，当显示正常画面时，所需的显示装置22的原始分辨率为3840x2160。当执行一多重并列画面(Picture By Picture，PBP)功能时，所需的显示装置22的原始分辨率为1920x2160。假设存储器阵列264的子阵列2640的延伸显示能力识别数据EDID1当中的详细时序描述区域1(Detailed Timing Descriptor Block 1，DTDB 1)(即延伸显示能力识别数据的EDID1第54-71位元组)所记载分辨率为3840x2160，存储器阵列264的子阵列2642的延伸显示能力识别数据EDID2当中的详细时序描述区域1(即延伸显示能力识别数据的EDID2第54-71位元组)所记载分辨率为1920x2160，存储器阵列264的子阵列2644的延伸显示能力识别数据EDID3当中的详细时序描述区域1(即延伸显示能力识别数据的EDID3第54-71位元组)所记载分辨率为3840x1080，以及存储器阵列264的子阵列2646的延伸显示能力识别数据EDID4当中的详细时序描述区域1(即延伸显示能力识别数据的EDID4第54-71位元组)所记载分辨率为1920x1080。
在一实施例中，当显示装置22显示正常画面时，控制器24可先由存储器阵列264的子阵列2640、2642、2644与2646当中选择出子阵列2640，并将子阵列2640所存储的延伸显示能力识别数据EDID1的存储位置的存储器位址(即存储器位址信息)提供至控制逻辑电路262。当输入输出逻辑电路260决定执行识别数据存取程序后，控制逻辑电路262可检测并取得控制器24所提供的存储器位址信息(例如子阵列2640所存储的延伸显示能力识别数据EDID1的存储位置的存储器位址)并根据存储器位址信息选择存储器阵列264的子阵列2640做为目标子阵列并读取出存储器阵列264的子阵列2640中所存储的延伸显示能力识别数据EDID1，以提供至主机端装置20。如此一来，主机端装置20可读取延伸显示能力识别数据的EDID1的第54-71位元组所记载的分辨率数据(分辨率为3840x2160)并根据延伸显示能力识别数据的EDID1的第54-71位元组所记载的分辨率来产生相应显示影像信号，进而提供至显示装置22进行显示。
在另一实施例中，当显示装置22当执行一多重并列画面功能时，控制器24可先由存储器阵列264的子阵列2640、2642、2644与2646当中选择出子阵列2642，并将子阵列2642所存储的延伸显示能力识别数据EDID2的存储位置的存储器位址(即存储器位址信息)提供至控制逻辑电路262。当输入输出逻辑电路260决定执行识别数据存取程序后，控制逻辑电路262可检测并取得控制器24所提供的存储器位址信息(例如子阵列2642所存储的延伸显示能力识别数据EDID2的存储位置的存储器位址)并根据存储器位址信息选择存储器阵列264的子阵列2642做为目标子阵列并读取出子阵列2642中所存储的延伸显示能力识别数据EDID2，以提供至主机端装置20。如此一来，主机端装置20可读取延伸显示能力识别数据的EDID2的第54-71位元组所记载的分辨率数据(分辨率为1920x2160)并根据延伸显示能力识别数据的EDID2的第54-71位元组所记载的分辨率来产生相应显示影像信号，进而提供至显示装置22进行显示。由于切换使用了正确的影像分辨率，所显示的影像画面将不致因为执行多重并列画面而有变形情况。
关于控制逻辑电路262根据存储器位址信息读取出存储器阵列264的目标子阵列中的延伸显示能力识别数据。请参考图4，图4为图2的存储器装置26的一实施例示意图。如图4所示，存储器装置26另包含一防写保护电路266、一读写控制电路268、位址解码器270、272、一高压产生器274。防写保护电路266用以执行防写保护功能。例如，当防写保护电路266启动防写保护功能时，存储器装置26只可进行读取运行，并且不可进行写入运行。当防写保护电路266关闭防写保护功能时，存储器装置26可进行读取或写入运行。读写控制电路268用以控制执行读取或写入运行。位址解码器270、272用以解码读取或写入地址。高压产生器274用以提供高电压信号。当控制逻辑电路262取得存储器位址信息后，位址解码器270、272将存储器位址信息解码以输出读取地址。防写保护电路266可启动防写保护功能。读写控制电路268可控制执行读取运行。如此一来，将可由存储器阵列264的目标子阵列中读取出相应延伸显示能力识别数据。
综上所述，主机端装置20只要通过发送相同的识别数据请求(包含相同装置选择地址)，本实施例的单一存储器装置在收到相同的识别数据请求的情况下可根据控制器24的设定而回传不同的延伸显示能力识别数据，以因应不同显示模式的需求。换言之，本实施例利用单一存储器装置内存储多组延伸显示能力识别数据，并且本实施例在单一颗存储器装置的情况下可以实现模拟多颗存储器装置的作用，进而能有效简化电路设计与降低制造成本，同时可避免电容效应所导致的错误异常或功能失效的问题。
以上所述仅为本发明的优选实施例，凡依本发明权利要求所做的均等变化与修饰，皆应属本发明的涵盖范围。
Claims (10)
1.一种显示装置，包含有：
一存储器装置，包含有：
一存储器阵列，包含有多个子阵列，每一子阵列存储有一延伸显示能力识别数据；
一输入输出逻辑电路，用来接收来自一主机端装置的一识别数据请求，并根据该识别数据请求决定是否执行一识别数据存取程序；以及
一控制逻辑电路，用来根据一存储器位址信息读取出该存储器阵列的该多个子阵列中的一目标子阵列中所存储的延伸显示能力识别数据，以响应于决定执行该识别数据存取程序。
2.如权利要求1所述的显示装置，其中该识别数据请求包含一装置选择地址，该输入输出逻辑电路比对该识别数据请求中的该装置选择地址与该存储器装置的装置地址，并且于该识别数据请求中的该装置选择地址符合该存储器装置的装置地址时决定执行该识别数据存取程序。
3.如权利要求1所述的显示装置，其中响应于决定执行该识别数据存取程序，该控制逻辑电路根据该存储器位址信息由该存储器阵列的该多个子阵列中选择出该目标子阵列，并读取出该目标子阵列中所存储的延伸显示能力识别数据。
4.如权利要求1所述的显示装置，其中该存储器装置为一电子抹除式可复写只读存储器。
5.如权利要求1所述的显示装置，其还包含：
一控制器，用来提供该存储器位址信息。
6.一种控制方法，用于一显示装置，该显示装置包含有一存储器装置，该存储器装置包含有一存储器阵列，该存储器阵列包含有多个子阵列，每一子阵列存储有一延伸显示能力识别数据，该控制方法包含有：
接收来自一主机端装置的一识别数据请求；
根据该识别数据请求决定是否执行一识别数据存取程序；以及
响应于决定执行该识别数据存取程序，根据一存储器位址信息读取出该存储器阵列的该多个子阵列中的一目标子阵列中所存储的延伸显示能力识别数据。
7.如权利要求6所述的控制方法，其中该识别数据请求包含一装置选择地址，其中根据该识别数据请求决定是否执行该识别数据存取程序的步骤包含有：
比对该识别数据请求中的该装置选择地址与该存储器装置的装置地址；以及
于该识别数据请求中的该装置选择地址符合该存储器装置的装置地址时决定执行该识别数据存取程序。
8.如权利要求6所述的控制方法，其中响应于决定执行该识别数据存取程序，根据该存储器位址信息读取出该存储器阵列的该多个子阵列中的该目标子阵列中所存储的延伸显示能力识别数据的步骤包含有：
根据该存储器位址信息由该存储器阵列的该多个子阵列中选择出该目标子阵列，并读取出该目标子阵列中所存储的延伸显示能力识别数据，以响应于决定执行该识别数据存取程序。
9.如权利要求6所述的控制方法，其中该存储器装置为一电子抹除式可复写只读存储器。
10.一种电子系统，包含有：
一主机端装置，用来传送出一识别数据请求；以及
一显示装置，包含有：
一存储器装置，包含有：
一存储器阵列，包含有多个子阵列，每一子阵列存储有一延伸显示能力识别数据；
一输入输出逻辑电路，用来接收该识别数据请求，并根据该识别数据请求决定是否执行一识别数据存取程序；以及
一控制逻辑电路，用来根据一存储器位址信息读取出该存储器阵列的该多个子阵列中的一目标子阵列中所存储的延伸显示能力识别数据，以响应于决定执行该识别数据存取程序；以及
一控制器，用来提供该存储器位址信息。
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