CN111835991B - 显示数据通道电路 - Google Patents
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Abstract
一种显示数据通道电路，用于实现发送源设备与显示设备之间的通信连接。显示数据通道电路包括选择电路、主控模块以及多个传输电路。每一所述传输电路电连接于发送源设备及选择电路之间。每一传输电路包括缓冲模块，缓冲模块电连接于发送源设备及选择电路之间，缓冲模块用于将发送源设备发送的通信信号暂存缓冲。选择电路用于从多个传输电路中选择一个传输电路来将缓冲模块中的通信信号传输给主控模块。主控模块与选择电路电连接，主控模块用于根据通信信号对应接收发送源设备所发送的音视频信号。如此可以避免长距离传输导致信号衰减的问题。
Description
技术领域
本发明涉及一种显示数据通道电路。
背景技术
一般而言，由于高分辨率多媒体接口(High Definition Multimedia Interface，HDMI)技术在传输数字影音信号方面的突出优势，自2002年HDMI1.0标准推出以来，搭载HDMI接口的设备越来越多。同时HDMI规范要求HDMI的数据显示通道(Display DataChannel，DDC)的输入容值低于50PF。
现有技术中，在接收设备的主控芯片与HDMI接口距离较远时，较长的线路在传输信号时将会导致信号衰减。
发明内容
有鉴于此，有必要提供一种可避免长距离传输导致信号衰减的显示数据通道电路。
一种显示数据通道电路，用于实现发送源设备与显示设备之间的通信连接，所述显示数据通道电路包括一选择电路、一主控模块以及多个传输电路；
每一所述传输电路电连接于所述发送源设备及所述选择电路之间，每一所述传输电路包括一缓冲模块，所述缓冲模块电连接于所述发送源设备及所述选择电路之间，所述缓冲模块用于将所述发送源设备发送的通信信号暂存缓冲；
所述选择电路用于从所述多个传输电路中选择一个传输电路来将所述缓冲模块中的通信信号传输给所述主控模块；及
所述主控模块与所述选择电路电连接，所述主控模块用于根据所述通信信号对应接收所述发送源设备所发送的音视频信号。
进一步地，每一所述传输电路还包括一接口，所述接口用于与所述发送源设备的接口电性连接。
进一步地，每一所述传输电路还包括一存储模块，每一所述存储模块与每一所述缓冲模块电连接，所述存储模块用于记录对应的所述通信信号的地址信息。
进一步地，所述接口为高清多媒体接口。
进一步地，所述通信信号为集成电路总线信号。
进一步地，所述缓冲模块包括一缓冲器件，所述缓冲器件为PCA9617A。
进一步地，所述缓冲模块还包括第一电阻及第二电阻，所述缓冲器件的第一时钟引脚及第一数据引脚与所述接口连接，所述缓冲器件的第一电源引脚连接于一电源，所述第一数据引脚通过所述第一电阻连接于所述电源，所述第一时钟引脚通过所述第二电阻连接于所述电源。
进一步地，所述缓冲模块还包括第一双向瞬变抑制二极管、第二双向瞬变抑制二极管、第一电容及第二电容，所述第一数据引脚还通过所述第一双向瞬变抑制二极管接地，所述第一电容的两端分别连接于所述第一双向瞬变抑制二极管的两端，所述第一时钟引脚还通过所述第二双向瞬变抑制二极管接地，所述第二电容的两端分别连接于所述第二双向瞬变抑制二极管的两端。
进一步地，所述缓冲模块还包括第三电容、第三电阻、第四电阻及第五电阻，所述缓冲器件的第二电源引脚连接于所述电源，所述第二电源引脚还通过所述第三电容接地，所述缓冲器件的使能引脚通过第五电阻连接至所述第二电源引脚，所述缓冲器件的第二时钟引脚及第二数据引脚分别通过所述第三电阻及所述第四电阻连接至所述存储模块，所述缓冲器件的第二时钟引脚及第二数据引脚还分别通过所述第三电阻及所述第四电阻连接至所述选择电路。
进一步地，所述存储模块为带电可擦可编程只读存储器。
上述显示数据通道电路通过将缓冲模块连接于所述接口及所述存储模块之间，将所述显示数据通道电路分成两部分以使得每部分的容值减少，从而避免长距离传输信号导致信号衰减。
附图说明
图1为一种显示数据通道电路的较佳实施方式的模块图。
图2为图1中缓冲模块的较佳实施方式的电路图。
主要元件符号说明
显示数据通道电路 100
发送源设备 200
显示设备 300
传输电路 10
接口 12
缓冲模块 14
缓冲器件 142
电阻 R1、R2、R3、R4、R5
双向瞬变抑制二极管 D1、D2
电容 C1、C2、C3
电源 VCC
存储模块 16
选择电路 20
主控模块 30
如下具体实施方式将结合上述附图进一步说明本发明。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例是本发明一部分实施例，而不是全部的实施例。
为了使本发明的目的、技术方案及优点更加清楚明白，以下将会结合附图及实施方式，以对本发明中的显示数据通道电路作进一步详细的描述及相关说明。
请参考图1，在本发明一较佳实施方式中，一种显示数据通道电路100用于实现发送源设备200与显示设备300之间的通信连接。所述显示数据通道电路100包括多个传输电路10、一选择电路20及一主控模块30。
所述多个传输电路10电连接于所述发送源设备200与所述选择电路20之间，所述主控模块30电连接于所述选择电路20与所述显示设备300之间。
每一所述传输电路10均包括接口12、缓冲模块14及存储模块16。所述缓冲模块14电连接于所述接口12及所述存储模块16之间，所述接口12电连接所述发送源设备200，所述缓冲模块14电连接所述选择电路20。本实施例中，所述传输电路10的数量为两个。在其他实施方式中，所述传输电路10的数量还可以多于两个。
所述接口12用于与所述发送源设备200的接口(图未示)进行插接，当所述接口12与所述发送源设备200的接口插接时，所述发送源设备200与所述显示数据通道电路100电性连接，所述发送源设备200通过所述接口12发送源信号给所述显示数据通道电路100及所述显示设备300。其中，所述源信号包括音视频信号及通信信号，所述通信信号包括所述源信号的地址信息，即所述源信号传输时所对应的接口信息。所述接口12将所述通信信号传输至对应连接的所述缓冲模块14。
所述缓冲模块14用于接收所述接口12传输的通信信号，并将所述通信信号暂存缓冲。如此，所述缓冲模块14可将所述显示数据通道电路100分为两部分电路。具体地，其中第一部分电路为所述接口12至所述缓冲模块14之间的电路，第二部分电路为所述缓冲模块14至所述主控模块30之间的电路。如此一来，可以相对的减少每一部分电路的电容值以使得所述显示数据通道电路100的输入容值满足要求，还可以避免长距离传输信号导致信号衰减。
所述缓冲模块14将所述通信信号传输至所述存储模块16。所述存储模块16用于记录对应的所述通信信号的地址信息。
本实施例中，所述存储模块16可为带电可擦可编程只读存储器(ElectricallyErasable Programmable read only memory，EEPROM)。
本实施例中，所述接口12为高分辨率多媒体接口(High Definition MultimediaInterface，HDMI)，所述高分辨率多媒体接口与所述发送源设备200之间通过高分辨率多媒体接口的线缆连接，所述源信号为高分辨率多媒体信号。所述接口12、所述缓冲模块14、所述存储模块16、所述选择电路20及所述主控模块30之间均通过集成电路总线(InterIntegrated Circuit，I2C)连接，所述通信信号为集成电路总线信号。
所述选择电路20在一控制单元(图未示)的控制下选择与所述多个传输电路10中的一个传输电路10建立通信连接，以接收所述缓冲模块14传输的通信信号，并将所述通信信号传输至所述主控模块30。具体地，所述控制单元根据所述存储模块16中的地址信息选择对应的传输电路10与所述选择电路20建立通信连接。
所述主控模块30接收所述选择电路20所传输的通信信号，并根据所述通信信号接收对应的所述接口12所传输的音视频信号。所述主控模块30还将根据所述音视频信号控制所述显示设备300输出显示信息。
请参考图2，图2为本实施例中所述缓冲模块14的电路图。所述缓冲模块14包括一缓冲器件142、五个电阻R1-R5、两个双向瞬变抑制二极管D1-D2以及三个电容C1-C3。
所述缓冲器件142的第一时钟引脚SCLA及第一数据引脚SDAA均与所述接口12连接。所述缓冲器件142的第一电源引脚VCC_A连接于电源VCC。所述第一数据引脚SDAA还通过所述电阻R1连接于所述电源VCC。所述第一时钟引脚SCLA还通过所述电阻R2连接于所述电源VCC。所述第一数据引脚SDAA还通过所述双向瞬变抑制二极管D1接地，所述电容C1的两端分别连接于所述双向瞬变抑制二极管D1的两端。所述第一时钟引脚SCLA还通过所述双向瞬变抑制二极管D2接地，所述电容C2的两端分别连接于所述双向瞬变抑制二极管D2的两端。所述双向瞬变抑制二极管D1、D2分别用于提高所述第一时钟引脚SCLA及第一数据引脚SDAA的抗过压能力。
所述缓冲器件142的第二电源引脚VCC_B连接于所述电源VCC，所述缓冲器件142的第二电源引脚VCC_B还通过电容C3接地。所述缓冲器件142的使能引脚EN通过所述电阻R5连接至所述第二电源引脚VCC_B。所述缓冲器件142的第二时钟引脚SCLB及第二数据引脚SDAB分别通过所述电阻R3及所述电阻R4连接至所述存储模块16。所述缓冲器件142的第二时钟引脚SCLB及第二数据引脚SDAB分别通过所述电阻R3及所述电阻R4连接至所述选择电路20。所述缓冲器件142的引脚GND接地。
本实施例中，所述缓冲器件142为PCA9617A。所述电源VCC为5V电源。所述电阻R1及所述电阻R2的电阻值均为10K欧姆。
本实施例中所述缓冲器件142的工作频率高达1M赫兹，可以向下兼容集成电路总线的快速模式(400KHz)和标准模式(100KHz)，而本实施例中集成电路总线的工作频率为100KHz。如此所述缓冲器件142可以保证本实施例中集成电路总线的工作模式不变，从而对传输过程中的通信信号起暂存缓冲的作用。
下面将详细介绍本发明所述显示数据通道电路100的工作原理。
工作时，所述发送源设备200通过所述接口12将通信信号传输至所述缓冲器件142的第一时钟引脚SCLA与所述第一数据引脚SDAA，所述缓冲器件142对所述通信信号进行暂存缓冲，并通过所述第二时钟引脚SCLB与所述第二数据引脚SDAB传输所述通信信号至所述选择电路20。所述选择电路20在所述控制单元的控制下选择接收一个所述缓冲模块14传输的通信信号，并将所述通信信号传输至所述主控模块30。所述主控模块30接收所述选择电路20所传输的通信信号，并根据所述通信信号接收对应的所述接口12所传输的音视频信号,所述主控模块30根据所述音视频信号控制所述显示设备300输出显示信息。
上述显示数据通道电路100通过将缓冲模块14连接于所述接口12及所述存储模块16之间，将所述显示数据通道电路100分成两部分电路，从而使得所述显示数据通道电路100的输入容值满足要求，同时还可避免长距离传输导致信号衰减。
最后应说明的是，以上实施例仅用以说明本发明的技术方案而非限制，尽管参照较佳实施例对本发明进行了详细说明。
本领域的普通技术人员应当理解，可以对本发明的技术方案进行修改或等同替换，而不脱离本发明技术方案的精神和范围。
并且，基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都将属于本发明保护的范围。
Claims (9)
1.一种显示数据通道电路，用于实现发送源设备与显示设备之间的通信连接，其特征在于，所述显示数据通道电路包括一选择电路、一主控模块以及多个传输电路；
每一所述传输电路电连接于所述发送源设备及所述选择电路之间，每一所述传输电路包括一缓冲模块，所述缓冲模块电连接于所述发送源设备及所述选择电路之间，所述缓冲模块用于将所述发送源设备发送的通信信号暂存缓冲，所述缓冲模块包括：一缓冲器件、一第一双向瞬变抑制二极管、一第二双向瞬变抑制二极管、一第一电容及一第二电容，所述缓冲器件包括一第一数据引脚及一第一时钟引脚，所述第一数据引脚还通过所述第一双向瞬变抑制二极管接地，所述第一电容的两端分别连接于所述第一双向瞬变抑制二极管的两端，所述第一时钟引脚还通过所述第二双向瞬变抑制二极管接地，所述第二电容的两端分别连接于所述第二双向瞬变抑制二极管的两端；
所述选择电路用于从所述多个传输电路中选择一个传输电路来将所述缓冲模块中的通信信号传输给所述主控模块；及
所述主控模块与所述选择电路电连接，所述主控模块用于根据所述通信信号对应接收所述发送源设备所发送的音视频信号。
2.如权利要求1所述的显示数据通道电路，其特征在于，每一所述传输电路还包括一接口，所述接口用于与所述发送源设备的接口电性连接。
3.如权利要求2所述的显示数据通道电路，其特征在于，每一所述传输电路还包括一存储模块，每一所述存储模块与每一所述缓冲模块电连接，所述存储模块用于记录对应的所述通信信号的地址信息。
4.如权利要求3所述的显示数据通道电路，其特征在于，所述接口为高清多媒体接口。
5.如权利要求4所述的显示数据通道电路，其特征在于，所述通信信号为集成电路总线信号。
6.如权利要求3所述的显示数据通道电路，其特征在于，所述缓冲器件为PCA9617A。
7.如权利要求6所述的显示数据通道电路，其特征在于，所述缓冲模块还包括第一电阻及第二电阻，所述缓冲器件的第一时钟引脚及第一数据引脚与所述接口连接，所述缓冲器件的第一电源引脚连接于一电源，所述第一数据引脚通过所述第一电阻连接于所述电源，所述第一时钟引脚通过所述第二电阻连接于所述电源。
8.如权利要求7所述的显示数据通道电路，其特征在于，所述缓冲模块还包括第三电容、第三电阻、第四电阻及第五电阻，所述缓冲器件的第二电源引脚连接于所述电源，所述第二电源引脚还通过所述第三电容接地，所述缓冲器件的使能引脚通过第五电阻连接至所述第二电源引脚，所述缓冲器件的第二时钟引脚及第二数据引脚分别通过所述第三电阻及所述第四电阻连接至所述存储模块，所述缓冲器件的第二时钟引脚及第二数据引脚还分别通过所述第三电阻及所述第四电阻连接至所述选择电路。
9.如权利要求4所述的显示数据通道电路，其特征在于，所述存储模块为带电可擦可编程只读存储器。
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