CN111800350A - 一种融合的限速整形方法及存储介质 - Google Patents

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武斌
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Abstract

本发明公开了一种融合的限速整形方法及存储介质,所述融合的限速整形方法,采用bps限速方式和pps限速方式两种限速方式进行流量管理,所述bps限速方式与所述pps限速方式共用一个存储器,同一设备同一时刻只采用两种限速方式中的任意一种。本发明通过将传统方案中bps限速方式和pps限速方式均配置各自的存储器改进为bps限速方式和pps限速方式共用一个存储器,其极大了节省了存储的硬件资源,减小了芯片的面积,降低了芯片成本。

Description

一种融合的限速整形方法及存储介质
技术领域
本发明属于流量管理领域,具体是指一种融合的限速整形方法及存储介质。
背景技术
限速和整形是流量管理的基本策略,通常采用bps限速方式或者pps限速方式,如图1所示,bps限速一般基于队列号或者流号,需要用基于队列号的存储器(如RAM)存储漏桶的剩余令牌。而如图2所示,pps限速需要存储队列通过的包个数。当队列特别多的时候,两种限速方法都会消耗相当多的存储资源,目前通常的做法是配置两个存储器,其造成了存储资源的大量浪费,提高了芯片成本。
发明内容
本发明为解决上述技术问题,提供了一种融合的限速整形方法及存储介质,其bps限速方式和pps限速方式共用一个存储器,极大了节省了存储的硬件资源,减小了芯片的面积,降低了芯片成本。
为了实现上述目的,本发明采取的技术方案如下:
技术方案一:
一种融合的限速整形方法,采用bps限速方式和pps限速方式两种限速方式进行流量管理,所述bps限速方式与所述pps限速方式共用一个存储器,同一设备同一时刻只采用两种限速方式中的任意一种。
作为进一步的技术方案,当配置为bps限速方式时,存储器在固定的时间间隔内自动填充固定大小的令牌,当有数据包进入限速装置时,BPS计算逻辑从存储器读取当前队列的令牌数,并将所述令牌数与数据包长进行比较,当所述令牌数大于所述数据包长时,允许数据包通过,同时,将漏桶令牌数减去所述数据包长作为剩余令牌数写入存储器,当所述令牌数小于等于所述数据包长时,丢弃所述数据包,漏桶令牌数不变。
作为更进一步的技术方案,所述令牌的大小以字节为单位。
作为进一步的技术方案,当配置为pps限速方式时,当有数据包进入限速装置时,pps计算逻辑从存储器读取当前队列的通过包的个数,然后将读取的通过包的个数加一后数值与配置的允许通过包的个数阈值进行比较,如果读取的通过包的个数加一后数值小于配置的允许通过包的个数阈值,则允许数据包通过,并将读取的通过包的个数加一后数值加入存储器,如果读取的通过包的个数加一后数值大于等于配置的允许通过包的个数阈值,则丢弃数据包,不写入存储器。
作为进一步的技术方案,所述存储器是基于队列号或流号的。
技术方案二:
一种存储介质,为存储器,所述存储器存储有bps限速方式的程序指令和pps限速方式的程序指令,用于实现如上述方法的步骤。
与现有技术相比,本发明所取得的有益效果如下:
本发明通过将传统方案中bps限速方式和pps限速方式均配置各自的存储器改进为bps限速方式和pps限速方式共用一个存储器,其极大了节省了存储的硬件资源,减小了芯片的面积,降低了芯片成本;且由于存储器在bps限速模式与pps限速模式下存储内容有所不同,用到的位宽可能不一致,但不影响本发明的实施。
附图说明
图1为现有技术中bps限速方式的工作原理图;
图2为现有技术中pps限速方式的工作原理图;
图3为本发明一个实施例的工作原理图。
具体实施方式
下面将结合附图对本发明的技术方案进行清楚、完整地描述,显然,所描述的实施例是本发明一部分实施例,而不是全部的实施例。
图3示出了一种融合的限速整形方法的一个实施例,采用bps限速方式和pps限速方式两种限速方式进行流量管理,所述bps限速方式与所述pps限速方式共用一个存储器,同一设备同一时刻只采用两种限速方式中的任意一种。
当配置为bps限速方式时,存储器在固定的时间间隔内自动填充固定大小的令牌(所述令牌的大小以字节为单位),当有数据包进入限速装置时,BPS计算逻辑从存储器读取当前队列的令牌数,并将所述令牌数与数据包长进行比较,当所述令牌数大于所述数据包长时,允许数据包通过,同时,将漏桶令牌数减去所述数据包长作为剩余令牌数写入存储器,当所述令牌数小于等于所述数据包长时,丢弃所述数据包,漏桶令牌数不变;
当配置为pps限速方式时,当有数据包进入限速装置时,pps计算逻辑从存储器读取当前队列的通过包的个数,然后将读取的通过包的个数加一后数值与配置的允许通过包的个数阈值进行比较,如果读取的通过包的个数加一后数值小于配置的允许通过包的个数阈值,则允许数据包通过,并将读取的通过包的个数加一后数值加入存储器,如果读取的通过包的个数加一后数值大于等于配置的允许通过包的个数阈值,则丢弃数据包,不写入存储器。
进一步的,所述存储器是基于队列号或流号的。
此外,为了实现上述方法,本发明还公开了一种存储介质,其为存储器,所述存储器存储有bps限速方式的程序指令和pps限速方式的程序指令,用于实现上述方法的步骤。
本发明通过将bps限速方式与pps限速方式的存储器进行融合,使两者共用一个存储器,其极大了节省了存储的硬件资源,减小了芯片的面积,降低了芯片成本;且由于存储器在bps限速模式与pps限速模式下存储内容有所不同,用到的位宽可能不一致,但不影响本发明的实施。
以上所述实施方式仅为本发明的优选实施例,而并非本发明可行实施的穷举。对于本领域一般技术人员而言,在不背离本发明原理和精神的前提下对其所作出的任何显而易见的改动,都应当被认为包含在本发明的权利要求保护范围之内。

Claims (6)

1.一种融合的限速整形方法,采用bps限速方式和pps限速方式两种限速方式进行流量管理,其特征在于,所述bps限速方式与所述pps限速方式共用一个存储器,同一设备同一时刻只采用两种限速方式中的任意一种。
2.根据权利要求1所述的一种融合的限速整形方法,其特征在于,当配置为bps限速方式时,存储器在固定的时间间隔内自动填充固定大小的令牌,当有数据包进入限速装置时,BPS计算逻辑从存储器读取当前队列的令牌数,并将所述令牌数与数据包长进行比较,当所述令牌数大于所述数据包长时,允许数据包通过,同时,将漏桶令牌数减去所述数据包长作为剩余令牌数写入存储器,当所述令牌数小于等于所述数据包长时,丢弃所述数据包,漏桶令牌数不变。
3.根据权利要求2所述的一种融合的限速整形方法,其特征在于,所述令牌的大小以字节为单位。
4.根据权利要求1所述的一种融合的限速整形方法,其特征在于,当配置为pps限速方式时,当有数据包进入限速装置时,pps计算逻辑从存储器读取当前队列的通过包的个数,然后将读取的通过包的个数加一后数值与配置的允许通过包的个数阈值进行比较,如果读取的通过包的个数加一后数值小于配置的允许通过包的个数阈值,则允许数据包通过,并将读取的通过包的个数加一后数值加入存储器,如果读取的通过包的个数加一后数值大于等于配置的允许通过包的个数阈值,则丢弃数据包,不写入存储器。
5.根据权利要求1所述的一种融合的限速整形方法,其特征在于,所述存储器是基于队列号或流号的。
6.一种存储介质,为存储器,其特征在于,所述存储器存储有bps限速方式的程序指令和pps限速方式的程序指令,用于实现如权利要求1~5任一项所述方法的步骤。
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Citations (3)

* Cited by examiner, † Cited by third party
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CN101741815A (zh) * 2008-11-26 2010-06-16 凹凸电子(武汉)有限公司 统计值刷新系统以及方法
CN102714618A (zh) * 2009-06-22 2012-10-03 思杰系统有限公司 用于平台速率限制的系统和方法
CN107222358A (zh) * 2016-03-21 2017-09-29 深圳市中兴微电子技术有限公司 包每秒流量监管方法及装置

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN101741815A (zh) * 2008-11-26 2010-06-16 凹凸电子(武汉)有限公司 统计值刷新系统以及方法
CN102714618A (zh) * 2009-06-22 2012-10-03 思杰系统有限公司 用于平台速率限制的系统和方法
CN107222358A (zh) * 2016-03-21 2017-09-29 深圳市中兴微电子技术有限公司 包每秒流量监管方法及装置

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