CN111314640A - 一种视频压缩方法、设备以及介质 - Google Patents

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CN111314640A CN202010109927.4A CN202010109927A CN111314640A CN 111314640 A CN111314640 A CN 111314640A CN 202010109927 A CN202010109927 A CN 202010109927A CN 111314640 A CN111314640 A CN 111314640A
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Abstract

本发明公开了一种视频压缩方法,包括以下步骤:接收帧数据;对帧数据添加帧头和帧尾;根据帧头和帧尾得到帧数据的实际像素点数,并去除帧头和帧尾;将实际像素点数与标准像素点数进行对比以判断帧数据中是否有数据丢失;响应于帧数据中有数据丢失,根据实际像素点数与标准像素点数的差值确定待补充的像素点数;根据待补充的像素点数对帧数据进行像素点的补充以进行压缩,并返回接收帧数据的步骤。本发明还公开了一种计算机设备以及可读存储介质。本发明提出的方案通过检测帧头和帧尾标志,判断帧数据是否丢失数据,并对丢失数据的帧,进行补全,避免一帧或几帧有像素点丢失,而导致视频显示不正常的现象。

Description

一种视频压缩方法、设备以及介质
技术领域
本发明涉及视频处理领域,具体涉及一种视频压缩方法、设备以及存储介质。
背景技术
传统的带视频压缩功能的SoC系统中,如图1所示,显卡(VGA IP)输出的是RGB原始数据,该原始数据,是不带帧头,帧尾标志信息的,后级模块只能依靠分辨率信息,去获得固定数据(比如分辨率是1024x768,则认为获取的第一组1024x768个像素点是第一帧数据,第二组1024x768个像素点是第二帧数据……),但是由于视频数据量巨大,以1024x768,60fps(frame per second),RGB888计算,一秒的数据量就达到1024x768x60x3=135MB,一分钟的数据量将达到8GB。如此巨大的数据量,在送入压缩IP之前,会通过ASYNC进行异步处理,因为总线的时钟频率,往往与视频模块频率不一致,尤其是在芯片化项目中,有可能会存在因为开发者代码质量问题,后端布局布线问题,存在一帧数据中,个别数据丢失(如不满足建立保持时间,在时钟延没有被采到)的现象,在存在异步处理的项目中,上述现象出现的概率会极大的增加。
与此同时,压缩IP仍然按照固定的分辨率像素点,去取一帧数据,这样出现的现象就是,只要有一帧的数据有一个丢失,则后续所有的帧数据,都会被采集错误(比如第10帧丢1个数,则压缩IP会把第11帧的第1个数,当作是第10帧的最后1个数,并且中间还有其他的帧数据丢失的可能性),进而导致视频数据紊乱,压缩IP输出的视频图像有异常。进而远端的显示就出现异常,导致SOC系统的视频功能完全混乱。
另外,VGA IP(显卡)输出视频源数据,方式有两种(图1中的1和2),1是VGA接口的形式,2是VGA IP将源视频数据写入DDR,然后DATA_GET子模块再去读DDR。然后经过异步处理,因为AXI总线的时钟,有可能跟压缩IP的运行时钟不一致。这个异常处理通常是异步FIFO实现的。压缩IP读取异步FIFO的输出数据,进行视频压缩,将压缩完成的数据写入DDR(3),并且通知软件(比如以中断的形式),软件进而将DDR中编码完成的数据读走(4),通过网络等介质,传至远端,进行视频显示。
同时从图1可以看出,需要访问DDR的接口很多,接口2(如果是采用源视频数据存DDR形式的话)/3/4,与此通过CPU上运行的SoC系统的其他软件,也是运行在DDR中,接口为5。接口3和4会长时间占用DDR的,因为视频数据会一直不断的产生,因此会造成DDR接口访问竞争,一般系统软件(通过接口5,访问DDR),就有可能占用不到DDR接口,造成软件运行卡顿。
发明内容
有鉴于此,为了克服上述问题的至少一个方面,本发明实施例提出一种视频压缩方法,包括以下步骤:
接收帧数据;
对所述帧数据添加帧头和帧尾;
根据所述帧头和所述帧尾得到所述帧数据的实际像素点数,并去除所述帧头和所述帧尾;
将所述实际像素点数与标准像素点数进行对比以判断所述帧数据中是否有数据丢失;
响应于所述帧数据中有数据丢失,根据所述实际像素点数与所述标准像素点数的差值确定待补充的像素点数;
根据所述待补充的像素点数对所述帧数据进行像素点的补充以进行压缩,并返回接收帧数据的步骤。
在一些实施例中,接收帧数据,进一步包括:
获取源数据以及用户输入的配置信息;
根据所述配置信息,对所述源数据进行丢帧处理;
接收进行丢帧处理后的源数据中的帧数据。
在一些实施例中,对所述源数据进行丢帧处理,进一步包括:
响应于所述配置信息为第一配置信息,不进行丢帧处理;
响应于所述配置信息为第二配置信息,将所述源数据进行丢帧处理后得到第一帧频的数据;
响应于所述配置信息为第三配置信息,将所述源数据进行丢帧处理后得到第二帧频的数据;
响应于所述配置信息为第四配置信息,将所述源数据直接丢弃。
在一些实施例中,所述第一帧频的数据为由所述源数据中第[N*源数据的帧频/第一帧频]帧组成的数据;所述第二帧频的数据为由所述源数据中第[M*源数据的帧频/第二帧频]帧组成的数据;
其中,N取值为0~第一帧频之间的整数,M取值为0~第一帧频之间的整数,[]表示向下取整。
在一些实施例中,还包括:
响应于所述帧数据中没有数据丢失,直接将所述帧数据发送至压缩模块以进行压缩,并返回接收帧数据的步骤。
在一些实施例中,对所述帧数据添加帧头和帧尾,进一步包括:
生成伪随机数;
将所述伪随机数作为所述帧数据的帧头和帧尾。
基于同一发明构思,根据本发明的另一个方面,本发明的实施例还提供了一种计算机设备,包括:
至少一个处理器;以及
存储器,所述存储器存储有可在所述处理器上运行的计算机程序,其特征在于,所述处理器执行所述程序时执行以下步骤:
接收帧数据;
对所述帧数据添加帧头和帧尾;
根据所述帧头和所述帧尾得到所述帧数据的实际像素点数,并去除所述帧头和所述帧尾;
将所述实际像素点数与标准像素点数进行对比以判断所述帧数据中是否有数据丢失;
响应于所述帧数据中有数据丢失,根据所述实际像素点数与所述标准像素点数的差值确定待补充的像素点数;
根据所述待补充的像素点数对所述帧数据进行像素点的补充以进行压缩,并返回接收帧数据的步骤。
在一些实施例中,接收帧数据,进一步包括:
获取源数据以及用户输入的配置信息;
根据所述配置信息,对所述源数据进行丢帧处理;
接收进行丢帧处理后的源数据中的帧数据。
在一些实施例中,对所述源数据进行丢帧处理,进一步包括:
响应于所述配置信息为第一配置信息,不进行丢帧处理;
响应于所述配置信息为第二配置信息,将所述源数据进行丢帧处理后得到第一帧频的数据;
响应于所述配置信息为第三配置信息,将所述源数据进行丢帧处理后得到第二帧频的数据;
响应于所述配置信息为第四配置信息,将所述源数据直接丢弃。
在一些实施例中,所述第一帧频的数据为由所述源数据中第[N*源数据的帧频/第一帧频]帧组成的数据;所述第二帧频的数据为由所述源数据中第[M*源数据的帧频/第二帧频]帧组成的数据;
其中,N取值为0~第一帧频之间的整数,M取值为0~第一帧频之间的整数,[]表示向下取整。
基于同一发明构思,根据本发明的另一个方面,本发明的实施例还提供了一种计算机可读存储介质,所述计算机可读存储介质存储有计算机程序,所述计算机程序被处理器执行时执行如上所述的任一种视频压缩方法的步骤。
本发明具有以下有益技术效果之一:本发明提出的方案通过对帧数据添加帧头和帧尾,实现了通过检测帧头和帧尾标志,判断帧数据是否丢失数据,并对丢失数据的帧,进行补全,避免一帧或几帧有像素点丢失,而导致视频显示不正常的现象。极大的提升了SoC系统中视频压缩功能的稳定性。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的实施例。
图1为现有技术中的SOC系统的结构框图;
图2为本发明的实施例提供的视频压缩方法的流程示意图;
图3为本发明的实施例提供的SOC系统的结构框图;
图4为本发明的实施例提供的计算机设备的结构示意图;
图5为本发明的实施例提供的计算机可读存储介质的结构示意图。
具体实施方式
为使本发明的目的、技术方案和优点更加清楚明白,以下结合具体实施例,并参照附图,对本发明实施例进一步详细说明。
需要说明的是,本发明实施例中所有使用“第一”和“第二”的表述均是为了区分两个相同名称非相同的实体或者非相同的参量,可见“第一”“第二”仅为了表述的方便,不应理解为对本发明实施例的限定,后续实施例对此不再一一说明。
根据本发明的一个方面,本发明的实施例提出一种视频压缩方法,如图2所示,其可以包括步骤:S1,接收帧数据;S2,对所述帧数据添加帧头和帧尾;S3,根据所述帧头和所述帧尾得到所述帧数据的实际像素点数,并去除所述帧头和所述帧尾;S4,将所述实际像素点数与标准像素点数进行对比以判断所述帧数据中是否有数据丢失;S5,响应于所述帧数据中有数据丢失,根据所述实际像素点数与所述标准像素点数的差值确定待补充的像素点数;S6,根据所述待补充的像素点数对所述帧数据进行像素点的补充以进行压缩,并返回接收帧数据的步骤。
本发明提出的方案通过对帧数据添加帧头和帧尾,实现了通过检测帧头和帧尾标志,判断帧数据是否丢失数据,并对丢失数据的帧,进行补全,避免一帧或几帧有像素点丢失,而导致视频显示不正常的现象。极大的提升了SoC系统中视频压缩功能的稳定性。
在一些实施例中,在步骤S1接收帧数据中,进一步包括:
获取源数据以及用户输入的配置信息;
根据所述配置信息,对所述源数据进行丢帧处理;
接收进行丢帧处理后的源数据中的帧数据。
具体的,如图3所示,VGA IP(显卡)输出的源视频数据(RGB格式),有两种形式,一是通过接口1,表示是VGA接口,直接输入给DATA_PROC模块。二是通过接口2,表示是VGA IP先将视频数据存放至DDR,然后DATA_PROC模块再去读DDR。DATA_PROC为数据处理模块,一方面接收RANDOM_GEN发送来的数据,即伪随机数产生模块产生的帧头和帧尾数据,然后将每一帧数据加上帧头和帧尾,另一方面,接收CFG模块的配置信息,进行丢帧操作。
需要说明的是,丢帧操作是指将完整的一帧数据丢弃。
在一些实施例中,对所述源数据进行丢帧处理,进一步包括:
响应于所述配置信息为第一配置信息,不进行丢帧处理;
响应于所述配置信息为第二配置信息,将所述源数据进行丢帧处理后得到第一帧频的数据;
响应于所述配置信息为第三配置信息,将所述源数据进行丢帧处理后得到第二帧频的数据;
响应于所述配置信息为第四配置信息,将所述源数据直接丢弃。
具体的,在一些实施例中,如图3所示,可以通过CFG配置模块接受用户的配置,由用户根据SoC软件运行的情况,对DATA_PROC的丢帧情况进行设置,例如可以分为4个档次/级别进行丢帧。例如可以分别是LEVEL_0、LEVEL_1、LEVEL_2、LEVEL_3。分别对应配置寄存器的值为0(第一配置信息)、1(第二配置信息)、2(第三配置信息)和3(第四配置信息)。其中当用户选择LEVEL_0时,表示用户认为SoC当前运行的软件优先级低,视频数据优先,即帧数据全部保留,不进行丢帧操作。当用户选择LEVEL_1时,表示用户认为SoC当前运行的软件优先级略高,可以丢弃部分帧数据,得到第一帧频的数据,该第一帧频的数据可以保留到人肉眼的分辨限度。当用户选择LEVEL_2时,表示用户认为SoC当前运行的软件优先级很高,可以丢弃大部分帧数据,得到第二帧频的数据,这样情况下,远端视频略有卡顿感,但是能优先保证SoC当前运行软件的流畅性。当用户选择LEVEL_3时,表示用户认为SoC当前运行的软件优先级特别高,可以先暂停视频传输,这样的情况下,将丢弃所有的帧数据,将DDR接口完全给SoC软件使用,极大保证SoC当前运行的软件的流畅性。
在一些实施例中,所述第一帧频的数据为由所述源数据中第[N*源数据的帧频/第一帧频]帧组成的数据;所述第二帧频的数据为由所述源数据中第[M*源数据的帧频/第二帧频]帧组成的数据;
其中,N取值为0~第一帧频之间的整数,M取值为0~第一帧频之间的整数,[]表示向下取整。
具体的,例如第一帧频为24帧/s(即保留24帧—人肉眼的分辨限度)。源视频的帧频为60,则第一帧频的数据由源视频的第0、2(2.5向下取整得到)、5、7(7.5向下取整得到)、10、…、57(57.5向下取整)帧数据组成。例如第二帧频为10帧/s,源视频的帧频为60时,第二帧频的数据由源视频的第0、6、12、…、54帧数据组成。这样取帧频中间隔最大的帧,以保证视频的质量。
这样,通过CFG配置模块的丢帧处理,解决了DDR接口竞争问题,由用户在SoC软件运行过程中,根据软件的优先级及运行状况进行配置,实现丢帧功能,减少了视频压缩输出的数据量,缓解了DDR接口竞争的问题,同时降低了帧数据紊乱的概率。
在一些实施例中,在步骤S2对所述帧数据添加帧头和帧尾中,进一步包括:
生成伪随机数;
将所述伪随机数作为所述帧数据的帧头和帧尾。
具体的,如图3所示,为防止真正的视频数据与帧头帧尾标志信息重复,可以通过伪随机数产生模块(RANDOM_GEN),产生不固定长度数据,作为伪随机的帧头和帧尾标志,极大降低了源视频数据与帧头帧尾数据重复的概率。其中,每一帧数据的帧头和帧尾所对应的伪随机数可以相同,也可以不同,另外不同帧数据的帧头和帧尾所对应的伪随机数不同。
需要说明的是,伪随机数产生模块的实现方法有很多,最简单的一种实现方式就是用移位寄存器的方式进行,该模块可以产生位宽随机(有限度的随机)的伪随机数,分别发送至DATA_PROC和ERROR_DETECT模块,这样将极大的降低帧头帧尾与真正的视频数据重复的概率。
在一些实施例中,在步骤S3-S6中,具体的,如图3所示,可以通过错误检测模块(ERROR_DETECT)检测输入的一帧数据中是否有数据丢失。首先检测帧头信息,然后对输入的帧数据进行计数,直到检测到帧尾信息,得到输入的一帧数据的像素点数目,然后与正常帧的像素点数据进行比对,如果有数据丢失,则进行补全(如补0)。
例如,在1024x768 RGB888模式下,在帧头FFD8和帧尾FFD9中间,有2359294个数,而正常帧中,应该有1024x768x3=2359296个数,说明此帧丢失了两个数,此时则在帧数据的最后补全2个0。然后才继续接收下一帧数据,检测下一帧的帧头。
需要说明的是,错误检测模块(ERROR_DETECT)还完成了去除帧头帧尾数据的工作,并且只将补全的真正视频数据送入后级的压缩IP。
在一些实施例中,方法还包括:
响应于所述帧数据中没有数据丢失,直接将所述帧数据发送至压缩模块以进行压缩,并返回接收帧数据的步骤。
本发明提出的方案通过DATA_PROC,数据处理模块,加入帧头帧尾信息,同时设计ERROR_DETECT模块,检测帧头帧尾,并且对于丢数的帧,进行补全处理(比如补0),进而将数据输入至压缩IP,完成视频压缩。并且,为防止真正的视频数据与帧头帧尾数据重复,通过伪随机数产生模块RANDOM_GEN,产生不固定长度的数据,作为伪随机的帧头和帧尾,极大降低了源视频数据与帧头帧尾数据重复的概率。与此同时,为解决DDR接口竞争问题,设计CFG配置模块,用于丢帧功能,由用户在SoC软件运行过程中,根据软件的优先级及运行状况进行配置,实现丢帧功能,减少了视频压缩输出的数据量,缓解了DDR接口竞争的问题,同时降低了帧数据紊乱的概率。
基于同一发明构思,根据本发明的另一个方面,如图4所示,本发明的实施例还提供了一种计算机设备501,包括:
至少一个处理器520;以及
存储器510,存储器510存储有可在处理器上运行的计算机程序511,处理器520执行程序时执行如上的任一种视频压缩方法的步骤。
基于同一发明构思,根据本发明的另一个方面,如图5所示,本发明的实施例还提供了一种计算机可读存储介质601,计算机可读存储介质601存储有计算机程序指令610,计算机程序指令610被处理器执行时执行如上的任一种视频压缩方法的步骤。
最后需要说明的是,本领域普通技术人员可以理解实现上述实施例方法中的全部或部分流程,可以通过计算机程序来指令相关硬件来完成,的程序可存储于一计算机可读取存储介质中,该程序在执行时,可包括如上述各方法的实施例的流程。其中,的存储介质可为磁碟、光盘、只读存储记忆体(ROM)或随机存储记忆体(RAM)等。上述计算机程序的实施例,可以达到与之对应的前述任意方法实施例相同或者相类似的效果。
此外,典型地,本发明实施例公开的装置、设备等可为各种电子终端设备,例如手机、个人数字助理(PDA)、平板电脑(PAD)、智能电视等,也可以是大型终端设备,如服务器等,因此本发明实施例公开的保护范围不应限定为某种特定类型的装置、设备。本发明实施例公开的客户端可以是以电子硬件、计算机软件或两者的组合形式应用于上述任意一种电子终端设备中。
此外,根据本发明实施例公开的方法还可以被实现为由CPU执行的计算机程序,该计算机程序可以存储在计算机可读存储介质中。在该计算机程序被CPU执行时,执行本发明实施例公开的方法中限定的上述功能。
此外,上述方法步骤以及系统单元也可以利用控制器以及用于存储使得控制器实现上述步骤或单元功能的计算机程序的计算机可读存储介质实现。
此外,应该明白的是,本文的计算机可读存储介质(例如,存储器)可以是易失性存储器或非易失性存储器,或者可以包括易失性存储器和非易失性存储器两者。作为例子而非限制性的,非易失性存储器可以包括只读存储器(ROM)、可编程ROM(PROM)、电可编程ROM(EPROM)、电可擦写可编程ROM(EEPROM)或快闪存储器。易失性存储器可以包括随机存取存储器(RAM),该RAM可以充当外部高速缓存存储器。作为例子而非限制性的,RAM可以以多种形式获得,比如同步RAM(DRAM)、动态RAM(DRAM)、同步DRAM(SDRAM)、双数据速率SDRAM(DDRSDRAM)、增强SDRAM(ESDRAM)、同步链路DRAM(SLDRAM)、以及直接Rambus RAM(DRRAM)。所公开的方面的存储设备意在包括但不限于这些和其它合适类型的存储器。
本领域技术人员还将明白的是,结合这里的公开所描述的各种示例性逻辑块、模块、电路和算法步骤可以被实现为电子硬件、计算机软件或两者的组合。为了清楚地说明硬件和软件的这种可互换性,已经就各种示意性组件、方块、模块、电路和步骤的功能对其进行了一般性的描述。这种功能是被实现为软件还是被实现为硬件取决于具体应用以及施加给整个系统的设计约束。本领域技术人员可以针对每种具体应用以各种方式来实现的功能,但是这种实现决定不应被解释为导致脱离本发明实施例公开的范围。
结合这里的公开所描述的各种示例性逻辑块、模块和电路可以利用被设计成用于执行这里功能的下列部件来实现或执行:通用处理器、数字信号处理器(DSP)、专用集成电路(ASIC)、现场可编程门阵列(FPGA)或其它可编程逻辑器件、分立门或晶体管逻辑、分立的硬件组件或者这些部件的任何组合。通用处理器可以是微处理器,但是可替换地,处理器可以是任何传统处理器、控制器、微控制器或状态机。处理器也可以被实现为计算设备的组合,例如,DSP和微处理器的组合、多个微处理器、一个或多个微处理器结合DSP和/或任何其它这种配置。
结合这里的公开所描述的方法或算法的步骤可以直接包含在硬件中、由处理器执行的软件模块中或这两者的组合中。软件模块可以驻留在RAM存储器、快闪存储器、ROM存储器、EPROM存储器、EEPROM存储器、寄存器、硬盘、可移动盘、CD-ROM、或本领域已知的任何其它形式的存储介质中。示例性的存储介质被耦合到处理器,使得处理器能够从该存储介质中读取信息或向该存储介质写入信息。在一个替换方案中,存储介质可以与处理器集成在一起。处理器和存储介质可以驻留在ASIC中。ASIC可以驻留在用户终端中。在一个替换方案中,处理器和存储介质可以作为分立组件驻留在用户终端中。
在一个或多个示例性设计中,功能可以在硬件、软件、固件或其任意组合中实现。如果在软件中实现,则可以将功能作为一个或多个指令或代码存储在计算机可读介质上或通过计算机可读介质来传送。计算机可读介质包括计算机存储介质和通信介质,该通信介质包括有助于将计算机程序从一个位置传送到另一个位置的任何介质。存储介质可以是能够被通用或专用计算机访问的任何可用介质。作为例子而非限制性的,该计算机可读介质可以包括RAM、ROM、EEPROM、CD-ROM或其它光盘存储设备、磁盘存储设备或其它磁性存储设备,或者是可以用于携带或存储形式为指令或数据结构的所需程序代码并且能够被通用或专用计算机或者通用或专用处理器访问的任何其它介质。此外,任何连接都可以适当地称为计算机可读介质。例如,如果使用同轴线缆、光纤线缆、双绞线、数字用户线路(DSL)或诸如红外线、无线电和微波的无线技术来从网站、服务器或其它远程源发送软件,则上述同轴线缆、光纤线缆、双绞线、DSL或诸如红外线、无线电和微波的无线技术均包括在介质的定义。如这里所使用的,磁盘和光盘包括压缩盘(CD)、激光盘、光盘、数字多功能盘(DVD)、软盘、蓝光盘,其中磁盘通常磁性地再现数据,而光盘利用激光光学地再现数据。上述内容的组合也应当包括在计算机可读介质的范围内。
以上是本发明公开的示例性实施例,但是应当注意,在不背离权利要求限定的本发明实施例公开的范围的前提下,可以进行多种改变和修改。根据这里描述的公开实施例的方法权利要求的功能、步骤和/或动作不需以任何特定顺序执行。此外,尽管本发明实施例公开的元素可以以个体形式描述或要求,但除非明确限制为单数,也可以理解为多个。
应当理解的是,在本文中使用的,除非上下文清楚地支持例外情况,单数形式“一个”旨在也包括复数形式。还应当理解的是,在本文中使用的“和/或”是指包括一个或者一个以上相关联地列出的项目的任意和所有可能组合。
上述本发明实施例公开实施例序号仅仅为了描述,不代表实施例的优劣。
本领域普通技术人员可以理解实现上述实施例的全部或部分步骤可以通过硬件来完成,也可以通过程序来指令相关的硬件完成,的程序可以存储于一种计算机可读存储介质中,上述提到的存储介质可以是只读存储器,磁盘或光盘等。
所属领域的普通技术人员应当理解:以上任何实施例的讨论仅为示例性的,并非旨在暗示本发明实施例公开的范围(包括权利要求)被限于这些例子;在本发明实施例的思路下,以上实施例或者不同实施例中的技术特征之间也可以进行组合,并存在如上的本发明实施例的不同方面的许多其它变化,为了简明它们没有在细节中提供。因此,凡在本发明实施例的精神和原则之内,所做的任何省略、修改、等同替换、改进等,均应包含在本发明实施例的保护范围之内。

Claims (10)

1.一种视频压缩方法,其特征在于,包括以下步骤:
接收帧数据;
对所述帧数据添加帧头和帧尾;
根据所述帧头和所述帧尾得到所述帧数据的实际像素点数,并去除所述帧头和所述帧尾;
将所述实际像素点数与标准像素点数进行对比以判断所述帧数据中是否有数据丢失;
响应于所述帧数据中有数据丢失,根据所述实际像素点数与所述标准像素点数的差值确定待补充的像素点数;
根据所述待补充的像素点数对所述帧数据进行像素点的补充以进行压缩,并返回接收帧数据的步骤。
2.如权利要求1所述的方法,其特征在于,接收帧数据,进一步包括:
获取源数据以及用户输入的配置信息;
根据所述配置信息,对所述源数据进行丢帧处理;
接收进行丢帧处理后的源数据中的帧数据。
3.如权利要求2所述的方法,其特征在于,对所述源数据进行丢帧处理,进一步包括:
响应于所述配置信息为第一配置信息,不进行丢帧处理;
响应于所述配置信息为第二配置信息,将所述源数据进行丢帧处理后得到第一帧频的数据;
响应于所述配置信息为第三配置信息,将所述源数据进行丢帧处理后得到第二帧频的数据;
响应于所述配置信息为第四配置信息,将所述源数据直接丢弃。
4.如权利要求3所述的方法,其特征在于,所述第一帧频的数据为由所述源数据中第[N*源数据的帧频/第一帧频]帧组成的数据;所述第二帧频的数据为由所述源数据中第[M*源数据的帧频/第二帧频]帧组成的数据;
其中,N取值为0~第一帧频之间的整数,M取值为0~第一帧频之间的整数,[]表示向下取整。
5.如权利要求1所述的方法,其特征在于,还包括:
响应于所述帧数据中没有数据丢失,直接将所述帧数据发送至压缩模块以进行压缩,并返回接收帧数据的步骤。
6.如权利要求1所述的方法,其特征在于,对所述帧数据添加帧头和帧尾,进一步包括:
生成伪随机数;
将所述伪随机数作为所述帧数据的帧头和帧尾。
7.一种计算机设备,包括:
至少一个处理器;以及
存储器,所述存储器存储有可在所述处理器上运行的计算机程序,其特征在于,所述处理器执行所述程序时执行以下步骤:
接收帧数据;
对所述帧数据添加帧头和帧尾;
根据所述帧头和所述帧尾得到所述帧数据的实际像素点数,并去除所述帧头和所述帧尾;
将所述实际像素点数与标准像素点数进行对比以判断所述帧数据中是否有数据丢失;
响应于所述帧数据中有数据丢失,根据所述实际像素点数与所述标准像素点数的差值确定待补充的像素点数;
根据所述待补充的像素点数对所述帧数据进行像素点的补充以进行压缩,并返回接收帧数据的步骤。
8.如权利要求7所述的设备,其特征在于,接收帧数据,进一步包括:
获取源数据以及用户输入的配置信息;
根据所述配置信息,对所述源数据进行丢帧处理;
接收进行丢帧处理后的源数据中的帧数据。
9.如权利要求8所述的设备,其特征在于,对所述源数据进行丢帧处理,进一步包括:
响应于所述配置信息为第一配置信息,不进行丢帧处理;
响应于所述配置信息为第二配置信息,将所述源数据进行丢帧处理后得到第一帧频的数据;
响应于所述配置信息为第三配置信息,将所述源数据进行丢帧处理后得到第二帧频的数据;
响应于所述配置信息为第四配置信息,将所述源数据直接丢弃;
其中,所述第一帧频的数据为由所述源数据中第[N*源数据的帧频/第一帧频]帧组成的数据;所述第二帧频的数据为由所述源数据中第[M*源数据的帧频/第二帧频]帧组成的数据;
其中,N取值为0~第一帧频之间的整数,M取值为0~第一帧频之间的整数,[]表示向下取整。
10.一种计算机可读存储介质,所述计算机可读存储介质存储有计算机程序,其特征在于,所述计算机程序被处理器执行时执行如权利要求1-6任意一项所述的方法的步骤。
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