CN110336961B - 电视通道切换处理方法、电视及存储介质 - Google Patents

电视通道切换处理方法、电视及存储介质 Download PDF

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Abstract

本发明公开了电视通道切换处理方法、电视及存储介质，所述方法包括：当选择8K通道，SOC电视主芯片读取FPGA接收的8K视频信号；控制将SOC电视主芯片输出信号切换到只输出透明的模式；同时FPGA切换到图像叠加模式；FPGA将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出。本发明可以实现基于FPGA 8K电视8K通道切换，完成4K OSD与8K视频信号叠加，可以实现8K通道完美切换，提高了切换时图像清楚稳定性，可以节约电视信号通道切换的切换时间，提高电视信号通道切换的切换效率；方便用户使用。

Description

电视通道切换处理方法、电视及存储介质
技术领域
本发明涉及电视技术领域，具体涉及一种电视通道切换处理方法、电视及存储介质。
背景技术
随着电子技术的发展和人们生活水平的不断提高，各种电视的使用越来越普及。现在经常用于8K高清电视。
现有技术电视的通道切换方式由SOC（电视机主芯片）单独完成，不能处理图像叠加。
因此，现有技术还有待于改进和发展。
发明内容
鉴于上述现有技术的不足之处，本发明的目的在于提供一种电视通道切换处理方法、电视及存储介质，本发明可以实现基于FPGA 8K电视8K通道切换，完成4K OSD与8K视频信号叠加，可以实现8K通道完美切换。
为了达到上述目的，本发明采取了以下技术方案：
一种电视通道切换处理方法，其中，包括如下步骤：
预先在电视的SOC电视主芯片与显示屏之间连接设置用于进行图像叠加FPGA，并设置SOC电视主芯片接入4K信号源，FPGA接入8K信号源；
当选择8K通道， SOC电视主芯片读取FPGA接收的8K视频信号；控制将SOC电视主芯片输出信号切换到只输出透明的模式；同时FPGA切换到图像叠加模式；
FPGA将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出。
所述的电视通道切换处理方法，其中，
所述当选择8K通道， SOC电视主芯片读取FPGA接收的8K视频信号的步骤包括：当选择8K通道，SOC电视主芯片将系统声音禁声；SOC电视主芯片读取FPGA接收的8K视频信号；
其中，所述控制将SOC电视主芯片输出信号切换到只输出透明的模式；同时FPGA切换到图像叠加模式的步骤包括：
SOC电视主芯片将图像静帧，FPGA将图像静帧；SOC电视主芯片输出信号从ARGB模式切换到屏蔽RGB信号只输出透明的模式；
同时FPGA从4K UPSCALE 8K模式切换到VBYONE与8K图像叠加模式；
其中，所述预先在电视的SOC电视主芯片与显示屏之间连接设置用于进行图像叠加FPGA，并设置SOC电视主芯片接入4K信号源，FPGA接入8K信号源的步骤包括：
在所述FPGA与SOC电视主芯片间设置VBYONE数字接口信号线，I2C信号线，IO1信号线。
所述的电视通道切换处理方法，其中，所述FPGA将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出的步骤具体包括：
SOC电视主芯片解静帧，FPGA解静帧，FPGA将SOC通过VBYONE输出透明度信号与8K接口输入的8K图像信号叠加，并输出到显示屏，同时将8K信号中的音频分量解码输出。
一种电视通道切换处理方法，其中，包括如下步骤：
当选择8K通道， SOC电视主芯片读取FPGA接收的8K视频信号；同时控制FPGA切换到图像叠加模式；SOC电视主芯片输出信号切换到只输出透明的模式；
SOC电视主芯片输出透明度信号至FPGA，用于与FPGA接收的8K图像信号进行叠加后，输出给显示屏，同时将8K信号中的音频分量解码输出。
一种电视通道切换处理方法，其中，包括如下步骤：
当选择8K通道， FPGA检测到SOC电视主芯片输出信号切换到只输出透明的模式信息；FPGA切换到图像叠加模式；
FPGA将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出。
一种电视，其中，包括：
SOC电视主芯片，用于当选择8K通道， SOC电视主芯片读取FPGA接收的8K视频信号；控制将SOC电视主芯片输出信号切换到只输出透明的模式；同时控制FPGA切换到图像叠加模式；
与SOC电视主芯片连接的FPGA，用于FPGA将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出；
与FPGA芯片连接的显示屏。
所述电视，其中，其还包括：与SOC电视主芯片连接的存储器，所述存储器上存储有可被所述SOC电视主芯片执行的电视通道切换处理程序；所述SOC电视主芯片执行所述电视通道切换处理程序时还实现如下步骤：
当选择8K通道，SOC电视主芯片将系统声音禁声；SOC电视主芯片读取FPGA接收的8K视频信号；
SOC电视主芯片将图像静帧，FPGA将图像静帧；SOC电视主芯片输出信号从ARGB模式切换到屏蔽RGB信号只输出透明的模式；
同时FPGA从4K UPSCALE 8K模式切换到VBYONE与8K图像叠加模式。
所述电视，其中，所述SOC电视主芯片执行所述电视通道切换处理程序时还实现如下步骤：
SOC电视主芯片解静帧，FPGA解静帧，FPGA将SOC通过VBYONE输出透明度信号与8K接口输入的8K图像信号叠加，并输出到显示屏，同时将8K信号中的音频分量解码输出;
在所述FPGA与SOC电视主芯片间设置VBYONE数字接口信号线，I2C信号线，IO1信号线。
一种SOC芯片，其中，包括：
读取模块，用于当选择8K通道，读取FPGA接收的8K视频信号；
控制模块，用于控制FPGA切换到图像叠加模式，输出信号切换到只输出透明的模式；
输出模块，用于输出透明度信号至FPGA，用于与FPGA接收的8K图像信号进行叠加后，输出给显示屏，同时将8K信号中的音频分量解码输出。
一种FPGA，其中，包括：
通知模块，用于检测到SOC电视主芯片输出信号切换到只输出透明的模式信息时，通知FPGA切换到图像叠加模式；
输出模块，用于将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出。
一种计算机可读存储介质，其中，所述计算机可读存储介质存储有一个或者多个程序，所述一个或者多个程序可被一个或者多个SOC电视主芯片执行，以实现任意一项所述的电视通道切换处理方法中的步骤。
相较于现有技术，本发明提供的电视通道切换处理方法、电视及存储介质，本发明可以实现基于FPGA 8K电视8K通道切换，完成4K OSD与8K视频信号叠加，可以实现8K通道完美切换，提高了切换时图像清楚稳定性，可以节约电视信号通道切换的切换时间，提高电视信号通道切换的切换效率；方便用户使用。
附图说明
图1为本发明电视第一较佳实施例的功能模块图。
图2为本发明电视第二较佳实施例的功能模块图。
图3为本发明电视较佳实施例的工作原理流程图。
图4为本发明提供的电视通道切换处理方法的流程图。
图5为本发明SOC芯片较佳实施例的功能模块图。
图6为本发明FPGA较佳实施例的功能模块图。
具体实施方式
为使本发明的目的、技术方案及效果更加清楚、明确，以下参照附图并举实施例对本发明进一步详细说明。应当理解，此处所描述的具体实施例仅用以解释本发明，并不用于限定本发明。
图1为本发明实施例的电视功能原理框图，如图1所示，本发明实施例所示的电视，包括：
SOC电视主芯片，用于当选择8K通道， SOC电视主芯片读取FPGA接收的8K视频信号；控制将SOC电视主芯片输出信号切换到只输出透明的模式；同时控制FPGA切换到图像叠加模式。本实施例的SOC电视主芯片可接4K信号源，SOC电视主芯片是电视的系统级芯片，可对FPGA发送各种控制指令；
与SOC电视主芯片连接的FPGA，用于FPGA将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出。本实施例的FPGA（即现场可编程门阵列）可接入8K信号源；所述FPGA与SOC电视主芯片间连接有VBYONE(ARGB面向图像传输开发出的数字接口)信号线，I2C信号线，IO1信号线；FPGA用于将4K信号中的A分量与8K图像信号叠加，并将叠加后的信号输出到8K液晶屏；
与FPGA芯片连接的8K液晶屏（显示屏），所述8K液晶屏通过P2P与FPGA连接。所述显示屏在一些实施例中可以是LED显示屏、液晶显示屏、触控式液晶显示屏以及OLED（OrganicLight-Emitting Diode，有机发光二极管）触摸器等。所述显示屏用于显示在所述电视的信息以及用于显示可视化的用户界面。
图1仅示出了电视的部分组件，但是应理解的是，并不要求实施所有示出的组件，可以替代的实施更多或者更少的组件。
本发明实施例中通过SOC电视主芯片与FPGA交互，由SOC（电视机主芯片）和FPGA共同完成，通过SOC电视主芯片对FPGA发送指令，FPGA做完相关处理之后反馈相关信息给SOC电视主芯片，两者相互结合才能完成8K通道切换。关键点在于FPGA的图像叠加功能，可完美实现8K通道切换。
进一步地实施例，如图2所示，本实施例所述电视，在图1实施例的基础上，其还包括：与SOC电视主芯片连接的存储器，所述存储器在一些实施例中可以是所述电视的内部存储单元，例如电视的内存。所述存储器在另一些实施例中也可以是所述电视的外部存储设备，例如所述电视上配备的插接式U盘，智能存储卡（Smart Media Card, SMC），安全数字（Secure Digital, SD）卡，闪存卡（Flash Card）等。进一步地，所述存储器还可以既包括所电视的内部存储单元也包括外部存储设备。所述存储器用于存储安装于所述电视的应用软件及各类数据，例如所述安装电视的程序代码等。所述存储器还可以用于暂时地存储已经输出或者将要输出的数据。在一实施例中，存储器上存储有电视通道切换处理方法程序，该电视通道切换处理方法程序可被SOC电视主芯片所执行，从而实现本申请中电视通道切换处理方法。
在一实施例中，当所述SOC电视主芯片执行所述电视通道切换处理程序时还实现如下步骤：
当选择8K通道，SOC电视主芯片将系统声音禁声；SOC电视主芯片读取FPGA接收的8K视频信号；
SOC电视主芯片将图像静帧，FPGA将图像静帧；SOC电视主芯片输出信号从ARGB模式切换到屏蔽RGB信号只输出透明的模式；
同时FPGA从4K UPSCALE 8K模式切换到VBYONE与8K图像叠加模式。
其中，所述SOC电视主芯片执行所述电视通道切换处理程序时还实现如下步骤：
SOC电视主芯片解静帧，FPGA解静帧，FPGA将SOC通过VBYONE输出透明度信号与8K接口输入的8K图像信号叠加，并输出到显示屏，同时将8K信号中的音频分量解码输出。
其中，在所述FPGA与SOC电视主芯片间设置VBYONE数字接口信号线，I2C信号线，IO1信号线。
如图3所示，本发明实施例的电视工作原理如下：
1、开始：
2、当选择8K通道时，此时SOC电视主芯片 Mute（禁音）系统声音，并通过I2C告知FPGA用户已经选择8K通道；SOC电视主芯片 Mute（禁音）系统声音主要是为了防止通道切换过程中有异响；
3、FPGA检测8K信号输入接口是否有信号输入，无信号则IO1默认为高（1）电平；有信号则将IO1接低（0）为低电平；
4、SOC电视主芯片判断IO1的状态，如果为1则显示信号；
5、如果为0，SOC电视主芯片通过I2C读取FPGA通过8K接口接收的视频信号信息（包括分辨率、帧率）；
6、SOC电视主芯片将图像静帧、FPGA将图像静帧；静帧意思为将图像信息冻结，作用是防止通道切换过程中出现异常显示，如花屏。
7、SOC VBYONE输出信号从ARGB模式切换到屏蔽RGB信号只输出透明度的模式，同时FPGA从4K Upscaling 8K模式切换到VBYONE与8K图像叠加模式；其中，RGB是信号的一种传输模式，其中A代表透明度分量，RGB分别代表三基色分量，只输出透明度的模式即屏蔽ARGB模式中RGB三基色分量，只输出A分量。
Upscaling是一种将4K图像通过算法插像素点的方式转变为8K图像的手段。
8、SOC解静帧，FPGA解静帧，FPGA将SOC通过VBYONE输出的透明度信号（OSD）与8K接口输入的图像信号叠加，并输出点屏，同时将8K信号中的音频分量解码输出，完成8K通道切换；其中，解静帧意思是将图像解冻，让其正常输出，因为此时通道切换准备工作已经做完，所以可以正常输出图像了。
FPGA将4K信号中的A分量与8K图像信号叠加，并将叠加后的信号输出点屏。前面过程都是为最终这一步做准备。
9、结束。
由上可见，本发明本的电视可以实现基于FPGA 8K电视8K通道切换，完成4K OSD与8K视频信号叠加，可以实现8K通道完美切换，提高了切换时图像清楚稳定性，可以节约电视信号通道切换的切换时间，提高电视信号通道切换的切换效率；方便用户使用。
基于上述实施例的电视，本发明还提供了一种电视通道切换处理方法，如图4所示，本实施例所述电视通道切换处理方法包括如下步骤：
步骤S100、预先在电视的SOC电视主芯片与显示屏之间连接设置用于进行图像叠加FPGA，并设置SOC电视主芯片接入4K信号源，FPGA接入8K信号源。
如图1所示，本发明中预先在电视的SOC电视主芯片与显示屏之间连接设置用于进行图像叠加FPGA，在所述FPGA与SOC电视主芯片间设置VBYONE数字接口信号线，I2C信号线，IO1信号线。
步骤S200、当选择8K通道， SOC电视主芯片读取FPGA接收的8K视频信号；控制将SOC电视主芯片输出信号切换到只输出透明的模式；同时FPGA切换到图像叠加模式。
本发明实施例中，当选择8K通道，SOC电视主芯片将系统声音禁声；SOC电视主芯片读取FPGA接收的8K视频信号；
然后SOC电视主芯片将图像静帧，FPGA将图像静帧；SOC电视主芯片输出信号从ARGB模式切换到屏蔽RGB信号只输出透明的模式；
同时FPGA从4K UPSCALE 8K模式切换到VBYONE与8K图像叠加模式。
步骤S300、FPGA将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出。
SOC电视主芯片解静帧，FPGA解静帧，FPGA将SOC通过VBYONE输出透明度信号与8K接口输入的8K图像信号叠加，并输出到显示屏，同时将8K信号中的音频分量解码输出。
进一步地，所述方法实施例具体包括如下步骤：
第一步：当电视通过遥控选择8K通道后，SOC电视主芯片控制功放将系统声音Mute(静音)，并通过I2C信号线发送I2C协议告知FPGA电视已进入8K通道；本步骤中SOC电视主芯片控制功放将系统声音Mute(静音)是为了防止通道切换过程中有异响。
第二步：FPGA检测8K信号输入接口是否有信号输入，无信号则IO1信号线默认为高（1）电平，有信号则将IO1拉低（0）为低电频；
第三步：SOC电视主芯片检测IO1信号线的状态，若为高则显示无信号并循环检测，若为低则进入下一步；
第四步：SOC电视主芯片通过I2C信号线读取FPGA通过8K接口接收的视频信号信息（包括分辨率、帧率）；
第五步：SOC电视主芯片将图像静帧，FPGA将图像静帧；本发明实施例中，将图像静帧意思为将图像信息冻结，作用是防止通道切换过程中出现异常显示，如花屏。
第六步：SOC电视主芯片的VBYONE接口（ARGB面向图像传输开发出的数字接口）输出信号从ARGB 模式切换到屏蔽RGB信号只输出透明度的模式 ，同时FPGA从4K Upscaling8K模式切换到VBYONE与8K图像叠加模式；Upscaling是一种将4K图像通过算法插像素点的方式转变为8K图像的手段。
其中，ARGB是信号的一种传输模式，其中A代表透明度分量，RGB分别代表三基色分量，只输出透明度的模式即屏蔽ARGB模式中RGB三基色分量，只输出A分量。
而本步骤中只输出透明度的模式是：此时是在准备进入8K通道，因此需要屏蔽4K通道的图像信息，即屏蔽ARGB模式中的RGB分量，但8K通道的菜单显示是来至于4K通道ARGB模式中的A分量，所以此时是只输出透明度模式，即只输出A分量。
第七步：SOC电视主芯片解静帧，FPGA解静帧，FPGA将SOC通过VBYONE输出的透明度信号（OSD）与8K接口输入的图像信号叠加，并输出点屏，同时将8K信号中的音频分量解码输出，完成8K通道切换。
解静帧意思是将图像解冻，让其正常输出，因为此时通道切换准备工作已经做完，所以可以正常输出图像了。
FPGA将4K信号中的A分量与8K图像信号叠加，并将叠加后的信号输出点屏。前面过程都是为最终这一步做准备。
基于上述实施例，本发明另外的实施例还提供了一种电视通道切换处理方法，包括如下步骤：
当选择8K通道， SOC电视主芯片读取FPGA接收的8K视频信号；同时控制FPGA切换到图像叠加模式；SOC电视主芯片输出信号切换到只输出透明的模式；
SOC电视主芯片输出透明度信号至FPGA，用于与FPGA接收的8K图像信号进行叠加后，输出给显示屏，同时将8K信号中的音频分量解码输出，具体如上所述。
基于上述实施例，本发明另外的实施例还提供了一种电视通道切换处理方法，包括如下步骤：
当选择8K通道， FPGA检测到SOC电视主芯片输出信号切换到只输出透明的模式信息；FPGA切换到图像叠加模式；
FPGA将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出，具体如上所述。
基于上述实施例，如图5所示，本发明实施例还提供了一种SOC芯片，包括：
读取模块510，用于当选择8K通道，读取FPGA接收的8K视频信号；具体如上所述；
控制模块520，用于控制FPGA切换到图像叠加模式，输出信号切换到只输出透明的模式；具体如上所述；
输出模块530，用于输出透明度信号至FPGA，用于与FPGA接收的8K图像信号进行叠加后，输出给显示屏，同时将8K信号中的音频分量解码输出，具体如上所述。
基于上述实施例，如图6所示，本发明实施例还一种FPGA，包括：
通知模块610，用于检测到SOC电视主芯片输出信号切换到只输出透明的模式信息时，通知FPGA切换到图像叠加模式；
输出模块620，用于将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出，具体如上所述。
基于上述实施例，本发明还提供了一种计算机可读存储介质，所述计算机可读存储介质存储有一个或者多个程序，所述一个或者多个程序可被一个或者多个SOC电视主芯片执行，以实现如上述任意一项所述的电视通道切换处理方法中的步骤，具体如上所述。
综上所述，相较于现有技术，本发明提供的电视通道切换处理方法、电视及存储介质，本发明可以实现基于FPGA 8K电视8K通道切换，完成4K OSD与8K视频信号叠加，可以实现8K通道完美切换，提高了切换时图像清楚稳定性，可以节约电视信号通道切换的切换时间，提高电视信号通道切换的切换效率；方便用户使用。。
当然，本领域普通技术人员可以理解实现上述实施例方法中的全部或部分流程，是可以通过计算机程序来指令相关硬件（如SOC电视主芯片，控制器等）来完成，所述的程序可存储于一计算机可读取的存储介质中，该程序在执行时可包括如上述各方法实施例的流程。其中所述的存储介质可为存储器、磁碟、光盘等。
应当理解的是，本发明的应用不限于上述的举例，对本领域普通技术人员来说，可以根据上述说明加以改进或变换，所有这些改进和变换都应属于本发明所附权利要求的保护范围。

Claims (9)

1.一种电视通道切换处理方法，其特征在于，包括如下步骤：
预先在电视的SOC电视主芯片与显示屏之间连接设置用于进行图像叠加FPGA，并设置SOC电视主芯片接入4K信号源，FPGA接入8K信号源；
当选择8K通道， SOC电视主芯片读取FPGA接收的8K视频信号；SOC电视主芯片将系统声音禁声，SOC电视主芯片将图像静帧，FPGA将图像静帧，控制将SOC电视主芯片输出信号切换到只输出透明的模式；同时FPGA切换到图像叠加模式；
FPGA将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出；
其中，所述FPGA将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出的步骤具体包括：
SOC电视主芯片将图像解静帧，FPGA将图像解静帧，FPGA将所述SOC电视主芯片通过VBYONE输出透明度信号与8K接口输入的8K图像信号叠加，并输出到显示屏，同时将8K信号中的音频分量解码输出；
所述FPGA切换到图像叠加模式具体包括：FPGA从4K UPSCALE 8K模式切换到VBYONE与8K图像叠加模式。
2.根据权利要求1所述的电视通道切换处理方法，其特征在于，所述预先在电视的SOC电视主芯片与显示屏之间连接设置用于进行图像叠加FPGA，并设置SOC电视主芯片接入4K信号源，FPGA接入8K信号源的步骤包括：
在所述FPGA与SOC电视主芯片间设置VBYONE数字接口信号线、I2C信号线和IO1信号线。
3.一种电视通道切换处理方法，其特征在于，包括如下步骤：
当选择8K通道， SOC电视主芯片读取FPGA接收的8K视频信号；同时控制FPGA切换到图像叠加模式；SOC电视主芯片将系统声音禁声，SOC电视主芯片将图像静帧；SOC电视主芯片输出信号切换到只输出透明的模式；
SOC电视主芯片输出透明度信号至FPGA，用于与FPGA接收的8K图像信号进行叠加后，输出给显示屏，同时将8K信号中的音频分量解码输出；
其中，所述SOC电视主芯片输出透明度信号至FPGA，用于与FPGA接收的8K图像信号进行叠加后，输出给显示屏，同时将8K信号中的音频分量解码输出的步骤具体包括：
SOC电视主芯片将图像解静帧，FPGA将所述SOC电视主芯片通过VBYONE输出透明度信号与8K接口输入的8K图像信号叠加，并输出到显示屏，同时将8K信号中的音频分量解码输出；
所述FPGA切换到图像叠加模式具体包括：FPGA从4K UPSCALE 8K模式切换到VBYONE与8K图像叠加模式。
4.一种电视通道切换处理方法，其特征在于，包括如下步骤：
当选择8K通道， FPGA检测到SOC电视主芯片输出信号切换到只输出透明的模式信息；FPGA将图像静帧；FPGA切换到图像叠加模式；
FPGA将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出；
其中，所述FPGA将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出的具体步骤包括：
FPGA将图像解静帧，FPGA将所述SOC电视主芯片通过VBYONE输出透明度信号与8K接口输入的8K图像信号叠加，并输出到显示屏，同时将8K信号中的音频分量解码输出；
所述FPGA切换到图像叠加模式具体包括：FPGA从4K UPSCALE 8K模式切换到VBYONE与8K图像叠加模式。
5.一种电视，其特征在于，包括：
SOC电视主芯片，用于当选择8K通道， SOC电视主芯片读取FPGA接收的8K视频信号；控制将SOC电视主芯片输出信号切换到只输出透明的模式；同时控制FPGA切换到图像叠加模式；
与SOC电视主芯片连接的FPGA，用于FPGA将接收的8K图像信号与SOC电视主芯片输出的透明度信号进行叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出；
与FPGA芯片连接的显示屏；
与SOC电视主芯片连接的存储器，所述存储器上存储有可被所述SOC电视主芯片执行的电视通道切换处理程序；所述SOC电视主芯片执行所述电视通道切换处理程序时还实现如下步骤：
当选择8K通道，SOC电视主芯片将系统声音禁声；SOC电视主芯片读取FPGA接收的8K视频信号；
SOC电视主芯片将图像静帧，FPGA将图像静帧；SOC电视主芯片输出信号从ARGB模式切换到屏蔽RGB信号只输出透明的模式；
同时FPGA从4K UPSCALE 8K模式切换到VBYONE与8K图像叠加模式。
6.根据权利要求5所述电视，其特征在于，所述SOC电视主芯片执行所述电视通道切换处理程序时还实现如下步骤：
SOC电视主芯片将图像解静帧，FPGA将图像解静帧，FPGA将所述SOC电视主芯片通过VBYONE输出透明度信号与8K接口输入的8K图像信号叠加，并输出到显示屏，同时将8K信号中的音频分量解码输出;
在所述FPGA与SOC电视主芯片间设置VBYONE数字接口信号线、I2C信号线和IO1信号线。
7.一种SOC芯片，其特征在于，包括：
读取模块，用于当选择8K通道，读取FPGA接收的8K视频信号；
控制模块，用于控制FPGA切换到图像叠加模式，将系统声音禁声，将图像静帧，输出信号切换到只输出透明的模式；其中，控制FPGA切换到图像叠加模式具体包括：控制FPGA从4KUPSCALE 8K模式切换到VBYONE与8K图像叠加模式；
输出模块，用于将图像解静帧，用于通过VBYONE输出透明度信号至FPGA，用于与FPGA接收的8K图像信号进行叠加后，输出给显示屏，同时将8K信号中的音频分量解码输出。
8.一种FPGA，其特征在于，包括：
通知模块，用于检测到SOC电视主芯片输出信号切换到只输出透明的模式信息时，通知FPGA切换到图像叠加模式；其中，FPGA切换到图像叠加模式具体包括：FPGA将图像静帧，并从4K UPSCALE 8K模式切换到VBYONE与8K图像叠加模式；
输出模块，用于将图像解静帧，并将所述SOC电视主芯片通过VBYONE输出透明度信号与8K接口输入的8K图像信号叠加，并输出给显示屏，同时将8K信号中的音频分量解码输出。
9.一种计算机可读存储介质，其特征在于，所述计算机可读存储介质存储有一个或者多个程序，所述一个或者多个程序可被一个或者多个SOC电视主芯片执行，以实现如权利要求1-4任意一项所述的电视通道切换处理方法中的步骤。
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