CN110137227B - 显示面板 - Google Patents

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Abstract

一种显示面板，包括阵列基板、显示区、两侧边阵列栅极驱动电路、多个资料驱动电路、底部阵列栅极驱动电路。显示区，设置在所述阵列基板上。两侧边阵列栅极驱动电路设置在所述阵列基板上并且位于所述显示区两侧，在所述两侧边阵列栅极驱动电路之间连接有多个设置在阵列基板上的第一栅极线。多个资料驱动电路连接到所述阵列基板，且连接有多个资料线。底部阵列栅极驱动电路设置在所述阵列基板上并且位于所述显示区下方，在所述底部阵列栅极驱动电路上连接有多个第二栅极线，所述多个第二栅极线连接所述多个第一栅极线的中间段。所述显示面板添加底部阵列栅极驱动驱动电路，降低了大尺寸面板中间位置信号延迟。

Description

显示面板
技术领域
本发明是有关于一种显示面板，其添加底部阵列栅极驱动(Gate Driver onArray)驱动电路，降低了大尺寸面板中间位置信号延迟，提升了显示均匀性。
背景技术
请参照图1，现有技术采用阵列栅极驱动(Gate Driver on Array)电路的显示面板9，包括阵列基板91、显示区(Active Area，AA)、两GOA电路92、多个覆晶薄膜驱动(Chipon Film，COF)电路93。所述显示区AA设置在所述阵列基板91上。所述两GOA电路92设置在所述阵列基板91上并且位于显示区AA两侧，在所述两GOA电路92之间横向连接有多个设置在阵列基板91上的栅极线921。所述多个COF电路93连接到所述阵列基板91并位于所述显示区AA下方，在所述多个COF电路93上连接有多个资料线931，所述多个资料线931与所述多个栅极线921垂直交错并且连接。
然而，当上述显示面板9的GOA驱动设计架构应用在大尺寸的显示面板上时，设置于所述显示区AA的左右两侧提供栅极信号的GOA电路92的栅极线921的电阻/电容(Resistor/Capacitor,RC)充放电时间延迟较大，导致在显示区AA中间位置信号延迟严重，充电率下降，进而影响显示效果。
故，有必要提供一种显示面板，以解决现有技术所存在的问题。
发明内容
有鉴于此，本发明提供一种显示面板，其添加底部阵列栅极驱动(Gate Driver onArray)电路，降低了大尺寸面板中间位置信号延迟，提升了显示均匀性，藉此解决了现有技术的显示面板中，设置于所述显示区的左右两侧提供栅极信号的GOA电路栅极线的电阻/电容(Resistor/Capacitor,RC)充放电时间延迟较大，导致在显示区中间位置信号延迟严重，充电率下降，进而影响显示效果的技术问题。
本发明的主要目的在于提供一种显示面板，包括：
阵列基板；
显示区，设置在所述阵列基板上；
两侧边阵列栅极驱动电路，设置在所述阵列基板上并且位于所述显示区两侧，在所述两侧边阵列栅极驱动电路之间连接有多个设置在阵列基板上的第一栅极线；
多个资料驱动电路，连接到所述阵列基板并位于所述显示区下方，在所述多个资料驱动电路上连接有多个资料线，所述多个资料线与所述多个第一栅极线垂直交错并且连接；以及
底部阵列栅极驱动电路，设置在所述阵列基板上并且位于所述显示区下方，在所述底部阵列栅极驱动电路上连接有多个第二栅极线，所述多个第二栅极线连接所述多个第一栅极线的中间段。
在本发明的一实施例中，所述多个第一栅极线横向分布在所述阵列基板上，所述多个第二栅极线垂直分布在所述阵列基板上。
在本发明的一实施例中，所述多个第二栅极线的数量对应所述多个第一栅极线的数量，且所述多个第二栅极线分别连接所述多个第一栅极线的中间段。在本发明的一实施例中，各所述第二栅极线包括由下而上依序堆迭设置的氧化铟锡层、银层、氧化铟锡层。
在本发明的一实施例中，所述多个资料驱动电路为覆晶薄膜驱动电路。
本发明的另一目的在于提供一种显示面板，包括︰
阵列基板；
显示区，设置在所述阵列基板上；
两侧边阵列栅极驱动电路，设置在所述阵列基板上并且位于所述显示区两侧，在所述两侧边阵列栅极驱动电路之间连接有多个设置在阵列基板上的第一栅极线；
多个资料驱动电路，连接到所述阵列基板并位于所述显示区下方，在所述多个资料驱动电路上连接有多个资料线，所述多个资料线与所述多个第一栅极线垂直交错并且连接；以及
底部阵列栅极驱动电路，设置在所述阵列基板上并且位于所述显示区下方，在所述底部阵列栅极驱动电路上连接有多个第二栅极线，所述多个第二栅极线连接所述多个第一栅极线的中间段；
其中，所述多个第一栅极线横向分布在所述阵列基板上，所述多个第二栅极线垂直分布在所述阵列基板上；
其中，所述多个第二栅极线的数量对应所述多个第一栅极线的数量，且所述多个第二栅极线分别连接所述多个第一栅极线的中间段。
在本发明的一实施例中，各所述第二栅极线包括由下而上依序堆迭设置的氧化铟锡层、银层、氧化铟锡层。
在本发明的一实施例中，所述多个资料驱动电路为覆晶薄膜驱动电路。
本发明的又一目的在于提供一种显示面板，其特征在于：所述显示面板包括︰
阵列基板；
显示区，设置在所述阵列基板上；
两侧边阵列栅极驱动电路，设置在所述阵列基板上并且位于所述显示区两侧，在所述两侧边阵列栅极驱动电路之间连接有多个设置在阵列基板上的第一栅极线；
多个资料驱动电路，连接到所述阵列基板并位于所述显示区下方，在所述多个资料驱动电路上连接有多个资料线，所述多个资料线与所述多个第一栅极线垂直交错并且连接；以及
底部阵列栅极驱动电路，设置在所述阵列基板上并且位于所述显示区下方，在所述底部阵列栅极驱动电路上连接有多个第二栅极线，所述多个第二栅极线连接所述多个第一栅极线的中间段；
其中，各所述第二栅极线包括由下而上依序堆迭设置的氧化铟锡层、银层、氧化铟锡层；
其中，所述多个资料驱动电路为覆晶薄膜驱动电路。
相较于现有技术，本发明显示面板在所述显示区底部新增了底部阵列栅极驱动电路。且所述第二栅极线通过氧化铟锡(ITO)层、银(Ag)层、氧化铟锡(ITO)层的结构，可大幅降低所述第二栅极线与所述阵列基板的金属之间的电容值，第二栅极线直接将栅极信号输入显示面板的显示区中间位置处的第一栅极线的中间段，可减少大尺寸显示面板的中间位置处的栅极的电阻/电容(Resistor/Capacitor,RC)充放电时间延迟，进而能提升显示区中间位置处的充电率。此外，本发明可应用于大尺寸三边窄边框顶发光有机发光二极管(Organic Light Emitting Diode,OLED)显示面板。
为让本发明的上述内容能更明显易懂，下文特举优选实施例，且配合所附图式，作详细说明如下：
附图说明
图1是现有技术的显示面板的俯视示意图。
图2是本发明的显示面板的俯视示意图。
图3是本发明的第二栅极线的侧面剖视图。
具体实施方式
请参照图2，本发明显示面板1，包括：阵列基板10、显示区AA、两侧边阵列栅极驱动电路20、多个资料驱动电路30、以及底部阵列栅极驱动电路40。
所述显示区AA，设置在所述阵列基板10上。
所述两侧边阵列栅极驱动电路20，设置在所述阵列基板10上并且位于所述显示区AA两侧，在所述两侧边阵列栅极驱动电路20之间连接有多个设置在阵列基板10上的第一栅极线21。
所述多个资料驱动电路30，连接到所述阵列基板10并位于所述显示区AA下方，在所述多个资料驱动电路30上连接有多个资料线31，所述多个资料线31与所述多个第一栅极线21垂直交错并且连接。
所述底部阵列栅极驱动电路40，设置在所述阵列基板10上并且位于所述显示区AA下方，在所述底部阵列栅极驱动电路40上连接有多个第二栅极线41，所述多个第二栅极线41连接所述多个第一栅极线21的中间段210。
在本发明的一实施例中，所述多个第一栅极线横向分布在所述阵列基板10上，所述多个第二栅极线41垂直分布在所述阵列基板10上。
在本发明的一实施例中，所述多个第二栅极线41的数量对应所述多个第一栅极线21的数量，且所述多个第二栅极线41分别连接所述多个第一栅极线21的中间段210。
在本发明的一实施例中，各所述第一栅极线21的所述中间段210的长度是所述第一栅极线21的全长少于或等于1/2。在本发明的一实施例中，各所述第一栅极线21的所述中间段210的长度是所述第一栅极线21的全长少于或等于1/3。在本发明的一实施例中，各所述第一栅极线21的所述中间段210的长度是所述第一栅极线21的全长少于或等于1/4。在本发明的一实施例中，各所述第一栅极线21的所述中间段210的长度是所述第一栅极线21的全长少于或等于1/5。中间段210的长度与所述第一栅极线21的全长的比例可根据实际需求做出各种设定。
请参照图3，在本发明的一实施例中，各所述第二栅极线41包括由下而上依序堆迭设置的氧化铟锡层(Indium Tin Oxide,ITO)411、银(Ag)层412、氧化铟锡层(ITO)411。该堆迭结构简称ITO/Ag/ITO。此种驱动结构较适合应用于顶发光有机发光二极管(OrganicLight Emitting Diode,OLED)面板，阳极走线一般是采用ITO/Ag/ITO(不透明，可反光)，由于ITO/Ag/ITO堆迭结构下面有较厚的有机平坦层，所以该堆迭结构与其他金属层的电容较小，避免显示面板上产生非预期的电容效应。
在本发明的一实施例中，所述多个资料驱动电路30为覆晶薄膜驱动电路。
相较于现有技术，本发明显示面板1在所述显示区AA底部新增了底部阵列栅极驱动电路40。对于高分辨率高刷新率的面板(如8K,120Hz)，栅极信号在一帧内从Vgl(用于开启显示面板上的栅极驱动芯片的薄膜晶体管的电压值)上升不到Vgh(用于关闭显示面板上的栅极驱动芯片的薄膜晶体管的电压值)从而导致充电率下降，而栅极信号直接输入到中间位置，可以降低中间位置栅极信号的上升/下降时间，使栅极信号达到Vgh，从而提高充电率。此外，所述第二栅极线41通过氧化铟锡(ITO)层、银(Ag)层、氧化铟锡(ITO)层的结构。因此，本发明可大幅降低所述第二栅极线41与所述阵列基板10的金属之间的电容值，第二栅极线41直接将栅极信号输入显示面板1的显示区AA中间位置处的第一栅极线21的中间段210，可减少大尺寸显示面板1的中间位置处的栅极的电阻/电容(Resistor/Capacitor,RC)充放电时间延迟，进而能提升显示区AA中间位置处的充电率。
此外，本发明的显示面板的顶边无GOA，无覆晶薄膜驱动(Chip on Film，COF)，左/右侧边只有GOA电路，所以这三边可以做到窄边框；中间位置由于底部阵列栅极驱动电路40大量的输入走线会占用许多空间，如果使用底发光的设计，那么中间位置的像素开口会远小于左右两侧，而采用顶发光设计，它的开口率与底部的电路走线无关；如果是非自发光的面板，如液晶显示面板LCD，同样存在中间位置开口率减小的问题，而自发光的顶发射OLED不存在该问题。因此，本发明尤其适用于大尺寸三边窄边框顶发光有机发光二极管(Organic Light Emitting Diode,OLED)显示面板1。

Claims (10)

1.一种显示面板，其特征在于：所述显示面板包括︰
阵列基板；
显示区，设置在所述阵列基板上；
两侧边阵列栅极驱动电路，设置在所述阵列基板上并且位于所述显示区两侧，在所述两侧边阵列栅极驱动电路之间连接有多个设置在阵列基板上的第一栅极线；
多个资料驱动电路，连接到所述阵列基板并位于所述显示区沿水平于所述阵列基板方向的下方，在所述多个资料驱动电路上连接有多个资料线，所述多个资料线与所述多个第一栅极线垂直交错并且连接；以及
底部阵列栅极驱动电路，设置在所述阵列基板上并且位于所述显示区沿水平于所述阵列基板方向的下方，在所述底部阵列栅极驱动电路上连接有多个第二栅极线，所述多个第二栅极线连接所述多个第一栅极线的中间段。
2.如权利要求1所述的显示面板，其特征在于：所述多个第一栅极线横向分布在所述阵列基板上，所述多个第二栅极线垂直分布在所述阵列基板上。
3.如权利要求1所述的显示面板，其特征在于：所述多个第二栅极线的数量对应所述多个第一栅极线的数量，且所述多个第二栅极线分别连接所述多个第一栅极线的中间段。
4.如权利要求1所述的显示面板，其特征在于：各所述第二栅极线包括由下而上依序堆迭设置的氧化铟锡层、银层、氧化铟锡层。
5.如权利要求1所述的显示面板，其特征在于：所述多个资料驱动电路为覆晶薄膜驱动电路。
6.一种显示面板，其特征在于：所述显示面板包括︰
阵列基板；
显示区，设置在所述阵列基板上；
两侧边阵列栅极驱动电路，设置在所述阵列基板上并且位于所述显示区两侧，在所述两侧边阵列栅极驱动电路之间连接有多个设置在阵列基板上的第一栅极线；
多个资料驱动电路，连接到所述阵列基板并位于所述显示区沿水平于所述阵列基板方向的下方，在所述多个资料驱动电路上连接有多个资料线，所述多个资料线与所述多个第一栅极线垂直交错并且连接；以及
底部阵列栅极驱动电路，设置在所述阵列基板上并且位于所述显示区沿水平于所述阵列基板方向的下方，在所述底部阵列栅极驱动电路上连接有多个第二栅极线，所述多个第二栅极线连接所述多个第一栅极线的中间段；
其中，所述多个第一栅极线横向分布在所述阵列基板上，所述多个第二栅极线垂直分布在所述阵列基板上；
其中，所述多个第二栅极线的数量对应所述多个第一栅极线的数量，且所述多个第二栅极线分别连接所述多个第一栅极线的中间段。
7.如权利要求6所述的显示面板，其特征在于：各所述第二栅极线包括由下而上依序堆迭设置的氧化铟锡层、银层、氧化铟锡层。
8.如权利要求6所述的显示面板，其特征在于：所述多个资料驱动电路为覆晶薄膜驱动电路。
9.如权利要求7所述的显示面板，其特征在于：所述多个资料驱动电路为覆晶薄膜驱动电路。
10.一种显示面板，其特征在于：所述显示面板包括︰
阵列基板；
显示区，设置在所述阵列基板上；
两侧边阵列栅极驱动电路，设置在所述阵列基板上并且位于所述显示区两侧，在所述两侧边阵列栅极驱动电路之间连接有多个设置在阵列基板上的第一栅极线；
多个资料驱动电路，连接到所述阵列基板并位于所述显示区沿水平于所述阵列基板方向的下方，在所述多个资料驱动电路上连接有多个资料线，所述多个资料线与所述多个第一栅极线垂直交错并且连接；以及
底部阵列栅极驱动电路，设置在所述阵列基板上并且位于所述显示区沿水平于所述阵列基板方向的下方，在所述底部阵列栅极驱动电路上连接有多个第二栅极线，所述多个第二栅极线连接所述多个第一栅极线的中间段；
其中，各所述第二栅极线包括由下而上依序堆迭设置的氧化铟锡层、银层、氧化铟锡层；
其中，所述多个资料驱动电路为覆晶薄膜驱动电路。
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