CN109949203B - 一种异构cpu多路4k超高清视频处理装置与控制方法 - Google Patents

一种异构cpu多路4k超高清视频处理装置与控制方法 Download PDF

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Abstract

本发明提供了一种异构CPU多路4K超高清视频处理装置,包括多路4K视频采集的FPGA 4K/8K超高清采集阵列电路、完成媒体调度的主控处理器、做图像压缩存储及图像跟踪算法控制的ARM+DSP异构处理器、做AI算法的ARM+GPU异构处理器。本发明还提供了一种异构CPU多路4K超高清视频处理装置的控制方法。本发明的有益效果是:采用多CPU并行处理方式,提高视频处理性能;将控制流和视频流采用有向图的方式连接起来,每个CPU作为该有向图的一个节点,负责数据的处理,异构系统只要对该双流有向图进行控制即可用完成对多CPU任务的调度和管理,从而简化CPU之间通讯控制方法,提高效率,简化系统设计难度。

Description

一种异构CPU多路4K超高清视频处理装置与控制方法
技术领域
本发明涉及视频处理装置,尤其涉及一种异构CPU多路4K超高清视频处理装置与控制方法。
背景技术
目前,现有基于4K视频处理技术主要应用为4K网络摄像机,主要技术局限于单路4K视频的采集、编码、传输,在一些应用场合需要多路4K视频的采集,合成,智能分析,编码传输,单CPU无法满足处理性能。
发明内容
为了解决现有技术中的问题,本发明提供了一种异构CPU多路4K超高清视频处理装置与控制方法。
本发明提供了一种异构CPU多路4K超高清视频处理装置,包括多路4K视频采集的FPGA 4K/8K超高清采集阵列电路、完成媒体调度的主控处理器、做图像压缩存储及图像跟踪算法控制的ARM+DSP异构处理器、做AI算法的ARM+GPU异构处理器,其中,所述FPGA 4K/8K超高清采集阵列电路与所述主控处理器输入输出双向连接,所述主控处理器分别与所述ARM+DSP异构处理器、ARM+GPU异构处理器输入输出双向连接。
作为本发明的进一步改进,所述FPGA 4K/8K超高清采集阵列电路与所述主控处理器分别通过高清1080p媒体流子通道、控制数据流的I2C总线、超高清4K/8K媒体流主通道输入输出双向连接,所述主控处理器分别通过PCIe总线、控制数据流的I2C总线与所述ARM+DSP异构处理器输入输出双向连接,所述主控处理器分别通过PCIe总线、控制数据流的I2C总线与ARM+GPU异构处理器输入输出双向连接。
本发明还提供了一种异构CPU多路4K超高清视频处理装置的控制方法,采用多CPU并行处理方式,将控制流和视频流采用双流有向图的方式连接起来,每个CPU作为该双流有向图的一个节点,负责数据的处理,异构系统只要对该双流有向图进行控制即可用完成对多CPU任务的调度和管理。
作为本发明的进一步改进,包括以下步骤:
S1、异构CPU双流有向图构成,进行双流有向图的定义和回路约定;
S2、双流有向图控制原语与控制方法;
S3、媒体流控制;
S4、链路通道、节点任务与L原语通道的对应。
作为本发明的进一步改进,步骤S1包括以下子步骤:
S11、双流有向图定义;
双流有向图主要由抽象节点、抽象控制通道和抽象媒体通道构成,其中,抽象控制通道与抽象媒体通道都是单向的,双流有向图G公式如下:
G=(N,V1,V2,S)
其中,N是节点集合,V1是控制流集合,V2是媒体流集合,S是图的事务状态;
S12、双流有向图控制原语与控制方法;
双流有向图控制原语主要用于对整个异构系统控制过程高级抽象,包括L、F、A原语。
作为本发明的进一步改进,在步骤S12中,L原语的说明如下:
L原语主要作用是双流有向图的构建,声明每个节点的能力,以及确立节点任务;
L原语包括参数有双流有向图G,连接节点N1,以及目标节点N2,前向控制通道C1,前向媒体通道C2,以及节点任务TASK,和上下文CTX,L原语返回双流有向图G,L原语的第一个节点定义为双流有向图G的主控节点;
L原语公式G1=L(G,N1,N2,C1,C2,TASK,CTX);
TASK为集合T的元素,
集合T={COL,TRANS,CODEC,DECODEC,MERGE,DENORSE,DISP,STORE,PUSH}COL为采集,TRANS为转换格式,CODEC为编码,DECODC为解码,DENORSEE为去噪,DISP为显示,STORE为存储,PUSH为推送;
L原语执行过程如下:
L1、检查N1相邻节点状;
L2、枚举N1所有物理链接;
L3、在物理通道是交换节能力信息;
L4、建立控制逻辑通道C1;
L5、建立媒体逻辑通道C2;
步骤L1中,如果图G1的主控节点不是N0时候,N0需要将命令路由到N1上执行,并且N0与N1建立好关联,否则原语执行失败。如果步骤L1,N1与相邻节点的物理链路交换完毕,步骤L2,L3不再执行;
步骤L4和步骤L5中,如果N2不具备L原语所描述的能力执行任务时候,建立通道失败;
步骤L5中,需要执行环路检查,如果连接变成环路,建立通道失败,环路检查的方法是,L原语每成功一次,将新建的节点名字加入CTX的媒体队列,如果N2发现自己已经在媒体队列中,则环路检测失败。
作为本发明的进一步改进,在步骤S12中,F原语的说明如下:
F原语的主要作用是在双流有向图中所有有能力的节点执行同一个命令,F原语具有事务控制能力,F原语只能由双流有向图G的主控节点执行,双流有向图G的主控节点由L原语定义,非主控节点的要求其他节点执行需要通过A原语请求;
F原语公式如下:
G2:=F(G,cmd,CTX)其中G为双流有向图,cmd为命令,必须支持集合CCMD,CTX存放F命令路径栈;
集合CCMD={ST,CLS,REST,RECLS}
命令ST为启动,CLS为关闭,REST为延时启动,RECLS为延时关闭;
如果F失败,返回双流有向图G以前的事务状态,如果成功返回新的事务状态;
设双流有向图G的主控节点为N1,执行过程如下所示:
F1、检查自身能力执行能力;
F2、如果有能力执行命令,如果没有不执行;
F3、如果执行成功则,将事务状态的执行计数加1,同时向下执行原语,将本节点ID放入CTX的F路径栈中,重复F1,F2,F3步骤;
F4、如果执行失败,通过A原语向主控反馈失败;
F5主控收到失败反馈,采用F原语发送CLS命令终止所有节点任务。
作为本发明的进一步改进,在步骤S12中,A原语的说明如下:
A原语主要功能是完成F命令的反馈确认,公式为:
G3=A(G,F,N,CMD,CTX)执行如下:
A1、检查目标节点,如果自己接收则终止否则,从A原语取出当前的路径栈,如果A原语还没有路径栈则从F中取出当前的栈CTX;
A2、检测目标节点是否位于CTX中;
A3、如果CTX中如果没有目标节点,则向所有的邻近节点转发A原语;
A4、如果CTX中没有目标节点,则向所有的邻近节点转发A原语,重复A3,A4;
A5、如果CTX中有目标节点,则向CTX出栈节点转发A,同时将CTX放入A原语栈,重复A1,A2,A3,A4,A5。
作为本发明的进一步改进,在步骤S3中,当F原语启动节点任务时候,产生媒体流,媒体流按照双流有向图G规定的路径流动,媒体流控制包括缓冲和容错控制,控制方法,具体包括如下步骤:
S31、接收到F原语的启动命令时候,打开媒体接收器;
S32、启动缓冲区,开始接收媒体流同时启动定时器T1,T1超时为2秒;S33、启动媒体处理任务,启动成功后关闭定时器T1,启动定时器T2,T2超时为5秒;
S34、如果定时器T1超时,通过A原语向主控告警;
S35、如果定时器T2超时间,检查缓冲区,如果缓冲增长超过10%,通过A原语向主控告警。
作为本发明的进一步改进,在步骤S4中,控制流物理链路由I2C总线实现,媒体流主要由PCIE、MIPI总线实现,节点的任务由单个CPU实现,必须实现向L原语中声明的任务。
本发明的有益效果是:通过上述方案,采用多CPU并行处理方式,提高视频处理性能;将控制流和视频流采用有向图的方式连接起来,每个CPU作为该有向图的一个节点,负责数据的处理,异构系统只要对该双流有向图进行控制即可用完成对多CPU任务的调度和管理,从而简化CPU之间通讯控制方法,提高效率,简化系统设计难度。
附图说明
图1是本发明一种异构CPU多路4K超高清视频处理装置的示意图。
图2是本发明一种异构CPU多路4K超高清视频处理装置的控制方法的L原语执行过程图。
图3是本发明一种异构CPU多路4K超高清视频处理装置的控制方法的F原语执行过程图。
图4是本发明一种异构CPU多路4K超高清视频处理装置的控制方法的A原语执行过程图。
图5是本发明一种异构CPU多路4K超高清视频处理装置的控制方法的媒体流控制过程图。
具体实施方式
下面结合附图说明及具体实施方式对本发明作进一步说明。
如图1所示,一种异构CPU多路4K超高清视频处理装置,包括多路4K视频采集的FPGA 4K/8K超高清采集阵列电路101、完成媒体调度的主控处理器102、做图像压缩存储及图像跟踪算法控制的ARM+DSP异构处理器103、做AI算法的ARM+GPU异构处理器104,其中,所述FPGA 4K/8K超高清采集阵列电路101与所述主控处理器102输入输出双向连接,所述主控处理器102分别与所述ARM+DSP异构处理器103、ARM+GPU异构处理器104输入输出双向连接。
如图1所示,所述FPGA 4K/8K超高清采集阵列电路101与所述主控处理器102分别通过高清1080p媒体流子通道、控制数据流的I2C总线、超高清4K/8K媒体流主通道输入输出双向连接,所述主控处理器102分别通过PCIe总线、控制数据流的I2C总线与所述ARM+DSP异构处理器103输入输出双向连接,所述主控处理器102分别通过PCIe总线、控制数据流的I2C总线与ARM+GPU异构处理器104输入输出双向连接。
本发明还提供了一种异构CPU多路4K超高清视频处理装置的控制方法,基于异构CPU多路4K超高清视频处理装置,采用多CPU并行处理方式,将控制流和视频流采用双流有向图的方式连接起来,每个CPU作为该双流有向图的一个节点,负责数据的处理,异构系统(即异构CPU多路4K超高清视频处理装置)只要对该双流有向图进行控制即可用完成对多CPU任务的调度和管理,具体包括以下过程:
(1)异构CPU双流有向图构成
1)双流有向图定义
双流有向图由抽象节点、抽象控制通道、和抽象媒体通道构成,其中抽象控制通道与抽象媒体通道都是单向的。双向有向图G公式如下:
G=(N,V1,V2,S)
其中N是节点集合,V1是控制流集合,V2是媒体流集合,S是图的事务状态。
2)双流有向图回路约定
由抽象节点,抽象控制通道构成的有向图可以形成回路,由抽象节点抽象媒体通道构成的有向图不可以有回路。
(2)双流有向图控制原语与控制方法
双流有向图控制原语主要用于对整个异构系统控制过程高级抽象,包括L、F、A原语
1)L原语
L原语主要作用是双流控制图的构建,声明每个节点的能力,以及确立节点任务。L原语包括参数有双流控制图G,连接节点N1,以及目标节点N2,前向控制通道C1,前向媒体通道C2,以及节点任务TASK,和上下文CTX,L原语返回图G,L原语的第一个节点定义为图G的主控节点。
L原语公式G=L(G,N1,N2,C1,C2,TASK,CTX);
TASK为集合T的元素,
集合T={COL,TRANS,CODEC,DECODEC,MERGE,DENORSE,DISP,STORE,PUSH}
COL为采集,TRANS为转换格式,CODEC为编码,DECODC为解码,DENORSEE为去噪,DISP为显示,STORE为存储,PUSH为推送。
如图2所示,L原语执行过程如下:
L1、检查N1相邻节点状;
L2、枚举N1所有物理链接;
L3、在物理通道是交换节能力信息;
L4、建立控制逻辑通道C1;
L5、建立媒体逻辑通道C2;
步骤L1中,如果图G1的主控节点不是N0时候,N0需要将命令路由到N1上执行,并且N0与N1建立好关联,否则原语执行失败。如果步骤L1,N1与相邻节点的物理链路交换完毕,步骤L2,L3不再执行;
步骤L4和步骤L5中,如果N2不具备L原语所描述的能力执行任务时候,建立通道失败;
步骤L5中,需要执行环路检查,如果连接变成环路,建立通道失败,环路检查的方法是,L原语每成功一次,将新建的节点名字加入CTX的媒体队列,如果N2发现自己已经在媒体队列中,则环路检测失败。
2)F原语
F作用控制命令主要作用是在双向图中所有有能力的节点执行同一个命令,F原语具有事务控制能力,F原语只能由于图G的主控节点执行,图G的主控节点由L原语定义,非主控节点的要求其他节点执行需要通过A原语请求。F原语公式如下:
G:=F(G,cmd,CTX)其中G为图,cmd为命令,必须支持集合CCMD,CTX存放F命令路径栈
集合CCMD={ST,CLS,REST,RECLS}
命令ST为启动,CLS为关闭,REST为延时启动,RECLS为延时关闭。
如果F失败,返回G以前的事务状态,如果成功返回新的事务状态。
设G的主控节点为N1,执行过程如下图3所示:
F1、检查自身能力执行能力;
F2、如果有能力执行命令,如果没有不执行;
F3、如果执行成功则,将事务状态的执行计数加1,同时向下执行原语,将本节点ID放入CTX的F路径栈中,重复F1,F2,F3步骤;
F4、如果执行失败,通过A原语向主控反馈失败;
F5主控收到失败反馈,采用F原语发送CLS命令终止所有节点任务。
3)A原语
A原语主要功能是完成F命令的反馈确认,公式为:
G=A(G,F,N,CMD,CTX)
如图4所示,执行如下:
A1、检查目标节点,如果自己接收则终止否则,从A原语取出当前的路径栈,如果A原语还没有路径栈则从F中取出当前的栈CTX;
A2、检测目标节点是否位于CTX中;
A3、如果CTX中如果没有目标节点,则向所有的邻近节点转发A原语;
A4、如果CTX中没有目标节点,则向所有的邻近节点转发A原语,重复A3,A4;
A5、如果CTX中有目标节点,则向CTX出栈节点转发A,同时将CTX放入A原语栈,重复A1,A2,A3,A4,A5。
(3)媒体流控制
当F原语启动节点任务时候,产生媒体流,媒体流按照双流有向图G规定的路径流动。媒体流控制包括缓冲和容错控制,控制方法,如图5所示,具体过程如下:
1、接收到F原语的启动命令时候,打开媒体接收器;
2、启动缓冲区,开始接收媒体流同时启动定时器T1,T1超时为2秒;
3、启动媒体处理任务,启动成功后关闭定时器T1,启动定时器T2,T2超时为5秒;
4、如果定时器T1超时,通过A原语向主控告警;
5、如果定时器T2超时间,检查缓冲区,如果缓冲增长超过10%,通过A原语向主控告警。
(4)链路通道、节点任务与L原语通道的对应
控制流物理链路由I2C总线实现,媒体流主要由PCIE、MIPI总线实现,节点的任务由单个CPU实现,必须实现向L原语中声明的任务。
本发明提供的一种异构CPU多路4K超高清视频处理装置与控制方法,采用多CPU并行处理方式,提高视频处理性能,同时提出一种异构CPU的控制方法,该方法将控制流和视频流采用有向图的方式连接起来,每个CPU作为该有向图的一个节点,负责数据的处理,异构系统只要对该双流有向图进行控制即可用完成对多CPU任务的调度和管理,从而简化CPU之间通讯控制方法,提高效率,简化系统设计难度。
以上内容是结合具体的优选实施方式对本发明所作的进一步详细说明,不能认定本发明的具体实施只局限于这些说明。对于本发明所属技术领域的普通技术人员来说,在不脱离本发明构思的前提下,还可以做出若干简单推演或替换,都应当视为属于本发明的保护范围。

Claims (10)

1.一种异构CPU多路4K超高清视频处理装置,其特征在于:包括多路4K视频采集的FPGA4K/8K超高清采集阵列电路、完成媒体调度的主控处理器、做图像压缩存储及图像跟踪算法控制的ARM+DSP异构处理器、做AI算法的ARM+GPU异构处理器,其中,所述FPGA 4K/8K超高清采集阵列电路与所述主控处理器输入输出双向连接,所述主控处理器分别与所述ARM+DSP异构处理器、ARM+GPU异构处理器输入输出双向连接。
2.根据权利要求1所述的异构CPU多路4K超高清视频处理装置,其特征在于:所述FPGA4K/8K超高清采集阵列电路与所述主控处理器分别通过高清1080p媒体流子通道、控制数据流的I2C总线、超高清4K/8K媒体流主通道输入输出双向连接,所述主控处理器分别通过PCIe总线、控制数据流的I2C总线与所述ARM+DSP异构处理器输入输出双向连接,所述主控处理器分别通过PCIe总线、控制数据流的I2C总线与ARM+GPU异构处理器输入输出双向连接。
3.一种异构CPU多路4K超高清视频处理装置的控制方法,其特征在于:采用多CPU并行处理方式,将控制流和视频流采用双流有向图的方式连接起来,每个CPU作为该双流有向图的一个节点,负责数据的处理,异构系统只要对该双流有向图进行控制即可用完成对多CPU任务的调度和管理。
4.根据权利要求3所述的异构CPU多路4K超高清视频处理装置的控制方法,其特征在于,包括以下步骤:
S1、异构CPU双流有向图构成,进行双流有向图的定义和回路约定;
S2、双流有向图控制原语与控制方法;
S3、媒体流控制;
S4、链路通道、节点任务与L原语通道的对应。
5.根据权利要求4所述的异构CPU多路4K超高清视频处理装置的控制方法,其特征在于,步骤S1包括以下子步骤:
S11、双流有向图定义;
双流有向图主要由抽象节点、抽象控制通道和抽象媒体通道构成,其中,抽象控制通道与抽象媒体通道都是单向的,双流有向图G公式如下:G=(N,V1,V2,S)
其中,N是节点集合,V1是控制流集合,V2是媒体流集合,S是图的事务状态;
S12、双流有向图控制原语与控制方法;
双流有向图控制原语主要用于对整个异构系统控制过程高级抽象,包括L、F、A原语。
6.根据权利要求5所述的异构CPU多路4K超高清视频处理装置的控制方法,其特征在于:在步骤S12中,L原语的说明如下:
L原语主要作用是双流有向图的构建,声明每个节点的能力,以及确立节点任务;
L原语包括参数有双流有向图G,连接节点N1,以及目标节点N2,前向控制通道C1,前向媒体通道C2,以及节点任务TASK,和上下文CTX,L原语返回双流有向图G,L原语的第一个节点定义为双流有向图G的主控节点;
L原语公式G1=L(G,N1,N2,C1,C2,TASK,CTX);
TASK为集合T的元素,
集合T={COL,TRANS,CODEC,DECODEC,MERGE,DENORSE,DISP,STORE,PUSH}
COL为采集,TRANS为转换格式,CODEC为编码,DECODC为解码,DENORSEE为去噪,DISP为显示,STORE为存储,PUSH为推送;
L原语执行过程如下:
L1、检查N1相邻节点状;
L2、枚举N1所有物理链接;
L3、在物理通道是交换节能力信息;
L4、建立控制逻辑通道C1;
L5、建立媒体逻辑通道C2;
步骤L1中,如果图G1的主控节点不是N0时候,N0需要将命令路由到N1上执行,并且N0与N1建立好关联,否则原语执行失败;如果步骤L1,N1与相邻节点的物理链路交换完毕,步骤L2,L3不再执行;
步骤L4和步骤L5中,如果N2不具备L原语所描述的能力执行任务时候,建立通道失败;
步骤L5中,需要执行环路检查,如果连接变成环路,建立通道失败,环路检查的方法是,L原语每成功一次,将新建的节点名字加入CTX的媒体队列,如果N2发现自己已经在媒体队列中,则环路检测失败。
7.根据权利要求5所述的异构CPU多路4K超高清视频处理装置的控制方法,其特征在于:在步骤S12中,F原语的说明如下:
F原语的主要作用是在双流有向图中所有有能力的节点执行同一个命令,F原语具有事务控制能力,F原语只能由双流有向图G的主控节点执行,双流有向图G的主控节点由L原语定义,非主控节点的要求其他节点执行需要通过A原语请求;
F原语公式如下:
G2:=F(G,cmd,CTX)其中G为双流有向图,cmd为命令,必须支持集合CCMD,CTX存放F命令路径栈;
集合CCMD={ST,CLS,REST,RECLS}
命令ST为启动,CLS为关闭,REST为延时启动,RECLS为延时关闭;
如果F失败,返回双流有向图G以前的事务状态,如果成功返回新的事务状态;
设双流有向图G的主控节点为N1,执行过程如下所示:
F1、检查自身能力执行能力;
F2、如果有能力执行命令,如果没有不执行;
F3、如果执行成功则,将事务状态的执行计数加1,同时向下执行原语,将本节点ID放入CTX的F路径栈中,重复F1,F2,F3步骤;
F4、如果执行失败,通过A原语向主控反馈失败;
F5主控收到失败反馈,采用F原语发送CLS命令终止所有节点任务。
8.根据权利要求5所述的异构CPU多路4K超高清视频处理装置的控制方法,其特征在于:在步骤S12中,A原语的说明如下:
A原语主要功能是完成F命令的反馈确认,公式为:
G3=A(G,F,N,CMD,CTX)执行如下:
A1、检查目标节点,如果自己接收则终止否则,从A原语取出当前的路径栈,如果A原语还没有路径栈则从F中取出当前的栈CTX;
A2、检测目标节点是否位于CTX中;
A3、如果CTX中如果没有目标节点,则向所有的邻近节点转发A原语;
A4、如果CTX中没有目标节点,则向所有的邻近节点转发A原语,重复A3,A4;
A5、如果CTX中有目标节点,则向CTX出栈节点转发A,同时将CTX放入A原语栈,重复A1,A2,A3,A4,A5。
9.根据权利要求5所述的异构CPU多路4K超高清视频处理装置的控制方法,其特征在于:在步骤S3中,当F原语启动节点任务时候,产生媒体流,媒体流按照双流有向图G规定的路径流动,媒体流控制包括缓冲和容错控制,控制方法,具体包括如下步骤:
S31、接收到F原语的启动命令时候,打开媒体接收器;
S32、启动缓冲区,开始接收媒体流同时启动定时器T1,T1超时为2秒;
S33、启动媒体处理任务,启动成功后关闭定时器T1,启动定时器T2,T2超时为5秒;
S34、如果定时器T1超时,通过A原语向主控告警;
S35、如果定时器T2超时间,检查缓冲区,如果缓冲增长超过10%,通过A原语向主控告警。
10.根据权利要求5所述的异构CPU多路4K超高清视频处理装置的控制方法,其特征在于:在步骤S4中,控制流物理链路由I2C总线实现,媒体流主要由PCIE、MIPI总线实现,节点的任务由单个CPU实现,必须实现向L原语中声明的任务。
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CN110708513B (zh) * 2019-10-18 2021-06-01 中国科学院长春光学精密机械与物理研究所 一种8k视频多核异构处理装置
CN111399911B (zh) * 2020-03-24 2021-11-02 杭州博雅鸿图视频技术有限公司 一种基于多核异构计算的人工智能开发方法及装置

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20080085126A (ko) * 2008-08-28 2008-09-23 정진욱 메가픽셀 고해상도 지능형 영상인식/추적/보안감시기기와코덱h.264 압축/저장/전송과 실시간 양방향원격제어통합그래픽유저인터페이스운영방법
CN105635661A (zh) * 2014-11-07 2016-06-01 田佳聪 一种基于双核异构的双路视频处理平台
CN108255773A (zh) * 2017-12-07 2018-07-06 中国航空工业集团公司西安航空计算技术研究所 一种智能计算异构多核处理方法与平台
CN108366288A (zh) * 2018-03-01 2018-08-03 厦门普杰信息科技有限公司 一种用于高清视频的高效解码和播放方法及系统

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