CN108965819B - 一种同步信号处理方法、装置及视频传输系统 - Google Patents
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Abstract
本申请提供一种同步信号处理方法、装置及系统,根据从视频输入装置获取的时钟信号和同步信号计算得到图像分辨率;根据所述图像分辨率还原所述同步信号;将从视频输入装置获取的视频数据和还原得到的同步信号输出给编码装置。通过所述同步信号处理方法,可以在视频源中断或切换导致同步信号中断时,持续地为编码装置提供同步信号,解决了因视频源中断或切换而造成的视频传输中断的问题。
Description
技术领域
本申请涉及通信技术领域,特别涉及一种同步信号处理方法、装置及视频传输系统。
背景技术
通常视频源主要是摄像机或摄像头采集的原始图像经过HDMI、SDI、DVI等常用的标准接口输出。视频传输系统通过HDMI、SDI接口接入到发射机传输到另一端供给用户存储、播放、编辑等。视频传输系统主要包括视频源的采集,压缩编码,通过传输媒介(包括wifi、有线网络、其它传输方式)发送视频数据,在另一端接收数据后解码解压缩,在显示器中显示视频数据。
常规的视频传输系统包括视频输入装置、编码装置、传输装置、解码装置和视频输出装置,在视频的传输过程中,每个装置都是依赖前一个装置的状态做相应的处理。例如:视频编码装置需要视频输入装置给出一个稳定的视频数据后才开始编码;视频传输装置需要视频编码装置准备好编码的数据流后开始稳定的传输数据;视频解码装置需要接收到稳定的数据才能解码恢复视频数据,视频输出装置需要解码装置提供稳定的解码后的视频数据才能输出。由于传输系统的每个环节都是环环相扣的,所以视频源的输入对整个传输系统的影响非常大。
现有的视频传输系统在部分应用中通常会频繁的切换或中断视频源,视频源的切换或中断会导致视频源输入给视频输入装置的信号中断,视频输入装置无法输出同步信号给编码装置,编码装置无法编码,整个视频传输过程中断,需重新建立连接后开始传输视频数据。视频传输重新建立连接的过程需要消耗一定的时间,因而视频源切换或中断造成视频传输中断这一问题会给用户带来不良的体验。
发明内容
有鉴于此,本申请的第一方面提供了一种同步信号处理方法,在视频源切换或中断后,通过从视频输入装置获取的时钟信号和同步信号计算得到图像分辨率,并根据所述图像分辨率还原所述同步信号,将所述同步信号和视频数据输出给编码装置。
具体地,本申请提供了一种同步信号处理方法,所述方法包括:
根据从视频输入装置获取的时钟信号和同步信号计算得到图像分辨率;
根据所述图像分辨率还原所述同步信号;
将从视频输入装置获取的视频数据和所述同步信号输出给编码装置。
在一实施例中,所述同步信号包括行同步信号、场同步信号、数据使能信号。
在一实施例中,所述图像分辨率的计算方法包括:
通过时钟信号和计数器计算行同步信号的宽度,确定图像的宽度;
通过时钟信号和计数器计算场同步信号的宽度,确定图像的高度;
由所述图像的宽度和高度确定图像的分辨率。
在一实施例中,所述还原同步信号的方法包括:
由图像分辨率得到行同步信号参数和场同步信号参数;
通过本地时钟信号和计数器得到同步信号电平高低变化;
由行同步信号参数、场同步信号参数和同步信号电平高低变化还原所述同步信号。
在一实施例中,所述行同步信号参数包括行同步信号的消隐前肩、行场同步头、消隐后肩和数据有效区域,所述场同步信号参数包括场同步信号的消隐前肩、场同步头、消隐后肩和数据有效区域。
在一实施例中,将所述从视频输入装置获取的视频数据经存储器存储后再输出给所述编码装置。
本申请的第二方面公开了一种同步信号处理装置,所述装置连接于视频传输系统的视频输入装置和编码装置之间,从所述视频输入装置获取时钟信号、同步信号和视频数据,根据所述时钟信号和同步信号计算得到图像分辨率,根据所述图像分辨率还原所述同步信号,将所述同步信号和视频数据输出给编码装置。
在一实施例中,所述同步信号处理装置包括:
同步时序检测模块,用于根据所述视频输入装置传输的时钟信号和同步信号计算得到所述图像分辨率;
同步时序生成模块,用于根据所述的图像分辨率还原所述同步信号;
输出模块,用于将所述视频数据和还原得到的同步信号输出给编码装置。
在一实施例中,所述同步信号处理装置还包括视频数据缓存模块,用于存储从视频输入装置获取的视频数据。
本申请的第三方面公开了一种视频传输系统,所述视频传输系统包括视频输入装置、编码装置;其特征在于,所述视频传输系统包括同步信号处理装置;
所述视频输入装置用于从视频源获取时钟信号、视频数据和同步信号;
所述同步信号处理装置用于从视频输入装置获取所述时钟信号、视频数据和同步信号,并根据所述时钟信号和同步信号计算得到图像分辨率;以及根据所述图像分辨率还原所述同步信号;并将所述同步信号和视频数据输出给编码装置;
所述编码装置用于基于所述同步信号对所述视频数据编码。
在一实施例中,所述同步信号处理装置集成于FPGA芯片上。
在一实施例中,所述同步信号处理装置包括存储器,用于存储所述视频输入装置传输的视频数据。
在一实施例中,所述同步信号处理装置集成于独立的设备上,或集成于视频输入装置/编码装置所在的设备上。
本申请提供了一种同步信号处理方法、装置及视频传输系统,根据从视频输入装置获取的时钟信号和同步信号计算得到图像分辨率;根据所述图像分辨率还原所述同步信号;将从视频输入装置获取的视频数据和所述同步信号输出给编码装置。在视频源中断导致同步信号中断时,可以持续地为编码装置提供同步信号,解决了因视频源中断或切换而造成的视频传输中断的问题。
附图说明
图1是本申请一示例性实施例示出的视频传输过程示意图;
图2是本申请一示例性实施例示出的一种同步信号处理方法流程图;
图3是本申请一示例性实施例示出的分辨率计算方法流程图;
图4是本申请一示例性实施例示出的同步信号还原方法流程图;
图5是本申请一示例性实施例示出的一种同步信号处理方法流程图;
图6A是本申请一示例性实施例示出的同步信号处理装置逻辑框图;
图6B是本申请一示例性实施例示出的同步信号处理装置逻辑框图;
图7是本申请一示例性实施例示出的同步信号处理装置还原同步信号的示意图;
图8是本申请一示例性实施例示出的视频传输系统逻辑框图。
具体实施方式
这里将详细地对示例性实施例进行说明,其示例表示在附图中。下面的描述涉及附图时,除非另有表示,不同附图中的相同数字表示相同或相似的要素。以下示例性实施例中所描述的实施方式并不代表与本申请相一致的所有实施方式。相反,它们仅是与如所附权利要求书中所详述的、本申请的一些方面相一致的装置和方法的例子。
在本申请使用的术语是仅仅出于描述特定实施例的目的,而非旨在限制本申请。在本申请和所附权利要求书中所使用的单数形式的“一种”、“所述”和“该”也旨在包括多数形式,除非上下文清楚地表示其他含义。还应当理解,本文中使用的术语“和/或”是指并包含一个或多个相关联的列出项目的任何或所有可能组合。
应当理解,尽管在本申请可能采用术语第一、第二、第三等来描述各种信息,但这些信息不应限于这些术语。这些术语仅用来将同一类型的信息彼此区分开。例如,在不脱离本申请范围的情况下,第一信息也可以被称为第二信息,类似地,第二信息也可以被称为第一信息。取决于语境,如在此所使用的词语“如果”可以被解释成为“在……时”或“当……时”或“响应于确定”。
安防、视频会议以及影视拍摄等许多场景都会用到视频传输系统,常规的视频传输系统包括视频输入装置、编码装置、传输装置、解码装置和视频输出装置,如图1所示。在视频的传输过程中,每个装置都是依赖前一个装置的工作状态做相应的处理,如果有一个装置的任务没有完成,则其后面的装置都无法正常工作,导致整个视频传输过程中断。由于视频传输系统的每个环节都是环环相扣的,因而视频源对整个视频传输过程影响极大。通常在视频传输过程中,经常会出现视频源切换和中断的场景,比如在视频拍摄过程中,有时需要有两个或两个以上的摄像头轮流采集图像数据,在拍摄过程中往往需要在多个摄像头间不停的切换。每次视频源的切换或中断会导致视频源输入给视频输入装置的信号中断,视频输入装置无法输出同步信号给编码装置,编码装置没有接收到同步信号则无法编码,整个视频传输过程中断,需重新建立连接后才能开始传输视频数据,这一中断和重新建立连接的过程需消耗一定的时间,会给用户带来不良的体验。
本申请的第一方面提供了一种同步信号处理方法,可以解决因视频源中断或切换引起的视频传输中断的问题。所述同步信号处理方法如图2所示,包括以下步骤:
S201、根据从视频输入装置获取的时钟信号和同步信号计算得到图像分辨率;
S202、根据所述图像分辨率还原所述同步信号;
S203、将从视频输入装置获取的视频数据和所述同步信号输出给编码装置。
一般情况下,视频源在采集图像数据时,只要采集的图像分辨率相同,则输出的同步信号基本一致。作为一个实施例,在首次接收到该同步信号时,将该同步信号还原出来,在视频源切换或中断后,只要后续采集的图像分辨率不变,则可以将还原得到的同步信号输出给编码装置,避免因同步信号中断而到导致视频传输中断。当然,也可以在第二次或第三次接收到同步信号时再进行还原,只要是在视频源切换或中断前即可,本申请不作限制。
所述同步信号处理方法可以是根据美国电子消费品制造商协会(ConsumerElectronics Association,CEA)制定的“未压缩数字视频标准”(CEA-861)来产生符合该标准时序的同步信号。
通常情况下视频输入装置会将视频源采集的图像数据解码为符合CEA-861的时钟信号、同步信号、视频数据三个部分,同步信号作为视频数据在视频输入装置与编码装置之间的传输信号,编码装置只有在接收到正确的同步信号后才能锁定视频输入的数据有效,开始编码工作,然而由于视频源中断或切换,会导致视频源输出给视频输入装置的同步信号中断,因而视频输入装置也无法为编码装置提供同步信号,编码装置无法编码,进而整个视频传输过程会中断。本申请提供的同步信号处理方法是在收到视频输入装置输入的视频同步信号和时钟信号后,根据所述同步信号和时钟信号计算得到图像分辨率,并根据图像分辨率还原该同步信号,如此一来,当视频源中断或切换后,只要视频源所采集的图像分辨率未改变,依然可以将还原的同步信号提供给编码装置,避免传输过程中断。
进一步地,所述同步信号可以包括行同步信号、场同步信号、数据使能信号。
根据CEA-861标准,一周期的行同步信号包括消隐前肩、行同步头、消隐后肩和行有效区域,这些统称为行同步信号参数,行同步信号一周期的总长度在数值上等于上述行同步信号参数值相加。一周期的场同步信号包括消隐前肩、场同步头、消隐后肩和场有效区域,这些统称为场同步信号参数,场同步信号一周期的总长度在数值上等于上述场同步信号参数值相加。当图像为某个分辨率时,这些参数的值都严格CEA-861标准中该分辨率的时序参数的规定来设定。例如,图像分辨率为1920X1080P时,上述行同步信号的消隐前肩、行同步头、消隐后肩和有效区域的宽度和场同步信号的消隐前肩、场同步头、消隐后肩和有效区域参数的宽度都严格按照CEA-861标准中1920×1080p分辨率的时序参数的规定宽度来设定的。所以只要图像分辨率固定,其同步信号的行同步信号和场同步信号参数都是固定的。
为了还原同步信号,可以先得到所述同步信号的行同步信号和场同步信号参数,由于行同步信号和场同步信号参数可由其分辨率确定,所以我们可以先计算得到图像的分辨率。
在一实施例中,在还原同步信号之前,可以先根据首次从视频源输入的同步信号和时钟信号计算得到图像分辨率,所述图像分辨率的计算过程如图3所示,包括:
S301、通过时钟信号和计数器计算行同步信号的宽度,确定图像的宽度;
S302、通过时钟信号和计数器计算场同步信号的宽度,确定图像的高度;
S303、由所述图像的宽度和高度确定图像的分辨率。
由于固定分辨率下的行同步信号参数和场同步信号参数都是固定的,可以先通过计数器和时钟信号可以计算得到行同步信号和场同步信号的宽度,再根据CEA-861标准得到计算得到的行同步信号和场同步信号的宽度对应的分辨率,即可得出图像的分辨率。
在计算行同步信号宽度和场同步信号宽度时,可以借助于两个计数器,一个行同步信号计数器,一个场同步信号计数器,行同步信号计数器是对时钟进行计数,其计数值不超过CEA-861标准中规定的当前分辨率下行同步信号一周期的总时钟个数,由行同步信号的总长度决定;如果行同步信号计数器的计数值达到行同步信号一周期的总时钟个数即记满,则清零,从0开始重新计数;所以通过行同步信号计数器和视频输入装置输入的时钟信号可计算的到行同步信号的宽度,根据CEA-861标准,可确定图像宽度。
场同步信号计数器在行同步信号计数器每完成一个计数周期即记满一次,也就是记完一行时,计数值加1;同理,场同步信号计数器的计数值不超过CEA-861标准中规定的当前分辨率下一帧的总行数即场同步信号的总长度,如果场同步信号计数器的计数值达到一帧的总行数,则清零,从0开始重新计数;同样的通过场同步信号计数器和视频输入装置输入的时钟信号可计算的到场同步信号的宽度,根据CEA-861标准,可确定图像高度。由所述图像的宽度和高度即可确定图像的分辨率。当然上述计算图像分辨率的方法只是本申请获得图像分辨率的一种实施方式,本申请并不对计算图像分辨率的方法进行限制。
在计算得到图像的分辨率后,可根据该分辨还原所述同步信号,参考图4,在一实施例中,本申请还原所述同步信号的方法包括:
S401、由图像分辨率得到行同步信号参数和场同步信号参数;
S402、通过本地时钟信号和计数器得到同步信号电平高低变化;
S403、由行同步信号参数、场同步信号参数及同步信号电平高低变化还原所述同步信号。
由于固定分辨率下的行同步信号参数和场同步信号参数都是固定的,所以可通过在存储器中存储的不同分辨率的图像的行同步信号参数和场同步信号参数,当计算得到图像分辨率后,便可以根据该分辨率从存储器中存储的数据得到该分辨率下行同步信号的消隐前肩、行同步头、消隐后肩和有效区域的宽度和场同步信号的消隐前肩、同步头、消隐后肩和有效区域的宽度。
在还原同步信号时还可以借助于两个计数器和一个本地时钟,计数器包括一个行同步信号计数器,一个场同步信号计数器,行同步信号计数器对本地时钟产生的时钟信号进行计数,而场同步信号计数器则对行同步信号进行计数,其中两个计数器的工作原理与计算图像分辨率时一致。得到行信号计数器和场信号计数器的计数结果后,根据CEA-861标准来设置行同步信号、场同步信号和数据有效信号的电平的高低变化,根据上述由分辨率得到的行(场)同步信号的消隐前肩、行(场)同步头、消隐后肩和数据有效区域宽度确定电平的宽度,最终可还原得到同步信号。所述还原同步信号的方法只是本申请中一种还原同步信号的方式,本申请并不对还原同步信号的方法进行限制。
在还原得到同步信号后,将所述同步信号和从视频输入装置获取并保存的视频数据一起发送给编码装置,编码装置基于所述同步信号对视频数据进行编码。在一实施例中,由于从视频输入装置获取的视频数据和还原得到的同步信号是来源于两个不同的时钟域,从视频输入装置获取的视频数据来源于视频源的时钟,而还原得到的同步信号来源于本地时钟,将视频数据从视频源时钟域转换成本地时钟域时,通常会有数据丢失的情况,为了在数据丢失的时候保证视频图像正常,通常会把视频数据先缓存一帧,如果数据有丢失,就重复播放缓存的一帧图像,以保证视频图像播放正常。
为了更清楚的介绍本申请提供的同步信号处理方法,以下用一个具体实施例说明。参考图5,视频输入装置会将视频源采集的图像数据解码为符合CEA-861的时钟信号、同步信号、视频数据三个部分,从视频输入装置获取时钟信号、同步信号和视频数据,将视频数据存储在存储器中。通过行同步信号计数器对时钟信号进行计数,得到行同步信号的宽度,根据CEA-861标准,可得到图像宽度,通过场同步信号计数器对行同步信号计数,可计算的到场同步信号的宽度,根据CEA-861标准,可得到图像宽度,由此,可确定图像分辨率。
通过存储器存储不同分辨的行同步信号参数和场同步信号参数,根据计算得到的图像分辨率,可从存储器中存储的数据获取所述分辨率的行同步信号参数和场同步信号参数。通过本地时钟产生本地时钟信号,通过行同步信号计数器对本地时钟产生的时钟信号进行计数,而场同步信号计数器则对行同步信号进行计数,得到行同步信号计数器和场信号计数器的计数结果,再根据CEA-861标准来设置行同步信号、场同步信号和数据有效信号的电平的高低变化,再根据上述分辨率行同步信号参数和场同步信号参数即可还原同步信号。将还原得到的同步信号和是视频数据输出给编码装置。
本发明的第二发面提供了一种同步信号处理装置,所述同步信号处理装置如图6A所示,包括:
同步时序检测模块(601),用于根据所述视频输入装置传输的同步信号计算得到所述图像分辨率;
同步时序生成模块(602),用于根据所述的图像分辨率还原所述同步信号;
输出模块(603),用于将所述视频数据和还原得到的同步信号输出给编码装置。
在一实施例中,如图6B所示,所述同步信号处理装置还包括:视频数据缓存模块(604),用于存储从视频输入装置获取的视频数据。
在一实施例中,所述同步信号处理装置702的还原所述同步信号的过程如图7所示,同步时序检测模块7021从视频输入装置701获取时钟信号和同步信号,根据这两个信号计算的到图像分辨率,并将计算得到的图像分辨率输出给同步时序生成模块7022,同步时序生成模块7022根据分辨率还原所述同步信号。视频数据缓存模块7023从视频输入装置701获取视频数据存储,输出模块7024根据同步生成器模块提供的同步信号将视频数据输出给编码模装置703。
上述装置中各个单元的功能和作用的实现过程具体详见上述方法中对应步骤的实现过程,在此不再赘述。
对于装置实施例而言,由于其基本对应于方法实施例,所以相关之处参见方法实施例的部分说明即可。以上所描述的装置实施例仅仅是示意性的,其中所述作为分离部件说明的单元可以是或者也可以不是物理上分开的,作为单元显示的部件可以是或者也可以不是物理单元,即可以位于一个地方,或者也可以分布到多个网络单元上。可以根据实际的需要选择其中的部分或者全部模块来实现本申请方案的目的。本领域普通技术人员在不付出创造性劳动的情况下,即可以理解并实施。
本发明的第三方面,还提供了一种视频传输系统,如图8所示,所述视频传输系统800包括视频输入装置801、编码装置802和同步信号处理装置803;
所述视频输入装置801用于从视频源获取时钟信号、视频数据和同步信号;
所述同步信号处理装置用于从视频输入装置获取所述时钟信号、视频数据和同步信号,存储所述视频数据并根据所述时钟信号和同步信号计算得到图像分辨率;以及根据所述图像分辨率还原所述同步信号;并将所述同步信号和视频数据输出给编码装置802;
所述编码装置802用于基于所述同步信号对所述视频数据编码。
在一个实施例中,所述同步信号处理装置集成于FPGA(Field-ProgrammableGate Array),即“现场可编程门阵列”芯片上。FPGA芯片的主要特点是可以完全由用户通过软件进行配置和编程,从而完成某种特定的功能,且可以反复擦写。在本申请的一个实施例中,同步信号处理装置完成同步信号处理的功能也基于由用户通过软件进行配置和编程来实现的,所采用的编程语言是Verilog语言,当然编程语言也可以是VHDL语言等其它硬件描述语言,本申请不作限制。
由于视频数据和还原得到的同步信号来源于不同的时钟域,所以视频数据要先缓存。在一个实施例中,所述同步信号处理装置包括存储器,用于写入和读取所述视频输入装置传输的视频数据,所述存储器可以采用DDR、RAM等存储器,本申请不作限制。
另外,在计算图像分辨率和还原生成同步信号时,都需要依据CEA-861标准中规定的不同分辨率下的行同步信号参数和场同步信号参数。所以,在一实施例中,所述同步信号处理装置包括存储器,所述存储器可用于存储不同分辨下的行同步信号参数和场同步信号参数,所述存储器可采用ROM,EMMC等,本申请不作限制。
由于在计算图像分辨率和还原同步信号时,都需用到行同步信号计数器和场同步信号计数器,所以,在一实施例中,所述同步信号处理装置还包括计数器,其中,行同步信号计数器用于对时钟信号计数,场同步信号用于对行同步信号计数。
所述同步信号处理装置可以集成于独立的设备上,也可以集成于视频输入装置或编码装置所在的设备上,本申请不作限制。
以上所述仅为本申请的较佳实施例而已,并不用以限制本申请,凡在本申请的精神和原则之内,所做的任何修改、等同替换、改进等,均应包含在本申请保护的范围之内。
Claims (12)
1.一种同步信号处理方法,其特征在于,所述方法包括:
根据从视频输入装置获取的时钟信号和同步信号计算得到图像分辨率,其中,所述视频输入装置用于从视频源获取所述时钟信号、所述同步信号以及视频数据;
根据所述图像分辨率还原所述同步信号;
在所述视频源切换或中断,且切换后的视频源采集的图像的分辨率与所述视频源采集的图像的分辨率一致时,将从所述视频输入装置获取的视频数据和还原得到的同步信号输出给编码装置。
2.如权利要求1所述的一种同步信号处理方法,其特征在于,所述同步信号包括行同步信号、场同步信号、数据使能信号。
3.如权利要求1所述的一种同步信号处理方法,其特征在于,所述图像分辨率的计算步骤包括:
通过时钟信号和计数器计算行同步信号的宽度,确定图像的宽度;
通过时钟信号和计数器计算场同步信号的宽度,确定图像的高度;
由所述图像的宽度和高度确定图像的分辨率。
4.如权利要求1所述的一种同步信号处理方法,其特征在于,所述还原同步信号的方法包括:
由图像分辨率得到行同步信号参数和场同步信号参数;
通过本地时钟信号和计数器得到同步信号电平值;
由行同步信号参数、场同步信号参数及同步信号电平值还原所述同步信号。
5.如权利要求4所述的一种同步信号处理方法,其特征在于,所述行同步信号参数包括行同步信号的消隐前肩、行场同步头、消隐后肩和数据有效区域,所述场同步信号参数包括场同步信号的消隐前肩、场同步头、消隐后肩和数据有效区域。
6.如权利要求1所述的一种同步信号处理方法,其特征在于,将所述从视频输入装置获取的视频数据经存储器存储后再输出给编码装置。
7.一种同步信号处理装置,其特征在于,所述同步信号处理装置包括:
同步时序检测模块,用于根据视频输入装置传输的时钟信号和同步信号计算得到图像分辨率,其中,所述视频输入装置用于从视频源获取所述时钟信号、所述同步信号以及视频数据;
同步时序生成模块,用于根据所述图像分辨率还原所述同步信号;
输出模块,用于在所述视频源切换或中断,且切换后的视频源采集的图像的分辨率与所述视频源采集的图像的分辨率一致时,将从所述视频输入装置获取的视频数据和还原得到的同步信号输出给编码装置。
8.如权利要求7所述的一种同步信号处理装置,其特征在于,所述装置还包括视频数据缓存模块,用于存储从所述视频输入装置获取的视频数据。
9.一种视频传输系统,所述视频传输系统包括视频输入装置、编码装置;其特征在于,所述视频传输系统包括同步信号处理装置;
所述视频输入装置用于从视频源获取时钟信号、视频数据和同步信号;
所述同步信号处理装置用于从视频输入装置获取所述时钟信号、视频数据和同步信号,并根据所述同步信号计算得到图像分辨率;以及根据所述图像分辨率还原所述同步信号;并在所述视频源切换或中断,且切换后的视频源采集的图像的分辨率与所述视频源采集的图像的分辨率一致时,将所述同步信号和视频数据输出给编码装置;
所述编码装置用于基于所述同步信号对所述视频数据编码。
10.如权利要求9所述的一种视频传输系统,其特征在于,所述同步信号处理装置集成于FPGA芯片上。
11.如权利要求9所述的一种视频传输系统,其特征在于,所述同步信号处理装置包括存储器,用于存储所述视频输入装置传输的视频数据。
12.如权利要求9所述的一种视频传输系统,其特征在于,所述同步信号处理装置集成于独立的设备上,或集成于视频输入装置/编码装置所在的设备上。
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Denomination of invention: A synchronous signal processing method, device, and video transmission system Effective date of registration: 20230625 Granted publication date: 20201215 Pledgee: Shenzhen small and medium sized small loan Co.,Ltd. Pledgor: SHENZHEN HOLLYLAND TECHNOLOGY Co.,Ltd. Registration number: Y2023980045319 |