CN108762662B - 高速暂态量保护的采样数据存储方法及系统 - Google Patents
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Abstract
本发明公开了一种高速暂态量保护的采样数据存储方法及系统。现有暂态量保护存在CPU无法快速处理高速采样数据并进行逻辑判别的问题。本发明采用的技术方案包括:暂态量保护装置正常运行时,FPGA控制AD高速采样,并记录各个采样数据的采样时刻;FPGA对高速采样数据按照4kHz进行抽点缓存,同时存储采样数据的时标信息;FPGA判别低速采样缓冲区数据是否启动,如果启动,再根据启动点的时标信息寻址高速采样的数据,查找到数据后,将启动前3ms和启动后2ms对应的高速采样数据发送给保护CPU;保护CPU开辟多个计算缓冲区分别存储FPGA发送的故障数据。本发明解决了现有暂态量保护CPU无法快速处理高速采样数据进行逻辑判别的问题,满足了高速暂态量保护动作时间的速动性要求。
Description
技术领域
本发明属于电力系统继电保护技术领域,具体地说是一种高速暂态量保护的采样数据存储方法及系统。
背景技术
高速暂态量保护是一种基于检测故障所产生的高频暂态量的继电保护装置,在电力系统故障时将产生附加的暂态分量,这些故障分量包含丰富的故障信息并分布于从直流分量到高频分量的广阔频谱范围内,而且高频分量中包含着比工频分量更多的故障信息,暂态量保护通过提高装置采样频率,来获取电力系统故障时的暂态信号,并利用这些暂态的时域和频域的信息,快速完成故障的识别。
高速暂态量保护采样率高,CPU要在2-3ms内快速切除故障,针对高速暂态量保护的采样数据进行甄别存储,有利于保护的动作性能。
现有暂态量保护存在CPU无法快速处理高速采样数据并进行逻辑判别的问题。
发明内容
本发明提供一种高速暂态量保护的采样数据存储方法,其为高速暂态量保护的动作速度提供保障措施,以解决现有暂态量保护CPU无法快速处理高速采样数据并进行逻辑判别的问题,满足高速暂态量保护动作时间的速动性要求。
为此,本发明采用的技术方案为:高速暂态量保护的采样数据存储方法,其包括如下步骤:
步骤一,暂态量保护装置正常运行时,FPGA控制AD高速采样,并记录各个采样数据的采样时刻;
步骤二,FPGA对高速采样数据按照4kHz进行抽点缓存,同时存储采样数据的时标信息;
步骤三,FPGA判别低速采样缓冲区数据是否启动,如果启动,再根据启动点的时标信息寻址高速采样的数据,查找到数据后,将启动前3ms和启动后2ms对应的高速采样数据发送给保护CPU;
步骤四,保护CPU开辟多个计算缓冲区分别存储FPGA发送的故障数据,用于故障计算。
作为上述方法的补充,步骤一中,采样频率为1.2MHz。
作为上述方法的补充,步骤二中,FPGA内部设置两个循环缓冲区,一个用于存放高速采样数据,一个用于存放抽点后的采样数据。
本发明还提供一种高速暂态量保护的采样数据存储系统,其包括:
数据采样时刻记录单元:暂态量保护装置正常运行时,FPGA控制AD高速采样,并记录各个采样数据的采样时刻;
采样数据时标信息存储单元:FPGA对高速采样数据按照4kHz进行抽点缓存,同时存储采样数据的时标信息;
低速采样缓冲区数据启动判别单元:FPGA判别低速采样缓冲区数据是否启动;
高速采样数据发送单元:如果低速采样缓冲区数据启动,再根据启动点的时标信息寻址高速采样的数据,查找到数据后,将启动前3ms和启动后2ms对应的高速采样数据发送给保护CPU;
故障数据存储单元:保护CPU开辟多个计算缓冲区分别存储FPGA发送的故障数据,用于故障计算。
本发明具有的有益效果如下:本发明解决了现有暂态量保护CPU无法快速处理高速采样数据进行逻辑判别的问题,满足了高速暂态量保护动作时间的速动性要求。
附图说明
图1是本发明实施例1高速暂态量保护的采样数据存储方法的流程图;
图2是本发明实施例2高速暂态量保护的采样数据存储系统的示意图。
具体实施方式
下面结合说明书附图和具体实施方式对本发明作进一步详细的说明。
实施例1
本实施例提供一种高速暂态量保护的采样数据存储方法,如图1所示,包括如下步骤:
步骤一,暂态量保护装置正常运行时,FPGA控制AD高速采样,采样频率为1.2MHz,并记录各个采样数据的采样时刻。
步骤二,FPGA对高速采样数据按照4kHz进行抽点缓存,同时存储采样数据的时标信息;FPGA内部设置两个循环缓冲区,一个用于存放高速采样数据,一个用于存放抽点后的采样数据。
步骤三,FPGA判别低速采样缓冲区数据是否启动;如果启动,再根据启动点的时标信息寻址高速采样的数据,查找到数据后,将启动前3ms和启动后2ms对应的高速采样数据发送给保护CPU;如果不启动,直接结束。
步骤四,保护CPU开辟10个计算缓冲区分别存储FPGA发送的故障数据,用于故障计算。
实施例2
本实施例提供一种高速暂态量保护的采样数据存储系统,如图2所示,包括:
数据采样时刻记录单元:暂态量保护装置正常运行时,FPGA控制AD高速采样,采样频率为1.2MHz,并记录各个采样数据的采样时刻。
采样数据时标信息存储单元:FPGA对高速采样数据按照4kHz进行抽点缓存,同时存储采样数据的时标信息;FPGA内部设置两个循环缓冲区,一个用于存放高速采样数据,一个用于存放抽点后的采样数据。
低速采样缓冲区数据启动判别单元:FPGA判别低速采样缓冲区数据是否启动。
高速采样数据发送单元:如果低速采样缓冲区数据启动,再根据启动点的时标信息寻址高速采样的数据,查找到数据后,将启动前3ms和启动后2ms对应的高速采样数据发送给保护CPU。
故障数据存储单元:保护CPU开辟10个计算缓冲区分别存储FPGA发送的故障数据,用于故障计算。
以上所述,仅用以说明本发明的技术方案而非限制,本领域普通技术人员对本发明的技术方案所做的其它修改或者等同替换,只要不脱离本发明技术方案的精神和范围,均应涵盖在本发明的权利要求范围当中。
Claims (4)
1.高速暂态量保护的采样数据存储方法,其特征在于,包括如下步骤:
步骤一,暂态量保护装置正常运行时,FPGA控制AD高速采样,并记录各个采样数据的采样时刻;
步骤二,FPGA对高速采样数据按照4kHz进行抽点缓存,同时存储采样数据的时标信息;
步骤三,FPGA判别低速采样缓冲区数据是否启动,如果启动,再根据启动点的时标信息寻址高速采样的数据,查找到数据后,将启动前3ms和启动后2ms对应的高速采样数据发送给保护CPU;
步骤四,保护CPU开辟多个计算缓冲区分别存储FPGA发送的故障数据,用于故障计算。
2.根据权利要求1所述的高速暂态量保护的采样数据存储方法,其特征在于,步骤一中,采样频率为1.2MHz。
3.根据权利要求1或2所述的高速暂态量保护的采样数据存储方法,其特征在于,步骤二中,FPGA内部设置两个循环缓冲区,一个用于存放高速采样数据,一个用于存放抽点后的采样数据。
4.高速暂态量保护的采样数据存储系统,其特征在于,包括:
数据采样时刻记录单元:暂态量保护装置正常运行时,FPGA控制AD高速采样,并记录各个采样数据的采样时刻;
采样数据时标信息存储单元:FPGA对高速采样数据按照4kHz进行抽点缓存,同时存储采样数据的时标信息;
低速采样缓冲区数据启动判别单元:FPGA判别低速采样缓冲区数据是否启动;
高速采样数据发送单元:如果低速采样缓冲区数据启动,再根据启动点的时标信息寻址高速采样的数据,查找到数据后,将启动前3ms和启动后2ms对应的高速采样数据发送给保护CPU;
故障数据存储单元:保护CPU开辟多个计算缓冲区分别存储FPGA发送的故障数据,用于故障计算。
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