CN107808644A - 供电单元以及包括该供电单元的显示装置 - Google Patents

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Abstract

公开了一种防止源极驱动器集成电路被VDD电压与HVDD电压之间的供给颠倒损坏的供电单元以及包括该供电单元的显示装置。

Description

供电单元以及包括该供电单元的显示装置
相关申请的交叉引用
本申请要求于2016年8月31日提交的韩国专利申请第10-2016-0112185号的权益。
技术领域
本公开涉及一种供电单元以及包括该供电单元的显示装置。
背景技术
随着信息化社会的不断发展，对用于显示图像的显示装置的各种要求越来越高。因此，近来正在使用诸如液晶显示(LCD)装置、等离子体显示面板(PDP)装置、有机发光二极管显示装置等各种显示装置。
显示装置包括显示面板、栅极驱动器、数据驱动器、定时控制器和供电单元。显示面板包括多条数据线、多条栅极线和分别设置在由数据线和栅极线的交点限定的多个区域中的多个像素，并且当栅极信号被供给至栅极线时，多个像素被供给有数据线的数据电压。像素根据数据电压发出具有一定亮度的光。栅极驱动器将栅极信号供给至栅极线。数据驱动器包括向数据线供给数据电压的源极驱动器集成电路(IC)。定时控制器控制栅极驱动器的操作定时和数据驱动器的操作定时。供电单元供给用于驱动栅极驱动器、数据驱动器和定时控制器所需的电压。
源极驱动器IC被设置为多个，并且所述多个源极驱动器IC均包括移位寄存器、锁存器、数模转换器(DAC)和输出缓冲器。输出缓冲器包括输出正数据电压的多个正输出电路以及输出负数据电压的多个负输出电路。正数据电压相对于公共电压为高数据电压，而负数据电压相对于公共电压为低数据电压。正输出电路和负输出电路接收VDD电压、低于VDD电压的VSS电压以及VDD电压与VSS电压之间的半VDD(HVDD)电压作为驱动电压。
近来，随着消费者需求的增加，正在发布60英寸或更大英寸的大屏幕显示装置。在大屏幕显示装置中，由于作为源极驱动器IC的驱动电压的VDD电压，消耗电流显著增大。产生VDD电压的VDD电压发生器的最大输出电流受到限制，因此，在大屏幕显示装置中，难以将供电单元配置成包括VDD电压发生器。因此，在大屏幕显示装置中，供电单元可以包括多个VDD电压发生器，例如第一VDD电压发生器和第二VDD电压发生器。此外，供电单元可以包括HVDD电压发生器，该HVDD电压发生器从第一VDD电压发生器的第一VDD电压和第二VDD电压发生器的第二VDD电压中的一个产生HVDD电压。
如图1所示，为了稳定驱动，当输入电力时，向源极驱动器IC供给VDD电压，然后供给HVDD电压。然而，当输入电力时，由于第一VDD电压发生器的VDD电压升高时间与第二VDD电压发生器的VDD电压升高时间之间的差异，VDD电压可能比HVDD电压更晚地被供给至源极驱动器IC。例如，在从第一VDD电压生成HVDD电压的情况下，如果第二VDD电压的升高时间比第一VDD电压的升高时间慢，则在源极驱动器IC中可能发生VDD电压与HVDD电压之间的供给颠倒(supply reversal)。源极驱动器IC可能会由于VDD电压与HVDD电压之间的供给颠倒而被损坏。
发明内容
因此，本公开涉及提供一种基本上消除了由于现有技术的限制和缺点而引起的一个或更多个问题的供电单元以及包括该供电单元的显示装置。
本公开的一个方面涉及提供一种防止源极驱动器IC被VDD电压与HVDD电压之间的供给颠倒损坏的供电单元以及包括该供电单元的显示装置。
根据一个示例，提供了一种用于显示装置的供电单元，该供电单元包括：第一VDD电压发生器，其用于产生第一VDD电压；第一VDD电压线，其连接至第一VDD电压发生器，以用于将第一VDD电压供给至显示面板的多个第一源极驱动器IC；第二VDD电压发生器，其用于产生第二VDD电压；第二VDD电压线，其连接至第二VDD电压发生器，以用于将第二VDD电压供给至显示面板的多个第二源极驱动器IC；以及二极管电路，其包括p个二极管，p为等于或大于1的整数，二极管电路连接在第一VDD电压线与第二VDD电压线之间，并且被配置成如果第一VDD电压线的第一VDD电压与第二VDD电压线的第二VDD电压之间的差大于预定电压，则允许电流从第一VDD电压线流向第二VDD电压线。多个第一源极驱动器IC和多个第二源极驱动器IC可以彼此不同。因此，如果第二VDD电压的初始升高比第一VDD电压的初始升高慢，则经由二极管电路对第二VDD电压线充电，从而导致源极驱动器IC处的供电延迟。因此，可以确保在某种程度上同时供给第一VDD电压或第二VDD电压。
供电单元还可以包括：HVDD电压发生器，其用于产生HVDD电压；以及HVDD电压线，其连接至HVDD电压发生器，以用于将HVDD电压供给至显示面板的第一源极驱动器IC和第二源极驱动器IC。第一VDD电压和第二VDD电压可以具有高于HVDD电压的电压电平。HVDD电压的电压电平可以等于或大于正数据电压的最小电压电平，并且等于或小于负数据电压的最大电压电平。HVDD电压发生器可以连接至第一VDD电压线。HVDD电压发生器可以被配置成使用第一VDD电压产生HVDD电压。在这种情况下，可以防止只有在向第二源极驱动器IC供给HVDD电压之后才向第二源极驱动器IC供给第二VDD电压，从而防止电压反向造成第二源极驱动器IC的损坏。
预定电压可以是二极管的阈值电压。二极管电路可以包括彼此串联连接的至少两个二极管，p≥2。在二极管电路中，二极管的阳极电极可以电连接至第一VDD电压线，并且二极管的阴极电极可以电连接至第二VDD电压线。
供电单元还可以包括短路检测器，其连接至第一VDD电压线，并且被配置成输出用于指示第一VDD电压的电压电平是否小于预定电压电平的短路检测信号。供电单元还可以包括电压输出控制器，其被配置成基于短路检测信号来控制第一VDD电压发生器和第二VDD电压发生器。如果第一VDD电压的电压电平小于预定电压电平，则第一VDD电压发生器和第二VDD电压发生器被控制为不输出第一VDD电压和第二VDD电压。此外，电压输出控制器可以控制供电单元的所有电压产生单元都不输出电压。
第一VDD电压发生器和/或第二VDD电压发生器可以包括升压IC。HVDD发生器可以包括降压转换器。
根据另一示例，提供了一种显示装置，该显示装置包括：包括多个像素的显示面板；根据先前示例中任一项所述的供电单元；以及包括多个第一源极驱动器IC和第二源极驱动器IC的数据驱动器。显示面板可以包括彼此交叉以用于限定多个像素的多条栅极线和多条数据线。源极驱动器IC可以被配置成向多条数据线输出数据电压。
源极驱动器IC可以分别包括输出缓冲器，该输出缓冲器包括用于输出正数据电压的至少一个正输出缓冲器以及用于输出负数据电压的至少一个负输出缓冲器。第一VDD电压和第二VDD电压中的一个可以被输入至正输出缓冲器的第一参考电压端子。HVDD电压可以被输入至正输出缓冲器的第二参考电压端子。
根据又一示例，提供了一种显示装置，该显示装置包括：第一VDD电压发生器，其用于产生第一VDD电压；第一VDD电压线，其连接至第一VDD电压发生器，以用于将第一VDD电压供给至显示面板的多个第一源极驱动器IC；第二VDD电压发生器，其用于产生第二VDD电压；第二VDD电压线，其连接至第二VDD电压发生器，以用于将第二VDD电压供给至显示面板的多个第二源极驱动器IC；短路检测器，其连接至第一VDD电压线，并且被配置成输出用于指示第一VDD电压的电压电平是否小于预定电压电平的短路检测信号；以及电压输出控制器，其被配置成基于短路检测信号来控制第一VDD电压发生器和第二VDD电压发生器。如果第一VDD电压的电压电平小于预定电压电平，则第一VDD电压发生器和第二VDD电压发生器被控制为不输出第一VDD电压和第二VDD电压。
根据另一示例，供电单元包括第一VDD电压发生器，其被配置成产生第一VDD电压以将第一VDD电压输出至第一VDD电压线；第二VDD电压发生器，其被配置成产生第二VDD电压以将第二VDD电压输出至第二VDD电压线；第一VDD电压线与所述第二VDD电压线之间的二极管电路，该二极管电路包括至少一个二极管；以及电力控制器，其包括HVDD电压发生器，该HVDD电压发生器被配置成使用从施加自第一VDD电压发生器的第一VDD电压产生HVDD电压，以将HVDD电压输出至HVDD电压线。
至少一个二极管的阳极电极可以耦接至第一VDD电压线，并且阴极电极耦接至第二VDD电压线。所述至少一个二极管可以包括通用二极管，肖特基(Schottky)势垒二极管或其组合。电力控制器还可以包括短路检测器，该短路检测器被配置成当第一VDD电压线的第一VDD电压可以降低到阈值电压电平或更低时，输出具有第一逻辑电平电压的短路检测信号。电力控制器还可以包括电压输出控制器，该电压输出控制器被配置成输出电压输出控制信号，使得当输入具有第一逻辑电平电压的短路检测信号时，第一VDD电压发生器和第二VDD电压发生器不输出电压。
根据另一示例，显示装置包括：显示面板，该显示面板包括多条数据线、多条栅极线以及连接至所述多条数据线和所述多条栅极线的多个像素；多个源极驱动器集成电路(IC)，所述多个源极驱动器集成电路(IC)被配置成将数字视频数据转换成数据电压并且将数据电压施加至多条数据线；栅极驱动器，其被配置成向多条栅极线施加栅极信号；以及供电单元，其被配置成向所述多个源极驱动器IC中的一些施加第一VDD电压和HVDD电压，并且向其他源极驱动器IC施加第二VDD电压和HVDD电压，其中，供电单元包括：第一VDD电压发生器，其被配置成产生第一VDD电压以将第一VDD电压输出至第一VDD电压线；第二VDD电压发生器，其被配置成产生第二VDD电压以将第二VDD电压输出至第二VDD电压线；包括至少一个二极管的二极管电路，该二极管电路允许电流从第一VDD电压线流向第二VDD电压线；以及电力控制器，其包括HVDD电压发生器，该HVDD电压发生器被配置成从施加自第一VDD电压发生器的第一VDD电压产生HVDD电压，以将HVDD电压输出至HVDD电压线。
多个源极驱动器IC中的一些可以耦接至第一VDD电压线，并且其他源极驱动器IC可以耦接至第二VDD电压线。多个源极驱动器IC可以耦接至HVDD电压线。在供电单元中，至少一个二极管的阳极电极可以耦接至第一VDD电压线，并且阴极电极可以耦接至第二VDD电压线。所述至少一个二极管可以包括通用二极管、肖特基势垒二极管或其组合。电力控制器还可以包括短路检测器，其被配置成当第一VDD电压线的第一VDD电压降低到阈值电压或更低时，输出具有第一逻辑电平电压的短路检测信号。电力控制器还可以包括电压输出控制器，其被配置成输出电压输出控制信号，使得当输入具有第一逻辑电平电压的短路检测信号时，第一VDD电压发生器和第二VDD电压发生器不输出电压。
本公开的附加优点和特征的一部分将在接下来的说明书中阐述，并且在考察了下面的内容时本公开的附加优点和特征的一部分将对本领域普通技术人员变得明显或者可以从本公开的实践中了解。本公开的目的和其他优点可以通过在所撰写的说明书及其权利要求书以及附图中具体指出的结构来实现和获得。
将理解的是，本公开的前述一般性描述和以下详细描述都是示例性和说明性的，并且旨在对所要求保护的本公开提供进一步说明。
附图说明
附图被包括以提供对本公开的进一步理解并且被并入本说明书并构成本说明书的一部分；附图示出了本公开的实施方式并且与描述一起用于说明本公开的原理。在附图中：
图1是示出将VDD电压和HVDD电压供给至源极驱动器IC的顺序的图；
图2是示出根据本公开的实施方式的显示装置的框图；
图3是示出根据本公开的实施方式的显示装置的下基板、源极驱动器IC、源极柔性膜、源极电路板、控制电路板和定时控制器以及根据本公开的实施方式的供电单元的示意图；
图4是示出图2的像素的示例的图；
图5是详细示出图3的源极驱动器IC的框图；
图6是详细示出图5的输出缓冲器的电路图；
图7是详细示出图2的供电单元的示例的框图；
图8A和图8B是示出现有技术以及本公开的实施方式中的供电单元的第一VDD电压、第二VDD电压和HVDD电压的升高顺序的波形图；
图9A和图9B是示出在现有技术以及本公开的实施方式中当第一VDD电压线与地面短路时的第一VDD电压、第二VDD电压和HVDD电压的波形图；以及
图10A和图10B是示出在现有技术以及本公开的实施方式中当第二VDD电压线与地面短路时的第一VDD电压、第二VDD电压和HVDD电压的波形图。
具体实施方式
现在将详细地参考本公开的示例性实施方式，本发明的示例性实施方式的示例在附图中示出。只要有可能，贯穿附图将使用相同的附图标记指代相同或类似的部件。
在说明书中，应当注意，只要有可能，对元件使用在其他附图中已经用于表示相同元件的相似附图标记。在下面的描述中，当本领域技术人员已知的功能和配置与本公开的基本配置无关时，将省略对其的详细描述。说明书中描述的术语应理解如下。
本公开的优点和特征及其实现方法将通过参考附图描述的下面的实施方式阐明。然而，本公开可以以不同方式实施，而且不应被解释为限于本文中所述的实施方式。而是，这些实施方式被提供来使得该公开内容将是全面和完整的，并向本领域技术人员完全地传达本公开的范围，另外，本公开将仅受权利要求的范围限定。
在附图中所公开的用于描述本公开的实施方式的形状、大小、比率、角度和数目仅是示例，因而，本公开不限于所示出的细节。贯穿全文，相似的附图标记指代相似的元件。在下面的描述中，在对相关公知功能或配置的详细描述被确定为不必要地使本公开的重点模糊的情况下，将省略该详细描述。
以使用在本说明书中所述的“包含”、“具有”和“包括”的情况下，除非使用“仅”，则可以添加另一部件。除非指代相反的意思，则单数形式的术语可以包括复数形式。
在构造元件时，虽然没有明确的描述，但是该元件被解释为包括误差范围。
在描述位置关系时，例如，当两部分之间的位置关系被描述为“上”、“上方”、“下方”和“相邻”时，除非使用“正”或“直接”，否则一个或多个其他部分可以被放置在两个部分之间。
在描述时间关系时，例如，在时间顺序被描述为“之后”、“随后”、“接下来”和“之前”时，除非使用“仅”或“直接”，否则可以包括不连续的情况。
将理解的是，尽管在本文中可以使用术语“第一”、“第二”等来描述多种元件，但是这些元件不应被这些术语所限制。这些术语仅用于将一个元件与另一元件进行区分。例如，在不脱离本公开的范围情况下，第一元件可以称为第二元件，类似地，第二元件可以称为第一元件。
X轴方向、Y轴方向和Z轴方向不应被解释为其间的关系仅为垂直的几何关系，而是可以表示在本公开的元件的正常运行范围内具有更宽的方向性。
术语“至少一个”应理解为包括相关联地列出的项中的一个或更多个的任何和所有的组合。例如，“第一项、第二项和第三项中的至少一个”的含义表示从第一项、第二项和第三项中的两个或更多个中提出的所有项的组合，以及第一项、第二项或第三项。
如本领域技术人员可以充分理解的，本公开的各种实施方式的特征可以部分地或全部地彼此耦接或组合，并且可以彼此不同地相互操作并且在技术上驱动。本公开的实施方式可以彼此独立地执行，或者可以在共同依赖关系中一起执行。
在下文中，将参照附图详细描述本公开的示例性实施方式。
图2是示出根据本公开的实施方式的显示装置的框图。图3是示出根据本公开的实施方式的显示装置的下基板、源极驱动器IC、源极柔性膜、源极电路板、控制电路板和定时控制器以及根据本公开的实施方式的供电单元和伽马参考电压供给单元的图。
根据本公开的实施方式的显示装置的示例可以包括以向栅极线G1至Gn提供栅极信号的线扫描方法向像素供给数据电压的所有显示装置。例如，根据本公开的实施方式的显示装置可以实现为液晶显示器(LCD)装置、有机发光显示装置、场致发射显示装置、电泳显示装置等中的一个。在本公开的实施方式中，将描述将显示装置实现为LCD装置的示例，但本公开不限于此。
参照图2和图3，根据本公开的实施方式的显示装置可以包括显示面板10、栅极驱动器14、数据驱动器20、定时控制器30、供电单元40和伽马参考电压供给单元50。
显示面板10可以通过使用多个像素来显示图像。显示面板10可以包括下基板、上基板以及下基板与上基板之间的液晶层。多个数据线D1至Dm和多个栅极线G1至Gn可以布置在显示面板10的下基板上。数据线D1至Dm可以与栅极线G1至Gn相交。
如图2中的像素P可以分别设置在由数据线D1至Dm和栅极线G1至Gn的交点限定的多个区域中。像素P中的每一个可以连接至数据线和栅极线。如图4中的像素P可以各自包括晶体管T、像素电极11、公共电极12、液晶层13和存储电容器Cst。晶体管T可以通过栅极线的栅极信号接通并且可以将数据线的数据电压供给至像素电极11。公共电极12可以连接至公共线并且可以通过公共线供给有公共电压。因此，像素P中的每一个可以利用从供给至像素电极11的数据电压与供给至公共电极12的公共电压之间的电位差生成的电场来驱动液晶层13的液晶，从而调节从背光单元入射的光的透射率。因此，像素P可以显示图像。此外，存储电容器Cst可以设置在像素电极11与公共电极12之间并且可以在像素电极11与公共电极12之间保持恒定的电位差。
在垂直电场模式例如扭曲向列(TN)模式或垂直配向(VA)模式下，公共电极12设置在上基板上。在横向电场模式例如面内切换(IPS)模式或边缘场切换(FFS)模式下，公共电极12设置在下基板上。显示面板10的液晶模式可以被实现为任意的液晶模式以及TN模式、VA模式、IPS模式和FFS模式。
可以在显示面板10的上基板上设置黑矩阵、滤色器等。滤色器中的每一个可以设置在未被黑矩阵覆盖的开口中。在显示面板10被设置在TFT(COT)结构的滤色器中的情况下，可以在显示面板10的下基板上设置黑矩阵和滤色器。
可以在显示面板10的下基板和上基板的每一个上附接偏光器，并且可以在下基板和上基板的每一个上设置用于调节液晶的预倾角的配向层。可以在显示面板10的下基板与上基板之间设置用于保持液晶层的单元间隙的颜色间隔物。
显示面板10可以代表性地使用用于调制来自背光单元的光的透射型液晶显示面板。背光单元可以包括利用从背光驱动器供给的驱动电流发光的光源、导光板(或漫射板)和多个光学片。背光单元可以被实现为直接型或边缘型背光单元。背光单元的光源可以包括热阴极荧光灯(HCFL)、冷阴极荧光灯(CCFL)、外部电极荧光灯(EEFL)、发光二极管(LED)和有机发光二极管(OLED)中的一个或两个或更多个。
背光驱动器可以生成用于打开背光单元的光源的驱动电流。背光驱动器可以根据背光控制器的控制生成供给至光源的驱动电流。背光控制器可以根据从主系统或定时控制器30输入的全局/局部调光信号，以串行外围接口(SPI)数据格式向背光驱动器传送背光控制数据——包括脉宽调制(PWM)信号的占空比控制值。
栅极驱动器14可以从定时控制器30接收栅极控制信号GCS并且可以从供电单元40接收栅极高电压VGH和栅极低电压VGL。栅极高电压VGH可以是用于接通显示面板10的像素P的晶体管的电压并且可以被设置作为用于关断显示面板10的像素P的晶体管的电压。栅极驱动器14可以生成从栅极低电压VGL摆动到栅极高电压VGH的栅极信号并且可以根据栅极控制信号GCS将栅极信号供给至栅极线G1至Gn。
栅极驱动器14可以以面板(GIP)类型的栅极驱动器被布置在非显示区域NDA中。在图2中，示出了在显示区域DA的一侧外部的非显示区域NDA中布置栅极驱动器14的示例，但本实施方式不限于此。在其他实施方式中，栅极驱动器14可以被布置在显示区域DA的两侧外部的非显示区域NDA中。
替代地，栅极驱动器14可以包括多个栅极驱动器IC，并且栅极驱动器IC可以安装在栅极柔性膜上。栅极柔性膜中的每一个可以是带状载体封装或芯片上的膜。栅极柔性膜中的每一个可以通过使用各向异性导电膜以带状自动接合(TAB)类型附着在显示面板10的非显示区域NDA上，并且因此，栅极驱动器IC可以连接至栅极线G1至Gn。
数据驱动器20可以从定时控制器30接收数字视频数据DATA和数据控制信号DCS。数据驱动器20可以从供电单元40接收第一VDD电压VDD1和第二VDD电压VDD2、HVDD电压HVDD以及VSS电压VSS。数据驱动器20可以从伽马参考电压供给单元50接收伽马参考电压PGMA和NGMA。
数据驱动器20可以包括至少一个源极驱动器IC 21。源极驱动器IC 21可以将伽马参考电压PGMA和NGMA分开以生成伽马灰度级电压。源极驱动器IC 21可以基于伽马灰度级电压，根据数据控制信号DCS将数字视频数据DATA转换成模拟数据电压。源极驱动器IC 21可以向数据线D1至Dm供给模拟数据电压。下面将参照图5来描述源极驱动器IC 21的详细描述。
源极驱动器IC 21中的每一个可以被制造为驱动芯片。源极驱动器IC 21中的每一个可以安装在源极柔性膜60上。源极柔性膜60可以被设置成多个，并且源极柔性膜60中的每一个可以被实现为带状载体封装或芯片上的膜并且可以弯曲或成弧形。源极柔性膜60中的每一个可以通过使用各向异性导电膜以TAB类型附着在显示面板10的非显示区域NDA上，并且因此源极柔性膜60可以连接至数据线D1至Dm。
替代地，源极驱动器IC 21可以以玻璃上芯片(COG)类型或塑料上芯片(COP)类型直接附着在下基板上并且可以连接至数据线D1至Dm。
源极柔性膜60可以附着在源极电路板70上。源极电路板70可以是能够弯曲或成弧形(curved)的柔性印刷电路板(FPCB)。源极电路板70可以被设置为一个或多个。
定时控制器30可以从外部系统板(未示出)接收视频数据DATA和定时信号TS。定时信号TS可以包括垂直同步信号、水平同步信号、数据使能信号和点时钟。
定时控制器30可以基于定时信号TS和存储在存储器例如电可擦除可编程只读存储器(EEPROM)中的驱动定时信息，生成用于控制栅极驱动器14的操作定时的栅极控制信号GCS和用于控制数据驱动器20的操作定时的数据控制信号DCS。定时控制器30可以向栅极驱动器14供给栅极控制信号GCS。定时控制器30可以向数据驱动器20供给视频数据DATA和数据控制信号DCS。
供电单元40可以生成用于驱动栅极驱动器14、数据驱动器20和定时控制器30所需的电压并且可以分别向驱动栅极驱动器14、数据驱动器20和定时控制器30供给电压。供电单元40可以向栅极驱动器14供给栅极高电压VGH和栅极低电压VGL。栅极高电压VGH可以是用于接通显示面板10的像素P的晶体管的电压，并且栅极低电压VGL可以是用于关断显示面板10的像素P的晶体管的电压。
供电单元40可以向数据驱动器20供给第一VDD电压VDD1和第二VDD电压VDD2、HVDD电压HVDD和VSS电压VSS。第一VDD电压VDD1和第二VDD电压VDD2可以各自是具有电平比HVDD电压HVDD的电平高的电压。HVDD电压HVDD可以分别是具有电平比VSS电压VSS的电平高的电压。
近来，随着消费者需求的增加，正在发布60英寸或更大英寸的大屏幕显示装置。在大屏幕显示装置中，由于作为源极驱动器IC 21的驱动电压的VDD电压，消耗电流显著增大。因此，在大屏幕显示装置中，供电单元40可以包括多个VDD电压发生器，例如，第一VDD电压发生器和第二VDD电压发生器。在这种情况下，如图3所示，第一VDD电压发生器可以通过第一VDD电压线VDDL1将第一VDD电压供给至源极驱动器IC 21中的一些，并且第二VDD电压发生器可以通过第二VDD电压线VDDL2将第二VDD电压供给至另一些源极驱动器IC 21，从而稳定地将VDD电压供给至源极驱动器IC 21。
如图3所示，供电单元40可以通过HVDD电压线HVDDL将HVDD电压HVDD供给至所有源极驱动器IC 21。供电单元40可以向定时控制器30和伽马参考电压供给单元50供给驱动电压。下面将参照图7来描述供电单元40的详细描述。
伽马参考电压供给单元50可以从定时控制器30接收伽马参考电压数据Dgma，以基于伽马参考电压数据Dgma生成伽马参考电压PGMA和NGMA。伽马参考电压可以包括正伽马参考电压PGMA和负伽马参考电压NGMA。在显示装置是LCD装置的情况下，正伽马参考电压PGMA可以各自表示相对于公共电压的高电平电压，并且负伽马参考电压NGMA可以各自为相对于公共电压的低电平电压。
如图3所示，定时控制器30、供电单元40和伽马电压供给单元50可以安装在控制电路板80上。控制电路板80可以通过柔性电路板90例如柔性扁平电缆(FFC)或柔性印刷电路(FPC)连接至源极电路板70。
图5是详细示出图3的源极驱动器IC 21的框图。参照图5，源极驱动器IC 21可以包括移位寄存器121、锁存器122、数字模拟转换器(DAC)123、输出缓冲器124和分压电路125。
源极驱动器IC 21可以从定时控制器30接收数据控制信号DCS、从供电单元40接收第一驱动电压HVDD、第二驱动电压VDD和第三驱动电压VSS，并且从伽马参考电压供给单元50接收正伽马参考电压PGMA和负伽马参考电压NGMA。
数据控制信号DCS可以包括源极起始脉冲SSP、源极采样时钟SSC、源极输出使能信号SOE、极性控制信号POL等。源极起始脉冲SSP可以控制源极驱动器IC 21的数据采样起始点。源极采样时钟SSC可以是用于基于上升沿或下降沿来控制源极驱动器IC 21中的数据采样操作的时钟信号。源极输出使能信号SOE可以控制源极驱动器IC 21的输出。极性控制信号POL可以控制数据电压的极性。
移位寄存器121可以响应于源极起始脉冲SSP和源极采样时钟SSC输出采样信号SAM。锁存器122可以响应于从移位寄存器121输出的采样信号SAM来按顺序采样视频数据DATA，并且可以根据源极输出使能信号SOE针对一条水平线同时输出采样的视频数据DATA。锁存器122可以被设置成两个或更多个，但是为了便于描述，仅示出和描述一个锁存器122。
DAC 123可以从分压电路125接收伽马灰度级电压GV。DAC 123可以通过使用伽马灰度级电压GV将针对一条水平线的视频数据DATA转换成正的数据电压PDV和负的数据电压NDV。亦即，DAC 123可以将作为数字视频数据的视频数据DATA转换成模拟数据电压。
输出缓冲器124可以包括用于输出正数据电压PDV而无压降的多个正输出缓冲器和用于输出负数据电压NDV而无压降的多个负输出缓冲器。正输出缓冲器可以输出第一VDD电压VDD1或第二VDD电压VDD2与HVDD电压HVDD之间的正数据电压PDV。负输出缓冲器可以输出VSS电压VSS和HVDD电压HVDD之间的负数据电压NDV。此外，输出缓冲器124可以在从正输出缓冲器输出的正数据电压PDV和从负输出缓冲器输出的负数据电压NDV中选择一个数据电压，并且可以将选择的数据电压DV输出到数据线D1至Dm中的对应数据线。下面将参照图6来描述输出缓冲器124的详细描述。
分压电路125可以接收正伽马参考电压PGMA和负伽马参考电压NGMA。分压电路125可以包括多个电阻器串R串。分压电路125可以通过使用电阻器串R串来使正伽马参考电压PGMA和负伽马参考电压NGMA分开(divide)，以产生伽马灰度级电压GV。伽马灰度级电压GV可以包括正伽马灰度级电压和负伽马灰度级电压。可以从正伽马灰度级电压生成正数据电压PDA，并且可以从负伽马灰度级电压生成负数据电压NDA。
图6是详细示出图5的输出缓冲器的电路图。在图6中，为了便于描述，仅示出了用于向第j条数据线Dj输出数据电压的第j个正输出缓冲器PBj、第j个负输出缓冲器NBj和第j个多路复用器MUXj。
参照图6，第j个正输出缓冲器PBj的输入端子(i)可以连接至第j条正数据电压线PDLj，并且输出端子(o)可以连接至第j个多路复用器MUXj。第j条正数据电压线PDLj可以是连接至DAC 123的线，通过该线输出从DAC 123输出的第j个正数据电压。第j个正输出缓冲器PBj可以将第j个正数据电压输出至第j个多路复用器MUXj。
此外，第一VDD电压VDD1或第二VDD电压VDD2可以输入至第j个正输出缓冲器PBj的第一参考电压端子(RV1)，并且HVDD电压HVDD可以输入至第二参考电压端子(RV2)。因此，第j个正输出缓冲器PBj可以输出第一驱动电压HVDD与第二驱动电压VDD之间的电压。
第j个负输出缓冲器NBj的输入端子(j)可以连接至第j条负数据电压线NDLj，并且输出端子(o)可以连接至第j个多路复用器MUXj。第j条负数据电压线NDLj可以是连接至DAC123的线，通过该线输出从DAC 123输出的第j个负数据电压。第j个负输出缓冲器NBj可以将第j个负数据电压输出至第j个多路复用器MUXj。
此外，HVDD电压HVDD可以输入至第j个负输出缓冲器NBj的第一参考电压端子(RV1)，并且VSS电压VSS可以输入至第二参考电压端子(RV2)。因此，第j个负输出缓冲器NBj可以输出HVDD电压HVDD与VSS电压VSS之间的电压。
HVDD电压HVDD可以输入至第j个正输出缓冲器PBj的第二参考电压端子(RV2)，并且因此可以作为能够由第j个正输出缓冲器PBj输出的最小电压被输入。此外，HVDD电压HVDD可以输入至第j个负输出缓冲器NBj的第一参考电压端子(RV1)，并且因此可以作为能够由第j个负输出缓冲器NBj输出的最大电压被输入。因此，HVDD电压HVDD应该被设计作为用于满足正数据电压的最小值和负数据电压的最大值二者的电压。亦即，HVDD电压HVDD可以被设计作为正数据电压的最小值与负数据电压的最大值之间的电压。例如，VDD电压可以是20V，HVDD电压可以是10V，VSS电压可以是0V。此外，HVDD电压可以与公共电压基本相同。
第j个多路复用器MUXj可以接收从第j个正输出缓冲器PBj输出的第j个正数据电压和从第j个负输出缓冲器NBj输出的第j个负数据电压。此外，第j个多路复用器MUXj可以接收极性控制信号POL。第j个多路复用器MUXj可以根据极性控制信号POL从第j个正数据电压和第j个负数据电压中选择一个数据电压并且可以将选择的一个数据电压输出至第j条数据线Dj。例如，当输入具有第一逻辑电平电压的极性控制信号POL时，第j个多路复用器MUXj可以选择第j个正数据电压，以将第j个正数据电压输出至第j条数据线Dj，并且当输入具有第二逻辑电平电压的极性控制信号POL时，第j个复用器MUXj可以选择第j个负数据电压，以将第j个负数据电压输出至第j条数据线Dj。
如上所述，源极驱动器IC 21中的每一个的输出缓冲器124可以被供给来自供电单元40的第一VDD电压VDD1或第二VDD电压VDD2、HVDD电压HVDD和VSS电压VSS。特别地，对大屏幕显示装置的需求正在增加，并且在大屏幕显示装置中，由于作为源极驱动器IC 21的驱动电压的VDD电压，消耗电流显著增大。因此，根据本公开的实施方式的供电单元40可以包括多个VDD电压发生器，例如第一VDD电压发生器和第二VDD电压发生器。在这种情况下，第一VDD电压发生器可以将第一VDD电压VDD1供给至源极驱动器IC 21中的一些，并且第二VDD电压发生器可以将第二VDD电压VDD2供给至另一些源极驱动器IC 21，从而稳定地将VDD电压供给至所有源极驱动器IC 21。在下文中，将参照图7详细描述根据本公开的实施方式的供电单元40。
图7是详细示出图2的供电单元的示例的框图。参照图7，供电单元40可以包括第一VDD电压发生器110、第二VDD电压发生器120、二极管电路130和电力管理器140。
第一VDD电压发生器110可以被供给来自外部的电力Vin，并且当输入电力Vin时，第一VDD电压发生器110可以生成第一VDD电压VDD1并且可以将第一VDD电压VDD1输出至第一VDD电压线VDDL1。第一VDD电压VDD1可以通过控制电路板80、柔性电路板90、源极电路板70和源极柔性膜60被供给至源极驱动器IC 21中的一些。第一VDD电压发生器110可以被实现为升压IC。
第二VDD电压发生器120可以被供给来自外部的电力Vin，并且当输入电力Vin时，第二VDD电压发生器120可以生成第二VDD电压VDD2并且可以将第二VDD电压VDD2输出至第二VDD电压线VDDL2。第二VDD电压VDD2可以通过控制电路板80、柔性电路板90、源极电路板70和源极柔性膜60被供给至其他源极驱动器IC 21。第二VDD电压发生器120可以被实现为升压IC。
二极管电路130可以包括一个或更多个二极管Dio。一个或更多个二极管Dio可以各自配置有通用二极管、肖特基势垒二极管或其组合。在下文中，为了便于描述，将描述二极管电路130包括p(其中p是整数，文字等于或大于2)个二极管Dio的示例。然而，如上所述，二极管电路130还可以仅包括一个二极管，即p等于1。
P个二极管Dio可以如图7所示彼此串联连接。p个二极管Dio的阳极电极可以电连接至第一VDD电压线VDDL1，并且阴极电极可以电连接至第二VDD电压线VDDL2。因此，在p个二极管Dio中的每一个的阈值电压为“Vth”的情况下，如果第一VDD电压线VDDL1的第一VDD电压VDD1与第二VDD电压线VDDL2的第二VDD电压VDD2之间的差大于“p×Vth”时，电流可以从第一VDD电压线VDDL1流向第二VDD电压线VDDL2。
电力管理器140可以包括HVDD电压发生器141、短路检测器142和电压输出控制器143。
HVDD电压发生器141可以连接至第一VDD电压线VDDL1并且可以被供给有第一VDD电压发生器110的第一VDD电压VDD1。HVDD电压发生器141可以使用第一VDD电压VDD1生成HVDD电压HVDD并且可以将HVDD电压HVDD输出至HVDD电压线HVDDL。HVDD电压HVDD可以通过控制电路板80、柔性电路板90、源极电路板70和源极柔性膜60供给至源极驱动器IC 21中的每一个。HVDD电压发生器141可以利用降压转换器来实现。
短路检测器142可以连接至第一VDD电压线VDDL1并且可以被供给有第一VDD电压发生器110的第一VDD电压VDD1。短路检测器142可以监测第一VDD电压VDD1是否降低到阈值电压或更低。当第一VDD电压VDD1降低到阈值电压或更低时，短路检测器142可以确定第一VDD电压VDD1或间接地(下面将说明)第二VDD电压VDD2接地短路。当第一VDD电压发生器110的第一VDD电压VDD1降低到阈值电压电平或更低时，短路检测器142可以输出具有第一逻辑电平电压的短路检测信号SIS，并且如果第一VDD电压发生器110的第一VDD电压VDD1未降低到阈值电压电平或更低，则短路检测器142可以输出具有第二逻辑电平电压的短路检测信号SIS。阈值电压电平可以是与接地电压的电平基本相同的电平或者可以是接地电压与第一VDD电压VDD1之间的电压电平。
当短路检测器142检测到第一VDD电压VDD1或第二VDD电压VDD2的短路时，电压输出控制器143可以控制第一VDD电压发生器110和第二VDD电压发生器120不输出第一VDD电压VDD1或第二VDD电压VDD2。此外，当短路检测器142检测到第一VDD电压VDD1或第二VDD电压VDD2的短路时，电压输出控制器143可以控制电力管理器140的电压发生器以及第一VDD电压发生器110和第二VDD电压发生器120，以便不输出电压。
例如，当电压输出控制器143从短路检测器142接收到具有第一逻辑电平电压的短路检测信号SIS时，电压输出控制器143可以输出具有第二逻辑电平电压的电压输出控制信号OCS。此外，当电压输出控制器143从短路检测器142接收到具有第二逻辑电平电压的短路检测信号SIS时，电压输出控制器143可以输出具有第一逻辑电平电压的电压输出控制信号OCS。在这种情况下，当第一VDD电压发生器110和第二VDD电压发生器120接收到具有第二逻辑电平电压的电压输出控制信号OCS时，第一VDD电压发生器110和第二VDD电压发生器120可以不输出第一VDD电压VDD1和第二VDD电压VDD2，并且当第一VDD电压发生器110和第二VDD电压发生器120接收到具有第一逻辑电平电压的电压输出控制信号OCS时，第一VDD电压发生器110和第二VDD电压发生器120可以输出第一VDD电压VDD1和第二VDD电压VDD2。
在图7中，为了便于描述，示出了电力管理器140包括HVDD电压发生器141、短路检测器142和电压输出控制器143的示例。然而，除了HVDD电压发生器141、短路检测器142和电压输出控制器143之外，电力管理器140还可以包括生成栅极高电压VGH的栅极高电压发生器、生成栅极低电压VGL的栅极低电压发生器以及生成VCC电压的VCC电压发生器。电力管理器140可以利用电力管理IC来实现。
而且，在图7中，短路检测器142和电压输出控制器143各自被示出为单独的块，但短路检测器142可以包括在电压输出控制器143中。
而且，在图7中，第一VDD电压发生器110和第二VDD电压发生器120各自被示出为被设计为单独的IC而没有被内置在电力管理器140中，但二者不限于此。在其他实施方式中，第一VDD电压发生器110和第二VDD电压发生器120中的一个可以内置在电力管理器140中。
图8A和图8B分别是示出现有技术以及本公开的实施方式中的供电单元的第一VDD电压、第二VDD电压和HVDD电压的升高顺序的波形图。
在现有技术中，没有提供连接在第一VDD电压线VDDL1与第二VDD电压线VDDL2之间的二极管电路130。因此，在现有技术中，如图8A所示，当输入电力时，由于第一VDD电压发生器110的VDD电压升高时间与第二VDD电压发生器120的VDD电压升高时间之间的差异，VDD电压可以比HVDD电压稍后供给至源极驱动器IC 21。例如，如图7所示，在从第一VDD电压VDD1生成HVDD电压HVDD的情况下，如果第二VDD电压VDD2的升高时间比第一VDD电压VDD1的升高时间慢，则如图8A所示，第一VDD电压VDD1升高，HVDD电压HVDD随后升高，并且然后第二VDD电压VDD2升高。在这种情况下，源极驱动器IC 21中的一些被供给有HVDD电压HVDD，并且然后被供给有第二VDD电压VDD2。亦即，在源极驱动器IC 21中的一些中可能会发生VDD电压与HVDD电压之间的供给颠倒，并且由于VDD电压与HVDD电压之间的供给颠倒，源极驱动器IC21可能被损坏。
另一方面，在本公开的实施方式中，提供连接在第一VDD电压线VDDL1与第二VDD电压线VDDL2之间的二极管电路130。因此，在本公开的实施方式中，如图8B所示，当输入电力时，尽管在第一VDD电压发生器110的VDD电压升高时间与第二VDD电压发生器120的VDD电压升高时间之间出现差异，但第二VDD电压线VDDL2通过二极管电路130使用“VDD1-(p×Vth)”进行充电。因此，即使当第二VDD电压VDD2的升高时间0至t1比第一VDD电压VDD1的升高时间慢时，如图8B所示，第一VDD电压VDD1升高，第二VDD电压VDD2随后升高，然后HVDD电压HVDD升高。在这种情况下，不会发生供给至源极驱动器IC 21的VDD电压与HVDD电压之间的供给颠倒。因此，防止源极驱动器IC 21由于VDD电压与HVDD电压之间的供给颠倒而损坏。
同时，第一VDD电压VDD1、第二VDD电压VDD2和HVDD电压HVDD可以在第二时刻t2之后达到这些电压中的每一个的最大电压，以便限制可能在启动时使元件退化的浪涌电流。
图9A和图9B分别是示出在现有技术以及本公开的实施方式中当第一VDD电压线接地短路时的第一VDD电压、第二VDD电压和HVDD电压的波形图。
在现有技术中，即使当第一VDD电压线VDDL1接地短路时，也不执行控制，以使第一VDD电压生成器110和第二VDD电压发生器120不输出第一VDD电压VDD1和第二VDD电压VDD2。因此，在现有技术中，如图9A所示，即使当第一VDD电压线VDDL1接地短路时，第二VDD电压发生器120仍与先前一样输出第二VDD电压VDD2，并且因此第二VDD电压线VDDL2将第二VDD电压VDD2保持成与先前一样。因此，在现有技术中，当第一VDD电压线VDDL1接地短路时，第一VDD电压VDD1和第二VDD电压VDD2以不同的电平供给至源极驱动器IC 21，从而显示面板10显示异常图像。
另一方面，在本公开的实施方式中，当第一VDD电压线VDDL1接地短路时，如图9B所示，执行控制，以使第一VDD电压发生器110和第二VDD电压发生器120不输出第一VDD电压VDD1和第二VDD电压VDD2。因此，在本公开的实施方式中，当第一VDD电压线VDDL1接地短路时，第二VDD电压发生器120不输出第二VDD电压VDD2。亦即，在本公开的实施方式中，当第一VDD电压线VDDL1接地短路时，电力管理器140感测到短路，并且因此，执行控制，以使第一VDD电压VDD1和第二VDD电压VDD2不被供给至源极驱动器IC 21。因此，在本公开的实施方式中，当第一VDD电压线VDDL1接地短路时，以相同的接地电平供给第一VDD电压VDD1和第二VDD电压VDD2，从而防止显示面板10显示异常图像。
图10A和图10B分别是示出在现有技术以及本公开的实施方式中当第二VDD电压线接地短路时的第一VDD电压、第二VDD电压和HVDD电压的波形图。
在现有技术中，不提供连接在第一VDD电压线VDDL1与第二VDD电压线VDDL2之间的二极管电路130。此外，在现有技术中，即使当第二VDD电压线VDDL2接地短路时，如图10A所示，也不执行控制，以使第一VDD电压发生器110和第二VDD电压发生器120不输出第一VDD电压VDD1和第二VDD电压VDD2。因此，在现有技术中，即使当第二VDD电压线VDDL2接地短路时，第一VDD电压生成器110仍与先前一样输出第一VDD电压VDD1。因此，在现有技术中，当第二VDD电压线VDDL2接地短路时，第一VDD电压VDD1和第二VDD电压VDD2以不同的电平被供给至源极驱动器IC 21，因此，显示面板10显示异常图像。
另一方面，在本公开的实施方式中，提供连接在第一VDD电压线VDDL1与第二VDD电压线VDDL2之间的二极管电路130。此外，在本公开的实施方式中，当第二VDD电压线VDDL2接地短路时，如图10B所示，执行控制，以使第一VDD电压发生器110和第二VDD电压发生器120不输出第一VDD电压VDD1和第二VDD电压VDD2。具体地，在本公开的实施方式中，第一VDD电压线VDDL1的第一VDD电压VDD1经由二极管电路130通过第二VDD电压线VDDL2对地放电。此外，在本公开的实施方式中，由于第一VDD电压线VDDL1的第一VDD电压VDD1降低到阈值电压或更低，所以电力管理器140感测到短路，并且因此，执行控制以使第一VDD电压VDD1和第二VDD电压VDD1VDD2不被供给至源极驱动器IC 21。由于二极管电路130中包括多个二极管Dio，所以在第一VDD电压VDD1与第二VDD电压VDD2之间出现差“p×Vth”。因此，在本公开的实施方式中，当第二VDD电压线VDDL2接地短路时，以接地电压电平供给第二VDD电压VDD2，并且以与接地电压相似的电平供给第一VDD电压VDD1，从而防止显示面板10显示异常画面。
同时，与第二VDD电压线VDDL2接地短路无关，会存在用于对第一VDD电压线的电容器进行充电的电流，因此第一VDD电压VDD1会由于该电流而稍微升高。由于第二VDD电压线VDDL2接地短路，所以可以经由二极管电路130将第一VDD电压线的升高的电压放电到第二VDD电压线中。当第一VDD电压线的升高的电压比二极管电路103的“p×Vth”高时，在图10B中，第一VDD电压VDD1可以比第二VDD电压VDD2和HVDD电压HVDD高多达“p×Vth”。
如上所述，根据本公开的实施方式，供电单元可以包括连接在第一VDD电压线与第二VDD电压线之间的二极管电路。因此，在本公开的实施方式中，即使当第二VDD电压的升高时间比第一VDD电压的升高时间慢时，第二VDD电压仍可以在第一VDD电压升高之后升高，然后，HVDD电压可以升高。因此，在本公开的实施方式中，由于不会发生VDD电压与HVDD电压之间的供给颠倒，所以可以防止源极驱动器IC由于VDD电压与HVDD电压之间的供给颠倒而损坏。
此外，根据本公开的实施方式，当第一VDD电压线接地短路时，可以控制第一VDD电压发生器和第二VDD电压发生器不输出第一VDD电压和第二VDD电压。因此，在本公开的实施方式中，当第一VDD电压线接地短路时，可以控制第一VDD电压和第二VDD电压，以便不被供给至源极驱动器IC。因此，在本公开的实施方式中，当第一VDD电压线接地短路时，可以以相同的接地电平供给第一VDD电压和第二VDD电压，从而防止显示面板显示异常画面。
此外，根据本公开的实施方式，供电单元可以包括连接在第一VDD电压线与第二VDD电压线之间的二极管电路，并且当第二VDD电压线接地短路时，可以控制第一VDD电压发生器和第二VDD电压发生器不输出第一VDD电压和第二VDD电压。具体地，在本公开的实施方式中，当第二VDD电压线接地短路时，第一VDD电压线的第一VDD电压可以经由二极管电路通过第二VDD电压线放电到地。在这种情况下，第一VDD电压线的第一VDD电压降低到阈值电压或更低，并且因此在本公开的实施方式中，通过感测短路，可以控制第一VDD电压和第二VDD电压以便不被供给至源极驱动器IC。因此，在本公开的实施方式中，当第二VDD电压线接地短路时，可以以接地电压电平供给第二VDD电压，并且可以以与接地电压类似的电平来供给第一VDD电压，从而防止显示面板显示异常画面。
对于本领域技术人员显而易见的是，在不脱离本公开的范围的情况下，可以对本公开进行各种修改和变化。因此，本公开旨在涵盖本公开的修改和变化，只要所述修改和变化在所附权利要求及其等同物的范围内。

Claims (10)

1.一种用于显示装置的供电单元(40)，包括：
第一VDD电压发生器(110)，其用于产生第一VDD电压(VDD1)；
第一VDD电压线(VDDL1)，其连接至所述第一VDD电压发生器(110)，以用于将所述第一VDD电压(VDD1)供给至显示面板(10)的多个第一源极驱动器集成电路(21)；
第二VDD电压发生器(120)，其用于产生第二VDD电压(VDD2)；
第二VDD电压线(VDDL2)，其连接至所述第二VDD电压发生器(120)，以用于将所述第二VDD电压(VDD2)供给至所述显示面板(10)的多个第二源极驱动器集成电路(21)；以及
二极管电路(130)，其包括p个二极管(Dio)，p为等于或大于1的整数，所述二极管电路(130)连接在所述第一VDD电压线(VDDL1)与所述第二VDD电压线(VDDL2)之间，并且被配置成如果所述第一VDD电压线(VDDL1)的所述第一VDD电压(VDD1)与所述第二VDD电压线(VDDL2)的所述第二VDD电压(VDD2)之间的差大于预定电压，则允许电流从所述第一VDD电压线(VDDL1)流向所述第二VDD电压线(VDDL2)。
2.根据权利要求1所述的供电单元(40)，还包括：
HVDD电压发生器(141)，其用于产生HVDD电压；以及
HVDD电压线(HVDDL)，其连接至所述HVDD电压发生器(141)，以用于将低于所述第一VDD电压(VDD1)的所述HVDD电压(HVDD)供给至所述显示面板(10)的所述多个第一源极驱动器集成电路(21)和所述多个第二源极驱动器集成电路(21)。
3.根据权利要求2所述的供电单元(40)，其中，所述HVDD电压发生器(141)连接至所述第一VDD电压线(VDDL1)，并且被配置成使用所述第一VDD电压(VDD1)产生HVDD电压。
4.根据前述权利要求中任一项所述的供电单元(40)，其中，所述二极管电路(130)包括彼此串联连接的至少两个二极管(Dio)，p≥2。
5.根据权利要求1至3中任一项所述的供电单元(40)，其中，所述二极管(Dio)的阳极电极电连接至所述第一VDD电压线(VDDL1)，并且所述二极管(Dio)的阴极电极电连接至所述第二VDD电压线(VDDL2)。
6.根据权利要求1至3中任一项所述的供电单元(40)，还包括：
短路检测器(142)，其连接至所述第一VDD电压线(VDDL1)，并且被配置成输出指示所述第一VDD电压(VDD1)的电压电平是否小于预定电压电平的短路检测信号(SIS)；以及
电压输出控制器(143)，其被配置成基于所述短路检测信号(SIS)来控制所述第一VDD电压发生器(110)和所述第二VDD电压发生器(120)。
7.根据权利要求6所述的供电单元(40)，其中，如果所述第一VDD电压(VDD1)的电压电平小于所述预定电压电平，则所述第一VDD电压发生器(110)和所述第二VDD电压发生器(120)被控制为不输出所述第一VDD电压(VDD1)和所述第二VDD电压(VDD2)。
8.一种显示装置，包括：
显示面板(10)，其包括彼此交叉以用于限定多个像素(P)的多条栅极线(G1至Gn)和多条数据线(D1至Dm)；
根据前述权利要求中任一项所述的供电单元(40)；以及
数据驱动器(20)，其包括所述多个第一源极驱动器集成电路(21)和所述第二源极驱动器集成电路(21)，所述多个第一源极驱动器集成电路(21)和所述多个第二源极驱动器集成电路(21)被配置成向所述多条数据线(D1至Dm)输出数据电压。
9.根据权利要求8所述的显示装置，其中，所述多个第一源极驱动器集成电路(21)和所述多个第二源极驱动器集成电路(21)被配置成从所述供电单元(40)接收所述第一VDD电压(VDD1)和所述第二VDD电压(VDD2)中的一个以及HVDD电压(HVDD)。
10.根据权利要求9所述的显示装置，其中，所述多个第一源极驱动器集成电路(21)和所述多个第二源极驱动器集成电路(21)分别包括输出缓冲器(124)，所述输出缓冲器(124)包括用于输出正数据电压(PDV)的至少一个正输出缓冲器(PB)以及用于输出负数据电压(NDV)的至少一个负输出缓冲器(NB)，其中，所述第一VDD电压(VDD1)和所述第二VDD电压(VDD2)中的一个被输入至所述正输出缓冲器(PB)的第一参考电压端子(RV1)，并且所述HVDD电压(HVDD)被输入至所述正输出缓冲器(PB)的第二参考电压端子(RV2)。
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