CN107404384B - 用于通过至少一个导线对供应电力和差分数据的系统 - Google Patents

用于通过至少一个导线对供应电力和差分数据的系统 Download PDF

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Abstract

本发明涉及一种在PoE或PoDL系统的电源接口处的维持功率签名控制器。本发明涉及其中通过PSE例如通过差分数据导线对将DC电力供应到PD的系统。IEEE标准需要从所述PD汲取最小电流以便使所述PSE继续供应所述DC电压。如果所述PD处于低功率模式，那么所述PSE将正常地停止供应所述DC电压，此接着需要新的检测及分级程序来再次通电。为避免此情形，一种“维持功率签名”控制器通过在所述PD输入与所述PD的全桥式整流器之间连接的电流源提供周期性电流脉冲。在所述PD处于其低功率模式时反向偏置所述全桥式整流器的所述DC电压中的任何下降不会影响所述电流脉冲，使得所述PSE继续供应所述DC电压。

Description

用于通过至少一个导线对供应电力和差分数据的系统
相关申请案的交叉参考
此申请案要求迈克尔保罗等人在2016年5月19日申请的美国临时申请案第62/338,963号的优先权。
技术领域
本发明涉及系统，其中DC电压和差分数据通过相同电缆发射到用电装置(PD)负载，诸如在以太网供电(PoE)或数据线供电(PoDL)系统中。本发明更具体地涉及满足此类系统中的IEEE需求：通过供电设备(PSE)检测最小PD负载电流以便使PSE继续经由电缆将DC电压供应到PD负载。
背景技术
在PoE系统中，在载送差分以太网数据的相同导线对上通过PSE供应DC电压。或者，可在CAT-5以太网电缆中通过备用导线对发射DC电压，而在相同CAT-5电缆中通过数据导线对发射差分数据。类似地，在PoDL系统中，仅使用一个导线对，且通过相同导线对发射DC电压和差分数据。PSE和PD两者都具有分离出通过所述导线发射的AC(数据)和DC电压信号的电路(例如，变压器、感应器、电容器)。DC电压为所有PD组件供电，且通过物理层组件(PHY)处理所述数据。各种标准在IEEE 802.3中阐述且为人熟知。
在全DC电压通过PSE耦合到(诸)导线对之前，IEEE标准需要低功率握手程序。此握手程序可包含签名电阻测试来确定PD是否在其输入处呈现约25kOhms，表示其是PoE兼容的。如果这样，那么可接着执行低功率分级测试来识别PD的电力需求。如果握手程序传达PD与接收DC电压兼容且PSE可供应所需电力，那么PSE供应DC电压到所述导线以为PD完全供电。DC可为(例如)约44伏特，但是取决于系统，其它电压可为适当的。
每当通电所述系统时，必须在已经使用非PoE或非PoDL系统替换PD的情况下执行握手程序。
IEEE也指定最小负载电流(“维持功率签名”)，其必须通过PSE检测以便使PSE继续供应全DC电压到PD。如果PD负载电流下降低于最小阈值电流，那么PSE假定PD已经断开且终止DC电压。也可需要PD呈现跨导线的特定最小电容(其在正常操作期间通过PSE周期性感测)以便使PSE继续供应DC电压。
即使PD保持连接但进入低功率睡眠模式，导致最小电流电平不被满足，PSE停止DC电压且必须在再次供应DC电压之前执行新的握手程序。在一些应用中，通电时间可为显著的，尤其在PD可操作之前需要充电PD中的大电容器时。
为确保供应正确极性的DC电压到PD负载，IEEE标准需要PD输入与PD负载之间的全桥式整流器。平滑电容器通常跨整流器的输出连接以使DC电压平滑。即使PD在所需周期内产生高于“维持功率签名”(MPS)电平的电流脉冲，所述电流仍将必须通过所述全桥式整流器。在PD负载进入低功率模式且平滑电容器完全充电(此普遍发生)的情况下，输入DC电压的任何下降低于电容器电压将使全桥式整流器经反向偏置。因此，整流器将阻挡任何PD电流脉冲。此将使PSE丢失电流脉冲且切断DC电压。
因此，需要PoE或PoDL类型的系统，其中如果PD进入低功率模式且存在输入DC电压下降(反向偏置全桥式整流器)，那么PD可仍供应高于MPS阈值电流的电流脉冲使得PSE不终止DC电压。此将容许当PD将要进入其完全操作模式时更快速地启动PD。
发明内容
替代依赖于PD负载其自身来将所需最小电流负载呈现给PSE(通过IEEE 802.3标准指定)以便使PSE继续在(数个)导线对上供应DC电压，将新颖的“维持功率签名”(MPS)控制器连接到恰在DC解耦组件(变压器或感应器)的下游的PD的输入端口以用于呈现所述最小电流。所述MPS控制器经连接到所述全桥式整流器的上游，使得所述整流器的任何反向偏置(诸如归因于所述DC电压下降)不影响所述MPS控制器的性能。这样，即使存在反向偏置所述整流器的DC电压下降，所述PD负载仍可在所述PSE停止所述DC电压的情况下进入低电流模式。因此，当所述PD欲从其低功率模式进入其完全操作模式时将不存在延迟。
所述低功率模式可为其中仅通过所述PSE电压供电所述PD的PHY(使得可传达数据)的模式。此电流汲取可在100微安的数量级上，其远低于要求通过所述PSE感测到以便继续供应所述DC电压的所述MPS电流。
虽然MPS的IEEE标准随时间改变以适配不断改进的系统，但是一个当前MPS标准是10mA的PD最小电流在317ms的各周期内存在达至少7ms，其中所述PSE持续地监控通过所述PD汲取的所述电流。在一个实施例中，所述新颖MPS控制器包含产生至少所述最小电流的电流源，且跨所述导线对间歇地施加此低电流以满足所述IEEE MPS标准。因此，即使所述PD负载其自身在最小功率状态中完全不汲取电流，所述PSE仍继续供应所述DC电压，且所述DC电压下降低于所述全桥式整流器下游的电容器电压。
在一个实施例中，即使所述PD负载其自身正汲取高于所述MPS最小电流标准的电流，所述MPS控制器仍始终在作用中。在另一实施例中，为改善效率，如果所述PD负载汲取高于所述MPS最小电流标准的电流，那么所述MPS控制器不作用。
在一个实施例中，所述MPS控制器电流源通过跨所述全桥式整流器的输入耦合所述电流源而绕过所述全桥式整流器。在另一实施例中，所述MPS控制器电流源具有直接连接到所述全桥式整流器的输入的一个端子且通过一或多个整流元件(诸如在有源电桥中的二极管或MOSFET)汲取或返回电流。也可调整所述电流源以用于具有不同需求的不同系统中。
在一个实施例中，感测元件检测通过所述PD负载汲取的所述电流且取决于是否需要所述MPS控制器来供应所述最小电流而启用或停用所述MPS控制器。所述感测元件可为所述全桥式整流器中之MOSFET或串联感测电阻器，其中跨所述MOSFET或感测电阻器的所述电压降与所述PD负载电流成比例。
由于在所述全桥式整流器之前插入所述MPS控制器电流源，所以额外整流器可用于所述MPS控制器中来确保通过电流源的电流的正确方向。
所述MPS控制器电流也可包含有源全桥式整流器的控制器，这是由于其已经检测所述PD输入处的输入DC电压的极性。
所述MPS控制器可与所述有源整流器控制器分享信息以避免冗余。例如，所述有源整流器控制器可检测所述输入DC电压的所述极性且告知所述MPS控制器从哪个导线对汲取电流和将电流返回到哪个导线对。所述MPS控制器可告知所述有源整流器控制器停止有源工作(即，停止控制所述整流MOSFET)且当确定所述PD处于低功率模式时使用所述MOSFET内部二极管来降低功率消耗。接着，所述MPS控制器供应所述低电流脉冲到所述导线对以使所述PSE继续供应电力。
PD控制器执行各种其它功能，诸如执行握手程序和关闭开关以将所述DC电压耦合到所述PD负载(或DC/DC转换器)。所述全桥式整流器、所述MPS控制器和所述PD控制器可经形成为单芯片，使得不存在通过将所述MPS控制器添加到所述系统而增大的费用或复杂度。
所述MPS控制器概念可适用于PoE(两个或多于两个导线对)或PoDL(单导线对)。
揭示其它实施例。
附图说明
图1图示说明根据本发明的一个实施例的PoE系统，其中通过PSE经由两组导线对供应DC电压到PD，且其中MPS控制器在PD中连接在DC解耦变压器与全桥式整流器之间。
图2图示说明图1的MPS控制器的更多细节。
图3图示说明可为用于图2的MPS控制器中的电流源的传统电压控制电流源。
图4图示说明具有全桥式整流器(独立于图1的全桥式整流器)的MPS控制器的实施例来在不考虑来自PSE的DC电压的极性的情况下确保电流源经正确连接到导线对。
图5类似于图4但图示说明单电流源如何可用于通过数据对和备用对汲取最小电流。
图6图示说明由于MPS控制器经耦合至输入DC电压且必须首先确定极性以便正确地施加电流源跨导线对，MPS控制器如何也可控制有源全桥式整流器中的MOSFET。
图7图示说明MPS控制器电流源如何完全绕过图1中的全桥式整流器。
图8图示说明MPS控制器电流源可如何通过全桥式整流器中的正向偏置整流器的一者汲取电流同时仍达成其全部优点。
图9图示说明MPS控制器电流源可如何通过全桥式整流器中的正向偏置整流器的一者返回电流同时仍达成其全部优点。
图10图示说明用于呈现正确极性DC电压到PD负载的有源全桥式整流器，其中感测到PD负载电流，且如果负载电流下降低于阈值，那么启用MPS控制器电流源。
图11图示说明实施例，其中MPS控制器包含有源全桥式整流器控制器，其中流器控制器检测输入DC电压的极性及PD负载电流的量值以：1)允许MPS控制器电流源正确地连接到导线对；2)允许有源整流器在低功率模式中关闭以节省电力；及3)允许MPS控制器电流源仅在PD的低功率模式中启用以节省电力。
在各种附图中相同或等效的元件使用相同符号标记。
具体实施方式
虽然在使用CAT-5电缆中的数据导线对和备用导线对两者来引导DC电压的PoE系统内描述MPS控制器，但是MPS控制器可用于仅通过数据导线对(以及差分以太网数据)或仅通过备用导线对(通常不引导差分数据)引导DC电压的PoE系统中。另外，MPS控制器可用于仅使用单导线对来引导DC电压和差分数据两者的PoDL系统中。
在图1中，传统PSE 12跨两组扭绞数据导线对14和16供应DC电压(诸如44伏特)作为共模电压。为了适应使用负电压和零伏特的传统电话设备，PSE 12可在一个数据导线对上供应0伏特且在另一数据对上供应-44伏特。DC电压可通常高达57伏特。在其它系统中，电压可为很低的，诸如8伏特。数据导线对14也可载送差分发射数据，且数据导线对16也可载送差分接收数据来降低冲突。
为了供应更多电力到PD 18且最小化沿着导线的电压降，可跨两组扭绞备用导线对20及22施加相同DC电压。备用导线对20及22可或可不载送差分数据。
四个导线对终接在PD连接器24，其通常为CAT-5电缆的结尾处的RJ-45插头的插口。
中间抽头变压器26解耦共模DC电压与差分数据。差分数据接着经施加到PD 18中的传统PHY(未展示)以处理所述差分数据。取决于应用，PHY可或可不连接到备用导线对20及22。系统的数据处理方面与本发明无关且可为传统的。
虽然导线对上的DC电压可为任一极性，但是图1通过将电压识别为0伏特或-44伏特而识别所述极性的一实例。电压量值为任意的。
MPS控制器32展示为连接到四个变压器26的中心抽头以绕过全桥式整流器34和36，全桥式整流器34和36为PD负载38整流输入DC电压。MPS控制器32包含计时器和电流源(稍后描述)来通过导线对汲取且返回超过PSE 12需求的最小电流的电流以便使PSE 12继续供应DC电流。此最小电流的IEEE标准正不断改进，但是我们将假定在317ms的各周期内的10mA的最小电流达至少7ms，其中PSE 12持续地监控通过PD18汲取的电流。计时器供应所需脉冲到电流源以超过最小所需电流和“接通”时间，使得即使PD 18进入低功率模式，PSE 12仍持续供应DC电压。
PD 18可向PSE 12呈现至少最小电容和/或签名电阻，使得PSE 12可确保即使PD负载38实质上不汲取电力，PD 18仍处于物理连接。
PSE 12最初仅在通过传统低功率检测和分级程序(握手程序)确定PD是兼容PoE的时供应DC电压到导线对。MPS控制器32不影响握手程序。检测签名可为通过PD控制器40跨全桥式整流器34及36的输出呈现的25kOhm电阻器。PD控制器40也执行分级程序以至少识别PD18的功率需求。一旦PSE 12供应全DC电压，PD控制器40便检测到电压高于阈值且接着关闭开关S1以将全电压耦合到PD负载38。PD负载38可含有用于将输入DC电压转换为其各种组件的操作电压的DC/DC转换器。平滑电容器C1使经整流电压平滑且将被充电到全DC电压。
如果PD负载38处于低功率模式，那么PD负载38不会从电容器C1汲取大量电流，使得跨电容器C1的电压保持为高达一段时间。如果输入DC电压甚至下降少量，那么整流器34及36将经反向偏置。如果MPS控制器32在整流器34/36与PD负载38之间耦合，那么MPS控制器电流源将接着仅从电容器C1而非从PSE 12汲取电流。因此，PSE 12将检测不到经汲取的电流且根据IEEE标准终止DC电压。因此，在PD负载38可重新开始正常操作之前将必须执行新的握手程序及电容器充电。此可添加显著延迟。
在本发明中，由于MPS控制器32中的电流源定位在全桥式整流器34及36的上游，那么归因于DC电压下降的整流器的任何反向引导不会影响通过PSE 12检测通过MPS控制器32中的电流源汲取的电流。
虽然MPS控制器32中的电流源可汲取高于PSE 12保持供应DC电压所需的最小电流的任何量，但是在脉冲中供应电流是更具有能量效率的。图2图示说明MPS控制器32的实例，其中计时器44供应周期性脉冲到一对电压控制电流源46及48以至少提供通过PSE 12检测所需要的最小电流。在一个实施例中，计时器脉冲具有大于7ms的宽度和不超过250ms的周期来满足IEEE最小电流需求。所述脉冲的量值是使得电压控制电流源46及48各汲取至少10mA来满足IEEE最小电流需求。虽然展示电压控制电流源，但所述电流源可替代地汲取固定电流，且计时器脉冲控制跨导线对连接电流源达所需时间的开关。
图3图示说明可被使用的传统电压控制电流源46。电压控制电流源46的操作为人熟知。运算放大器50供应足够电压到MOSFET的栅极Q1以使跨电阻器R1的电压降(与电流成比例)与运算放大器50的输入处的控制电压相等。
PSE 12可以两个极性的任一者施加DC电压到导线对。因此，MPS控制器电流源应能够从PSE 12汲取具有任一极性的电流。图4图示说明MPS控制器32内的数据导线对和备用导线对的全桥式整流器52和54。整流器中的二极管确保来自PSE 12的输入DC电压经正确整流使得电流源46及48在正确方向上汲取且返回电流。在整流器54内展示图示说明通过前向偏置二极管的电流的方向的箭头。整流器52和54独立于图1中的整流器34和36。
图5图示说明在所展示的配置中如何仅需要一个电流源48。在图5中，通过数据导线对(在0VDC)汲取电流且通过备用导线对(在-44VDC)返回电流。
图6图示说明全桥式整流器34和36如何可为传统有源整流器(使用MOSFET作为整流元件)且通过MPS控制器58控制对MOSFET的控制。由于MPS控制器58接收在其初始极性的DC电压，所以其可确定极性且控制整流器34和36的MOSFET以在PD负载38产生正确极性。有源整流器为人熟知且使用比较器来比较输入电压电位以确定极性。比较器的输出接着用于开启高边MOSFET的一者及低边MOSFET的一者以输出所需极性。此类比较器和栅极驱动器在MPS控制器58中。
图7是简化图示说明，其展示PSE电压源60经耦合到数据导线对14和16且MPS控制器中的电流源62如何仅连接到全桥式整流器(诸如图1的整流器34)的输入，其中二极管D1和D2表示整流器34的前向偏置二极管。
图8图示说明图7的变体，其中电流源62的高边端子经连接到整流器34的一个前向偏置二极管输出且电流源62的低边端子经连接到整流器34的一个前向偏置二极管输入。即使平滑电容器C1经完全充电且PD处于低功率模式，不管任何电压下降，仍保证通过电流源62的电流流动通过二极管D1。这是因为通过二极管D2阻止电流源62从电容器C1汲取电流。将通过电流源62前向偏置二极管D1。
图9类似于图8，但其中电流源62的低边端子经连接到整流器34的一个前向偏置二极管输出且电流源62的高边端子经连接到整流器34的一个前向偏置二极管输入。即使平滑电容器C1经完全充电且PD处于低功率模式，不管任何电压下降，仍保证通过电流源62的电流流动通过二极管D2。这是因为通过二极管D1阻止电流源62从电容器C1汲取电流。将通过电流源62前向偏置二极管D2。
图10图示说明可用作图6中的整流器34或36的有源全桥式整流器63。基于输入电压的极性切换MOSFET 64。有源整流器开关控制电路66含有比较输入电压电位的量值以检测极性且相应控制MOSFET 64以输出正确极性电压的比较器。此类控制电流为人熟知且是传统的。有源整流器可通过避免二极管的电压降改善效率。
如果有源全桥式整流用作图6中的整流器34，那么归因于栅极的电容，通过开启及关闭MOSFET栅极而通电。如果PD处于低功率模式，那么希望在可能时保存电力。在此情况中，希望保持所有MOSFET 64关闭且仅使用其体二极管来输出DC电压的正确极性。PD负载电流传感器68例如通过使用与PD负载串联的低值感测电阻器或跨“接通”的MOSFET 64的一者的电压降而检测PD负载电流。如果负载电流高于阈值(例如通过比较器测量的)，那么MPS控制器不需要供应最小电流。因此，当PD负载电流高于使PSE 12保持供应DC电压的阈值时，电流传感器68停用计时器44(图2)。当PD负载电流低于阈值时，传感器68使计时器44能够提供使PSE 12保持供应DC电压所需要的电流脉冲。
图11图示说明实施例，其中全桥式整流器63和70是使用MOSFET的有源整流器，且MPS控制器72包含有源全桥式整流器控制器74、计时器75、开关76到79和电流源84。整流器63及70的输出OUTP及OUTN经施加到PD负载。导线对14/16和20/22上的输入DC电压可具有任一极性。整流器控制器74不仅检测输入极性(使用传统比较器)且控制整流器MOSFET来从整流器63和70输出正确的极性，而且识别将通过计时器75切换以汲取电流通过的正确开关76到79。在所展示的配置中，电流源84必须使其高边端子连接到导线对14/16和20/22上的正电压。整流器控制器74识别哪些导线对载送正DC电压。电流源84的低边端子经连接到整流器63/70的低边输出，其为到PSE的返回路径，类似于图9中展示的连接。如果PD负载电流低于阈值电流(相对于图10描述)，那么启用计时器75且仅间隙地开启经连接到正电压导线对的开关76到79。同时，整流器控制器74可停用整流器63和70中的MOSFET来节省电力。因此，不需要在图4和5中展示的MPS控制器中的单独全桥式整流器。此改善效率且降低电流的大小。
虽然已经展示且描述本发明的特定实施例，但是所属领域的技术人员将了解，可在不脱离本发明及其更宽方面的情况下作出改变和修改，且因此，所附权利要求将所有此类改变和修改包含在其范围内。

Claims (15)

1.一种用于通过至少一个导线对供应电力和差分数据的系统，其中通过供电设备PSE经由所述至少一个导线对将DC电力供应到用电装置PD，所述系统包括：
所述PD中的第一DC解耦电路，其经耦合到所述至少一个导线对以用于将DC电压与所述至少一个导线对解耦；
所述PD中的第一全桥式整流器，其经耦合以从所述第一DC解耦电路接收所述DC电压且输出所述DC电压的预定极性；及
所述PD中的第一电流源，其具有在所述第一DC解耦电路与所述第一全桥式整流器之间耦合到所述至少一个导线对的至少第一端子，
其中所述PSE经配置以在通过所述PD汲取的电流低于第一阈值电流时在所述至少一个导线对上提供所述DC电压，且
其中即使在所述第一全桥式整流器下游的PD负载汲取低于所述第一阈值电流的电流，所述第一电流源仍经配置以从所述至少一个导线对汲取高于所述第一阈值电流的电流。
2.根据权利要求1所述的系统，其中所述第一电流源为耦合到计时器的电压控制电流源，其中所述计时器经配置以产生脉冲以用于控制从所述第一电流源输出的电流脉冲的量值。
3.根据权利要求1所述的系统，其中所述第一电流源经由通过计时器控制的开关耦合到所述至少一个导线对，其中所述计时器经配置以产生脉冲以用于控制所述开关以使所述第一电流源从所述至少一个导线对汲取电流脉冲。
4.根据权利要求1所述的系统，其中所述第一电流源的第二端子通过所述PD中的所述第一全桥式整流器耦合到所述至少一个导线对。
5.根据权利要求1所述的系统，其进一步包括：
电流传感器，其经配置以检测通过所述PD汲取的电流；及
所述第一电流源的控制器；
其中，当通过所述PD汲取的所述检测到的电流下降到预定电平以下时，所述控制器控制所述第一电流源以从所述至少一个导线对汲取高于所述第一阈值电流的电流。
6.根据权利要求1所述的系统，其进一步包括：
所述第一电流源的控制器；
所述控制器包括第二全桥式整流器，其经耦合到所述PD中的所述第一DC解耦电路以用于将所述第一电流源以正确的极性连接到所述至少一个导线对。
7.根据权利要求6所述的系统，其中所述第一全桥式整流器为有源全桥式整流器，且所述控制器经配置以从所述至少一个导线对检测所述DC电压的极性及控制所述有源全桥式整流器中的开关。
8.根据权利要求1所述的系统，其中所述至少一个导线对为单导线对。
9.根据权利要求1所述的系统，其中所述至少一个导线对包括两个导线对，其中第一导线对载送第一DC电位，且第二导线对载送第二DC电位，其中所述DC电压为所述第一DC电位与所述第二DC电位之间的差。
10.根据权利要求1所述的系统，其中所述至少一个导线对包括四个导线对，其中第一导线对载送第一DC电位，第二导线对载送第二DC电位，第三导线对载送所述第一DC电位，且第四导线对载送所述第二DC电位，其中所述DC电压为所述第一DC电位与所述第二DC电位之间的差，且其中所述第一电流源跨所述第一导线对及所述第二导线对耦合，所述系统进一步包括：
所述PD中的第二DC解耦电路，其经耦合到所述第三导线对及所述第四导线对以用于将所述DC电压与所述第三导线对及所述第四导线对解耦；
所述PD中的第二全桥式整流器，其经耦合以从所述第二DC解耦电路接收所述DC电压且输出所述DC电压的预定极性；及
所述PD中的第二电流源，其具有耦合到所述第二DC解耦电路及所述第二全桥式整流器的至少第一端子，
其中所述PSE经配置以在通过所述PD汲取的所述电流低于所述第一阈值电流时停止跨所述第三导线对及所述第四导线对提供所述DC电压，且
其中即使在所述第二全桥式整流器下游的PD负载汲取低于所述第一阈值电流的电流，所述第二电流源仍经配置以从所述第三导线对或所述第四导线对的一者汲取高于所述第一阈值电流的电流。
11.根据权利要求1所述的系统，其中所述至少一个导线对包括四个导线对，其中第一导线对载送第一DC电位，第二导线对载送第二DC电位，第三导线对载送所述第一DC电位，且第四导线对载送所述第二DC电位，其中所述DC电压为所述第一DC电位与所述第二DC电位之间的差，且其中所述第一电流源跨所述第一导线对及所述第二导线对耦合，所述系统进一步包括：
所述PD中的第二DC解耦电路，其经耦合到所述第三导线对及所述第四导线对以用于将所述DC电压与所述第三导线对及所述第四导线对解耦；及
所述PD中的第二全桥式整流器，其经耦合以从所述第二DC解耦电路接收所述DC电压且输出所述DC电压的预定极性；
其中所述PD中的所述第一电流源跨所述第一DC解耦电路及所述第二DC解耦电路以正确的极性耦合。
12.根据权利要求11所述的系统，其进一步包括第三全桥式整流器，其经耦合到所述第一DC解耦电路以用于将所述第一电流源以正确的极性连接到所述至少一个导线对。
13.根据权利要求12所述的系统，其中所述第三全桥式整流器包括二极管。
14.根据权利要求12所述的系统，其中所述第三全桥式整流器包括有源开关。
15.根据权利要求11所述的系统，其进一步包括第四全桥式整流器，其经耦合到所述第二DC解耦电路以用于将所述第一电流源以正确的极性连接到所述至少一个导线对。
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