CN106483400A - 移动终端逻辑分析仪 - Google Patents

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Abstract

一种移动终端逻辑分析仪，包括移动处理器信号接口，用于与移动终端的LP时钟接口及MIPI DSI接口连接；时序采集电路，与移动处理器信号接口的LP时钟接口及MIPI DSI接口连接，用于根据LP时钟接口的时钟信号采集来自MIPI DSI接口的待测试信号；时序采集电路包括数据接口与时钟接口；FIFO电路，用于根据时序采集电路发出的时钟信号缓存时序采集电路采集到的待测试信号；FIFO电路的数据接口与时序采集电路的数据接口连接、时钟接口与时序采集电路的时钟接口连接；嵌入式处理器，与FIFO电路连接，用于对来自FIFO电路中数据进行滤波去除干扰、然后对数据进行硬件实时解码并输出波形数据。本发明针对性强，被分析数据深度更大，能更直观的显示被分析的数据。

Description

移动终端逻辑分析仪
技术领域
本发明涉及逻辑分析仪领域，特别涉及一种移动终端逻辑分析仪。
背景技术
现有技术中的逻辑分析仪针对所有接口类，其利用僵尸时钟对待测试信号进行高速采样，对数据进行分析，输出波形数据，需再由上位机解码或人工解码。因此，整个逻辑分析仪的性能受到影响，例如被分析数据深度较小，中间处理过程效率低，难以适应对移动终端中的移动处理器进行分析的要求。
发明内容
本发明提供了一种移动终端逻辑分析仪，以解决现有技术中的逻辑分析仪数据深度较小、中间处理过程效率低、难以适应对移动终端中的移动处理器进行分析的要求的问题。
为解决上述问题，作为本发明的一个方面，提供了一种移动终端逻辑分析仪，包括：移动处理器信号接口，用于与移动终端的LP时钟接口及MIPI DSI接口连接，所述移动处理器信号接口包括LP时钟接口及MIPI DSI接口；时序采集电路，与所述移动处理器信号接口的LP时钟接口及MIPI DSI接口连接，用于根据所述LP时钟接口的时钟信号采集来自所述MIPI DSI接口的待测试信号；所述时序采集电路包括数据接口与时钟接口；FIFO电路，用于根据所述时序采集电路发出的时钟信号缓存所述时序采集电路采集到的所述待测试信号；所述FIFO电路的数据接口与所述时序采集电路的数据接口连接、时钟接口与所述时序采集电路的时钟接口连接；嵌入式处理器，与所述FIFO电路连接，用于对来自所述FIFO电路中数据进行滤波去除干扰、然后对数据进行硬件实时解码并输出波形数据；UART电路，与所述嵌入式处理器连接，所述嵌入式处理器将波形数据发送给UART电路；UART转USB电路，与所述UART电路连接，用于将来自UART电路的波形数据转换成符合USB协议的波形数据后发送给上位机。
优选地，所述时序采集电路、FIFO电路、嵌入式处理器和UART电路集成在FPGA中。
与同类产品相比，本发明针对性强，被分析数据深度更大，能更直观的显示被分析的数据。
附图说明
图1示意性地示出了本发明的结构示意图。
具体实施方式
以下结合附图对本发明的实施例进行详细说明，但是本发明可以由权利要求限定和覆盖的多种不同方式实施。
如图1所示，本发明提供了一种移动终端逻辑分析仪，包括：移动处理器信号接口，用于与移动终端的LP时钟接口及MIPI DSI接口连接，所述移动处理器信号接口包括LP时钟接口及MIPI DSI接口；时序采集电路，与所述移动处理器信号接口的LP时钟接口及MIPIDSI接口连接，用于根据所述LP时钟接口的时钟信号采集来自所述MIPI DSI接口的待测试信号；所述时序采集电路包括数据接口与时钟接口；FIFO电路，用于根据所述时序采集电路发出的时钟信号缓存所述时序采集电路采集到的所述待测试信号；所述FIFO电路的数据接口与所述时序采集电路的数据接口连接、时钟接口与所述时序采集电路的时钟接口连接；嵌入式处理器，与所述FIFO电路连接，用于对来自所述FIFO电路中数据进行滤波去除干扰、然后对数据进行硬件实时解码并输出波形数据；UART电路，与所述嵌入式处理器连接，所述嵌入式处理器将波形数据发送给UART电路；UART转USB电路，与所述UART电路连接，用于将来自UART电路的波形数据转换成符合USB协议的波形数据后发送给上位机。
由于采用了上述技术方案，本发明可直接提取MIPI DSI下的LP时钟进行数据分析(一般逻辑分析仪采用全局时钟采样)，因而提高了采样精度和数据处理的效率。采样数据实时解码后经由USB数据线传输给上位机，上位机安装好USB驱动，使用串口工具选好波特率即可接收数据。上位机软件可显示被分析数据，上位机显示被分析对象LP传输的每个数据包，数据包为常用的16进制数据。本发明针对MIPI DSI通过硬件实现实时解码并直接输出数据包数组，非常直观，数据可直接调用，因而方便了工程师调试分析数据。与同类产品相比，本发明针对性强(只针对MIPI接口)，被分析数据深度更大，能更直观的显示被分析的数据。
优选地，所述时序采集电路、FIFO电路、嵌入式处理器和UART电路集成在FPGA中。
以上所述仅为本发明的优选实施例而已，并不用于限制本发明，对于本领域的技术人员来说，本发明可以有各种更改和变化。凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (2)

1.一种移动终端逻辑分析仪，其特征在于，包括：
移动处理器信号接口，用于与移动终端的LP时钟接口及MIPI DSI接口连接，所述移动处理器信号接口包括LP时钟接口及MIPI DSI接口；
时序采集电路，与所述移动处理器信号接口的LP时钟接口及MIPI DSI接口连接，用于根据所述LP时钟接口的时钟信号采集来自所述MIPI DSI接口的待测试信号；所述时序采集电路包括数据接口与时钟接口；
FIFO电路，用于根据所述时序采集电路发出的时钟信号缓存所述时序采集电路采集到的所述待测试信号；所述FIFO电路的数据接口与所述时序采集电路的数据接口连接、时钟接口与所述时序采集电路的时钟接口连接；
嵌入式处理器，与所述FIFO电路连接，用于对来自所述FIFO电路中数据进行滤波去除干扰、然后对数据进行硬件实时解码并输出波形数据；
UART电路，与所述嵌入式处理器连接，所述嵌入式处理器将波形数据发送给UART电路；
UART转USB电路，与所述UART电路连接，用于将来自UART电路的波形数据转换成符合USB协议的波形数据后发送给上位机。
2.根据权利要求1所述的移动终端逻辑分析仪，其特征在于，所述时序采集电路、FIFO电路、嵌入式处理器和UART电路集成在FPGA中。
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