CN103869516A - 显示面板放电电路及显示装置 - Google Patents

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Abstract

本发明涉及一种显示面板放电电路及显示装置，所述显示面板放电电路包括：延时控制模块，所述延时控制模块在显示面板关机后输出放电控制信号预定时间；接地模块，所述接地模块用于接收所述放电控制信号，并根据所述放电控制信号使信号线接地所述预定时间。通过采用本发明的显示面板放电电路能够将显示面板的信号线接地，达到释放电荷的目的，从而在显示面板待机时进行一次放电操作，避免电荷长时间积累。

Description

显示面板放电电路及显示装置
技术领域
本发明涉及显示技术领域，具体涉及一种显示面板放电电路及显示装置。
背景技术
液晶显示装置(LCD，Liquid Crystal Display)由于具有体积小、功耗低及寿命长等优点，被广泛用于诸如电视、显示器、笔记本电脑、平板电脑以及移动互联设备等显示装置中。
常规的显示面板设计容易出现电荷积累，使显示面板出现发绿、残像等不良，严重影响了显示面板的显示效果。因此，需要一种放电电路，能使显示面板在待机时迅速释放电荷。
发明内容
本发明所要解决的技术问题是显示面板容易出现电荷积累的问题。
为此目的，本发明提出了一种显示面板放电电路，包括：延时控制模块，所述延时控制模块在显示面板关机后输出放电控制信号预定时间；接地模块，所述接地模块用于接收所述放电控制信号，并根据所述放电控制信号使信号线接地所述预定时间。
优选地，所述延时控制模块包括延时器和第一开关，所述第一开关的一端连接所述延时器，另一端连接所述接地模块，所述延时器用于将显示面板关机前的高电平信号保持所述预定时间，所述第一开关在显示面板关机时导通，使所述延时器发出的高电平信号作为所述放电控制信号发送到所述接地模块。
优选地，所述第一开关由第一MOS晶体管构成，所述第一MOS晶体管的栅极连接显示面板电源，所述第一MOS晶体管的源极连接所述接地模块，所述第一MOS晶体管的漏极连接所述延时器。
优选地，当所述第一MOS晶体管为N型MOS晶体管时，所述延时控制模块还包括反相器，所述反相器连接在显示面板电源与所述第一MOS晶体管的栅极之间。
优选地，所述接地模块包括信号线开关，在接收到所述放电控制信号时所述信号线开关导通所述预定时间，以使所述信号线接地。
优选地，所述信号线开关包括多个开关，所述信号线为多条信号线，所述多个开关分别连接所述多条信号线和地，在接收到所述放电控制信号时所述多个开关全部导通所述预定时间，以使对应的所述信号线接地。
优选地，所述信号线包括栅线、数据线和公共电极线。
优选地，所述多个开关为第二开关、第三开关和第四开关，所述第二开关连接所述栅线和地，所述第三开关连接所述数据线和地，所述第四开关连接所述公共电极线和地，在接收到所述放电控制信号时所述第二开关、第三开关和第四开关同时导通所述预定时间，以使所述栅线、所述数据线和所述公共电极线全部接地。
优选地，所述第二开关由第二MOS晶体管构成，所述第三开关由第三MOS晶体管构成，所述第四开关由第四MOS晶体管构成。
优选地，所述第二MOS晶体管、所述第三MOS晶体管、所述第四MOS晶体管的栅极与所述延时控制模块连接；所述第二MOS晶体管、所述第三MOS晶体管、所述第四MOS晶体管的源极分别与栅线、数据线和公共电极线连接；所述第二MOS晶体管、所述第三MOS晶体管、所述第四MOS晶体管的漏极接地。
优选地，当所述第二MOS晶体管、所述第三MOS晶体管、所述第四MOS晶体管均为P型MOS晶体管时，所述接地模块还包括反相器，所述反相器连接在所述延时控制模块与所述第二MOS晶体管、所述第三MOS晶体管、所述第四MOS晶体管的栅极之间。
优选地，所述放电电路还包括栅线开关和数据线开关，所述栅线开关和所述数据线开关在接收到所述放电控制信号时导通，从而使栅电压加载到栅线上，使数据信号加载到数据线上。
本发明还提供一种显示装置，包括上述的显示面板放电电路。
通过采用本发明所公开的显示面板放电电路能够将显示面板的栅线、数据线和公共电极线同时接地，达到释放电荷的目的，从而在显示面板待机时进行一次放电操作，避免电荷长时间积累。
附图说明
通过参考附图会更加清楚的理解本发明的特征和优点，附图是示意性的而不应理解为对本发明进行任何限制，在附图中：
图1示出了根据本发明实施例的放电电路的模块图；
图2示出了根据本发明实施例的放电电路的更详细的模块图；
图3示出了根据本发明实施例的放电电路的示意图；
图4示出了根据本发明另一实施例的放电电路的示意图；
图5示出了根据本发明再一实施例的放电电路的示意图。
具体实施方式
下面将结合附图对本发明的实施例进行详细描述。
图1示出了根据本发明实施例的放电电路的模块图。如图1所示，根据本发明实施例的显示面板放电电路包括延时控制模块11和接地模块12，其中延时控制模块11连接显示面板电源VDD，在显示面板关机后，即显示面板电源VDD降至零时，延时控制模块11输出放电控制信号预定时间；接地模块12用于接收该放电控制信号，并根据该放电控制信号使信号线13接地该预定时间。
通过采用本发明所公开的显示面板放电电路能够将显示面板的信号线同时接地，达到释放电荷的目的，从而在显示面板待机时进行一次放电操作，避免电荷长时间积累。
图2示出了根据本发明实施例的放电电路的更详细的模块图。如图2所示，延时控制模块11包括延时器21和第一开关22，第一开关22的一端连接延时器21，另一端连接接地模块12，延时器21用于将显示面板关机前的高电平信号VDD保持该预定时间，第一开关22在显示面板关机时导通，使延时器21发出的高电平信号作为该放电控制信号发送到接地模块12。接地模块12包括至少一个信号线开关23，该至少一个信号线开关在接收到该放电控制信号时导通该预定时间，以使对应的至少一条信号线24接地。为了使电路放电更为充分，优选地，在接收到该放电控制信号时，该至少一个信号线开关23全部导通该预定时间，以使对应的信号线24全部接地。更具体地，信号线24是显示面板的栅线、数据线和公共电极线中的至少一条。
需要说明的是，延时器可采用现有的延时继电器即可，具体延迟时间的长短可根据需要选择设置。
下面以信号线包括显示面板的栅线、数据线和公共电极线为例，对应信号线开关23包括三个，分别为第二开关232、第三开关233和第四开关234，更详细地说明本发明的具体实施例。
图3示出了根据本发明实施例的放电电路的示意图。在图3中，晶体管T1至T6均为N型MOS晶体管，显示面板电源VDD一方面通过反相器连接到晶体管T1(即，第一开关)的栅极，另一方面通过延时器连接到晶体管T1的漏极。晶体管T1的源极连接到数据线开关DS、栅线开关GS、晶体管T2(即，第二开关)的栅极、晶体管T3、T4和T5(即，第三开关)的栅极以及晶体管T6(即，第四开关)的栅极。晶体管T2的源极连接到奇数行栅线GO和偶数行栅线GE，晶体管T3、T4和T5的源极分别连接到RGB数据线DR、DG、DB，晶体管T6的源极连接到公共电极线Vcom，并且晶体管T2至T6的漏极接地。
当显示面板待机时，显示面板电源VDD掉电，例如电压从3V变为0V。此时，与VDD相连接的非门输出高电平，从而使晶体管T1导通，同时VDD通过延时器，使得电压Vx(即晶体管T1漏极处的电压)保持高电平(3V)预定时间，例如延时50μs。由于此时晶体管T1处于导通状态，晶体管T1漏极处的高电平电压Vx将与晶体管T1源极相连的数据线开关DS和栅线开关GS拉高，使数据线开关DS和栅线开关GS导通，从而栅电压可以加载到栅线上，RGB数据信号可以加载到数据线上。
由于晶体管T1源极处于高电平，从而使得晶体管T2、T3、T4、T5和T6导通。晶体管T2导通，将奇数行和偶数行栅线GO、GE接地。对于显示电路而言，通常将栅线的奇数和偶数行在不同层分开布线，以提升空间的利用率，本领域技术人员应当理解，在空间足够的情况下，也可以只有一根栅线。由于晶体管T3、T4和T5导通，分别使得RGB数据信号线DR、DG、DB接地；由于晶体管T6导通，使得公共电极线Vcom接地。由此，当VDD掉电时，根据本发明实施例的放电电路将显示面板的栅线、数据线和公共电极线同时接地，达到释放电荷的目的，从而在显示面板待机时进行一次放电操作，避免电荷长时间积累。
当延时器延时结束后，电压Vx处于低电平，使得数据线开关DS和栅线开关GS均为低电平，不再向栅线加载栅电压GO/GE、向数据线加载RGB数据信号DR/DG/DB，同时还使得晶体管T2、T3、T4、T5和T6截止，从而RGB数据信号线DR、DG、DB、奇数行和偶数行栅线GO、GE以及公共电极线Vcom不再接地，放电过程结束。
上述放电电路中的晶体管均为N型MOS晶体管，优选地为薄膜晶体管。应当理解，根据本发明的放电电路中的晶体管并不仅限于N型MOS晶体管，也可以采用P型MOS晶体管。图4示出了根据本发明另一实施例的放电电路的示意图，其中晶体管T1至T6均为P型MOS晶体管。
与前一实施例类似，当VDD掉电后，晶体管T1导通，同时VDD通过延时器延时使得晶体管T1漏极处的电压Vx保持高电平，从而将数据线开关DS和栅线开关GS拉高，使得栅电压可以加载到栅线上，RGB数据信号可以加载到数据线上。与晶体管T1相连的非门将晶体管T1源极处的高电平转变为低电平，使晶体管T2至T6导通。由此，晶体管T2使得栅线接地，晶体管T3、T4和T5使数据线接地，晶体管T6使得公共电极线接地。当延时器延时结束后，电压Vx处于低电平，使得数据线开关DS和栅线开关GS均为低电平，不再向栅线加载栅电压GO/GE、向数据线加载RGB数据信号DR/DG/DB，同时使晶体管T2至T6截止，使得栅线、数据线和公共电极线不再接地，放电过程结束。
图5示出了根据本发明再一实施例的放电电路的示意图，在本实施例中省略了前述实施例中的非门，进一步简化了放电电路的电路结构。如图5所示，晶体管P1为P型MOS晶体管，晶体管N2至N6为N型MOS晶体管。当VDD掉电后，晶体管P1导通，同时VDD通过延时器延时使得晶体管P1漏极处的电压Vx保持高电平，从而将数据线开关DS和栅线开关GS拉高，使得栅电压可以加载到栅线上，RGB数据信号可以加载到数据线上。晶体管P1源极处的高电平使晶体管N2至N6导通。由此，晶体管N2使得栅线接地，晶体管N3、N4和N5使数据线接地，晶体管N6使得公共电极线接地。当延时器延时结束后，电压Vx处于低电平，使得数据线开关DS和栅线开关GS均为低电平，不再向栅线加载栅电压GO/GE、向数据线加载RGB数据信号DR/DG/DB，同时使晶体管N2至N6截止，使得栅线、数据线和公共电极线不再接地，放电过程结束。
以上实施例仅用于说明本发明，而并非意在穷举，或者对本发明作出任何限制。本领域技术人员在阅读本发明的基础上，能够想到对本发明作出各种改变和变型。例如采用其他电子元件来作为开关元件，采用其他延时方式，或改变MOS晶体管的类型并适应性地改变电路结构等等，这些改变和变型均在本发明的保护范围之内。
通过采用本发明所公开的显示面板放电电路能够将显示面板的栅线、数据线和公共电极线同时接地，达到释放电荷的目的，从而在显示面板待机时进行一次放电操作，避免电荷长时间积累。
本发明还提供一种显示装置，包括上述的显示面板放电电路。所述显示装置可以为：液晶面板、电子纸、OLED面板、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
虽然结合附图描述了本发明的实施方式，但是本领域技术人员可以在不脱离本发明的精神和范围的情况下作出各种修改和变型，这样的修改和变型均落入由所附权利要求所限定的范围之内。

Claims (13)

1.一种显示面板放电电路，其特征在于，包括：
延时控制模块，所述延时控制模块在显示面板关机后输出放电控制信号预定时间；
接地模块，所述接地模块用于接收所述放电控制信号，并根据所述放电控制信号使信号线接地所述预定时间。
2.根据权利要求1所述的放电电路，其特征在于，所述延时控制模块包括延时器和第一开关，所述第一开关的一端连接所述延时器，另一端连接所述接地模块，所述延时器用于将显示面板关机前的高电平信号保持所述预定时间，所述第一开关在显示面板关机时导通，使所述延时器发出的高电平信号作为所述放电控制信号发送到所述接地模块。
3.根据权利要求2所述的放电电路，其特征在于，所述第一开关由第一MOS晶体管构成，所述第一MOS晶体管的栅极连接显示面板电源，所述第一MOS晶体管的源极连接所述接地模块，所述第一MOS晶体管的漏极连接所述延时器。
4.根据权利要求3所述的放电电路，其特征在于，当所述第一MOS晶体管为N型MOS晶体管时，所述延时控制模块还包括反相器，所述反相器连接在显示面板电源与所述第一MOS晶体管的栅极之间。
5.根据权利要求1所述的放电电路，其特征在于，所述接地模块包括信号线开关，在接收到所述放电控制信号时所述信号线开关导通所述预定时间，以使所述信号线接地。
6.根据权利要求5所述的放电电路，其特征在于，所述信号线开关包括多个开关，所述信号线为多条信号线，所述多个开关分别连接所述多条信号线和地，在接收到所述放电控制信号时所述多个开关全部导通所述预定时间，以使对应的所述信号线接地。
7.根据权利要求6所述的放电电路，其特征在于，所述信号线包括栅线、数据线和公共电极线。
8.根据权利要求7所述的放电电路，其特征在于，所述多个开关为第二开关、第三开关和第四开关，所述第二开关连接所述栅线和地，所述第三开关连接所述数据线和地，所述第四开关连接所述公共电极线和地，在接收到所述放电控制信号时所述第二开关、第三开关和第四开关同时导通所述预定时间，以使所述栅线、所述数据线和所述公共电极线全部接地。
9.根据权利要求8所述的放电电路，其特征在于，所述第二开关由第二MOS晶体管构成，所述第三开关由第三MOS晶体管构成，所述第四开关由第四MOS晶体管构成。
10.根据权利要求9所述的放电电路，其特征在于，所述第二MOS晶体管、所述第三MOS晶体管、所述第四MOS晶体管的栅极与所述延时控制模块连接；所述第二MOS晶体管、所述第三MOS晶体管、所述第四MOS晶体管的源极分别与栅线、数据线和公共电极线连接；所述第二MOS晶体管、所述第三MOS晶体管、所述第四MOS晶体管的漏极接地。
11.根据权利要求10所述的放电电路，其特征在于，当所述第二MOS晶体管、所述第三MOS晶体管、所述第四MOS晶体管均为P型MOS晶体管时，所述接地模块还包括反相器，所述反相器连接在所述延时控制模块与所述第二MOS晶体管、所述第三MOS晶体管、所述第四MOS晶体管的栅极之间。
12.根据权利要求7至11中任一项所述的放电电路，其特征在于，还包括栅线开关和数据线开关，所述栅线开关和所述数据线开关在接收到所述放电控制信号时导通，从而使栅电压加载到栅线上，使数据信号加载到数据线上。
13.一种显示装置，其特征在于，包括如权利要求1至12所述的显示面板放电电路。
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