CN102024177A - 计数装置 - Google Patents

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Abstract

一种计数装置包括一取样电路及一计数显示电路。取样电路包括一接口、一第一电子开关及一第二电子开关,计数显示电路包括一第一计数译码器及一第一数码显示管。本发明计数装置将接口的电源端与第一电子开关的第一端相连,将第一电子开关的第二端与第二电子开关的第一端相连,将第二电子开关的第二端与第一计数译码器的加法计数时钟端相连,从而对电子设备成功上电的次数进行统计。

Description

计数装置
技术领域
本发明涉及一种计数装置。
背景技术
在计算机或服务器的可靠性测试中,有一个循环上电测试的项目,即模拟市电的接入与关断使得计算机或服务器上电与断电,以验证计算机或服务器的上电成功率。在该循环上电测试中,一般通过设定交流电源的上电时间、断电时间及循环次数,以使得该交流电源间断地给计算机或服务器供电,然后根据计算机或服务器成功上电的次数判断该计算机或服务器是否合格。在测试过程中,通常通过软件对成功上电进行计数,然而由于所述软件安装在计算机或服务器中,因此要实现对计算机或服务器成功上电的计数要求计算机或服务器中各个部件均工作正常。
发明内容
鉴于上述内容,有必要提供一种在电子设备循环上电测试时独立于该电子设备且可对电子设备成功上电进行计数的计数装置。
一种计数装置,包括:
一取样电路,包括一接口、一第一电子开关及一第二电子开关,所述接口用来与一电子设备相连,所述接口的电源端通过一第一电阻与所述第一电子开关的第一端相连,所述第二电子开关的第一端与所述第一电子开关的第二端相连,所述第一及第二电子开关的第二端分别通过一第二电阻及一第三电阻与一电源相连,所述第一及第二电子开关的第三端均接地;及
一计数显示电路,包括一第一计数译码器及一第一数码显示管,所述第一计数译码器包括一加法计数时钟端、一减法计数时钟端、一使能端、一锁存控制端及七个输出端,所述第一数码显示管包括七个输入端,所述第一计数译码器的七个输出端分别与所述第一数码显示管的七个输入端相连,所述第一计数译码器的加法计数时钟端与所述第二电子开关的第二端相连,减法计数时钟端通过一第四电阻接地,使能端及锁存控制端均接地。
本发明计数装置将所述接口的电源端通过一第一电阻与所述第一电子开关的第一端相连,将所述第二电子开关的第一端与所述第一电子开关的第二端相连,将所述第二电子开关的第二端与一计数译码器的加法计数时钟端相连,将第一计数译码器的七个输出端与第一数码显示管的七个输入端相连,从而实现对所述电子设备成功上电的次数进行统计。
附图说明
图1A及图1B为本发明计数装置的较佳实施方式的电路图。
具体实施方式
下面参照附图结合具体实施方式对本发明作进一步的描述。
请参照图1A及图1B,本发明计数装置用于对一电子设备成功上电的次数进行统计。本发明计数装置的较佳实施方式包括一取样电路100及一计数显示电路200。
所述取样电路100包括一接口10及两电子开关Q1、Q2。本实施方式中所述接口10为一通用串行总线(Universal Serial Bus,USB)接口。
所述USB接口10与所述电子设备的一USB接口(图未示)相连,以将所述计数装置与电子设备相连。所述USB接口10包括一电源端Vcc、一接地端GND及两信号端USB_P、USB_N。所述两信号端USB_P、USB_N均悬空,接地端GND接地。所述电子开关Q1、Q2均为一三极管。所述电子开关Q1的基极通过一电阻R1与所述USB接口10的电源端Vcc相连,集电极通过一上拉电阻R2与一+5V电源相连,发射极接地。所述电子开关Q2的基极与所述电子开关Q1的集电极相连,集电极通过一上拉电阻R3与所述+5V电源相连,发射极接地。
另外,所述取样电路100还可包括两电阻R4、R5、一隔离二极管D1及一电容C1。所述隔离二极管D1连接于电阻R1及USB接口10的电源端Vcc之间,所述隔离二极管D1的阳极与所述USB接口10的电源端Vcc相连并通过所述电阻R4接地,阴极通过所述电阻R1与所述电子开关Q1的基极相连。所述电子开关Q1的基极还分别通过所述电阻R5及电容C1接地。在所述电子设备上电的瞬间电压不稳定时,所述USB接口10的电源端Vcc会出现多个峰值,只有高于所述隔离二极管D1的导通电压的峰值才能通过所述隔离二极管D1,从而防止由于所述电子设备上电的瞬间电压不稳定造成的重复计数。所述电阻R4、R5用于在所述电子设备上电前将电容C1及所述电子设备的残留电荷快速释放,以防止残留电荷对电子设备上电时形成干扰。
所述计数显示电路200包括四个计数译码器U1、U2、U3及U4、四个数码显示管LED1、LED2、LED3及LED4。
所述四个计数译码器U1、U2、U3、U4均包括一电源端Vcc、一接地端GND、一使能端TE、一锁存控制端LE、一复位端RST、一加法计数时钟端CLK_UP、一减法计数时钟端CLK_DN、一输出进位端CY、一输出借位端BW、七个输出端A、B、C、D、E、F、G。
所述四个数码显示管LED1、LED2、LED3及LED4均包括两公共端VC1和VC2、七个输入端A+、B+、C+、D+、E+、F+、G+及一小数点输入端DP。每个数码显示管的公共端VC1和公共端VC2相连,并通过一电阻R6接地。每个数码显示管的小数点输入端DP均悬空。
所述四个计数译码器U1、U2、U3、U4的电源端Vcc与所述+5V电源相连,并分别通过电容C2、C3、C4及C5接地。所述四个计数译码器U1、U2、U3、U4的接地端GND、使能端TE及锁存控制端LE均接地,七个输出端A、B、C、D、E、F、G分别对应与数码显示管LED1、LED2、LED3及LED4的七个输入端A+、B+、C+、D+、E+、F+、G+相连,复位端RST通过一电阻R7接地并通过一开关SW与所述+5V电源相连。
所述计数译码器U1的加法计数时钟端CLK_UP与所述电子开关Q2的集电极相连,减法计数时钟端CLK_DN通过一电阻R8接地,输出进位端CY与计数译码器U2的加法计数时钟端CLK_UP相连,输出借位端BW与计数译码器U2的减法计数时钟端CLK_DN相连。
所述计数译码器U2的输出进位端CY与计数译码器U3的加法计数时钟端CLK_UP相连,输出借位端BW与计数译码器U3的减法计数时钟端CLK_DN相连。
所述计数译码器U3的输出进位端CY与计数译码器U4的加法计数时钟端CLK_UP相连,输出借位端BW与计数译码器U4的减法计数时钟端CLK_DN相连。
所述计数译码器U4的输出进位端CY及输出借位端BW均悬空。
下面对本发明计数装置的工作原理进行说明。
所述四个计数译码器U1、U2、U3、U4均采用德州仪器生产的型号为CD40110B的计数译码器,其真值表如表1所示。
表1
  CLK_UP   CLK_DN   LE   TE   RST   计数   输出显示
  ↑   X   0   0   0   加1   随计数显示
  X   ↑   0   0   0   减1   随计数显示
  ↓   ↓   X   X   0   不计数   不变化
  X   X   1   X   1   清零   显示锁存
  X   X   0   X   1   清零   显示“0”
  X   X   X   1   0   禁止   无显示
  ↑   X   1   0   0   加1   显示锁存
  X   ↑   1   0   0   减1   显示锁存
其中↑表示上升沿,↓表示下降沿,X表示任意电平,0表示低电平,1表示高电平。
当使能端TE为低电平时,所述计数译码器工作;复位端RST为高电平时,计数译码器清零;锁存控制端LE为高电平时,计数译码器锁存先前的计数。比如第一行即表示:所述计数译码器的使能端TE、复位端RST及锁存控制端LE均为低电平,当加法计数时钟端CLK_UP的电压出现上升沿、减法计数时钟端CLK_DN为任意电平时,所述计数译码器进行一次加法计数,并输出相应的计数结果。
当所述电子设备上电成功时,与所述电子设备的USB接口相连的所述USB接口10的电源端Vcc为高电平,即所述电子开关Q1的基极为高电平。此时所述电子开关Q1导通,所述电子开关Q1的集电极的电压被拉低,即所述电子开关Q2的基极为低电平,所述电子开关Q2截止。此时所述电子开关Q2的集电极为高电平,即所述计数译码器U1的加法计数时钟端CLK_UP出现上升沿,同时,由于锁存控制端LE、使能端TE、复位端RST均为低电平,所述计数译码器U1则作加法计数一次,所述数码显示管LED1则显示计数。
当所述电子设备断电时,与所述电子设备的USB接口相连的所述USB接口10的电源端Vcc为低电平,即所述电子开关Q1的基极为低电平。此时所述电子开关Q1截止,所述电子开关Q1的集电极为高电平,即所述电子开关Q2的基极为高电平,所述电子开关Q2导通。此时所述电子开关Q2的集电极的电压被拉低,即所述计数译码器U1的加法计数时钟端CLK_UP出现下降沿,同时,由于锁存控制端LE、使能端TE、复位端RST均为低电平,所述计数译码器U1不计数,所述数码显示管LED1的显示不变化。
如此当所述电子设备上电的次数超过10次、100次,甚至1000次时,级连起来的计数译码器U1、U2、U3及U4可对所述电子设备上电的次数进行计数并通过所述数码显示管LED1、LED2、LED3及LED4显示计数。
当按下所述开关SW时,所述四个计数译码器U1、U2、U3、U4的复位端RST变为高电平,同时由于锁存控制端LE为低电平,从而使得所述四个计数译码器U1、U2、U3、U4的计数信息被清零,且其显示计数为零。
本发明计数装置将所述USB接口10的电源端Vcc通过所述隔离二极管D1及电阻R1与所述电子开关Q1的基极相连,将所述电子开关Q1的集电极与所述电子开关Q2的基极相连,将所述电子开关Q2的集电极与所述计数译码器U1的加法计数时钟端CLK_UP相连,将计数译码器U1、U2、U3及U4的七个输出端A、B、C、D、E、F、G分别与数码显示管LED1、LED2、LED3及LED4的七个输入端A+、B+、C+、D+、E+、F+、G+相连从而对所述电子设备上电的成功次数进行统计。

Claims (10)

1.一种计数装置,包括:
一取样电路,包括一接口、一第一电子开关及一第二电子开关,所述接口用来与一电子设备相连,所述接口的电源端通过一第一电阻与所述第一电子开关的第一端相连,所述第二电子开关的第一端与所述第一电子开关的第二端相连,所述第一及第二电子开关的第二端分别通过一第二电阻及一第三电阻与一电源相连,所述第一及第二电子开关的第三端均接地;及
一计数显示电路,包括一第一计数译码器及一第一数码显示管,所述第一计数译码器包括一加法计数时钟端、一减法计数时钟端、一使能端、一锁存控制端及七个输出端,所述第一数码显示管包括七个输入端,所述第一计数译码器的七个输出端分别与所述第一数码显示管的七个输入端相连,所述第一计数译码器的加法计数时钟端与所述第二电子开关的第二端相连,减法计数时钟端通过一第四电阻接地,使能端及锁存控制端均接地。
2.如权利要求1所述的计数装置,其特征在于:所述第一计数译码器还包括一输出进位端及一输出借位端,所述计数显示电路还包括一第二计数译码器及一第二数码显示管,所述第二计数译码器的七个输出端分别与所述第二数码显示管的七个输入端相连,所述第二计数译码器的加法计数时钟端与第一计数译码器的输出进位端相连,减法计数时钟端与第一计数译码器的输出借位端相连。
3.如权利要求1所述的计数装置,其特征在于:所述接口为一通用串行总线接口。
4.如权利要求1所述的计数装置,其特征在于:所述取样电路还包括一隔离二极管,所述隔离二极管连接于所述接口的电源端与所述第一电阻之间,且所述隔离二极管的阳极与所述接口的电源端相连、阴极与所述第一电阻相连。
5.如权利要求1或4所述的计数装置,其特征在于:所述取样电路还包括一第五电阻,所述接口的电源端还通过所述第五电阻接地。
6.如权利要求1所述的计数装置,其特征在于:所述取样电路还包括一第五电阻,所述第一电子开关的第一端还通过所述第五电阻接地。
7.如权利要求1所述的计数装置,其特征在于:所述取样电路还包括一电容,所述第一电子开关的第一端还通过所述电容接地。
8.如权利要求1所述的计数装置,其特征在于:所述电源为+5V电源。
9.如权利要求1所述的计数装置,其特征在于:所述第一、第二电子开关均为一三极管,所述第一、第二电子开关的第一端为三极管的基极、第二端为三极管的集电极、第三端为三极管的发射极。
10.如权利要求1所述的计数装置,其特征在于:所述计数译码器还包括一复位端,所述复位端通过一第五电阻接地并通过一开关与所述电源相连。
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