CN101107863A - 用于实时并行编码的方法和装置 - Google Patents

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Abstract

提供了用于使在多个处理器上进行的编码处理并行的装置和方法。一种装置包括计算资源均衡器(199)和分解器(145)。计算资源均衡器(199)用于基于线程亲和性和进程亲和性中的至少一个将编码器示例分配给多个处理器中各自的一个处理器。分解器(145)用于按时间将进入的视频序列分为离散的GOP，使得每个编码器示例能够对进入的视频序列并行地编码，使得每个离散的GOP在多个处理器中各自的一个处理器上被编码。

Description

用于实时并行编码的方法和装置
相关申请的交叉引用
本申请要求2005年1月19日提交的、标题为“用于实时并行视频编码的方法和装置”的美国临时申请序列号60/645,179(代理案号PU0500013)的利益。
技术领域
本发明通常涉及视频编码器和解码器，更具体地涉及一种用于实时并行视频编码的方法和装置。
背景技术
在计算上非常需要视频数据的实时编码，该实时编码需要大量的内存和计算资源。
以往在一些示例中已经将利用并行和分布式系统的视频编码用于MPEG-1和MPEG-2系统中。最著名的一个例子是并行Berkeley编码器计划。该计划的目的是通过在时间方向使视频序列并行而加速视频编码处理。并行Berkeley编码器计划利用基于复杂性度量将许多帧分配给每个处理器的动态调度方案。当在复杂性度量以及编码期间发现失调时，为要被编码的后来的序列计算新的工作量分配。
然而，利用并行和分布式系统的视频编码不是没有缺点的。因此，具有用于实时并行视频编码的这样一种方法和装置是期望的并且很有利的：其针对此问题：将实时编码的视频的时间序列(例如具有JVT/H.264/MPEG-4 AVC(“JVT”)标准)调度到并行结构，使得编码时间是一致的。此外，具有用于实时并行视频编码的这样一种方法和装置是期望的并且很有利的：其针对另外一个问题：相对于并行视频编码器的多种示例维持精确的速率控制。另外，具有用于实时并行视频编码的这样一种方法和装置是期望的并且很有利的：其针对另外一个问题：在多处理器PC平台上进行实时编码。
发明内容
本发明针对现有技术的这些和其它劣势和缺点，其着重于一种用于实时并行视频编码的方法和装置。
根据本发明的一方面，提供了一种用于使在多个处理器上进行的编码处理并行的装置。该装置包括计算资源均衡器和分解器(splitter)。计算资源均衡器用于基于线程亲和性(thread affinity)和进程亲和性(process affinity)中的至少一个将编码器示例分配给多个处理器中各自的一个处理器。分解器用于按时间将进入的视频序列分为离散的画面组(GOP)，使得每个编码器示例能够对进入的视频序列并行地编码，使得每个离散的GOP在多个处理器中各自的一个处理器上被编码。
根据本发明的另一方面，提供了一种用于使在多个处理器上进行的编码处理并行的方法。该方法包括基于线程亲和性和进程亲和性中的至少一个将编码器示例分配给多个处理器中各自的一个处理器的步骤。该方法还包括以下步骤：按时间将进入的视频序列分为离散的GOP，使得每个编码器示例能够对进入的视频序列并行地编码，使得每个离散的GOP在多个处理器中各自的一个处理器上被编码。
根据本发明的另一方面，提供了一种用于使在多个处理器上进行的编码处理并行的装置。该装置包括计算资源均衡器和分解器。计算资源均衡器用于基于线程亲和性和进程亲和性中的至少一个将编码器示例分配给多个计算机处理器中各自的一个计算机处理器。分解器用于按空间将进入的视频序列分为离散的片段(slice)，使得每个编码器示例能够对进入的视频序列并行地编码，使得每个离散的片段在多个处理器中各自的一个处理器上被编码。
根据本发明的另一方面，提供了一种用于使在多个处理器上进行的编码处理并行的方法。该方法包括基于线程亲和性和进程亲和性中的至少一个将编码器示例分配给多个处理器中各自的一个处理器的步骤。该方法还包括以下步骤：按空间将进入的视频序列分为离散的片段，使得每个编码器示例能够对进入的视频序列并行地编码，使得每个离散的片段在多个处理器中各自的一个处理器上被编码。
联合附图阅读下面的示例实施例的详细描述，本发明的这些和其它方面、特性和优点将会变得显而易见。
附图说明
依照下面的示例图本发明可被更好地理解，其中：
图1示出了依照本发明的原理的JVT/H.264/MPEG-4 AVC(“JVT”)实施例中的并行视频编码器结构的框图；
图2示出了依照本发明的原理的JVT/H.264/MPEG-4 AVC(“JVT”)实施例中的并行视频编码的方法的流程图；以及
图3示出了依照本发明的原理的JVT/H.264/MPEG-4 AVC(“JVT”)实施例中的并行视频编码的另一种方法的流程图。
具体实施方式
本发明着重于一种用于实时并行视频编码的方法和装置。有利地，本发明提供了利用标准多处理器桌面PC的实时视频编码，尽管这里提出的权利要求不解释为限于多处理器桌面PC环境。虽然本发明在JVT/H.264/MPEG-4AVC(“JVT”)标准视频编码环境中被描述，但是本发明的原理也可适用于与其它的视频压缩标准使用。
如上所述，在计算上非常需要实时JVT编码，该JVT编码需要大量的内存和计算资源。这里，提供了这样一种方法和装置：其基于时间的画面组(GOP)使在多个处理器上进行的JVT视频编码处理并行，以完成实时编码。本发明使诸如画面复杂性分析、场景变化检测的技术与多线程软件调度技术相结合。
并非完全集中于用于确定视频序列的各部分在各处理器上如何调度的性能度量，除了时间窗口外还使用诸如场景变化检测的其它因素来调度序列。另外，在并行JVT编码器中，要编码的序列的每段(segment)彼此独立，这不是前面描述的并行Berkeley编码器计划中的情况。在并行Berkeley编码器计划中，在编码器示例之间有一些可造成额外的不期望的系统开销(overhead)的已解码的参考帧的交换。独立序列的使用使被并行编码的数据的相互依赖最小化，导致每个编码器示例之间只进行最小程度的通信。此外，也应提及：在并行Berkeley编码器计划中不针对编码器示例和场景变化检测间的精确的比特率控制。因此，当本发明和并行Berkeley编码器计划与并行视频编码相关时，该发明与用于完成并行编码的许多基本步骤和途径不同；其包括，但不限于：画面序列如何在各处理器上调度，以及如何精确地维持速率控制。
有利地，本发明针对将用于实时JVT编码的视频的时间序列调度为并行结构，使编码时间一致的问题。此外，本发明有利地针对维持相对于并行JVT视频编码器的多个示例的精确的速率控制的另一个问题。另外，本发明有利地针对在多处理器PC平台上进行实时编码的另一个问题。
本描述例示本发明的原理。因此应了解：本领域技术人员将能够对各种配置进行修改，所述配置虽然在这里没有明确地描述或示出，其包含本发明的原理，并包括在本发明的精神和范围内。
这里叙述的所有例子和条件语言意在教学的目的以帮助读者理解发明人贡献以促进技术的本发明的原理和构思，其被解释为不限于这样特定叙述的例子和条件。
此外，这里叙述本发明原理、方面和实施例的所有陈述，以及其特定的例子，意在包含其结构上和功能上二者的等价物。另外，其意在：这样的等价物包括当前已知的等价物以及将来开发的等价物二者，即无关结构如何的任何执行相同功能的所开发的元件。
因此，例如，本领域技术人员将了解这里提出的框图代表包含本发明原理的说明性电路的概念视图。类似地，将了解：任何流程图、作业图、状态转换图、伪代码等等代表可基本上在计算机可读介质中表示并可由计算机或处理器执行(无论这样的计算机或处理器是否明确地示出)的各种进程。
在图中示出的各种元件的功能可通过使用专用硬件以及能够联合适合的软件执行软件的硬件提供。当由处理器提供时，所述功能可由单个专用处理器、单个共享处理器、或其中的一些共享的多个独立处理器提供。此外，术语“处理器”或“控制器”的明确的使用不应解释为只代表能够执行软件的硬件，其也可以隐含地、不受限制地包括数字信号处理器(“DSP”)硬件、用于存储软件的只读存储器(“ROM”)、随机存取存储器(“RAM”)、以及非易失性存储。
也可包括其它的传统的和/或常规的硬件。类似地，图中所示的任何开关只是概念性的。它们的功能可通过程序逻辑、专用逻辑、程序控制和专用逻辑间的相互作用、或甚至手动地执行，特定的技术可由实施者选择，其可从上下文中被具体地理解。
在本权利要求中，表示为实施特定功能的部件的任何元件包含执行以下功能的任何方法，所述功能例如包括：a)执行该功能的电路元件的组合或者b)任何形式的软件，因此包括固件、微码等等，其与用于执行该软件的适合的电路结合以实施该功能。由这样的权利要求限定的本发明归于这样的事实：由各种所述部件提供的功能性以权利要求要求的方式组合并集合。因此应认为：可提供那些功能性的任何部件等价于这里所示的那些部件。
有利地，本发明提供了一种用于在多个处理器上完成实时JVT编码的新途径，例如在标准多处理器桌面PC上。假定用于完成实时JVT编码的计算上的高要求，为了完成此目标并行结构被认为是必需的。尽管存在一些使视频编码器并行的不同的途径，诸如在内部算法中开发并行关系(即，运动估计、模式判定等)、以及并行地对宏模块编码，仍选择并行地对画面或GOP的序列进行编码的途径，这是因为该方法在多个处理器上调整方面更有能力，而且其限制需要对现有的JVT编码器的核心结构和功能性做出的改变。
转向图1，通常用参考标号100表示JVT/H.264/MPEG-4 AVC(“JVT”)环境中的并行视频编码器结构。
并行视频编码器结构100包括实时捕捉接口105，其具有在信号通信中与音频捕获器(grabber)110的输入相连接的第一输出，以及在信号通信中与去交错器(deinterlacer)/噪声滤波器/缩放器(scaler)130的输入相连接的第二输出。
音频捕获器110的输出在信号通信中与音频编码器115的至少一个示例(下文中称为“音频编码器”)的输入相连接。音频编码器115的输出在信号通信中与MPEG2-TS多路复用器120的第一输入相连接。MPEG-2传输流(TS)多路复用器120的输出在信号通信中与数字视频广播-异步串行接口(DVB-ASI)发射机(Tx)125的输入相连接。
去交错器/噪声滤波器/缩放器130的输出在信号通信中与视频捕获器135的输入相连接。视频捕获器135的输出在信号通信中与预处理器/复杂性分析器140相连接。预处理器/复杂性分析器140的输出在信号通信中与画面组(GOP)分解器队列(这里也称为“场景变化检测器”)145的输入相连接。GOP分解器队列145的第1到N个输出在信号通信中分别与JVT编码器150的第1到N个示例的输入相连接。JVT编码器150的第1到N个示例的输出在信号通信中分别与已编码的JVT多路复用器160的第1到N个输入相连接。已编码的JVT多路复用器160的输出在信号通信中与MPEG-2TS多路复用器120的第二输入相连接。
并行视频编码器结构100还包括计算资源均衡器199，其识别系统资源并分配资源，使得可发生线程和进程亲和性分配(例如每个编码器一个单个处理器)。计算资源均衡器199在信号通信中至少与JVT编码器示例150或产生/管理JVT编码器示例150的元件相连接。计算资源均衡器199可以是主应用(未示出)的部分，该主应用主要负责为图1中所示的元件设置整条数据链，或者如图1所示可以是独立的元件。
应了解：当图1所示的一些元件被指定为硬件，而其它元件被指定为软件时，应了解本发明不限于图1所示的精确的配置，因此给出这里提供的本发明的教学，当维持本发明的范围时，这样的元件其它的配置和实施也可被采用。例如，在本发明的其它实施例中，图1所示的作为硬件元件的元件可被作为软件元件实施，图1所示的作为软件元件的元件可被作为硬件元件实施，和/或所示的作为一种类型(硬件或软件)的元件作为硬件和软件的组合实施。
如图1所示的数据的流程从左到右移动，其中输入数据表示为视频源，其为诸如、但不限于YUV420的未压缩的视频格式，输出数据表示为例如压缩的JVT视频NAL单位。实时捕捉接口105可以为模拟捕捉接口或数字视频捕捉接口，诸如串行数字接口(SDI)或DV(IEEE1394)。
现在将给出关于图1所示的去交错器/噪声滤波器/缩放器130的进一步的描述。去交错、滤波和缩放都是编码器平台的重要的功能组件。在模拟捕捉系统中，首先，输入视频通常为隔行(interlaced)的标准分辨率(SD)形式，即每秒60场的720×480i。然而，依照本发明的原理的实时H.264编码器优选地接受最大分辨率为352×288或每秒30帧的CIF的逐行(progressive)视频，因此，执行格式转换。除了去交错转换，也实行噪声滤波和缩放。噪声滤波以空间和/或时间的方式移除噪声(即，运动补偿时间滤波)，以便提高编码的视频的质量。另外，执行缩放使得输入视频处于编码器的正确的分辨率下。
也应注意：在此特定的H.264编码器平台上，去交错、滤波以及缩放都在硬件中完成。然而，本发明不限于这样的配置，因此这些功能也可在软件中或硬件和软件的组合中执行。
现在将给出关于图1所示的视频捕获器135的进一步的描述。在视频捕获器135处，从输入捕捉卡以恒定的速率捕捉输入视频帧。视频捕获器135可被实施为高优先级的线程，其将视频帧捕捉到输入缓冲器，接着被传送至编码器预处理器用于分析。
现在将给出关于图1所示的预处理器/复杂性分析器140和GOP分解器队列145的进一步的描述。GOP分解器队列145为如图1所示的每个并行编码器示例提供输入序列。将画面组(GOP)定义为要以特定方式编码的视频帧的序列。例如，每秒30帧的视频序列中的半秒的GOP可被编码为下面的已编码的帧的序列：IBBPBBPBBPBBPBBP。具体地，向预处理器/复杂性分析器140和编码器150提出的每个GOP的第一帧被编码为瞬时解码刷新(IDR)同步帧，使得其不依赖于前面的已编码的画面。
预处理器/复杂性分析器140计算相对于前面的帧的每个独立的视频帧的复杂性。在此阶段，为每个宏模块完成16×16快速运动估计。基于每宏块至少收集下面的一些统计量并接着将其存储(至少3个GOP的时间段)于编码器中用于以后使用：水平运动矢量、垂直运动矢量、绝对差总和(SAD)、以及方差和标准偏差。
上面的统计量用于帮助更精确地完成用于生成的已编码的比特流的期望的速率控制设置。所述方差提供图像的较好的度量和编码复杂性，其导致更理想的基于逐帧的比特分配。另外，所述统计量也用于计算在比特流中可能发生场景变化的位置，其接着为编码器提供关于如何更好地对比特流进行编码的线索。
估计的每画面的比特数也将在预处理器/复杂性分析器140中被分配，以便保持相对于在各编码器上已编码的画面输出质量和缓冲器限制一致的速率控制。
现在将给出关于图1所示的JVT编码器150的进一步的描述。在预处理后，并且一旦足够的视频数据可用时，JVT编码器150的每个示例将与一个GOP一起被提出以编码。当帧被编码时，已编码的帧将被插入多路复用器上的分类的链接列表。有可能由于失调和非理想系统条件所述帧可能到达一个无序的(out-of-order)序列。
现在将给出关于图1所示的已编码的JVT多路复用器160的进一步的描述。已编码的JVT多路复用器160保证编码器输出帧的正确顺序，并将序列中已编码的JVT比特流传递给文件或传输接口。最普通的传输接口为DVB-ASI接口和以太网。DVB-ASI接口为标准化的MPEG-2传输接口，而以太网接口为用于因特网协议(IP)传输的标准接口。
现在将给出依照本发明的原理的关于速率控制的描述。双处理器编码器中的速率控制方案的目的是保持每个编码器示例相对于预期的比特率一致的输出比特率。另外，也期望维持由独立的编码器的示例编码的GOP之间一致的编码质量。更具体地，确实不期望具有在已编码的视频中每个GOP之间的大的质量差异。为了限制GOP之间的质量差异，量化参数(QP)必须不能在一个GOP的结尾和下一个GOP的开始之间有很大的变化。预处理器/复杂性分析器140帮助估计GOP之间的边界条件，使得帧之间的已编码的QP差最小化。
转向图2，通常用参考标号200表示用于在JVT/H.264/MPEG-4 AVC(“JVT”)环境中并行视频编码的方法。
开始块202将控制传递给功能块205。功能块205基于线程亲和性和/或进程亲和性将编码器示例分配给多个计算机处理器中各自的一个计算机处理器，并将控制传递给功能块210。功能块210按时间将进入的视频序列分为离散的GOP，使得每个编码器示例能够对进入的视频序列并行地编码，使得每个离散的GOP在多个处理器中各自的一个处理器上被编码，并将控制传递给功能块215。
功能块210也包括功能块211和功能块212。功能块211限制离散的GOP之间的量化参数(QP)差，使得例如通过维持编码器示例之间的静态全局变量和/或公用变量，在离散的GOP之间维持一致的编码质量，所述QP差追踪编码器示例之间的平均QP。功能块212将向编码器示例提出的每个离散的GOP的第一帧编码为一个IDR帧，使得每个编码器示例能够相对于彼此独立地操作。
在GOP编码结束后，例如使用画面级别和/或GOP级别的序列数目和/或时间戳(timestamp)，功能块215将离散的GOP中的画面重新排序成序列顺序，并且将控制传递给结束块220。
转向图3，通常用参考标号300表示用于JVT/H.264/MPEG-4 AVC(“JVT”)环境中的并行视频编码的另一方法。
开始块302将控制传递给功能块305。功能块305基于线程亲和性和/或进程亲和性将编码器示例分配给多个计算机处理器中各自的一个计算机处理器，并将控制传递给功能块310。功能块310按空间将进入的视频序列分为离散的片段，使得每个编码器示例能够对进入的视频序列并行地编码，使得每个离散的片段在多个处理器中各自的一个处理器上被编码，并将控制传递给结束块320。
功能块310还包括功能块311。功能块311限制离散的GOP之间的量化参数(QP)差，使得例如通过维持编码器示例之间的静态全局变量和/或公用变量，在离散的GOP之间维持一致的编码质量，所述QP差追踪编码器示例之间的平均QP。
现在将给出本发明的许多伴随的优点/特性中的一些的描述。例如，一个优点/特性为用于使在多个计算机处理器上的H.264编码处理并行的装置，其中所述装置包括：计算资源均衡器，其用于基于线程和/或进程亲和性将编码器示例分配给多个计算机处理器中各自的一个计算机处理器；以及分解器，其用于将进入的视频序列分为离散的GOP或离散的片段，使得每个编码器示例能够对进入的视频序列并行地编码。所述离散的GOP或离散的片段被编码，使得一个GOP或片段在多个计算机处理器中的一个计算机处理器上被编码，另一个GOP或片段在多个计算机处理器中的另一个计算机处理器上被编码等等。此外，另一个优点/特性为如上所述的装置，其中GOP或片段之间的量化参数(QP)差被限制，使得在GOP或片段之间维持一致的编码质量。追踪编码器示例之间的平均QP的所述QP差可由例如静态全局变量(或两个编码器线程之间的公用变量)来维持。另外，另一个优点/特性为如上所述的装置，其中在GOP编码结束后将画面重新排序成序列顺序。可通过例如使用画面和/或GOP级别的序列数目和/或时间戳来执行所述的重新排序。同样，另一个优点/特性为如上所述的编码器，其中将向编码器示例提出的每个离散的GOP的第一帧编码为IDR帧。通过将每个GOP的初始帧编码为IDR帧，编码器的两个示例能够独立地操作。
本发明的这些或其它特性和优点可被本相关技术领域普通技术人员基于这里的教学容易地确定。应理解：本发明的教学可由各种形式的硬件、软件、固件、专用处理器或其组合来实施。
最优选地，将本发明的教学实施为硬件和软件的组合。此外，所述软件优选地实施为确实包含在程序存储单元上的应用程序。所述应用程序可被上载到包括任何合适结构的机器，并由其执行。优选地，所述机器在具有诸如一个或多个中央处理单元(“CPU”)、随机存取存储器(“RAM”)、以及输入/输出(“I/O”)接口的硬件的计算机平台上被实施。所述计算机平台也可包括操作系统和微指令代码。这里所述的各种处理和功能可以是可由CPU执行的微指令代码的部分、或应用程序的部分、或其任意的组合。另外，诸如附加数据存储单元和打印单元的各种其它的外围单元可与计算机平台相连接。
还应理解：由于在附图中描述的一些系统组成组件和方法优选地实施为软件，依赖本发明被安排的方式系统组件或进程功能块之间的实际连接可能不同。给出这里的教学，本相关领域普通技术人员将能够思考本发明的这些和相似的实施或配置。
虽然这里参考附图描述了示例实施例，应理解本发明不限于那些确切的实施例，在不偏离本发明的范围或精神的情况下，本相关领域普通技术人员可在其中做出各种改变和修改。所有这样的改变和修改意在包括在附加的权利要求中提出的本发明的范围内。

Claims (18)

1.一种用于使在多个处理器上进行的视频编码处理并行的装置，包括：
计算资源均衡器(199)，用于基于线程亲和性和进程亲和性中的至少一个将编码器示例分配给所述多个处理器中各自的一个处理器；以及
分解器(145)，用于按时间将进入的视频序列分为离散的画面组(GOP)，使得每个所述离散的GOP在所述多个处理器中各自的一个处理器上被编码。
2.根据权利要求1所述的装置，还包括用于限制所述离散的GOP之间的量化参数(QP)差，使得维持所述离散的GOP之间的一致的编码质量的部件。
3.根据权利要求2所述的装置，其中所述限制部件通过维持所述编码器示例之间的静态全局变量和公用变量中的至少一个限制所述QP差，所述QP差追踪所述编码器示例之间的平均QP。
4.根据权利要求1所述的装置，还包括多路复用器(160)，用于在GOP编码结束后将所述离散的GOP中的画面重新排序为序列顺序。
5.根据权利要求4所述的装置，其中所述多路复用器(160)使用画面级别和GOP级别中至少一个的序列数目和时间戳中的至少一个将所述画面重新排序。
6.根据权利要求1所述的装置，其中向编码器示例提出的每个所述离散的GOP的第一帧被编码为瞬时解码刷新(IDR)帧，使得每个所述编码器示例能够相对于彼此独立地操作。
7.一种用于使在多个处理器上进行的视频编码处理并行的方法，包括以下步骤：
基于线程亲和性和进程亲和性中的至少一个将编码器示例分配(205)给所述多个处理器中各自的一个处理器；以及
按时间将进入的视频序列分为(210)离散的画面组(GOP)，使得每个所述离散的GOP在所述多个处理器中各自的一个处理器上被编码。
8.根据权利要求7所述的方法，还包括以下步骤：限制(211)所述离散的GOP之间的量化参数(QP)差，使得在所述离散的GOP之间维持一致的编码质量。
9.根据权利要求8所述的方法，其中所述限制步骤(211)通过维持所述编码器示例之间的静态全局变量和公用变量中的至少一个限制所述QP差，所述QP差追踪所述编码器示例之间的平均QP。
10.根据权利要求7所述的方法，还包括以下步骤：在GOP编码结束后，将所述离散的GOP中的画面重新排序成序列顺序。
11.根据权利要求10所述的方法，其中所述重新排序的步骤(215)使用画面级别和GOP级别中至少一个的序列数目和时间戳中的至少一个将所述画面重新排序。
12.如权利要求7所述的方法，其中向所述编码器示例提出的每个所述离散的GOP的第一帧被编码为瞬时解码刷新(IDR)帧，使得每个所述编码器示例能够相对于彼此独立地操作。
13.一种用于使在多个处理器上进行的视频编码处理并行的装置，包括：
计算资源均衡器(199)，用于基于线程亲和性和进程亲和性中的至少一个将编码器示例分配给所述多个处理器中各自的一个处理器；以及
分解器(145)，用于按空间将所述进入的视频序列分为离散的片段，使得每个所述编码器示例能够对进入的视频序列并行地编码，使得每个所述离散的片段在所述多个处理器中各自的一个处理器上被编码。
14.根据权利要求13所述的装置，还包括用于限制所述离散的片段之间的量化参数(QP)差，使得在所述离散的片段之间维持一致的编码质量的部件。
15.根据权利要求14所述的装置，其中所述限制部件通过维持所述编码器示例之间的静态全局变量和公用变量中的至少一个限制所述QP差，所述QP差追踪所述编码器示例之间的平均QP。
16.一种用于使在多个处理器上进行的视频编码处理并行的方法，包括以下步骤：
基于线程亲和性和进程亲和性中的至少一个将编码器示例分配(305)给所述多个处理器中各自的一个处理器；以及
按空间将所述进入的视频序列分为(310)离散的片段，使得每个所述编码器示例能够对进入的视频序列并行地编码，使得每个所述离散的片段在所述多个处理器中各自的一个处理器上被编码。
17.根据权利要求16所述的方法，还包括以下步骤：限制(311)所述离散的片段之间的量化参数(QP)差，使得在所述离散的片段之间维持一致的编码质量。
18.根据权利要求17所述的方法，其中所述限制步骤(311)通过维持所述编码器示例之间的静态全局变量和公用变量中的至少一个限制所述QP差，所述QP差追踪所述编码器示例之间的平均QP。
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