CN101038563A - 一种通过网络远程自动恢复cmos数据的方法和装置 - Google Patents

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Abstract

本发明公开了一种计算机远程恢复CMOS数据的方法和系统，其中所述系统包括BMC、一个用于存储备份的CMOS数据的第一存储器、用于清除CMOS RAM中的CMOS数据的CMOS清除电路，该方法包括如下步骤：远端控制台向BMC发出清除CMOS数据的指令；BMC控制CMOS清除电路清除CMOS RAM中的CMOS数据；计算机启动时，BIOS将所述第一存储器中的CMOS数据写入到所述CMOS RAM中。利用本发明的方案，可以远程自动恢复CMOS数据，使CMOS数据的恢复简单易行。

Description

一种通过网络远程自动恢复CMOS数据的方法和装置
技术领域
本发明涉及一种恢复CMOS数据的方法和装置，尤其涉及一种通过网络远程自动恢复CMOS数据的方法和装置。
背景技术
由于用户在使用计算机的过程中产生的误操作，或者受病毒的攻击，经常会导致CMOS中保存的信息混乱或丢失。而由此带来的开机无显示的故障率也非常高，通过对联想维修数据的统计可知，在全部维修量中占到了5％。由于大部分个人电脑用户的使用水平不足以完成通过跳线的方式清除CMOS中的数据，并恢复其初始值，因此，由于该问题导致的上门服务增加了计算机厂家和用户的维护费用，同时还会降低用户的满意度。
虽然目前已有若干专利提供了免跳线的方式清除CMOS的方法，但是，这些方案都只能在用户现场操作，而且在操作中仍然需要技巧性的工作。在易用性上仍然存在缺陷。
发明内容
本发明的目的就是提供一种可以远程自动恢复CMOS数据的方法和装置，使CMOS数据的恢复简单易行。本发明采用如下技术方案实现本发明的目的：
本发明提供一种计算机远程恢复CMOS数据的方法，其中所述计算机包括基板管理控制器BMC和一个用于存储备份的CMOS数据的第一存储器，该方法包括如下步骤：
1)远端控制台向BMC发出清除CMOS数据的指令；
2)BMC控制CMOS清除电路清除CMOS RAM中的CMOS数据；
3)当计算机启动时，基本输入输出系统BIOS如果检测到所述CMOSRAM中的CMOS数据被清除，则将所述第一存储器中的CMOS数据写入到所述CMOS RAM中。
所述清除CMOS RAM中的CMOS数据的步骤包括将CMOS RAM中的某个管脚的电位拉低。
所述将CMOS RAM中的某个管脚的电位拉低的步骤包括用BMC将一个管脚置位，该管脚使得一个开关导通，从而使CMOS RAM中的某个管脚上的电压降低。
所述第一存储器中的CMOS数据是预先烧制在所述存储器中的。
所述CMOS RAM为计算机南桥芯片ICH中的内置静态存储器或专用CMOS存储器。
本发明还提供一种计算机系统，包括基板管理控制器BMC和基本输入输出系统BIOS，其特征在于，该系统还包括第一存储器和CMOS清除电路；
所述第一存储器，用于存储备份的CMOS数据；
所述CMOS清除电路，用于清除CMOS RAM中的CMOS数据；
所述BMC，能够控制所述CMOS清除电路清除所述CMOS RAM中的CMOS数据，
所述BIOS，在计算机启动时，如果检测到所述CMOS RAM中的CMOS数据被清除，则将所述第一存储器中的CMOS数据写入到所述CMOS RAM中。
所述CMOS清除电路包括一个能将所述CMOS RAM的一个管脚的电压拉低以清除CMOS数据的电路。
所述将CMOS RAM的一个管脚的电压拉低的电路包括一个第一开关，所述BMC可以控制所述第一开关处于导通或断开。
所述将CMOS RAM的一个管脚的电压拉低的电路还包括一个第二开关，所述第二开关在所述计算机处于启动状态时为断开，在关机状态时为导通。
所述将CMOS RAM的一个管脚的电压拉低的电路还包括一个手动开关，该手动开关为断开状态时，使得CMOS清除电路无法清除CMOS。
应用本发明的上述技术方案，当计算机因为CMOS数据混乱而不能启动时，或系统管理员需要重新恢复CMOS中的初始数据时，可以通过网络，由一台远程放置的客户端(远端控制台)与被控制计算机的网络芯片取得联系，发送清除CMOS信息和重置CMOS初始数据的指令。
当清除CMOS数据的操作完成后，由控制电路给客户端发送信息，表示远程清除CMOS数据的动作已经完成。然后，再由客户端发出启动计算机的指令，让被控计算机启动时恢复CMOS数据。
附图说明
图1为本发明的计算机系统结构图；
图2为本发明中的清除CMOS的执行电路图。
具体实施方式
本发明基于基板管理控制器BMC为核心的符合IPMI协议(IPMI2.0)的管理架构，当然也可以通过其他的智能芯片搭建。在本发明的实施例中采用BMC架构完成带外的CMOS清除。参考图1，本发明在现有技术方案的基础上增加了第一存储器和CMOS清除电路，BMC通过SMBUS(System ManagementBus)连接一个带外NIC(网络芯片，或称网卡控制器)，通过此NIC可以实现同控制台建立带外的网络连接。其中BMC和NIC等均是现有技术，所述CMOS清除电路与BMC的管脚和ICH(南桥芯片)连接，MCH和ICH的连接符合IA(intel architechture)架构(英特尔架构)，而ICH、BMC和第一存储器是通过LPC总线连接。
该第一存储器可以为非易失性存储器，如FLASH存储器，用于存储备份的BIOS设置(CMOS数据)，该BIOS设置相当于一种缺省BIOS设置，可以预先烧制在该第一存储器中。其中，在本实施例中采用ICH芯片中的内部静态存储器作为CMOS RAM(互补金属氧化物半导化随机存储器)，用于存储CMOS数据(BIOS设置)，通常CMOS数据存储在主板的南桥芯片里，容量只有256个字节。当然，也可以采用专门的CMOS RAM作为存储CMOS数据的存储芯片，同样可以利用本发明的CMOS清除电路对CMOS RAM进行放电来轻易清除CMOS数据；在计算机处于关机状态时，由5VSB(5V常被电压)提供电源，保证BMC通过NIC与远端的控制台进行正常通信。
在本实施例中，通过设计一个OEM IPMI命令clearcmos，在远端控制台向计算机的BMC发出清除CMOS RAM(本实施例中CMOS RAM为ICH芯片中的内部静态存储器)中的CMOS数据的命令(clear cmos)，计算机的BMC接受此命令后进行解析，从用于控制CMOS清除电路的一个管脚(GPIO管脚)输出控制信号，该控制信号控制CMOS清除电路清除在ICH芯片中的内部静态存储器中保存的CMOS数据。
下面结合图2中的CMOS清除电路说明BMC执行清除CMOS的原理。为了实现在电脑关机状态清除CMOS数据，本发明的CMOS清除电路设计有带电保护电路，使用户在计算机启动的情况下无法清除CMOS数据，图2中的电磁开关K1当计算机在启动状态，由5V电源使得开关K1常开，使得无法清除CMOS数据。为此，必须选择能够代表220V电源保持连接状态的信号，本案中选择5V电源。5V电源是计算机电源在计算机处于启动状态时，220V电源提供输出的电源。同时220V电源还提供5VSB(5V常备电源)，它同其他电源输出如3V、5V和12V不同，为单独输出，如果5VSB没有输出，那么可以表明没有提供电源220V电源，该5VSB用于为BMC和NIC等提供电源。
为说明5VSB和220W电源之间的关系，简要解释ATX电源规格。该规格是由Intel公司提出的，被广泛应用的工业标准。以ATX电源为例，其常备电源(standby power)5VSB为一个直流5V的电源，最大可以提供0.7A(安培)的输出电流，以便在系统关机的状态下驱动电脑系统中的基本电源管理。而本发明就是利用此类可提供主要电源和备用电源的电源装置来完成远程清除CMOS数据。
ICH(计算机南桥芯片)内部静态存储器中的CMOS数据的保持和清除是通过两个管脚来管理的：ICH芯片的管脚VCCRTC是内部静态存储器的供电脚，只要电压高于2V就可以维持住内部静态存储器存储的内容，但是ICH芯片并不允许直接将VCCRTC管脚拉低到2V以下的方式来清除CMOS设置。清除CMOS设置需要通过ICH芯片的另外一个管脚RTCRST，只要将RTCRST管脚拉低到低电平有效，那么ICH就会清除掉其内部静态存储器中的内容，达到清除CMOS数据的目的。
在图2中，ICH芯片的静态存储器的VCCRTC管脚的供电是由电池和3.3VSB共同完成的。在开机状态以及连接交流220V电源关机状态下，3.3VSB都是存在的，该3.3V常备电压是由5VSB常备电压经过电压调制而来的，在3.3VSB存在的情况下，ICH芯片内部静态存储器的电源由3.3VSB提供。当拔掉电源插座的时候，就不存在3.3VSB了，此时ICH芯片内部静态存储器由CMOS电池提供，这样就保证了任何情况下CMOS数据都不会丢失。图2中二极管D1和D2用于将3.3VSB电源与CMOS电池隔离。
如果需要清除CMOS设置内容，只需要将RTCRST管脚的电压拉低到低电平有效的即可。图中R1、R2、R4均为限流电阻，通过限流电阻R4将电容C1中的电荷放掉即可将RTCRST管脚的电压拉低到低电平。阻值的设定是本领域普通技术人员的基本技能，这里就不再详述；为了保证用户在开机情况下避免执行COMS清除动作，本发明通过一个电磁开关K1来保证，参考图2。电磁开关K1为一个常闭电磁开关，在开机状态220V电源产生5V电源，5V电源通过串联一限流电阻R3为电磁开关K1供电，电磁开关处于断开的状态，这样即使由BMC控制的电磁开关K2和手动开关K3都导通，也不会泄放电容C1的电荷，从而保证RTCRST管脚电压始终为高，不会执行CMOS数据的清除动作。除非在关机的情况下，开关K1和K3都导通，通过远端控制台向计算机的BMC发送清除CMOS数据的指令，BMC根据该指令产生一个GPIO信号，该GPIO信号施加到电磁开关K2上(BMC的一个GPIO管脚与电磁开关K2的一个控制端连接，产生一个GPIO信号就是将该GPIO管脚置位，产生一个控制电压)，使电磁开关K2导通，才能泄放电容C1的电荷，拉低RTCRST管脚的电平，执行CMOS清除动作。这里开关K2为常开的开关，而且也可以在开关K2上串联一个限流电阻，该GPIO信号通过这个限流电阻施加到开关K2上。这里设置一个手动开关K3是为了防止非法清除CMOS数据的又一层保障，对于开关K1和K3并不是必需的，仅仅是为了更加安全起见才设置的开关，没有这两个开关，同样可以清除CMOS数据，只是这样操作时要更加小心，防止误操作。
通过以上分析，BMC执行清除CMOS的命令就好理解了，可以选择BMC上一个GPIO管脚，连接到电磁开关K2的控制端，在接受到清除CMOS的命令后，BMC置位该GPIO管脚(相当于GPIO信号)，从而使电磁开关K2闭合，从而达到清除CMOS的动作。清除完CMOS数据后，BMC可以给远端控制台发送信息，表示远程重置CMOS数据的动作已经完成，这样，远端控制台就可以控制计算机重新启动了。
上面描述了CMOS数据的清除，下面描述CMOS数据的恢复，在本发明中同要需要对基本输入输出系统(BIOS)进行改进，计算机的启动过程都是由BIOS程序控制的，在启动过程中，BIOS会检测CMOS数据的状态，如果检测到ICH中的CMOS数据被清除，则自动从第一存储器将BIOS设置(CMOS数据)导入到ICH中的静态存储器中。这样，CMOS数据就得到了恢复，计算机也能正常工作了。
上述实施例采用的将CMOS数据存储在ICH芯片中的内部静态存储器中，当然，也可以采用专门的CMOS RAM(互补金属氧化物半导化随机存储器)作为存储CMOS数据的存储芯片，在该芯片中同样具有供电管脚和可以采用拉低电位释放CMOS数据的管脚，也可以与ICH芯片的内部静态存储器不同，采用拉低供电管脚电位的方式来清除CMOS数据，对于用于拉低管脚电位的方法和电路都是一些非常普通的方法和电路，本领域普通技术人员可以通过实际情况不需要花费创造性的劳动就可以利用各种泄流电路来完成拉低存储器管脚的电位，这里就不再一一例举了。
对于由BIOS控制将一个存储器中的数据写入到ICH芯片中的内部静态存储器或专门的CMOS RAM存储器中的技术都可以通过软件来实现，本领域普通技术人员不需要花费创造性的劳动就能实现，这里就不需要详细的描述了，本发明要旨在于通过远端控制台的控制来清除CMOS RAM中的CMOS数据，然后将预先存储在一个专门的存储器中BIOS设置写入到CMOS RAM中，达到恢复CMOS数据的目的。
上述实施例中开关K1和K2采用了电磁开关，但是并不限于此，还可以采用本领域技术人员所熟知的电子开关。上述实施例中采用了电容C1，但是本领域技术人员明白，只要限流电阻设置的合理，不需要电容C1，甚至可以不需要限流电阻R4，同样可以拉低RTCRST管脚的电平，以实现清除CMOS数据的目的。
以上所述仅是本发明的优选实施方式，应当指出，对于本技术领域的普通技术人员来说，在不脱离本发明原理的前提下，还可以作出若干改进和润饰，这些改进和润饰也应视为本发明的保护范围。

Claims (13)

1.一种计算机远程恢复CMOS数据的方法，其中所述计算机包括基板管理控制器BMC和一个用于存储备份的CMOS数据的第一存储器，该方法包括如下步骤：
1)远端控制台向BMC发出清除CMOS数据的指令；
2)BMC控制CMOS清除电路清除CMOS RAM中的CMOS数据；
3)当计算机启动时，基本输入输出系统BIOS如果检测到所述CMOSRAM中的CMOS数据被清除，则将所述第一存储器中的CMOS数据写入到所述CMOS RAM中。
2.根据权利要求1中所述的计算机远程恢复CMOS数据的方法，其特征在于，所述清除CMOS RAM中的CMOS数据的步骤包括将CMOS RAM中的某个管脚的电位拉低。
3.根据权利要求2中所述的计算机远程恢复CMOS数据的方法，其特征在于，所述将CMOS RAM中的某个管脚的电位拉低的步骤包括用BMC将一个管脚置位，该管脚使得一个开关导通，从而使CMOS RAM中的某个管脚上的电压降低。
4.根据权利要求1至3中任一项所述的计算机远程恢复CMOS数据的方法，其特征在于，所述第一存储器中的CMOS数据是预先烧制在所述存储器中的。
5.根据权利要求1至3中任一项所述的计算机远程恢复CMOS数据的方法，其特征在于，所述CMOS RAM为计算机南桥芯片ICH中的内置静态存储器或专用CMOS存储器。
6.根据权利要求4所述的计算机远程恢复CMOS数据的方法，其特征在于，所述CMOS RAM为计算机南桥芯片ICH中的内置静态存储器或专用CMOS存储器。
7.一种计算机系统，包括基板管理控制器BMC和基本输入输出系统BIOS，其特征在于，该系统还包括第一存储器和CMOS清除电路；
所述第一存储器，用于存储备份的CMOS数据；
所述CMOS清除电路，用于清除CMOS RAM中的CMOS数据；
所述BMC，能够控制所述CMOS清除电路清除所述CMOS RAM中的CMOS数据，
所述BIOS，在计算机启动时，如果检测到所述CMOS RAM中的CMOS数据被清除，则将所述第一存储器中的CMOS数据写入到所述CMOS RAM中。
8.根据权利要求7所述的计算机系统，其特征在于，所述CMOS清除电路包括一个能将所述CMOS RAM的一个管脚的电压拉低以清除CMOS数据的电路。
9.根据权利要求8所述的计算机系统，其特征在于，所述将CMOS RAM的一个管脚的电压拉低的电路包括一个第一开关，所述BMC可以控制所述第一开关处于导通或断开。
10.根据权利要求9所述的计算机系统，其特征在于，所述将CMOS RAM的一个管脚的电压拉低的电路还包括一个第二开关，所述第二开关在所述计算机处于启动状态时为断开，在关机状态时为导通。
11.根据权利要求9所述的计算机系统，其特征在于，所述将CMOS RAM的一个管脚的电压拉低的电路包括一个手动开关，该手动开关为断开状态时，使得CMOS清除电路无法清除CMOS。
12.根据权利要求7至12中任一项所述的计算机系统，其特征在于，所述CMOS RAM为计算机南桥芯片ICH中的内置静态存储器或专用CMOS存储器。
13.根据权利要求10所述的计算机系统，其特征在于，所述将CMOSRAM的一个管脚的电压拉低的电路包括一个手动开关，该手动开关为断开状态时，使得CMOS清除电路无法清除CMOS。
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