BRPI0607484B1

BRPI0607484B1 - método, aparelho e sistema para a produção de uma pluralidade de símbolos coerentes a partir de uma pluralidade de transmissores de rf digitais

Info

Publication number: BRPI0607484B1
Application number: BRPI0607484A
Authority: BR
Inventors: Simon Michael
Original assignee: Rohde & Schwarz
Priority date: 2005-03-02
Filing date: 2006-03-01
Publication date: 2020-02-04
Also published as: CA2598125A1; MX2007010577A; WO2006094053A2; CA2597689A1; EP1854283A4; US7532677B2; KR101152307B1; KR20070108166A; US7738582B2; US20070223612A1; EP1854283A2; WO2006094050A2; EP1854292A4; WO2006094050A3; US20060200852A1; EP1854292A2; BRPI0608253B1; BRPI0607484A2; BRPI0608253A2; KR20070106695A

Abstract

aparelhos, sistemas e métodos para a produção de símbolos coerentes em uma rede de freqüência única. a presente invenção refere-se um sistema, um método, um aparelho de um código de computador são providos para a produção de simbolos coerentes a partir de transmissores de rf digitais. um receptor recebe um primeiro pacote de inicialização que contém uma pluralidade de bytes de enchimento e codificadores de trellis são inicializados de forma determinística usando-se o primeiro pacote de inicialização.

Description

Relatório Descritivo da Patente de Invenção para MÉTODO, APARELHO E SISTEMA PARA A PRODUÇÃO DE UMA PLURALIDADE DE SÍMBOLOS COERENTES A PARTIR DE UMA PLURALIDADE DE TRANSMISSORES DE RF DIGITAIS.

REFERÊNCIA CRUZADA A PEDIDOS RELACIONADOS [001] Este pedido reivindica prioridade para e o benefício do Pedido de Patente Provisória U.S. N° de Série 60/657.416, depositado em 2 de março de 2005, e no Pedido de Patente Provisória U.S. N° de Série 60/740.424, depositado em 29 de novembro de 2005, ambos os quais são desse modo incorporados aqui como referência em sua totalidade.

ANTECEDENTES DA INVENÇÃO

Campo da Invenção [002] A presente invenção refere-se geralmente a redes de frequência única (SFNs) que usam uma multiplicidade de transmissores e, mais particularmente, a uma tecnologia para a produção de símbolos coerentes para implementação de SFNs.

Técnica Relacionada [003] Uma rede de frequência única (SFN) é uma coleção de transmissores operando à mesma frequência para o transporte da mesma informação para receptores em uma dada área. Os transmissores emitem sinais idênticos, vários dos quais podendo ser recebidos mais ou menos simultaneamente por receptores individuais. Uma vantagem do uso de múltiplos transmissores ao invés de um transmissor potente é que múltiplos transmissores provêem percursos alternativos para o sinal entrar em uma estrutura, tal como uma casa, desse modo se provendo melhor recepção. Em áreas montanhosas, por exemplo, pode ser difícil encontrar uma localização capaz de servir a todos os centros populacionais na área, uma vez que frequentemente eles estão localizados em vales. Múltiplos transmissores podem ser estrategi

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2/25 camente posicionados para cobrirem tais áreas pequenas e preencher os espaços.

[004] Uma aplicação de SFNs é para a transmissão de dados codificados digitalmente, tal como uma televisão digital (DTV), o sistema e os padrões relacionados para os quais foram estabelecidos pelo Advanced Television Systems Committee (ATSC). Sob o padrão de DTV do ATSC (ou padrão A/53), incorporado aqui como referência em sua totalidade, é possível transmitir grandes quantidades de dados, incluindo imagens de alta definição, som de alta qualidade, imagens de definição de padrão múltiplas e outras comunicações relacionadas associadas ou não relacionadas, os quais podem ser acessíveis pelo uso de um computador ou de um aparelho de televisão.

[005] O padrão de DTV inclui as camadas a seguir: a camada de vídeo / áudio, a camada de compressão, a camada de transporte e a camada de transmissão. No topo da hierarquia está o sinal digital não comprimido em um dos vários formatos de dados digitais (por exemplo, formatos de vídeo / áudio). O fluxo de dados que corresponde à camada de vídeo / áudio é conhecido como o fluxo elementar.

[006] A camada de compressão comprime o fluxo elementar em um fluxo de bit com uma taxa de dados mais baixa. No padrão de DTV do ATSC, uma compressão de MPEG-2 é usada para o vídeo e uma compressão de Dolby AC-3 é usada para o áudio. O fluxo de bit comprimido, por sua vez, pode ser empacotado e multiplexado com outros fluxos de bit em um fluxo de bit digital de taxa de dados mais alta na camada de transporte por um multiplexador. O protocolo de transporte de MPEG-2 define (dentre várias outras coisas) como empacotar e multiplexar pacotes em um fluxo de transporte de MPEG-2. O resultado é um fluxo de pacotes de dados altamente comprimidos em um fluxo de bit multiplexado, o qual pode incluir múltiplos programas e/ou múltiplos sinais de dados.

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3/25 [007] O fluxo de bit multiplexado a partir da camada de transporte é modulado em uma portadora de rádio frequência (RF) na camada de transmissão por um sistema de transmissão. O modo de difusão terrestre utilizado no padrão de DTV do ATSC atual para a transmissão de sinais digitais pelas ondas do ar é denominado a banda lateral vestigial Codificada por treliça de oito níveis (8T-VSB).

[008] A Figura 1 é um diagrama de blocos de um transmissor de

8T-VSB codificado por treliça bem-conhecido 100 usado em um sistema de transmissão de RF. O transmissor recebe os pacotes de dados chegando de vídeo, áudio e dados auxiliares entremeados, e, usando um randomizador de dados 102, randomiza os dados para produzir um espectro tipo de ruído plano. Um codificador de Reed-Solomon (RS) 104, conhecido por sua boa capacidade de correção de ruído de rajada e eficiência de tempo requerido para processamento de dados, codifica por RS os dados randomizados para adicionar bits de paridade ao final de cada pacote de dados. Por sua vez, os dados são entrelaçados de forma convoluta (isto é, propagados) pode muitos segmentos de dados por um entrelaçador de dados de byte 106.

[009] Um pré-codificador e um codificador de treliça 108 (referido no relatório descritivo a partir deste ponto como um codificador de treliça) adicionam uma redundância adicional ao sinal na forma de múltiplos níveis de dados, criando símbolos de dados de múltiplos níveis para transmissão. Um componente de inserção de sincronização 110 multiplexa as sincronizações de segmento e de quadro com os símbolos de dados de múltiplos níveis, antes de um deslocamento CC ser adicionado por um componente de inserção de piloto 112, para a criação de um piloto em fase de nível baixo. As sincronizações de segmento e de quadro não são entrelaçadas. Um modulador de VSB 114 provê um sinal de frequência intermediária (IF) filtrado a uma frequência padrão, com a maioria de uma banda lateral removida. Finalmente,

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4/25 um conversor para cima de RF 116 translada o sinal para o canal de RF desejado.

[0010] Uma propagação de percurso múltiplo é um problema comum em ambientes de difusão de transmissor único, porque ela impõe uma carga na capacidade de um equalizador de receptor de lidar com ecos de sinal. Em um sistema de transmissão distribuído, onde múltiplos transmissores são utilizados, o problema de propagação de percurso múltiplo é composto. É necessário, portanto, sincronizar ou ajustar o sincronismo do sistema de SFN para controle da dispersão de atraso vista pelos receptores em áreas de percurso múltiplo induzido de SFN para não exceder à faixa de manipulação de atraso de equalizadores de receptor e se tornar problemático.

[0011] Além disso, a extração de símbolos de cada transmissor é baseada no fluxo de transporte recebido, em como isto então é mapeado em um Quadro de Dados e seus estados iniciais dos codificadores de treliça, os quais são normalmente randômicos. Quando os transmissores emitem os mesmos símbolos que um outro para as mesmas entradas de dados, eles são ditos como sendo tornados coerentes. Se os transmissores em um SFN não forem sincronizados, eles não emitirão símbolos coerentes.

[0012] O ATSC promulgou um padrão, referido como o padrão

A/110, o qual provê regras para a sincronização de múltiplos transmissores emitindo sinais de 8T-VSB codificados por treliça em uma SFN ou um sistema de transmissão distribuída (DTx) para a criação de uma condição a qual permite que múltiplos transmissores sejam alimentados pelo mesmo fluxo de transporte para a produção de símbolos coerentes. SFN e DTx devem ser compreendidos como sendo termos sinônimos. O padrão A/110 desse modo é incorporado aqui como referência em sua totalidade.

[0013] A Figura 2 mostra um diagrama de blocos de um sistema

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5/25 de SFN de ATSC 200 que usa uma transmissão distribuída A/110 (DTx). O sistema de SFN 200 inclui três elementos: uma referência de tempo e frequência externa (mostrada como GPS), um adaptador de transmissão distribuído (DTxA) 202 situado na extremidade de origem do subsistema de distribuição (ou enlace de estúdio para transmissor (STL)), e sistemas de transmissão de RF plurais 208. O DTxA inclui dois blocos básicos: um insersor de sincronização de transmissor 206 e um modelo de processamento de dados 204. O insersor de sincronização de transmissor 206 insere uma informação (descrita em maiores detalhes abaixo) no fluxo de transporte (TS). O modelo de processamento de dados 204 é um modelo do processamento de dados em um modulador de ATSC, o qual serve como uma referência mestra para os blocos de processamento de dados sincronizados escravizados 210 nos sistemas de transmissão de RF 208. Geralmente, cada sistema de transmissão de RF 208 inclui dois blocos: um bloco de processamento de dados sincronizados 210 e um bloco de processamento de sinal e amplificação de potência 211, os quais coletivamente são referidos às vezes como um modulador 212. Estes estágios de nível baixo do transmissor também são referidos geralmente como o componente excitador. Aqui, os termos excitador e modulador são usados de forma intercambiável.

[0014] Em um sistema de SFN de ATSC, cada bloco de processamento de dados sincronizado 210 também inclui um transmissor de 8T-VSB codificado por treliça 100 discutido acima com referência à Figura 1. Conforme mostrado na Figura 2, o DTxA produz um fluxo de transporte (TS) e alimenta este fluxo para todos os blocos de processamento de dados sincronizados 210.

[0015] A Figura 3 mostra a estrutura de um pacote de transmissão distribuído de acordo com o padrão A/110, e a Figura 4 descreve um quadro de dados de VSB, o qual inclui pacotes de dados e uma corre

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6/25 ção de erro antecipada (FEC) e campos de sincronização de campo de dados (DFS).

[0016] O padrão A/110 requer que os três elementos de sistema de ATSC a seguir sejam sincronizados: 1. sincronização de frequência do piloto ou de frequências portadoras, 2. sincronização de quadro de dados, e 3. sincronização de pré-codificador e codificador de treliça (codificador de treliça). Uma descrição de como estes três elementos são sincronizados em um grupo de transmissores localizados separadamente se segue.

[0017] De acordo com padrão A/110, um controle de duas frequências de transmissor específicas é requerido. Em primeiro lugar, a frequência RF do sinal transmitido, conforme medido pela frequência de seu piloto, deve ser controlada de forma acurada para manutenção de frequências dos transmissores próximas o bastante umas das outras para que o receptor não seja sobrecarregado com um deslocamento de Doppler aparente entre os sinais. A frequência de temporizador de símbolo deve ser controlada de forma acurada, para se permitir que o fluxo de símbolo de saída se mantenha estável em relação a desvios de tempo entre transmissores em uma rede. Um indicador, stream_locked_flag, na estrutura de pacote de DTxP é usado para a identificação de uma de duas opções para a realização de uma sincronização de frequência de símbolo. Este indicador é um campo de 1 bit que indica para um transmissor escravo se é para travar sua frequência de temporizador de símbolo para a frequência de temporizador de fluxo de transporte chegando (metodologia de ATSC normal) ou travar sua frequência de temporizador de símbolo para a mesma frequência de referência de precisão externa usada por toda a rede (por exemplo, GPS).

[0018] Uma sincronização de quadro de dados requer que todos os moduladores escravos 212 em uma SFN usem o mesmo pacote de

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7/25 fluxo de transporte (TS) para se começar um quadro de dados de VSB (Figura 4). No padrão A/110 do ATSC atual, isto é realizado usando-se o DTxA 202 pela inserção de um sinal de cadência. Em particular, um sinal de cadência (CS) é inserido em um ponto determinístico no tempo, uma vez a cada 624 pacotes, no fluxo de transporte de MPEG-2 a partir do DTxA para cada um dos moduladores 212. Dividir a taxa de CS à metade produz uma Sincronização de Campo de Dados (DFS). O padrão A/53 especifica que o randomizador de dados 102, o codificador de RS 104, e um entrelaçador 106 e um entrelaçador intrasegmento em parte de 108 nos blocos de processamento de dados sincronizados escravos 210 devem ser todos escravizados para DFS.

[0019] Além disso, o padrão A/110 provê que é necessário desenvolver uma condição de estado para que as memórias de codificador de treliça sejam aplicadas em uma época específica no fluxo de dados simultaneamente por todos os sistemas de transmissão de RF 208 em uma rede. De acordo com o padrão A/110, de modo a se colocarem os pré-codificadores e os codificadores de treliça de todos os transmissores em uma rede no mesmo estado ao mesmo tempo, é necessário 'sincronizá-los por congestionamento' (jam sync) em relação ao modelo de codificador de treliça no Adaptador de Transmissão Distribuído. Em outras palavras, os codificadores de treliça não podem ser sincronizados pela identificação de uma época no fluxo de transporte (TS). Ao invés disso, para se colocarem os codificadores de treliça de todos os transmissores em uma rede nos mesmos estados ao mesmo tempo, uma amostra de todos os estados de codificador de treliça no modelo de processamento de dados 204 é capturada, e estes dados são portados em um elemento do DXP, treliça_code_state (Figura 3), a partir do DTxA 202 para todos os moduladores escravos 212.

[0020] Em um ponto no tempo posterior determinístico, os estados de código de treliça que foram extraídos do DXP são usados para ini

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8/25 cialização da memória de cada codificador de treliça nos moduladores escravos 212 para o estado do modelo de processamento de dados 204 no DTxA 202. Uma vez que isso tenha sido realizado, os codificadores de treliça de modulador são sincronizados, e todos os moduladores 212 devem produzir símbolos coerentes. Além disso, o DTxA indica um modo de operação para os transmissores e provê uma informação a ser transmitida no segmento de dados de sincronização de campo de dados através de um canal de lado de taxa de campo, o qual porta uma informação atualizada regularmente em uma taxa de campo de dados.

[0021] O método usado pelo padrão A/110 para a obtenção de sincronização de codificador de treliça adiciona muita complexidade ao sistema de transmissão distribuído de SFN geral ao requerer que o DTxA 202 amostre os estados de codificador de treliça de modelo de processamento de dados. Mais ainda, o A/110 não provê a capacidade de pós-processar dados no modulador uma vez que eles saiam do DTxA. Uma mudança de um bit no fluxo de dados após um DTxA romperá o esquema de sincronização de codificador de treliça, desse modo tornando difícil, se não impossível, adicionar melhoramentos ao padrão A/53 de ATSC. Mais ainda, conforme mais transmissores são adicionados em um esquema de múltiplos níveis (por exemplo, translador distribuído), a complexidade de uma SFN sob o padrão A/110 cresce, uma vez que um modelo de processamento de dados adicional 204 deve ser adicionado para cada nível. Assim, o que é necessário é uma tecnologia que seja escalonável em aplicações de SFN, sem a adição de complexidade adicional ou restrições na capacidade de extensão de sistema do sistema em geral.

[0022] Dado o precedente, o que é necessário é um sistema, um método e um produto de programa de computador para aparelhos, sistemas e métodos para a produção de símbolos coerentes em uma rePetição 870190046990, de 20/05/2019, pág. 14/70

9/25 de de frequência única.

BREVE DESCRIÇÃO DA INVENÇÃO [0023] A presente invenção se adéqua às necessidades identificadas acima pela provisão de aparelhos, sistemas e métodos para a produção de símbolos coerentes em uma rede de frequência única.

[0024] Uma vantagem da presente invenção é que ela é compatível retroativa aos padrões existentes de ATSC e receptores de ATSC de legado.

[0025] Uma outra vantagem da presente invenção é que ela provê uma reinicialização de treliça determinística.

[0026] Ainda uma outra vantagem da presente invenção é que ela provê uma sincronização de VSB determinística e também pode fazêlo simultaneamente com a reinicialização de treliça determinística de uma maneira eficiente.

[0027] Em um aspecto da presente invenção, sistemas, métodos, aparelhos e um código de computador são providos para a produção de uma pluralidade de símbolos coerentes a partir de uma pluralidade de transmissores de RF digitais. Um receptor recebe um primeiro pacote de inicialização contendo uma pluralidade de bytes de enchimento e codificadores de treliça são utilizados de forma determinística usando-se o primeiro pacote de inicialização.

[0028] Outras características e vantagens da presente invenção, bem como a estrutura e a operação de várias modalidades da presente invenção são descritos em detalhes abaixo, com referência aos desenhos associados.

BREVE DESCRIÇÃO DOS DESENHOS [0029] Os recursos e vantagens da presente invenção tornar-se-ão mais evidentes a partir da descrição detalhada estabelecida abaixo, quando tomada em conjunto com os desenhos, nos quais números de referência iguais indicam elementos idênticos ou funcionalmente simiPetição 870190046990, de 20/05/2019, pág. 15/70

10/25 lares.

[0030] A Figura 1 é um diagrama de blocos de um transmissor de

8T-VSB codificado por treliça 100.

[0031] A Figura 2 mostra um diagrama de blocos de um sistema de SFN de ATSC usando uma transmissão distribuída de A/110, onde múltiplos transmissores de 8T-VSB codificados por treliça são alimentados pelo mesmo fluxo de transporte.

[0032] A Figura 3 mostra a estrutura de um pacote de transmissão distribuída de acordo com o padrão A/110.

[0033] A Figura 4 descreve um quadro de dados de VSB de acordo com o padrão A/53 do ATSC.

[0034] A Figura 5 é um diagrama de sistema de uma SFN de exemplo, de acordo com uma modalidade da presente invenção.

[0035] A Figura 6 ilustra um método para inserção de pacotes de inicialização de quadro de VSB (VFIPs) de acordo com uma modalidade da presente invenção.

[0036] A Figura 7 descreve uma estrutura de um pacote de inicialização de quadro de VSB (VFIP) de acordo com uma modalidade da presente invenção.

[0037] A Figura 8 é um diagrama de blocos de um entrelaçador de dados para entrelaçamento de um fluxo de transporte com VFIPs, de acordo com uma modalidade da presente invenção.

[0038] A Figura 9 é um diagrama de blocos de um comutador entrelaçador alimentando VFIPs entrelaçadas para codificadores de treliça, de acordo com uma modalidade da presente invenção.

[0039] A Figura 10 descreve a saída de um entrelaçador de byte de convolução contínuo de 52 segmentos de ATSC com um VFIP entrelaçado, de acordo com uma modalidade da presente invenção.

[0040] A Figura 11 mostra a estrutura de um VFIP de acordo com uma modalidade da presente invenção.

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11/25 [0041] A Figura 12 descreve linhas de tempo de sincronização de

SFN mostrando a sintaxe de sincronismo e a semântica para uma SFN de ATSC, de acordo com uma modalidade da presente invenção. DESCRIÇÃO DETALHADA [0042] A presente invenção é descrita agora, em maiores detalhes aqui, em termos de um sistema, um método e um aparelho de exemplo para a produção de símbolos coerentes em uma rede de frequência única. Isto é para conveniência apenas, e não é pretendido para limitar a aplicação da presente invenção. De fato, após a leitura da descrição a seguir, será evidente para alguém versado na(s) técnica(s) relevante(s) como implementar a invenção a seguir em modalidades alternativas (por exemplo, redes de frequência múltipla).

[0043] Geralmente, a presente invenção realiza as sincronizações de ATSC requeridas: 1. sincronização de frequência do piloto ou de frequências portadoras, 2. sincronização de quadro de dados, e 3. sincronização de pré-codificador e codificador de treliça.

[0044] Uma sincronização de frequência do piloto ou da portadora é obtida pelo travamento da frequência portadora de um excitador no sistema de transmissor de RF para uma referência a partir de uma base de tempo de GPS.

[0045] O começo de um quadro de dados é determinado (isto é, sincronizado) pela identificação de um ponto no fluxo de transporte através de um pacote de sincronismo especial. Geralmente, um fluxo de transporte (TS) tendo um pacote de sincronismo especial é gerado em uma instalação de difusão. A taxa de TS é travada para um temporizador de GPS (por exemplo, 10 MHz), e a referência temporal de GPS (por exemplo, 1 PPS) é usada para a construção do pacote de sincronismo. Os pacotes de sincronização identificam um ponto de época de cadência no TS, o qual é usado para a escravização de todos os quadros de dados a serem difundidos a partir de um ou mais

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12/25 sistemas de transmissão de RF, e, daí, prover uma sincronização de quadro de dados (DFS).

[0046] A presente invenção ainda provê uma inicialização determinística das memórias de codificador de treliça pela criação de pacotes com padrões de dados predeterminados localizados em posições determinísticas por todo um quadro de dados. Os padrões de dados predeterminados são transmitidos a partir de uma estação de difusão para um excitador para se fazer com que seus estados de codificador de treliça sejam inicializados de uma forma previsível fixa. Uma sincronização de quadro de dados e uma sincronização de codificador de treliça podem ocorrer, assim, usando-se um pacote de inicialização único.

[0047] A Figura 5 é um diagrama de sistema de uma SFN 500 de acordo com uma modalidade da presente invenção. Para um emissor de fluxo de transporte 514 em uma instalação de difusão, tal como um estúdio ou um centro de operações de rede (NOC) é alimentado um fluxo de dados (por exemplo, um quadro de dados de MPEG-2). O emissor de fluxo de transporte 514 transmite o fluxo de dados para uma rede de distribuição 506 na forma de um fluxo de transporte (TS) tendo pacotes de inicialização de quadro de VSB (VFIPs). Os VFIPs são pacotes de sincronização especializados gerados por um multiplexador de emissão 504 do emissor de fluxo de transporte 514. Em uma modalidade, um módulo VFIP dentro de um multiplxador de emissão 504 gera VFIPs. Em uma modalidade, um módulo de VFIP é transmitido para um ou mais sistemas de transmissão 502 através de uma rede de distribuição 506 (por exemplo, fibra, satélite, microondas e similares). Um multiplexador de emissão 504 tem o temporizador acertado por uma base de tempo de GPS 505.

[0048] Uma outra configuração de emissor de fluxo de transporte pode ser usada, ao invés do emissor de fluxo de transporte 514. O emissor de fluxo de transporte 508, por exemplo, provê instalações de

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13/25 difusão com a capacidade de uso de um multiplexador padrão 510 com um insersor de VFIP 509. Nesta configuração alternativa de emissor de fluxo de transporte, o emissor de fluxo de transporte 508 inclui uma unidade de insersor de VFIP externa 509 acoplada em termos comunicativos a um multiplexador padrão 510. Um fluxo de transporte (TS) com pacotes de VFIP é comunicado de forma similar a partir do emissor de fluxo de transporte 508 para sistemas de transmissão de RF 502 através da rede de distribuição 506.

[0049] Os sistemas de transmissão de RF 502 a jusante da instalação de difusão incluem um excitador 512, o qual pode detectar os VFIPs no fluxo de transporte. Além disso, os sistemas de transmissão de RF 502 incluem outros componentes, tais como amplificadores de potência (PAs) 513. Conforme citado acima, os excitadores às vezes são referidos como moduladores.

[0050] Em uma modalidade da presente invenção, o excitador 512, bem como todos os outros nós na SFN 500 têm o temporizador acertado por uma base de tempo comum, a base de tempo de GPS 505. Uma sincronização de frequência do piloto ou da portadora assim é obtido pelo travamento da frequência portadora do excitador 512 para uma referência de 10 MHz a partir da base de tempo de GPS 505, para a regulagem do deslocamento de Doppler aparente visto pelo receptor de ATSC a partir da SFN em áreas de cobertura sobrepostas.

[0051] A descrição a seguir de sincronização de quadro de dados e sincronização de codificador de treliça é aplicável a ambas as configurações de emissor de fluxo de transporte (514 e 508). Por conveniência, a descrição a seguir é em termos do multiplexador de emissão 504. Na discussão precedente, quando apropriado, os componentes correspondentes do emissor de fluxo de transporte 508 são identificados.

[0052] Conforme explicado acima, uma sincronização de dados

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14/25 requer que todos os excitadores em uma SFN escolham o mesmo pacote a partir do TS chegando para o começo de um quadro de dados de VSB. Na presente invenção, cada excitador 512 segue o sincronismo de sincronização do multiplexador de emissão 504 para a obtenção de uma sincronização de quadro inicial e manter esta condição.

[0053] O multiplexador de emissão 504 tem sua taxa de dados travada para a referência de GPS 505, e inicia uma sincronização de quadro pela seleção de um dos pacotes de TS para começar um quadro de VSB. Uma vez que um pacote de TS inicial tenha sido selecionado para começar a contagem, o multiplexador de emissão 504 conta 634 pacotes de TS, inclusive do pacote selecionado (por exemplo, 0 a 622), o multiplexador de emissão 504 insere um VFIP como o último (623) pacote. Isto corresponde a um recipiente de dados (624 pacotes) o qual é equivalente à carga útil em um quadro de VSB de A/53 de ATSC tendo 624 segmentos de carga útil.

[0054] O multiplexador de emissão 504 insere um pacote de inicialização de quadro de VSB (VFIP), conforme mostrado na Figura 6. Pelo posicionamento do VFIP no último intervalo de pacote (623), uma sinalização de um quadro de VSB é tornada implícita. Mediante a recepção do VFIP, cada excitador 512 é sinalizado para começar um novo quadro de dados, após o último bit de pacote de VFIP ser recebido. A cadência também referida como sincronismo ou taxa de quadro dos quadros de VSB, assim, é baseada no sincronismo de sincronização de quadro, o qual é mantido pelo multiplexador de emissão 504. Uma vez que o multiplexador de emissão 504 está travado para a base de tempo de GPS 505, a contagem de pacote de 0 a 623 se torna a cadência da taxa de quadro de VSB. Após a primeira inserção de VFIP, VFIPs adicionais podem ser inseridos subsequentemente depois disso, a uma periodicidade predeterminada (por exemplo, aproximadamente uma vez por segundo). Por exemplo, sempre que o multiple

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15/25 xador de emissão 504 inserir um VFIP, ele aparecerá no intervalo 623, conforme determinado por um contador de cadência em um multiplexador de emissão. Conforme descrito em maiores detalhes abaixo, parâmetros de sincronismo adicionais podem ser ajustados, com base em valores de campos em particular no VFIP.

[0055] O método de acordo com a presente invenção compreende a decodificação de correção de erro do pacote de inicialização. O aparelho de acordo com a invenção compreende um decodificador operável para uma decodificação de correção de erro do pacote de inicialização. Além disso, no sistema, de acordo com a invenção, o multiplexador ainda compreende um codificador operável para uma codificação de correção de erro do pacote de inicialização, e o modulador ainda compreende um decodificador operável para uma decodificação de correção de erro do pacote de inicialização.

[0056] A Figura 7 descreve a estrutura de um VFIP de acordo com uma modalidade da presente invenção. Conforme mostrado na Figura 7, o VFIP inclui um campo de identificador de pacote (PID) armazenado na porção de cabeçalho do pacote de VFIP. O excitador 512 identifica cada pacote por seu PID. Em uma modalidade de exemplo, o excitador 512 identifica um pacote como um VFIP quando seu valor de PID for 0x1FFA. Após o pacote de VFIP ter sido lido, o excitador 512 insere uma sincronização de campo de dados de VSB (DFS). Os segmentos de carga útil de quadro assim começam após a Sincronização de Campo de Dados N° 1. O excitador 512 por sua vez faz uma determinação quanto a se 312 pacotes de TS foram recebidos. Se assim for, o excitador 512 insere DFSs adicionais pelo padrão A/53.

[0057] Conforme descrito no padrão A/53 do ATSC, uma DFS inclui uma série de sequências de número pseudo-randômico (PN) de comprimento de 511, 63, 63 e 63 símbolos, respectivamente. As sequências PN63 são idênticas, exceto pelo fato de que a sequência

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16/25 média é de sinal oposto em cada outra sincronização de campo. Esta inversão permite que o receptor reconheça os campos de dados alternados compreendendo um quadro. Na Sincronização de Campo de Dados N° 1, todas as três sequências PN63 estão na mesma fase e na Sincronização de Campo de Dados N° 2, a sequência PN63 média está invertida e as outras duas têm a mesma fase. O excitador 512 insere uma DFS sem uma inversão de PN63 diretamente após o último bit do pacote de VFIP e, então, continua com uma construção de quadro de VSB normal começando com o próximo pacote de TS (0) como o primeiro segmento de dados do próximo quadro de VSB.

[0058] Se um excitador 512 já tiver tido o quadro sincronizado, um pacote de VFIP recebido poderá ser usado para verificar que o excitador ainda está em fase com a cadência de quadro mantida em um multiplxador de emissão por causa do posicionamento implícito de VFIP no fluxo de transporte.

[0059] Conforme explicado acima, também é necessário desenvolver uma condição de estado para as memórias de codificador de treliça a ser aplicada em uma época específica no fluxo de dados simultaneamente por todos os transmissores em uma rede. A presente invenção usa uma reinicialização de treliça determinística (DTR) para a realização de uma sincronização de codificador de treliça ao forçar o codificador de treliça a entrar em um estado conhecido (por exemplo, zero), conforme o pacote de VFIP entrar no codificador de treliça.

[0060] A sincronização de codificador de treliça é realizada com base em um conhecimento a priori da localização do pacote de VFIP entrelaçado na saída de um entrelaçador de dados de byte 106 (Figura 1), antes do estágio de codificador de treliça 108 (Figura 1). Com o conhecimento da saída do entrelaçador de ATSC 106, uma vez que os dados de sincronização de quadro de dados tenham sido obtidos, doze posições de byte predeterminadas em VFIP são identificadas e

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17/25 usadas para o disparo de uma DTR em cada um dos doze codificadores de treliça em todos os excitadores na SFN. A inicialização ocorre tão logo cada um destes bytes atribuídos de forma determinística primeiramente entre em seu codificador de treliça designado. Mais particularmente, todos os codificadores de treliça são sincronizados após os quatro (4) primeiros segmentos do Quadro de Dados de VSB, sem qualquer necessidade de qualquer sintaxe no VFIP em si. Uma sintaxe adicional, descrita em maiores detalhes abaixo, pode ser adicionada para controle do sincronismo de emissão e outras funções auxiliares de transmissor. Assim, pelo uso do multiplexador de emissão 504 ou multiplexador padrão 510 e inserir CFIP 509 para a inserção de um VFIP, uma sincronização de quadro de VSB é implicitamente sinalizada. No momento em que o quarto segmento de dados de um novo quadro de VSB é transmitido, todos os codificadores de treliça em todos os excitadores serão reinicializados de forma determinística para um estado zero comum. Símbolos coerentes serão produzidos por todos os transmissores em SFN.

[0061] A Figura 8 é um diagrama de blocos mais detalhado de um entrelaçador de dados de convolução contínuo de 52 segmentos de ATSC. Conforme mostrado, o entrelaçador é ilustrado como registradores de deslocamento os quais permutam os símbolos no sinal de entrada, onde os registradores de deslocamento (exceto pelo primeiro) causam um atraso. A Figura 9 descreve como os dados entrelaçados são alimentados para os codificadores de treliça (N° 0 a N° 11). O A/53 define um ponto de partida determinístico no começo do primeiro segmento de dados de cada campo de dados. Com base neste ponto de partida e no conhecimento de antemão de como o entrelaçador de dados de byte 106 processará um fluxo de dados, bytes de enchimento em um VFIP são pré-calculados e inseridos nas posições de byte correta para alimentação de um respectivo dos doze codificadores de tre

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18/25 liça. Conforme cada byte de enchimento designado entra em um codificador de treliça alvo, a DTR será disparada.

[0062] A Figura 10 mostra um mapa de memória do entrelaçador de dados de convolução contínuo de 52 segmentos de ATSC. Conforme ilustrado na Figura 8, os bytes têm o temporizador ajustado como ilustrado pelo comutador à esquerda (isto é, a partir da saída de codificador Reed-Solomon 104), e os bytes são sincronizados como ilustrado pelo comutador na direita a partir da esquerda para a direita (isto é, a partir da memória de entrelaçador de dados de byte 106) e enviados para os estágios seguintes de doze (12) codificadores de treliça. Conforme explicado acima, uma Sincronização de Campo de Dados (DFS) é inserida mais tarde pela unidade de inserção de sincronização 110 no processo pelo excitador 512. A posição temporal de DFS é mostrada no mapeamento como uma linha horizontal através da metade de diagrama descrita no mapeamento mostrado na Figura 10, para ajudar na compreensão da presente invenção. Em particular, a Figura 10 mostra a inserção de uma DFS (sem inversão de PN63), em resposta a um VFIP no último intervalo de pacote (isto é, o 623^o pacote) do quadro de dados prévio.

[0063] As setas diagonais na Figura 10 mostram as posições assumidas pelos bytes do VFIP no entrelaçador. Conforme mostrado, existe uma dispersão temporal de pacotes através de fronteiras de quadro de VSB. Três dos bytes de VFIP (51, 103, 153) residem no último grupo de 52 segmentos, antes do fim do quadro prévio (Quadro n). Os dados remanescentes (bytes) estão nos 52 primeiros segmentos do atual (Quadro n+1). Os (4) bytes marcados em cada uma das três seções diagonais (isto é, os bytes de VFIP 52 a 55, 104 a 107, 156 a 159 ou bytes de enchimento) serão entregues de forma determinística a cada um dos (12) codificadores de treliça numerados 5, 2, B, 8; 9, 6, 3, C; 1, A, 7, 4 (hex), respectivamente, quando eles saírem

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19/25 da memória de entrelaçador. Isto permite que uma reinicialização de treliça determinística (DTR) ocorra, usando-se cada um dos bytes de enchimento designados. Assim, uma DTR ocorre no processamento de bytes de enchimento em um VFIP, e sem afetar ou ocorrer em pacotes transportando conteúdo (Vídeo, Áudio, Dados). Os bytes de VFIP 52 a 55, 104 a 107, 156 a 159 também são mostrados na Figura 7 e na Figura 11 (DTR de bytes de enchimento reservados).

[0064] Pelo conhecimento com certeza de quais bytes de VFIP em um VFIP entrelaçado passarão através dos codificadores de treliça, os bytes de enchimento podem ser usados para dispararem uma reinicialização de treliça (DTR) em todos os excitadores na SFN. Mais particularmente, quando cada um destes (12) bytes de enchimento entrar primeiramente em seus respectivos codificadores de treliça, isto fará com que o codificador de treliça inicialize para um estado predeterminado. Isto ocorrerá de uma forma serial por quatro (4) segmentos e efetivamente sincronizará todos (12) os codificadores de treliça em todos os excitadores 512 de uma forma determinística. Vantajosamente, a reinicialização de codificador de treliça determinística assim é implementada no excitador 512, de modo que adira às trajetórias de codificador de treliça normais de um codificador de treliça de quatro estados. Isto permite que uma lógica de combinação de comutador bemconhecida seja usada para a obtenção de um estado comum.

[0065] Um erro de paridade ocorrerá em cada VFIP pela ação da

DTR sobre doze bytes de enchimento designados; isto é, aceito e não afetará os pacotes transportando um conteúdo normal. Conforme descrito acima, os doze codificadores de treliça em cada excitador 512 serão reinicializados pelos quatro primeiros segmentos (0, 1, 2, 3) de Quadro N+1, usando-se os bytes de enchimento. Mais particularmente, cada byte de enchimento usado para DTR causará um erro determinístico de (1) byte no decodificador de RS, quando um VFIP for re

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20/25 cebido. A codificação de RS em A/53 permite uma correção de erros de até 10 bytes por pacote. Os doze bytes de enchimento quando uma DTR for realizada excederão a esta faixa de correção em dois bytes e gerarão um erro de pacote no decodificador de RS. Um receptor de ATSC ignora um erro de pacote em um VFIP, porque o VFIP é um valor de PID reservado definido para uso em um pacote operacional e de manutenção (isto é, nenhum conteúdo é transportado em um VFIP). Em particular, os receptores de ATSC demultiplexam com base no valor de PID e ignoram pacotes reservados (por exemplo, PID = 0x1FFA) conhecidos por não serem de qualquer uso para eles. Os receptores de ATSC também ignorarão um pacote se um indicador de erro de byte de paridade tiver sido regulado no cabeçalho daquele pacote pelo decodificador de RS em um receptor de ATSC.

[0066] Com referência à Figura 11, um outro campo no VFIP é um campo de paridade de RS de 20 bytes, VFIP_FEC, esta codificação de RS externa adicional provendo correção de erros de byte (por exemplo, correções de erro de 10 bytes) para proteção em perspectiva de possíveis erros introduzidos durante uma transmissão. Isto protege contra erros no enlace de rede de distribuição para transmissores, e também permite que um teste automatizado especial e um equipamento de medição no campo recuperem a carga útil de VFIP para fins de teste de rede e monitoração. Deve ser compreendido que qualquer tipo de codificação de correção que possa prover a capacidade de detecção e correção de erros pode ser usado, ao invés de uma codificação de RS, e ainda estar no escopo da invenção. Além disso, uma codificação de correção de erro pode ser realizada no multiplexador de emissão 504 ou pelo insersor de VFIP 509, dependendo da configuração usada de emissor de fluxo de transporte.

[0067] O espaço não usado remanescente em VFIP é usado para sintaxe para o sincronismo e controle da SFN. O período de VFIP é

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21/25 controlado por um campo no VFIP denominado o periodic_value (valor periódico). A regulagem deste indicador para alto faz com que o VFIP seja inserido em uma base periódica de campo de periodic_value. Em particular, um valor em um campo de periodic_value indica o número de quadros entre inserções de VFIP. Por exemplo, um valor de 20 indicaria que um pacote de VFIP seria inserido pelo multiplexador de emissão 504 a cada 20 quadros de dados, isto é, aproximadamente uma vez por segundo. Ao invés de tornar periódico o atraso de VFIP, um VFIP pode ser inserido em qualquer múltiplo de um quadro de dados em incremento com um contador de cadência descrito acima.

[0068] A rede de distribuição 506 para o sistema de transmissão

502 inerentemente tem um atraso devido ao tipo de rede de distribuição, por exemplo, fibra, microondas, satélite e similares, e outras conexões, por exemplo, cabos coaxiais e similares. Uma sintaxe de sincronismo no VFIP permite que cada transmissor de RF 502 calcule um atraso geral para compensação destes atrasos e provisão de um controle temporal firme do tempo de emissão dos símbolos coerentes a partir de antenas de todos os transmissores em uma SFN e, assim, prover um controle sobre a dispersão de atraso vista pelo receptor.

[0069] A Figura 12 descreve linhas de tempo de sincronização de

SFN mostrando a sintaxe de sincronismo e a semântica para uma SFN de ATSC, de acordo com uma modalidade da presente invenção. Com referência às Figura 11 e 12, os campos sync_time_stamp (STS) e max_delay (MD ou Atraso Máximo) no VFIP são usados para a provisão de compensação para todos os transmissores na SFN quanto a um atraso desigual ou variável no tempo na rede de distribuição 506. Além disso, o campo tx_time_offset (OD) é usado para uma sintonia fina e ajuste de sincronismo de um transmissor de RF 502 em particular na SFN.

[0070] Conforme descrito acima, o emissor de fluxo de transporte

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22/25 (514 e 508) e todos os excitadores 512 na SFN (isto é, todos os nós) usam uma base de tempo de GPS 505 para a recepção de 10 MHz de frequência e uma referência temporal de 1 PPS. Um contador binário de 24 bits nos emissores de fluxo de transporte mantém um acompanhamento do temporizador de referência com base na base de tempo de GPS 505. Este contador de 24 bits também está disponível em todos os excitadores 512. O sinal de 1 PPS da base de tempo de GPS 505 é usado para reinicialização de um contator binário de 24 bits para zero na borda de subida de 1 PPS. O contador tem o temporizador regulado por uma referência de frequência de 10 MHz, e conta de 0 a 9999999 em um segundo, então, reinicializa para zero. Cada tique de temporizador e avanço de contagem é de 100 nanossegundos. Esta técnica de contador binário de 24 bits está disponível em todos os nós da rede e forma a base para todas as estampas de tempo usadas na SFN.

[0071] O campo sync_time_stamp (STS) em um VFIP é um campo de 24 bits contendo o valor que o contator de 24 bits assumirá no multiplexador de emissão 504 observado no instante em que VFIP deixa o multiplexador de emissão 504 para a rede de distribuição 506. Na configuração alternativa, o campo sync_time_stamp (STS) em um VFIP é um campo de 24 bits contendo o valor que o contador binário de 24 bits assumirá no insersor de VFIP 509 observado no instante em que o VFIP deixa o insersor de VFIP 509 para a rede de distribuição 506. De modo similar, contadores de 24 bits são inseridos nos sistemas de transmissor de RF 502. Todos os contadores em todos os nós na rede são sincronizados para os mesmos 10 MHz de GPS e 1 PPS, permitindo que suas contagens sejam sincronizadas. Cada incremento do contador é de 100 nanossegundos. Este valor conhecido é usado em cada transmissor de RF 502 para o cálculo de um atraso de trânsito (TD) através de sua respectiva rede de distribuição (por exemplo, Sa

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23/25 télite, Microondas, Fibra e similares). Mais particularmente, conforme descrito acima, o valor de STS é o tempo em que o VFIP deixou o multiplexador de emissão 504 e entrou na rede de distribuição 506. O valor de STS é comparado com uma observação da contagem atual do contador de 24 bits no excitador 512 no instante em que o VFIP é recebido para determinação do TD de quanto tempo (isto é, quantos incrementos de 100 nanossegundos) o pacote de VFIP levará para chegar através da rede de distribuição 506. A Figura 12 mostra graficamente a liberação de um VFIP na rede de distribuição 506 e o instante em que VFIP chega a um transmissor 502 como uma função do tempo.

[0072] O campo maximum_delay no VFIP (correspondente ao

Atraso Máximo ou MD na Figura 12) é um valor de 24 bits contendo um valor de atraso predeterminado estabelecido com base em uma revisão quantitativa dos atrasos de todos os percursos de distribuição para todos os transmissores de RF digitais na SFN. Particularmente, o valor de maximum_delay introduzido é calculado para ser maior do que o atraso do percurso mais longo na rede de distribuição 506. Pela seleção de um valor de MD maior do que o atraso de trânsito máximo esperado através de todos os percursos de distribuição, um tampão de entrada pode ser calculado e configurado em cada excitador 512 para o atraso dos pacotes de TS chegando, de modo que eles sejam transmitidos a partir de todos os transmissores simultaneamente, independentemente do tempo de trânsito de um pacote através de uma rede de distribuição 506. Isto é mostrado na Figura 12 como o Tempo de Emissão de Referência. O tempo de emissão de referência é o começo da sincronização de segmento em DFS (sem uma inversão de PN63) imediatamente seguindo-se ao VFIP.

[0073] O campo tx_time_offset (OD) é um valor de 16 bits endereçado a cada transmissor que contiver um valor de atraso opcional

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24/25 usado para sintonia fina da dispersão de atraso de transmissores em particular para otimização da rede.

[0074] Assim, com base no cálculo de quanto tempo o pacote de

VFIP levará para chegar usando-se, em parte o sync_time_stamp (STS), o valor de max_delay (MD) e um tx_time_offset (OD), um transmissor de RF 502 pode regular seu tampão de atraso de entrada, TX Delay. Assim sendo, o valor do tampão de atraso em cada 512, TX Delay, é mostrado na Figura 12 e definido pela Equação (1), conforme se segue:

TX Delay = STS + MD + OD - TD (1) [0075] Assim o TX Delay para cada excitador na SFN 500 é calculado independentemente. Cada transmissor de RF 502, por sua vez, usa os valores globais de atraso (por exemplo, STS, MD) para o estabelecimento de um tempo de emissão de referência. O OD endereçado individualmente permite um controle fino do tempo de emissão dos símbolos coerentes a partir de todas as antenas de todos os receptores em uma SFN e, daí, controlará a dispersão de atraso vista por um receptor de ATSC. Um valor local (por exemplo, um valor de 16 bits, não mostrado) também pode ser introduzido em cada local para compensação pelo atraso calculado através dos transmissores, filtros de saída e comprimento de linha de transmissão alimentando a Antena. Este valor é subtraído de MD para um transmissor em particular, para obtenção de uma resolução fina no tempo de emissão a partir da antena a qual é o ponto de referência ou de demarcação em um sistema de SFN (isto é, o ponto no qual a onda guiada por sinal de RF transita para um espaço livre).

[0076] Embora várias modalidades da presente invenção tenham sido descritas acima, deve ser compreendido que elas foram apresentadas a título de exemplo e não de limitação. Será evidente para pessoas versadas na(s) técnica(s) relevante(s) que várias mudanças na

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25/25 forma e nos detalhes podem ser feitas ali, sem se desviar do espírito e do escopo da presente invenção. Assim, a presente invenção não deve ser limitada por qualquer uma das modalidades de exemplo descritas acima, mas deve ser definida apenas de acordo com as reivindicações a seguir e seus equivalentes.

[0077] Além disso, deve ser compreendido que as figuras ilustradas nos anexos, as quais destacam a funcionalidade e as vantagens da presente invenção, são apresentadas para fins de exemplo apenas. A arquitetura da presente invenção é suficientemente flexível e configurável, de modo que ela pode ser utilizada de várias outras formas além daquelas mostradas nas figuras associadas.

[0078] Ainda, a finalidade do Resumo precedente é permitir que o

Escritório de Patentes e Marcas dos Estados Unidos e o público em geral e, especialmente, os cientistas, engenheiros e praticantes na técnica que não estejam familiarizados com termos de patente ou legais ou a fraseologia determinem rapidamente a partir de uma inspeção superficial a natureza e a essência da descrição técnica do pedido. Não se pretende que o Resumo seja limitante para o escopo da presente invenção de forma alguma. Também é compreendido que as etapas e os processos recitados nas reivindicações não precisam ser realizados na ordem apresentada.

Claims

REIVINDICAÇÕES

1. Método para a produção de uma pluralidade de símbolos coerentes a partir de uma pluralidade de transmissores de RF digitais, cada um da pluralidade de transmissores de RF digitais tendo uma pluralidade de codificadores de treliça, caracterizado pelo fato de que compreende as etapas de:

recepção de um primeiro pacote de inicialização, o pacote de inicialização contendo uma pluralidade de bytes de enchimento, cada byte de enchimento posicionado em uma posição de byte predeterminada, respectivamente; e configuração de cada um da pluralidade de codificadores de treliça em um estado predeterminado, à medida que um byte de enchimento entra, assim fazendo com que a pluralidade de transmissores de RF digitais transmita uma pluralidade de símbolos de forma coerente.
2. Método, de acordo com a reivindicação 1, caracterizado pelo fato de que ainda compreende a etapa de:

recepção de um outro pacote de inicialização após um múltiplo de um número predeterminado de pacotes.
3. Método, de acordo com a reivindicação 1, caracterizado pelo fato de que o pacote de inicialização é recebido a partir de um fluxo de transporte.
4. Método, de acordo com a reivindicação 1, caracterizado pelo fato de que ainda compreende a etapa de:

decodificação de correção de erro do pacote de inicialização.
5. Método, de acordo com a reivindicação 1, caracterizado pelo fato de que o pacote de inicialização ainda contém uma estampa de tempo com base em uma base de tempo comum, um valor de atraso máximo predeterminado, um valor de atraso de desvio, e um

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2/13 endereço de transmissor correspondente ao atraso de desvio.
6. Método, de acordo com a reivindicação 5, caracterizado pelo fato de que a base de tempo comum é o sistema de posicionamento global (GPS).
7. Método, de acordo com a reivindicação 1, caracterizado pelo fato de que ainda compreende:

o entrelaçamento do pacote de inicialização.
8. Método, de acordo com a reivindicação 1, caracterizado pelo fato de que ainda compreende a etapa de:

travamento de um temporizador de símbolo e de uma frequência portadora em uma base de tempo comum.
9. Método, de acordo com a reivindicação 8, caracterizado pelo fato de que ainda compreende a etapa de:

travamento de um sinal digital que compreende o pacote de inicialização para a base de tempo comum.
10. Método, de acordo com a reivindicação 9, caracterizado pelo fato de que a base de tempo comum é o sistema de posicionamento global (GPS).
11. Método, de acordo com a reivindicação 1, caracterizado pelo fato de que ainda compreende a etapa de:

modulação de um sinal digital usando pelo menos uma dentre uma modulação de banda lateral vestigial de oito níveis (8-VSB) e uma modulação de banda lateral vestigial de treliça de oito níveis (8T-VSB).
12. Método, de acordo com a reivindicação 1, caracterizado pelo fato de que ainda compreende a etapa de:

sincronização de uma pluralidade de quadros de dados com base na chegada do pacote de inicialização.
13. Método, de acordo com a reivindicação 1, caracterizado pelo fato de que ainda compreende a etapa de:

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3/13 escravização de uma pluralidade de quadros de dados para serem difundidos a partir da pluralidade de transmissores de RF digitais com base na recepção de um pacote de inicialização.
14. Método, de acordo com a reivindicação 1, caracterizado pelo fato de que ainda compreende a etapa de:

cálculo de uma métrica de atraso correspondente a uma estampa de tempo de sincronização, um valor de atraso máximo e um valor de atraso de desvio no pacote de inicialização, e uma base de tempo comum, onde a estampa de tempo de sincronização é um valor da base de tempo comum observado quando o pacote de inicialização é transmitido para uma rede de distribuição, onde o valor de atraso máximo corresponde a um atraso em uma rede de distribuição, e o valor de atraso de desvio corresponde a um valor de desvio endereçado para um respectivo da pluralidade de transmissores de RF digitais.
15. Método, de acordo com a reivindicação 14, caracterizado pelo fato de que a base de tempo comum é o sistema de posicionamento global (GPS).
16. Método, de acordo com a reivindicação 1, caracterizado pelo fato de que ainda compreende a etapa de:

atraso do sinal digital quanto a ser transmitido pela pluralidade de transmissores de RF por um atraso predeterminado.
17. Método, de acordo com a reivindicação 16, caracterizado pelo fato de que o atraso predeterminado é maior do que o maior percurso de atraso em uma rede de distribuição para a pluralidade de transmissores de RF digitais.
18. Aparelho para a produção de uma pluralidade de símbolos coerentes a partir de uma pluralidade de transmissores de RF digitais, caracterizado pelo fato de que compreende:

um receptor de pacote operável para receber um primeiro

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4/13 pacote de inicialização, o pacote de inicialização contendo uma pluralidade de bytes de enchimento, cada byte de enchimento posicionado em uma posição de byte predeterminada, respectivamente; e uma pluralidade de codificadores de treliça, cada codificador de treliça sendo operável para ser configurado para um estado predeterminado, à medida que um byte de enchimento entra, assim fazendo com que a pluralidade de transmissores de RF digitais transmita uma pluralidade de símbolos de forma coerente.
19. Aparelho, de acordo com a reivindicação 18, caracterizado pelo fato de que o receptor ainda é operável para a detecção de um outro pacote de inicialização, após um múltiplo de um número predeterminado de pacotes.
20. Aparelho, de acordo com a reivindicação 18, caracterizado pelo fato de que o pacote de inicialização é recebido a partir de um fluxo de transporte.
21. Aparelho, de acordo com a reivindicação 18, caracterizado pelo fato de que ainda compreende:

um decodificador operável para uma decodificação de correção de erro do pacote de inicialização.
22. Aparelho, de acordo com a reivindicação 18, caracterizado pelo fato de que o pacote de inicialização ainda contém uma estampa de tempo de sincronização com base em uma base de tempo comum, um valor de atraso máximo predeterminado, um valor de atraso de desvio e um endereço de transmissor correspondente ao atraso de desvio.
23. Aparelho, de acordo com a reivindicação 22, caracterizado pelo fato de que a base de tempo comum é o sistema de posicionamento global (GPS).
24. Aparelho, de acordo com a reivindicação 18,

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5/13 caracterizado pelo fato de que ainda compreende:

um entrelaçador operável para entrelaçar o pacote de inicialização.
25. Aparelho, de acordo com a reivindicação 18, caracterizado pelo fato de que ainda compreende:

uma unidade de sincronismo operável para travar um temporizador de símbolo e uma frequência portadora em uma base de tempo comum.
26. Aparelho, de acordo com a reivindicação 25, caracterizado pelo fato de que ainda compreende:

uma unidade de sincronismo operável para travar um sinal digital que inclui o pacote de inicialização na base de tempo comum.
27. Aparelho, de acordo com a reivindicação 26, caracterizado pelo fato de que a base de tempo comum é o sistema de posicionamento global (GPS).
28. Aparelho, de acordo com a reivindicação 18, caracterizado pelo fato de que ainda compreende:

um processador de sinal operável para modular um sinal digital transportando o pacote de inicialização usando pelo menos uma dentre uma modulação de banda lateral vestigial de oito níveis (8-VSB) e uma modulação de banda lateral vestigial de treliça de oito níveis (8T-VSB).
29. Aparelho, de acordo com a reivindicação 18, caracterizado pelo fato de que ainda compreende:

uma unidade de sincronismo operável para sincronizar uma pluralidade de quadros de dados, com base na chegada do pacote de inicialização.
30. Aparelho, de acordo com a reivindicação 18, caracterizado pelo fato de que ainda compreende:

um controlador operável para escravizar uma pluralidade de

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6/13 quadros de dados a serem difundidos a partir da pluralidade de transmissores de RF digitais, com base na recepção de um pacote de inicialização.
31. Aparelho, de acordo com a reivindicação 18, caracterizado pelo fato de que ainda compreende:

uma unidade de sincronismo operável para calcular uma métrica de atraso correspondente a uma estampa de tempo de sincronização, um valor de atraso máximo e um valor de atraso de desvio no pacote de inicialização, e uma base de tempo comum, onde a estampa de tempo de sincronização é um valor da base de tempo comum observado quando o pacote de inicialização é transmitido para uma rede de distribuição, onde o valor de atraso máximo corresponde a um atraso em uma rede de distribuição, e o valor de atraso de desvio corresponde a um valor de desvio endereçado para um respectivo da pluralidade de transmissores de RF digitais.
32. Aparelho, de acordo com a reivindicação 31, caracterizado pelo fato de que a base de tempo comum é o sistema de posicionamento global (GPS).
33. Aparelho, de acordo com a reivindicação 18, caracterizado pelo fato de que ainda compreende:

uma unidade de sincronismo operável para atrasar o sinal digital quanto a ser transmitido pela pluralidade de transmissores de RF por um atraso predeterminado.
34. Aparelho, de acordo com a reivindicação 33, caracterizado pelo fato de que o atraso predeterminado é maior do que o maior percurso de atraso em uma rede de distribuição para a pluralidade de transmissores de RF digitais.
35. Aparelho para a produção de uma pluralidade de símbolos coerentes a partir de uma pluralidade de transmissores de RF digitais, cada um da pluralidade de transmissores de RF digitais

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7/13 tendo uma pluralidade de codificadores de treliça, caracterizado pelo fato de que compreende:

um meio para a recepção de um primeiro pacote de inicialização, o pacote de inicialização contendo uma pluralidade de bytes de enchimento, cada byte de enchimento posicionado em uma posição de byte predeterminada, respectivamente; e um meio para configurar cada um da pluralidade de codificadores de treliça em um estado predeterminado, à medida que um byte de enchimento entra, assim fazendo com que a pluralidade de transmissores de RF digitais transmita uma pluralidade de símbolos de forma coerente.
36. Aparelho, de acordo com a reivindicação 35, caracterizado pelo fato de que ainda compreende:

um meio para a recepção de um outro pacote de inicialização após um múltiplo de um número predeterminado de pacotes.
37. Aparelho, de acordo com a reivindicação 35, caracterizado pelo fato de que o pacote de inicialização é recebido a partir de um fluxo de transporte.
38. Aparelho, de acordo com a reivindicação 35, caracterizado pelo fato de que ainda compreende:

um meio para a decodificação de correção de erro do pacote de inicialização.
39. Aparelho, de acordo com a reivindicação 35, caracterizado pelo fato de que o pacote de inicialização ainda contém uma estampa de tempo com base em uma base de tempo comum, um valor de atraso máximo predeterminado, um valor de atraso de desvio, e um endereço de transmissor correspondente ao atraso de desvio.
40. Aparelho, de acordo com a reivindicação 39, caracterizado pelo fato de que a base de tempo comum é o sistema de

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8/13 posicionamento global (GPS).
41. Aparelho, de acordo com a reivindicação 35, caracterizado pelo fato de que ainda compreende:

um meio para o entrelaçamento do pacote de inicialização.
42. Aparelho, de acordo com a reivindicação 35, caracterizado pelo fato de que ainda compreende:

um meio para o travamento de um temporizador de símbolo e de uma frequência portadora em uma base de tempo comum.
43. Aparelho, de acordo com a reivindicação 42, caracterizado pelo fato de que ainda compreende:

um meio para o travamento de um sinal digital que compreende o pacote de inicialização em a base de tempo comum.
44. Aparelho, de acordo com a reivindicação 43, caracterizado pelo fato de que a base de tempo comum é o sistema de posicionamento global (GPS).
45. Aparelho, de acordo com a reivindicação 35, caracterizado pelo fato de que ainda compreende:

um meio para a modulação de um sinal digital usando pelo menos uma dentre uma modulação de banda lateral vestigial de oito níveis (8-VSB) e uma modulação de banda lateral vestigial de treliça de oito níveis (8T-VSB).
46. Aparelho, de acordo com a reivindicação 35, caracterizado pelo fato de que ainda compreende:

um meio para a sincronização de uma pluralidade de quadros de dados com base na chegada do pacote de inicialização.
47. Aparelho, de acordo com a reivindicação 35, caracterizado pelo fato de que ainda compreende:

um meio para a escravização de uma pluralidade de quadros de dados para serem difundidos a partir da pluralidade de transmissores de RF digitais com base na recepção de um pacote de

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9/13 inicialização.
48. Aparelho, de acordo com a reivindicação 35, caracterizado pelo fato de que ainda compreende:

um meio para o cálculo de uma métrica de atraso correspondente a uma estampa de tempo de sincronização, um valor de atraso máximo e um valor de atraso de desvio no pacote de inicialização, e uma base de tempo comum, onde a estampa de tempo de sincronização é um valor da base de tempo comum observado quando o pacote de inicialização é transmitido para uma rede de distribuição, onde o valor de atraso máximo corresponde a um atraso em uma rede de distribuição, e o valor de atraso de desvio corresponde a um valor de desvio endereçado para um respectivo da pluralidade de transmissores de RF digitais.
49. Aparelho, de acordo com a reivindicação 48, caracterizado pelo fato de que a base de tempo comum é o sistema de posicionamento global (GPS).
50. Aparelho, de acordo com a reivindicação 35, caracterizado pelo fato de que ainda compreende:

um meio para o atraso do sinal digital quanto a ser transmitido pela pluralidade de transmissores de RF por um atraso predeterminado.
51. Aparelho, de acordo com a reivindicação 50, caracterizado pelo fato de que o atraso predeterminado é maior do que o maior percurso de atraso em uma rede de distribuição para a pluralidade de transmissores de RF digitais.
52. Sistema para a produção de uma pluralidade de símbolos coerentes a partir de uma pluralidade de transmissores de RF digitais, caracterizado pelo fato de que compreende:

um multiplexador operável para receber um sinal digital que contém dados de conteúdo a serem difundidos a partir da pluralidade

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10/13 de transmissores de RF digitais e para inserção de um primeiro pacote de inicialização no sinal digital, o pacote de inicialização contendo uma pluralidade de bytes de enchimento, cada byte de enchimento posicionado em uma posição de byte predeterminada, respectivamente, e para transmissão do sinal digital para a pluralidade de transmissores de RF digitais; e um modulador que tem uma pluralidade de codificadores de treliça, o modulador operável para receber o sinal digital, extrair o primeiro pacote de inicialização e para configurar cada um da pluralidade de codificadores de treliça em um estado predeterminado, à medida que um byte de enchimento entra, assim fazendo com que a pluralidade de transmissores de RF digitais transmita uma pluralidade de símbolos de forma coerente.
53. Sistema, de acordo com a reivindicação 52, caracterizado pelo fato de que o multiplexador ainda é operável para a geração de um outro pacote de inicialização, após um múltiplo de um número predeterminado de pacotes.
54. Sistema, de acordo com a reivindicação 52, caracterizado pelo fato de que multiplexador transmite o sinal digital para o modulador por uma rede de distribuição.
55. Sistema, de acordo com a reivindicação 52, caracterizado pelo fato de que o multiplexador ainda compreende um codificador operável para uma codificação de correção de erro do pacote de inicialização, e o modulador ainda compreendendo um decodificador operável para uma decodificação de correção de erro do pacote de inicialização.
56. Sistema, de acordo com a reivindicação 52, caracterizado pelo fato de que o pacote de inicialização ainda contém uma estampa de tempo de sincronização com base em uma base de tempo comum, um valor de atraso máximo predeterminado, um valor

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11/13 de atraso de desvio e um endereço de transmissor correspondente ao atraso de desvio.
57. Sistema, de acordo com a reivindicação 56, caracterizado pelo fato de que a base de tempo comum é o sistema de posicionamento global (GPS).
58. Sistema, de acordo com a reivindicação 52, caracterizado pelo fato de que o modulador ainda compreende:

um entrelaçador operável para entrelaçar o pacote de inicialização.
59. Sistema, de acordo com a reivindicação 52, caracterizado pelo fato de que ainda compreende:

uma unidade de sincronismo operável para travar um temporizador de símbolo e uma frequência portadora em uma base de tempo comum.
60. Sistema, de acordo com a reivindicação 52, caracterizado pelo fato de que ainda compreende:

uma unidade de sincronismo operável para travar um sinal digital que inclui o pacote de inicialização em uma base de tempo comum.
61. Sistema, de acordo com a reivindicação 60, caracterizado pelo fato de que a base de tempo comum é o sistema de posicionamento global (GPS).
62. Sistema, de acordo com a reivindicação 52, caracterizado pelo fato de que o modulador é ainda operável para modular um sinal digital transportando o pacote de inicialização usando pelo menos uma dentre uma modulação de banda lateral vestigial de oito níveis (8-VSB) e uma modulação de banda lateral vestigial de treliça de oito níveis (8T-VSB).
63. Sistema, de acordo com a reivindicação 52, caracterizado pelo fato de que o modulador ainda compreende:

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12/13 uma unidade de sincronismo operável para sincronizar uma pluralidade de quadros de dados, com base na chegada do pacote de inicialização.
64. Sistema, de acordo com a reivindicação 52, caracterizado pelo fato de que o modulador ainda compreende:

um controlador operável para escravizar uma pluralidade de quadros de dados a serem difundidos a partir da pluralidade de transmissores de RF digitais, com base na recepção de um pacote de inicialização.
65. Sistema, de acordo com a reivindicação 52, caracterizado pelo fato de que ainda compreende:

uma unidade de sincronismo operável para calcular uma métrica de atraso correspondente a uma estampa de tempo de sincronização, um valor de atraso máximo e um valor de atraso de desvio no pacote de inicialização, e uma base de tempo comum, onde a estampa de tempo de sincronização é um valor da base de tempo comum observado quando o pacote de inicialização é transmitido para uma rede de distribuição, onde o valor de atraso máximo corresponde a um atraso em uma rede de distribuição, e o valor de atraso de desvio corresponde a um valor de desvio endereçado para um respectivo da pluralidade de transmissores de RF digitais.
66. Sistema, de acordo com a reivindicação 65, caracterizado pelo fato de que a base de tempo comum é o sistema de posicionamento global (GPS).
67. Sistema, de acordo com a reivindicação 52, caracterizado pelo fato de que ainda compreende:

uma unidade de sincronismo operável para atrasar o sinal digital quanto a ser transmitido pela pluralidade de transmissores de RF por um atraso predeterminado.
68. Sistema, de acordo com a reivindicação 67,

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13/13 caracterizado pelo fato de que o atraso predeterminado é maior do que o maior percurso de atraso em uma rede de distribuição para a pluralidade de transmissores de RF digitais.