BE894578R - Systeme de communication - Google Patents
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04W—WIRELESS COMMUNICATION NETWORKS
- H04W56/00—Synchronisation arrangements
- H04W56/0055—Synchronisation arrangements determining timing error of reception due to propagation delay
- H04W56/0065—Synchronisation arrangements determining timing error of reception due to propagation delay using measurement of signal travel time
- H04W56/007—Open loop measurement
- H04W56/0075—Open loop measurement based on arrival time vs. expected arrival time
- H04W56/0085—Open loop measurement based on arrival time vs. expected arrival time detecting a given structure in the signal
-
- H—ELECTRICITY
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- H04W48/08—Access restriction or access information delivery, e.g. discovery data delivery
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Description
L'invention se rapporte à un système de communication comprenant des postes émetteur/récepteur fixes, des postes émetteur/récepteur mobiles capables de communiquer par radio avec les postes fixes, des postes de commande contrôlant chacun une pluralité de postes fixes, et un équipement d'interface ayant une pluralité de postes de commande qui lui sont connectés et fournissant les connexions vers un réseau téléphonique automatique, les postes de commande étant interconnectés et un accès multiplex à division dans le temps étant utilisé au moins pour les communications par radio. Un tel système à été décrit dans le brevet principal et le but de la présente invention est de l'améliorer en évi- <EMI ID=1.1> services de radio,et en supprimant les effets de la réception par chemins multiples. Ce but est atteint par les moyens établis dans la première revendication et d'autres caractéristiques apparaîtront des sous-revendications. Des réalisations de l'invention seront maintenant expliquées en plus de détails et en se référant aux dessins accompagnant la description qui fait suite, dans lesquels La Fig. 1 est un diagramme sous forme de blocs d'un premier circuit pour détecter toutes les pointes de corrélation du préambule de synchronisation; La Fig . 2 est un diagramme sous forme de blocs d'un second circuit pour détecter les pointes de corrélation; La Fig. 3 est un diagramme sous forme de blocs d'un détecteur; La Fig. 4 est un diagramme relatif aux intégrateurs des détecteurs de la Fig. 3; et La Fig. 5 est un diagramme des signaux d'un intégrateur. Certains des éléments portent les mêmes numéros de référence que dans le brevet principal car ils sont analogues et par conséquent, Leurs caractéristiques et fonctions ne seront plus décrites ici. La Fig. 1 montre un diagramme sous forme de blocs d'un circuit pour détecter les pointes de corrélation du préaiabule de synchronisation. Ce dernier est appliquera partir <EMI ID=2.1> cade . Le premier sert également comme ligne de retard pour le second et tous deux sont reliés au dispositif 32 de mise en séquence qui n'est montré que partiellement. Le résultat du premier corrélateur 31a est envoyé à un démodulateur d'enveloppe 38a qui est suivi d'un détecteur de pointe 39 et d'un étage réducteur 40. Le résultat obtenu par le second corrélateur 31b va vers un démodulateur d'enveloppe 38b. Les sorties des démodulateurs d'enveloppe sont connectées à un étage de comparaison et de sélection 41 qui est suivi d'un autre détecteur de pointe 42. Les temps d'arrivée ti des signaux pertinents par chemin indirect peuvent être pris à la sortie du détecteur de pointe 42 et sont disponibles pour la réception des caractères. Le profil à chemins multiples ainsi obtenu se reflète dans la forme d'onde de la tension de sortie du corrélateur de synchronisation. Le délai du corrélateur 31(a) doit être choisi assez grand pour que le résultat de la corrélation du chemin le plus important soit disponible quand les signaux de sortie du corrélateur 31b sont appliqués à l'étage de comparaison de sélection 41. A partir du résultat de la corrélation du chemin le plus significatif, une valeur de seuil pour l'étage de comparaison et de sélection 41 est obtenue. La valeur de seuil sert à supprimer les pointes de corrélation se trouvant dans le bruit ou légèrement au-dessus. Le détecteur de pointe 39 détecte le maximum absolu des pointes de corrélation. tandis que le détecteur de pointe 42, auquel on fournit également l'instant de réception, détermine les temps d'arrivée des pointes dépassant la valeur du seuil. L'étage réducteur 40 dérive du niveau du chemin le plus significatif la valeur de seuil avec laquelle le profil des chemins multiples est comparé dans l'étage 41. Si le préambule de synchronisation est transmis deux fois avec poses intercalaire et subséquente,un circuit plus simple peut être utilisé pour détecter toutes les pointes de corrélation. Il est montré à la Fig. 2. Le corrélateur 31 est connecté au récepteur 8 et a sa sortie couplée à celle du dispositif de mise en séquence 32 (montré partiellement). Ce dernier comporte un démodulateur d'enveloppe 38 qui est suivi par un détecteur de pointe absolue 39, un étage réducteur 40, un étage de comparaison et de sélection 41 et un détecteur de pointe 42 pour détecter les maxima locaux. La sortie du détecteur de pointe 42 fournit à nouveau les temps d'arrivée ti des chemins pertinents. Un circuit 43 est connecté au démodulateur d'enveloppe 38 et il est commandé par le détecteur de pointe 39 pour servir à la commutation du <EMI ID=3.1> de sélection 41.' A l'aide du premier préambule de synchronisation, le maximum absolu du profil des chemins multiples et la valeur du seuil sont déterminés. les temps d'arrivée des chemins pertinents sont alors déterminés à partir de la corrélation avec le second préambule de synchronisation. Comme le corrélateur et le démodulateur d'enveloppe sont utilisés deux fois en succes- <EMI ID=4.1> dans le circuit de la Fig. 1. Mais les temps d'évaluation nécessai res sont égaux dans les deux circuits. La Fig. 3 montre le diagramme sous forme de bloc s d'un détecteur 33 pour un échantillonnage multiple des caractères reçus. Des seize corrélateurs 31 et détecteurs 33, un seul est représenté dans un but de simplification. Mais seize corrélateurs et détecteurs sont en fait présents car un alphabet à seize éléments (m = 16) a été choisi dans l'exemple décrit. Le corrélateur 31 délivre son signal à un démodulateur d'enveloppe 44 ayant quatre combinaisons série d'un <EMI ID=5.1> remise à zéro, et d'un autre commutateur 46a-d qui lui sont comectées. La sortie de cet arrangement parallèle est connectée à un étage de décision 34. Avec ce circuit, une intégra- <EMI ID=6.1> caractère est accomplie. L'arrangement parallèle des quatre intégrateurs avec système de remise à zéro permet aune intégration d'être accomplie sur une période de quatre caractères de code à m éléments. Si m = 16 et la durée pour un élément est de 100 nanosecondes, le durée du caractère est alors de 1,6 microsecondes et le temps d'intégration est de 6,4 microsecpndes. Les commutateurs 45 et 46 sont commandés par le dispositif de mise en séquence et servent à transférer des résultats de la corrélation et ceux de l'intégration respectivement vers les intégrateurs et l'étage de décision 34 aux instants corrects -. <EMI ID=7.1> mes les séquences dans le temps des opérations en ce qui concerne les intégrateurs avec système de remise à zéro. Le cycle de chacune des quatre combinaisons série montrées s'étend sur une période de quatre caractères de code à m éléments. Les cycles sont décalés l'un par rapport à l'autre d'une durée de caractère. Au début de chaque cycle, chaque intégrateur est remis à zéro. Aux temps de corrélation de chacun des cinq chemins supposés à la Fig. 4, le commutateur 45 est fermé pour un court instant de telle façon que les résultats de la corrélation sont additionnés . A la fin du cycle la fermeture du commutateur 46 provoque le transfert du résultat de l'intégration à l'étage de décision 34. Ce dernier sélectionne la plus grande des valeurs arrivant simultanément et évalue ainsi le caractère transmis. En ce qui concerne la différence de délai entre le premier et le dernier chemin devant être intégré et de la durée de 1,6 microsecondes déjà mentionnée (correspondant à 100 nanosecondes lorsque le caractère possède m = 16 éléments, cette période étant l'équivalent d'une fréquence de 10 MHz pour un taux de transmission de 32 Keb/s) , les profils à chemins multiples, dans les systèmes de communication mobiles s'étendent jusqu'à 6 microsecondes et dans des cas extrêmes jusqu'à 10 microsecondes. Comme un intégrateur par corrélateur peut être occupé pour environ 6 microsecondes, des intégrateurs supplémentaires doivent être disponibles pour les caractères arrivant entretemps. Dans l'exemple décrit, quatre intégrateurs par corréla- <EMI ID=8.1> microsecondes où le premier intégrateur est à nouveau disponible. 13s peuvent aussi être utilisés pour accomplir une pondération en amplitude. Ceci est accompli par exemple en fournissant aux intégrateurs plusieurs constantes de temps d'intégration numériquement espacées. La façon la plus simple de pondérer les amplitudes est d'intégrer seulement les résultats des chemins qui sont approximativement égaux en puissance tout en laissant la constante de temps d'intégration inchangée. Un échantillonnage simple ou multiple pour les corrélateurs de caractère sera déterminé par le niveau de seuil dans le dispositif de mise en séquence. Pour un seuil très élevé, un échantillon seulement est pris à la pointe de corrélation maximum. Pour un seuil moins élevé, il y a un échantillonnage multiple suivant les pointes de corrélation détectées. Quoique les principes de l'invention aient été décrits ci-dessus en se référant à des exemples particuliers il est bien entendu que cette description est faite seulement à titre d'exemple et ne constitue aucunement une limitation de la portée de l'invention.
Claims (9)
1) Système de communication comme dans le brevet principal, caractérisé en ce que pour chaque canal de temps <EMI ID=9.1>
sation sont détectées dans un corrélateur de synchronisation
(31) et que m corrélateurs de caractère associés avec les groupes de n éléments binaires sont échantillonnés au moins
à l'instant de la plus grande pointe de corrélation.
2) Système de communication comme sous 1, caractérisé en ce que, afin de permettre la détection des pointes
de corrélation et la sélection de la plus élevée, le préambule de synchronisation est transmis deux fois.
3) Système de communication comme sous 1, caractérisé en ce que, afin de détecter les pointes de corrélation
et choisir. la plus élevée, le préambule de synchronisation est évalué avec et sans délai, la détection étant effectuée dans deux corrélateurs reliés en cascade (31a, 31b).
4) Système de communication comme sous 1, caractérisé en ce que les corrélateurs de caractère (31) sont échantillonnés aux instants des pointes de corrélation et que les valeurs d'échantillonnage sont emmagasinées et additionnées dans des détecteurs qui leur font suite (33).
5) Système de communication comme sous 4, caractérisé en ce que l'échantillonnage multiple a lieu lors de pointes
de corrélation multiples approximativement égales.
6) Système de communication comme sous 4, caractérisé en ce que les valeurs d'échantillonnage apparaissant aux sorties du corrélateur de caractère (31) peuvent être additionnées sous une forme pondérée.
7) Système de communication comme sous 6, caractérisé en ce que l'emmagasinage et l'addition sont accomplis par des intégrateurs (ID) qui peuvent être remis à zéro au début de chaque cycle.
8) Système de communication comme sous 7, caractérisé en ce que, afin de pondérer les valeurs d'échantillonnage,
les intégrateurs (ID) peuvent être ajustés à des constantes de temps d'intégration différente s .
9) Système de communication comme sous 7, caractérisé
<EMI ID=10.1>
en parallèle et peuvent être activés successivement en des temps prédéterminés.
Soit un total de 9 Pactes
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
BE2/59857A BE894578R (fr) | 1981-10-03 | 1982-10-04 | Systeme de communication |
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19813139408 DE3139408A1 (de) | 1981-10-03 | 1981-10-03 | Nachrichtenuebertragungssystem |
BE2/59694A BE893102A (fr) | 1981-05-07 | 1982-05-07 | Systeme de communication |
BE2/59857A BE894578R (fr) | 1981-10-03 | 1982-10-04 | Systeme de communication |
Publications (1)
Publication Number | Publication Date |
---|---|
BE894578R true BE894578R (fr) | 1983-04-05 |
Family
ID=27159615
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
BE2/59857A BE894578R (fr) | 1981-10-03 | 1982-10-04 | Systeme de communication |
Country Status (1)
Country | Link |
---|---|
BE (1) | BE894578R (fr) |
-
1982
- 1982-10-04 BE BE2/59857A patent/BE894578R/fr not_active IP Right Cessation
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
RE | Patent lapsed |
Owner name: ALCATEL N.V. Effective date: 19970531 |