KR100251114B1 - Manufacturing method of ama - Google Patents

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Abstract

PURPOSE: A method for manufacturing a thin film type optical path adjusting device is provided to prevent a supporting layer of a lower electrode from being damaged by not performing an over-etching in an 'Iso-cut' etching process. CONSTITUTION: A lower electrode is formed with depositing the first conductive layer(130a) on a supporting layer(125) and depositing the second conductive layer(130b) on the first conductive layer(130a). A photoresist layer(131) is formed on the lower electrode(130). An oxygen ion injection and a heat treatment are performed using the photoresist layer(131) as an ion injection mask. As a result, the lower electrode(130) is short-circuited for each pixel. A strain layer is formed on the short-circuited lower electrode(130). An upper electrode is formed on the strain layer.

Description

박막형 광로 조절 장치의 제조 방법Manufacturing method of thin film type optical path control device

본 발명은 액츄에이티드 미러 어레이(Actuated Mirror array; AMA)를 이용한 박막형 광로 조절 장치의 제조 방법에 관한 것으로, 보다 상세하게는 하부 전극을 각 화소별로 단락시키기 위한 식각 공정을 진행할 때 그 하부에 형성된 지지층의 손상(attack)을 방지할 수 있는 박막형 광로 조절 장치의 제조 방법에 관한 것이다.The present invention relates to a method of manufacturing a thin film type optical path control device using an Actuated Mirror Array (AMA), and more particularly, to a method of manufacturing a thin film type optical path adjusting device formed at a lower portion thereof when an etching process for shorting a lower electrode for each pixel is performed. The present invention relates to a method for manufacturing a thin film type optical path control device capable of preventing an attack of a support layer.

광학 에너지(optical energy)를 스크린 상에 투영하기 위한 장치인 공간적인 광 변조기(spatial light modulator)는 광통신, 화상 처리 및 정보 디스플레이 장치와 같은 다양한 분야에 응용될 수 있다. 상기 광로 조절 장치 또는 공간적 광 변조기를 이용한 화상 처리 장치는 통상적으로 광학 에너지를 스크린 상에 표시하는 방법에 따라 직시형 화상 표시 장치(direct-view image display device)와 투사형 화상 표시 장치(projection-type image display device)로 구분된다.Spatial light modulators, which are devices for projecting optical energy onto a screen, can be applied to various fields such as optical communication, image processing, and information display devices. The image processing apparatus using the optical path adjusting device or the spatial light modulator typically has a direct-view image display device and a projection-type image device according to a method of displaying optical energy on a screen. display device).

직시형 화상 표시 장치의 예로서는 CRT(Cathode Ray Tube)를 들 수 있는데, 이러한 CRT 장치는 소위 브라운관으로 불리는 것으로서 화질은 우수하나 화면의 대형화에 따라 그 중량과 용적이 증가하여 제조 비용이 상승하게 되는 문제가 있다. 투사형 화상 표시 장치로는 액정 표시 장치(Liquid Crystal Display : LCD), 디포머블 미러 어레이(Deformable Mirror Device; DMD) 및 AMA를 들 수 있다. 이러한 투사형 화상 표시 장치는 다시 그들의 광학적 특성에 따라 2개의 그룹으로 나뉠 수 있다. 즉, LCD와 같은 장치는 전송 광 변조기(transmissive spatial light modulators)로 분류될 수 있는데 반하여, DMD 및 AMA는 반사 광 변조기(reflective spatial light modulators)로 분류될 수 있다.An example of a direct-view image display device is a CRT (Cathode Ray Tube). The CRT device is called a CRT, which has excellent image quality but increases in weight and volume as the screen is enlarged, leading to an increase in manufacturing cost. There is. Projection type image display devices include a liquid crystal display (LCD), a deformable mirror device (DMD), and an AMA. Such projection image display devices can be further divided into two groups according to their optical characteristics. That is, devices such as LCDs can be classified as transmissive spatial light modulators, while DMD and AMA can be classified as reflective spatial light modulators.

LCD와 같은 전송 광 변조기는 광학적 구조가 매우 간단하므로, 얇게 형성하여 중량을 가볍게 할 수 있으며 용적을 줄이는 것이 가능하다. 그러나, 빛의 극성으로 인하여 광효율이 낮으며, 액정 재료에 고유하게 존재하는 문제, 예를 들면 응답 속도가 느리고 그 내부가 과열되기 쉬운 단점이 있다. 또한, 현존하는 전송 광 변조기의 최대 광 효율은 1 내지 2 % 범위로 한정되며, 수용 가능한 디스플레이 품질을 제공하기 위해서 암실 조건을 필요로 한다. 따라서, 상술한 문제점들을 해결하기 위하여 DMD 및 AMA와 같은 광 변조기가 개발되었다.Transmission optical modulators, such as LCDs, have a very simple optical structure, which makes them thinner, lighter in weight, and smaller in volume. However, due to the polarity of the light, the light efficiency is low, there is a problem inherent in the liquid crystal material, for example, there is a disadvantage that the response speed is slow and the inside is easy to overheat. In addition, the maximum light efficiency of existing transmission light modulators is limited to a range of 1-2% and requires dark room conditions to provide acceptable display quality. Therefore, optical modulators such as DMD and AMA have been developed to solve the above problems.

DMD는 5% 정도의 비교적 양호한 광효율을 나타내지만, DMD에 채용된 힌지 구조물에 의해서 심각한 피로 문제가 발생할 뿐만 아니라, 매우 복잡하고 값비싼 구동 회로가 요구된다는 단점이 있다. AMA는 그 내부에 설치된 각각의 거울들이 광원으로부터 입사되는 빛을 소정의 각도로 반사하고, 상기 반사된 빛이 슬릿(slit)이나 핀홀(pinhole)과 같은 개구(aperture)를 통과하여 스크린에 투영되어 화상을 맺도록 광속을 조절할 수 있는 장치이다. 따라서, 그 구조와 동작 원리가 간단하며, LCD나 DMD에 비해 높은 광효율(10% 이상)을 얻을 수 있다. 또한, 콘트라스트(contrast)가 향상되어 밝고 선명한 화상을 얻을 수 있다.Although DMD shows a relatively good light efficiency of about 5%, the hinge structure employed in the DMD not only causes serious fatigue problems, but also requires a very complicated and expensive driving circuit. In the AMA, each of the mirrors installed therein reflects light incident from the light source at a predetermined angle, and the reflected light is projected on the screen through an aperture such as a slit or a pinhole. It is a device that can adjust the speed of light to form an image. Therefore, its structure and operation principle are simple, and high light efficiency (10% or more) can be obtained compared to LCD or DMD. In addition, contrast can be improved to obtain a bright and clear image.

AMA의 각 액츄에이터는 인가되는 전기적인 화상 신호 및 바이어스 전압에 의하여 발생되는 전기장에 따라 변형을 일으킨다. 상기 액츄에이터가 변형을 일으킬 때 그 상부에 장착된 각각의 거울들이 경사지게 된다. 따라서, 상기 경사진 거울들은 입사된 빛을 소정의 각도로 반사시켜 스크린 상에 화상을 맺을 수 있도록 한다. 상기 각각의 거울들을 구동하는 액츄에이터로서 PZT(Pb(Zr, Ti)O3), 또는 PLZT((Pb, La)(Zr, Ti)O3) 등의 압전 물질이 이용된다. 또한, PMN (Pb(Mg, Nb)O3) 등의 전왜 물질로서 상기 액츄에이터를 구성할 수도 있다.Each actuator of the AMA generates a deformation in accordance with the electric field generated by the applied electric image signal and the bias voltage. As the actuator deforms, each of the mirrors mounted thereon is tilted. Accordingly, the inclined mirrors reflect the incident light at a predetermined angle to form an image on the screen. Piezoelectric materials such as PZT (Pb (Zr, Ti) O 3 ), or PLZT ((Pb, La) (Zr, Ti) O 3 ) are used as actuators for driving the respective mirrors. The actuator can also be configured as a warping material such as PMN (Pb (Mg, Nb) O 3 ).

이러한 AMA 장치는 크게 벌크형(bulk type)과 박막형(thin film type)으로 구분된다. 상기 벌크형 광로 조절 장치는 Gregory Um 등에게 허여된 미합중국 특허 제 5,085,497호에 개시되어 있다. 벌크형 광로 조절 장치는 다층 세라믹을 얇게 절단하여 내부에 금속 전극이 형성된 세라믹 웨이퍼를 트랜지스터가 내장된 액티브 매트릭스(active matrix)에 장착한 후, 쏘잉 방법으로 가공하고 그 상부에 거울을 설치함으로써 이루어진다. 그러나, 벌크형 광로 조절 장치는 설계 및 제조에 있어서 매우 높은 정밀도가 요구되며, 변형층의 응답이 느리다는 단점이 있다.These AMA devices are largely divided into bulk type and thin film type. The bulk optical path control device is disclosed in US Pat. No. 5,085,497 to Gregory Um et al. The bulk optical path adjusting device is made by thinly cutting a multilayer ceramic to mount a ceramic wafer having a metal electrode formed therein in an active matrix in which a transistor is embedded, and then processing by a sawing method and installing a mirror thereon. However, the bulk optical path control device requires very high precision in design and manufacturing, and has a disadvantage in that the response of the strained layer is slow.

이에 따라, 반도체 제조 공정을 이용하여 제조할 수 있는 박막형 광로 조절 장치가 개발되었다. 상기 박막형 광로 조절 장치는 본 출원인이 1996년 9월 24일 대한민국 특허청에 특허 출원한 특허 출원 제96-42197호 (발명의 명칭: 멤브레인의 스트레스를 조절할 수 있는 박막형 광로 조절 장치의 제조 방법)에 개시되어 있다.Accordingly, a thin film type optical path control apparatus that can be manufactured using a semiconductor manufacturing process has been developed. The thin film type optical path control device is disclosed in the patent application No. 96-42197 (name of the invention: a method of manufacturing a thin film type optical path control device that can control the stress of the membrane) that the applicant filed a patent with the Korean Patent Office on September 24, 1996 It is.

도 1은 상기 선행 출원에 기재된 박막형 광로 조절 장치의 단면도이다.1 is a cross-sectional view of a thin film type optical path adjusting device described in the above prior application.

도 1을 참조하면, 상기 박막형 광로 조절 장치는 액티브 매트릭스(1) 및 액츄에이터(60)를 포함한다. 그 내부에 M×N(M, N은 정수) 개의 모스(metal oxide semiconductor; MOS) 트랜지스터가 내장되고 일측 상부에 드레인 패드(5)가 형성된 액티브 매트릭스(1)는, 상기 액티브 매트릭스(1) 및 드레인 패드(5)의 상부에 적층된 보호층(passivation layer)(10)과 보호층(10)의 상부에 적층된 식각 방지층(15)을 포함한다.Referring to FIG. 1, the thin film type optical path adjusting device includes an active matrix 1 and an actuator 60. An active matrix 1 having M × N (M, N is an integer) MOS transistors and a drain pad 5 formed on one side thereof includes the active matrix 1 and A passivation layer 10 stacked on top of the drain pad 5 and an etch stop layer 15 stacked on top of the passivation layer 10 are included.

액츄에이터(60)는 상기 식각 방지층(15) 중에서 그 아래에 드레인 패드(5)가 형성된 부분에 일측이 접촉되며 타측이 에어 갭(25)을 개재하여 상기 액티브 매트릭스(1)와 평행하도록 적층된 멤브레인(30), 상기 멤브레인(30)의 상부에 적층된 하부 전극(35), 상기 하부 전극(35)의 상부에 적층된 변형층(40), 상기 변형층(40)의 상부에 적층된 상부 전극(45), 상기 변형층(40)의 일측으로부터 하부 전극(35), 멤브레인(30), 식각 방지층(15) 및 보호층(10)을 통하여 상기 드레인 패드(5)까지 수직하게 형성된 비어 홀(50) 내에 하부 전극(35)과 드레인 패드(5)가 서로 전기적으로 연결되도록 형성된 비어 컨택(55)을 포함한다.The actuator 60 is a membrane in which one side is in contact with a portion of the etch stop layer 15 in which the drain pad 5 is formed and the other side is parallel to the active matrix 1 via the air gap 25. 30, a lower electrode 35 stacked on the membrane 30, a strained layer 40 stacked on the lower electrode 35, and an upper electrode stacked on the strained layer 40. 45, a via hole vertically formed from one side of the strained layer 40 to the drain pad 5 through the lower electrode 35, the membrane 30, the etch stop layer 15, and the protective layer 10. The lower electrode 35 and the drain pad 5 are formed in the via contact 55 to be electrically connected to each other.

상기 상부 전극(45)의 일부에는 스트라이프(46)가 형성된다. 상기 스트라이프(46)는 상부 전극(45)을 균일하게 작동시켜 광원으로부터 입사되는 빛의 난반사를 방지한다.A stripe 46 is formed on a portion of the upper electrode 45. The stripe 46 operates the upper electrode 45 uniformly to prevent diffuse reflection of light incident from the light source.

이하, 상기 박막형 광로 조절 장치의 제조 방법을 도 2a 내지 2d를 참조하여 설명한다.Hereinafter, a method of manufacturing the thin film type optical path control device will be described with reference to FIGS. 2A to 2D.

도 2a를 참조하면, M×N(M, N은 정수) 개의 트랜지스터(도시되지 않음)가 내장되고 그 일측 상부에 드레인 패드(5)가 형성된 액티브 매트릭스(1) 상에 인 실리케이트 유리(phosphor-silicate glass; PSG)로 구성된 보호층(10)을 형성한다. 상기 보호층(10)은 화학 기상 증착(chemical vapor deposition; CVD) 방법을 이용하여 1.0㎛ 정도의 두께를 갖도록 형성한다. 상기 보호층(10)은 후속 공정으로부터 액티브 매트릭스(1)를 보호한다.Referring to FIG. 2A, a phosphorus-silicate glass (phosphor—) is formed on an active matrix 1 having M × N (M and N are integers) transistors (not shown) and a drain pad 5 formed on one side thereof. A protective layer 10 made of silicate glass (PSG) is formed. The protective layer 10 is formed to have a thickness of about 1.0 μm using chemical vapor deposition (CVD). The protective layer 10 protects the active matrix 1 from subsequent processes.

상기 보호층(10) 상에는 질화물로 이루어진 식각 방지층(15)이 형성된다. 상기 식각 방지층(15)은 저압 화학 기상 증착(low pressure CVD; LPCVD) 방법을 이용하여 0.1∼1.0㎛ 정도의 두께를 갖도록 형성한다. 상기 식각 방지층(15)은 후속하는 식각 공정 동안에 보호층(10) 및 액티브 매트릭스(1)가 식각되는 것을 방지한다.An etch stop layer 15 made of nitride is formed on the protective layer 10. The etch stop layer 15 may be formed to have a thickness of about 0.1 μm to about 1.0 μm using a low pressure chemical vapor deposition (LPCVD) method. The etch stop layer 15 prevents the protective layer 10 and the active matrix 1 from being etched during the subsequent etching process.

상기 식각 방지층(15) 상에는 희생층(20)이 형성된다. 상기 희생층(20)은 인(P)의 농도가 높은 PSG를 대기압 화학 기상 증착(atmospheric pressure CVD; APCVD) 방법을 이용하여 1.0∼3.0㎛ 정도의 두께를 갖도록 형성한다. 이 경우, 희생층(20)은 트랜지스터가 내장된 액티브 매트릭스(1)의 상부를 덮고 있으므로, 그 표면의 평탄도가 매우 불량하다. 따라서, 희생층(20)의 표면을 스핀 온 글래스(spin-on glass; SOG)를 사용하는 방법 또는 화학 기계적 연마(chemical mechanical polishing; CMP) 방법을 이용하여 평탄화시킨다. 이어서, 상기 희생층(20) 중 그 아래에 드레인 패드(5)가 형성되어 있는 부분을 식각하여 상기 식각 방지층(15)의 일부를 노출시킴으로써 액츄에이터의 지지부가 형성될 위치를 만든다.The sacrificial layer 20 is formed on the etch stop layer 15. The sacrificial layer 20 is formed of a PSG having a high concentration of phosphorus (P) to have a thickness of about 1.0 μm to 3.0 μm by using an atmospheric pressure chemical vapor deposition (APCVD) method. In this case, since the sacrificial layer 20 covers the upper portion of the active matrix 1 in which the transistor is embedded, the surface flatness is very poor. Accordingly, the surface of the sacrificial layer 20 is planarized by using spin-on glass (SOG) or chemical mechanical polishing (CMP). Subsequently, a portion of the sacrificial layer 20 in which the drain pad 5 is formed is etched to expose a portion of the etch stop layer 15 to form a position where the support portion of the actuator is to be formed.

도 2b를 참조하면, 상기 노출된 식각 방지층(15) 및 희생층(20) 상에 0.1∼1.0㎛ 정도의 두께로 멤브레인(30)을 형성한다. 상기 멤브레인(30)은 질화물을 저압 화학 기상 증착(LPCVD) 방법을 이용하여 형성한다. 이때, 저압의 반응 용기 내에서 반응 가스의 비를 변화시키면서 멤브레인(30)을 형성함으로써, 멤브레인(30) 내의 응력(stress)을 조절한다.Referring to FIG. 2B, the membrane 30 is formed on the exposed etch stop layer 15 and the sacrificial layer 20 to a thickness of about 0.1 μm to about 1.0 μm. The membrane 30 forms nitride using low pressure chemical vapor deposition (LPCVD). At this time, by forming the membrane 30 while varying the ratio of the reaction gas in the reaction vessel of low pressure, the stress in the membrane 30 is controlled.

상기 멤브레인(30) 상에는 예컨대 백금(Pt)-탄탈륨(Ta)으로 구성된 하부 전극(35)이 형성된다. 이어서, 상기 하부 전극(35)을 식각하여 각 화소별로 상기 하부 전극(35)을 단락시킴으로써 각 화소들에 독립적인 제1 신호(화상 신호)가 인가되도록 한다(Iso-cut 식각 공정).On the membrane 30, for example, a lower electrode 35 made of platinum (Pt) -tantalum (Ta) is formed. Subsequently, the lower electrode 35 is etched to short the lower electrode 35 for each pixel so that an independent first signal (image signal) is applied to each pixel (Iso-cut etching process).

상기 하부 전극(35) 상에는 PZT 또는 PLZT로 구성된 변형층(40)이 형성된다. 상기 변형층(40)은 졸-겔(sol-gel)법을 이용하여 0.1∼1.0㎛, 바람직하게는 0.4㎛ 정도의 두께를 갖도록 형성한 후, 급속 열처리(rapid thermal annealing; RTA) 방법으로써 상변이시킨다. 상기 변형층(40)은 공통 전극인 상부 전극(45)과 신호 전극인 하부 전극(35) 사이에 발생하는 전기장에 의하여 변형을 일으키다.The deformation layer 40 formed of PZT or PLZT is formed on the lower electrode 35. The strained layer 40 is formed to have a thickness of about 0.1 μm to about 1.0 μm, preferably about 0.4 μm using a sol-gel method, and then a phase change is performed by a rapid thermal annealing (RTA) method. Makes it. The deformation layer 40 is deformed by an electric field generated between the upper electrode 45 that is a common electrode and the lower electrode 35 that is a signal electrode.

상기 상부 전극(45)은 변형층(40)의 상부에 형성된다. 상기 상부 전극(45)은 알루미늄 또는 백금 등의 전기 전도성 및 반사성이 우수한 금속을 스퍼터링 방법을 이용하여 0.1∼1.0㎛ 정도의 두께를 갖도록 형성한다. 공통 전극인 상부 전극(45)에는 제2 신호(바이어스 신호)가 인가된다. 또한, 상기 상부 전극(45)은 광원으로부터 입사되는 빛을 반사하는 거울의 기능도 함께 수행한다.The upper electrode 45 is formed on the strained layer 40. The upper electrode 45 is formed of a metal having excellent electrical conductivity and reflectivity such as aluminum or platinum so as to have a thickness of about 0.1 to 1.0 μm using a sputtering method. The second signal (bias signal) is applied to the upper electrode 45 which is the common electrode. In addition, the upper electrode 45 also functions as a mirror that reflects light incident from the light source.

도 2c를 참조하면, 상기 상부 전극(45)을 소정의 화소 형상으로 패터닝한다. 이때, 상기 상부 전극(45)의 일측 상부에 스트라이프(46)가 형성되도록 패터닝한다. 계속해서, 상기 변형층(40) 및 하부 전극(35)을 순차적으로 소정의 화소 형상으로 패터닝한 후, 변형층(40)의 일측 상부로부터 드레인 패드(5)의 상부까지 변형층(40), 하부 전극(35), 멤브레인(30), 식각 방지층(15) 및 보호층(10)을 순차적으로 식각함으로써 비어 홀(50)을 형성한다. 이어서, 텅스텐, 백금 또는 티타늄 등의 금속을 리프트-오프 방법으로 증착하여 상기 드레인 패드(5)와 하부 전극(35)을 전기적으로 연결시키는 비어 컨택(55)을 형성한다. 따라서, 상기 비어 컨택(55)은 비어 홀(50) 내에서 하부 전극(35)으로부터 드레인 패드(5)의 상부까지 수직하게 형성된다. 그러므로, 외부로부터 인가된 제1 신호는 액티브 매트릭스(1)에 내장된 트랜지스터, 드레인 패드(5) 및 비어 컨택(55)을 통하여 하부 전극(35)에 인가된다.Referring to FIG. 2C, the upper electrode 45 is patterned into a predetermined pixel shape. In this case, the stripe 46 is patterned so that the stripe 46 is formed on one side of the upper electrode 45. Subsequently, the strained layer 40 and the lower electrode 35 are sequentially patterned into a predetermined pixel shape, and then the strained layer 40 is formed from an upper portion of one side of the strained layer 40 to an upper portion of the drain pad 5. The via hole 50 is formed by sequentially etching the lower electrode 35, the membrane 30, the etch stop layer 15, and the protective layer 10. Subsequently, a metal such as tungsten, platinum or titanium is deposited by a lift-off method to form a via contact 55 that electrically connects the drain pad 5 and the lower electrode 35. Therefore, the via contact 55 is formed vertically from the lower electrode 35 to the top of the drain pad 5 in the via hole 50. Therefore, the first signal applied from the outside is applied to the lower electrode 35 through the transistor, the drain pad 5, and the via contact 55 embedded in the active matrix 1.

도 2d를 참조하면, 상기 비어 컨택(55)이 형성된 결과물 전면에 포토레지스트층(도시하지 않음)을 도포하고 이를 패터닝하여 상기 멤브레인(30)을 노출시킨다. 이어서, 상기 포토레지스트층을 식각 마스크로 사용하여 상기 멤브레인(30)을 이방성 식각함으로써 소정의 화소 형상으로 패터닝한다. 계속해서, 상기 포토레지스트층을 식각 마스크로 사용하여 49% 플루오르화 수소(HF) 증기에 의해 상기 희생층(20)을 등방성 식각함으로써 에어 갭(25)을 형성한다. 이어서, 상기 포토레지스트층을 제거하고, 남아있는 식각 용액을 제거하기 위하여 세정 및 건조 공정을 실시함으로써 AMA 소자를 완성한다.Referring to FIG. 2D, a photoresist layer (not shown) is coated on the entire surface of the resultant product in which the via contact 55 is formed and patterned to expose the membrane 30. Subsequently, the membrane 30 is anisotropically etched using the photoresist layer as an etching mask, thereby patterning a predetermined pixel shape. Subsequently, the air gap 25 is formed by isotropically etching the sacrificial layer 20 by 49% hydrogen fluoride (HF) vapor using the photoresist layer as an etching mask. Subsequently, the AMA device is completed by removing the photoresist layer and performing a cleaning and drying process to remove the remaining etching solution.

상술한 박막형 광로 조절 장치에 있어서, 화상 신호 전류가 액티브 매트릭스(1)에 내장된 MOS 트랜지스터, 드레인 패드(5) 및 비어 컨택(55)을 통하여 신호 전극인 하부 전극(35)에 인가된다. 또한, 외부로부터 공통 전극선(도시하지 않음)을 통하여 상부 전극(45)에는 제2 신호가 인가되어 상부 전극(45)과 하부 전극(35) 사이에 전기장이 발생한다. 이 전기장에 의하여 상부 전극(45)과 하부 전극(35) 사이에 적층되어 있는 변형층(40)이 변형을 일으킨다. 상기 변형층(40)은 전기장에 대하여 수직인 방향으로 수축하며, 변형층(40)을 포함하는 액츄에이터(60)는 멤브레인(30)이 형성되어 있는 방향의 반대 방향으로 휘어진다. 따라서, 액츄에이터(60) 상부의 상부 전극(45)도 같은 방향으로 경사진다. 광원으로부터 입사되는 빛은 상부 전극(45)에 의해 소정의 각도로 반사된 후, 스크린에 투영되어 화상을 맺는다.In the above-described thin film type optical path adjusting device, an image signal current is applied to the lower electrode 35 which is a signal electrode through the MOS transistor, the drain pad 5, and the via contact 55 embedded in the active matrix 1. In addition, a second signal is applied to the upper electrode 45 through a common electrode line (not shown) from the outside to generate an electric field between the upper electrode 45 and the lower electrode 35. Due to this electric field, the strained layer 40 stacked between the upper electrode 45 and the lower electrode 35 causes deformation. The strained layer 40 contracts in a direction perpendicular to the electric field, and the actuator 60 including the strained layer 40 is bent in a direction opposite to the direction in which the membrane 30 is formed. Therefore, the upper electrode 45 on the actuator 60 is also inclined in the same direction. Light incident from the light source is reflected by the upper electrode 45 at a predetermined angle, and then is projected onto the screen to form an image.

그러나, 상술한 박막형 광로 조절 장치에서는 하부 전극을 각각의 화소별로 단락시키기 위한 "Iso-cut" 식각 공정을 진행할 때, 박막형 AMA 모듈 전체에서 완벽한 "Iso-cut" 식각을 실시하기 위해서 식각 장비의 식각 균일성을 보상해주어야 한다. 따라서, 상기 식각 공정은 과도 식각(over etch)으로 진행하여야 한다. 이 경우, 상기 하부 전극의 하부층인 멤브레인이 함께 식각되게 되어, 공정 완료 후 박막형 AMA 소자의 불량(failure)을 초래한다.However, in the above-described thin film type optical path control apparatus, when the “Iso-cut” etching process for shorting the lower electrode for each pixel is performed, the etching of the etching equipment is performed to perform a complete “Iso-cut” etching in the entire thin film type AMA module. Uniformity must be compensated for. Therefore, the etching process must proceed with over etching. In this case, the membrane, which is the lower layer of the lower electrode, is etched together, resulting in a failure of the thin film type AMA device after completion of the process.

도 3은 상술한 "Iso-cut" 식각 공정을 진행한 후의 박막형 광로 조절 장치의 평면도이다.3 is a plan view of a thin film type optical path control apparatus after the above-mentioned "Iso-cut" etching process.

도 3에 도시된 바와 같이, "Iso-cut" 식각 공정을 완료한 후 변형층(40) 및 하부 전극(35)을 화소 형상으로 패터닝하기 위한 사진 식각 공정을 진행할 때, "A" 부분은 포토레지스트에 의해 덮어지지 않고 오픈되기 때문에 계속적으로 식각되게 된다. 따라서, "A" 부분의 멤브레인(30)이 계속적으로 식각되기 때문에 손상되어 공정 불량의 원인이 된다.As shown in FIG. 3, when the photolithography process for patterning the deformed layer 40 and the lower electrode 35 into a pixel shape after completing the “iso-cut” etching process, the “A” portion is a photo. It is continuously etched because it is opened without being covered by the resist. Thus, the membrane 30 in the "A" part is etched continuously, which causes damage and causes process failure.

따라서, 본 발명의 목적은 하부 전극을 각각의 화소별로 단락시키기 위한 "Iso-cut" 식각 공정을 진행할 때 그 하부의 지지층의 손상을 방지할 수 있는 박막형 광로 조절 장치의 제조 방법을 제공하는데 있다.Accordingly, it is an object of the present invention to provide a method for manufacturing a thin film type optical path control apparatus capable of preventing damage to a support layer under the Iso-cut etching process for shorting a lower electrode for each pixel.

도 1은 본 출원인의 선행 출원에 기재된 박막형 광로 조절 장치의 단면도이다.1 is a cross-sectional view of a thin film type optical path adjusting device described in the applicant's prior application.

도 2a 내지 도 2d는 도 1에 도시한 장치의 제조 방법을 설명하기 위한 단면도들이다.2A to 2D are cross-sectional views illustrating a method of manufacturing the apparatus shown in FIG. 1.

도 3은 도 2b의 하부 전극을 각 화소별로 단락시키기 위한 식각 공정을 진행한 후의 박막형 광로 조절 장치의 평면도이다.3 is a plan view of a thin film type optical path control apparatus after an etching process for shorting the lower electrode of FIG. 2B for each pixel.

도 4는 본 발명에 따른 박막형 광로 조절 장치의 평면도이다.4 is a plan view of a thin film type optical path control apparatus according to the present invention.

도 5는 도 4에 도시한 장치를 B­B' 선으로 자른 단면도이다.FIG. 5 is a cross-sectional view of the apparatus shown in FIG. 4 taken along line B′B ′.

도 6a 내지 도 6f는 도 5에 도시한 장치의 제조 방법을 설명하기 위한 단면도들이다.6A to 6F are cross-sectional views illustrating a method of manufacturing the apparatus shown in FIG. 5.

<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>

100 : 액티브 매트릭스 200 : 액츄에이터100: active matrix 200: actuator

105 : 드레인 패드 110 : 보호층105: drain pad 110: protective layer

115 : 식각 방지층 125 : 지지층115: etch stop layer 125: support layer

130 : 하부 전극 135 : 변형층130: lower electrode 135: strained layer

140 : 상부 전극 145 : 비어 홀140: upper electrode 145: via hole

150 : 비어 컨택150: beer contact

상술한 본 발명의 목적을 달성하기 위하여, 본 발명은 그 일측 상부에 드레인 패드가 형성된 액티브 매트릭스를 제공하는 단계; 그리고 상기 액티브 매트릭스의 상부에, i) 상기 액티브 매트릭스의 상부에 일측이 접촉되며 타측이 에어 갭을 개재하여 상기 액티브 매트릭스와 평행하게 지지층을 형성하는 단계, ⅱ) 상기 지지층의 상부에 제1 도전층과 제2 도전층을 적층하여 하부 전극을 형성하는 단계, ⅲ) 상기 하부 전극의 제2 도전층을 식각한 후 산소(O2) 이온 주입을 실시함으로써, 상기 하부 전극의 제1 도전층의 노출부를 절연체로 만들어 상기 하부 전극을 각각의 화소별로 단락시키는 단계, ⅳ) 상기 하부 전극의 상부에 변형층을 형성하는 단계, 및 v) 상기 변형층의 상부에 상부 전극을 형성하는 단계를 갖는 액츄에이터를 형성하는 단계를 포함하는 박막형 광로 조절 장치의 제조 방법을 제공한다.In order to achieve the above object of the present invention, the present invention comprises the steps of providing an active matrix having a drain pad formed on one side thereof; And forming a support layer on top of the active matrix, i) one side of which is in contact with the top of the active matrix and the other side parallel to the active matrix via an air gap, ii) a first conductive layer on top of the support layer. And forming a lower electrode by laminating a second conductive layer, iii) exposing the first conductive layer of the lower electrode by performing oxygen (O 2 ) ion implantation after etching the second conductive layer of the lower electrode. Shorting the lower electrode by each pixel by making a part an insulator, iii) forming a strained layer on top of the lower electrode, and v) forming an upper electrode on top of the strained layer. It provides a method for manufacturing a thin film type optical path control device comprising the step of forming.

상술한 본 발명의 박막형 광로 조절 장치에 있어서, 외부로부터 TCP의 패드 및 AMA 패널의 패드를 통하여 전달된 제1 신호는 액티브 매트릭스에 내장된 MOS 트랜지스터, 드레인 패드 및 비어 컨택을 통하여 신호 전극인 하부 전극에 인가된다. 동시에, 외부로부터 공통 전극선을 통하여 상부 전극에는 제2 신호가 인가되어 상부 전극과 하부 전극 사이에 전기장이 발생한다. 이 전기장에 의하여 상부 전극과 하부 전극 사이에 적층되어 있는 변형층이 변형을 일으킨다. 상기 변형층은 전기장에 대하여 직교하는 방향으로 수축하며, 변형층을 포함하는 액츄에이터는 소정의 각도를 가지고 상방으로 휘어진다. 따라서, 상기 액츄에이터 상부에서 거울의 기능도 수행하는 상부 전극도 같은 방향으로 경사진다. 이에 따라, 광원으로부터 입사되는 빛은 경사진 상부 전극에 의해 소정의 각도로 반사된 후, 슬릿을 통과하여 스크린에 투영됨으로써 화상을 맺게 된다.In the above-described thin film type optical path control device of the present invention, the first signal transmitted from the outside through the pad of the TCP and the pad of the AMA panel is a lower electrode which is a signal electrode through the MOS transistor, the drain pad, and the via contact embedded in the active matrix. Is applied to. At the same time, a second signal is applied to the upper electrode through the common electrode line from the outside to generate an electric field between the upper electrode and the lower electrode. By this electric field, the strained layer laminated between the upper electrode and the lower electrode causes deformation. The strained layer contracts in a direction perpendicular to the electric field, and the actuator including the strained layer is bent upward at a predetermined angle. Therefore, the upper electrode which also functions as a mirror on the actuator is inclined in the same direction. Accordingly, the light incident from the light source is reflected by the inclined upper electrode at a predetermined angle, and then passes through the slit to be projected onto the screen to form an image.

상술한 바와 같이 본 발명에 따른 박막형 광로 조절 장치의 제조 방법에 의하면, 제1 도전층, 예컨대 탄탈륨(Ta)과 제2 도전층, 예컨대 백금(Pt)이 적층되어 이루어진 하부 전극을 각 화소별로 단락시키기 위한 "Iso-cut" 식각 공정시, 상기 하부 전극의 제2 도전층을 바람직하게는 식각 종료점(end of point; EOP)을 이용한 식각 공정으로 식각한 후 노출된 표면에 산소 이온 주입을 실시한다. 그 결과, 상기 제1 도전층이 절연체, 예컨대 탄탈륨-산소(Ta-O)의 절연체가 됨으로써 상기 하부 전극이 각각의 화소별로 단락된다.As described above, according to the manufacturing method of the thin film type optical path control apparatus according to the present invention, a lower electrode formed by stacking a first conductive layer, such as tantalum (Ta) and a second conductive layer, such as platinum (Pt), is short-circuited for each pixel. In the “Iso-cut” etching process, the second conductive layer of the lower electrode is etched by an etching process using an etching end point (EOP), and then oxygen ion implantation is performed on the exposed surface. . As a result, the first conductive layer becomes an insulator such as an insulator of tantalum-oxygen (Ta-O), so that the lower electrode is shorted for each pixel.

따라서, 본 발명은 "Iso-cut" 식각 공정시 과도 식각을 실시하지 않으므로, 과 식각에 의한 하부 전극의 하부층(지지층)의 손상을 방지하면서 하부 전극을 각 화소별로 단락시킬 수 있다.Therefore, since the present invention does not perform excessive etching during the “Iso-cut” etching process, the lower electrode can be shorted for each pixel while preventing damage to the lower layer (support layer) of the lower electrode due to over etching.

이하, 본 발명의 바람직한 실시예를 첨부한 도면을 참조하여 상세히 설명하고자 한다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings.

도 4는 본 발명에 따른 박막형 광로 조절 장치의 평면도이고, 도 5는 도 4에 도시한 장치를 B­B' 선으로 자른 단면도이다.4 is a plan view of a thin film type optical path adjusting device according to the present invention, and FIG. 5 is a cross-sectional view taken along line B′B ′ of the device of FIG. 4.

도 4 및 도 5를 참조하면, 본 발명에 따른 박막형 광로 조절 장치는 액티브 매트릭스(100) 및 상기 액티브 매트릭스(100)의 상부에 형성된 액츄에이터(200)를 포함한다. 그 내부에 M×N(M, N은 정수) 개의 MOS 트랜지스터가 내장되고 일측 상부에 드레인 패드(105)가 형성된 액티브 매트릭스(100)는, 상기 액티브 매트릭스(100) 및 드레인 패드(105)의 상부에 적층된 보호층(110), 및 상기 보호층(110)의 상부에 적층된 식각 방지층(115)을 포함한다.4 and 5, the thin film type optical path adjusting apparatus according to the present invention includes an active matrix 100 and an actuator 200 formed on the active matrix 100. An active matrix 100 having M × N (M, N is an integer) MOS transistors and a drain pad 105 formed on one side thereof has an upper portion of the active matrix 100 and the drain pad 105. The protective layer 110 is stacked on the protective layer 110, and the anti-etching layer 115 stacked on top of the protective layer 110.

상기 액츄에이터(200)는 상기 식각 방지층(115) 중에서 그 아래에 드레인 패드(105)가 형성된 부분에 일측이 접촉되며 타측이 에어 갭(도시되지 않음)을 개재하여 상기 액티브 매트릭스(100)와 평행하게 적층된 단면을 갖는 지지층(125), 상기 지지층(125)의 상부에 적층된 하부 전극(130), 상기 하부 전극(130)의 상부에 적층된 변형층(135), 상기 변형층(135)의 상부에 적층된 상부 전극(140), 상기 변형층(135)의 일측으로부터 하부 전극(130), 지지층(125), 식각 방지층(115) 및 보호층(110)을 통하여 상기 드레인 패드(105)까지 수직하게 형성된 비어 홀(145) 내에 하부 전극(130)과 드레인 패드(105)가 서로 전기적으로 연결되도록 형성된 비어 컨택(via contact)(155)을 포함한다.The actuator 200 is in contact with a portion of the etch stop layer 115 in which the drain pad 105 is formed, and the other side thereof is parallel to the active matrix 100 via an air gap (not shown). The support layer 125 having a stacked cross section, the lower electrode 130 stacked on the support layer 125, the strained layer 135 stacked on the upper portion of the lower electrode 130, and the strained layer 135 From one side of the upper electrode 140, the deformation layer 135 stacked on the upper electrode 130, the support layer 125, the etch stop layer 115 and the protective layer 110 through the drain pad 105 A via contact 155 is formed in the via hole 145 vertically formed so that the lower electrode 130 and the drain pad 105 are electrically connected to each other.

또한, 도 4를 참조하면 상기 지지층(125)의 평면은 그 일측이 중앙부에 사각형 형상의 오목한 부분을 가지며 이러한 오목한 부분이 양쪽 가장자리로 갈수록 계단형으로 넓어지는 형상으로 형성된다. 상기 지지층(125)의 평면의 타측은 상기 오목한 부분에 대응하여 중앙부로 갈수록 계단형으로 좁아지는 사각형 형상의 돌출부를 갖는다. 그러므로, 상기 지지층(125)의 오목한 부분에 인접한 액츄에이터의 지지층의 돌출부가 끼워지고, 상기 사각형 형상의 돌출부가 인접한 액츄에이터의 지지층의 오목한 부분에 끼워지게 된다. 본 발명의 지지층(125)은 상기 선행 출원에 기재된 장치 중 멤브레인(30)의 기능을 수행한다.In addition, referring to FIG. 4, the plane of the support layer 125 is formed in a shape in which one side thereof has a rectangular concave portion at a central portion thereof, and the concave portion widens stepwise toward both edges. The other side of the plane of the support layer 125 has a quadrangular protrusion that narrows stepwise toward the central portion corresponding to the concave portion. Therefore, the protrusion of the support layer of the actuator adjacent to the concave portion of the support layer 125 is fitted, and the rectangular protrusion is fitted to the concave portion of the support layer of the adjacent actuator. The support layer 125 of the present invention performs the function of the membrane 30 of the device described in the preceding application.

이하, 본 발명의 바람직한 실시예에 따른 박막형 광로 조절 장치의 제조 방법을 도면을 참조하여 상세하게 설명한다.Hereinafter, a method of manufacturing a thin film type optical path control apparatus according to a preferred embodiment of the present invention will be described in detail with reference to the drawings.

도 6a 내지 도 6f는 도 5에 도시한 장치의 제조 방법을 설명하기 위한 단면도들이다. 도 6a 내지 도 6f에 있어서, 도 5와 동일한 부재들에 대해서는 동일한 참조 번호를 사용한다.6A to 6F are cross-sectional views illustrating a method of manufacturing the apparatus shown in FIG. 5. 6A to 6F, the same reference numerals are used for the same members as in FIG.

도 6a를 참조하면, M×N(M, N은 정수) 개의 MOS 트랜지스터(도시되지 않음)가 내장되고 그 일측 상부에 드레인 패드(105)가 형성된 액티브 매트릭스(100) 상에 보호층(110)을 형성한다. 상기 액티브 매트릭스(100)는 실리콘 등의 반도체로 이루어지거나 유리 또는 알루미나(Al2O3) 등의 절연 물질로 구성된다. 상기 보호층(110)은 인 실리케이트 유리(PSG)를 화학 기상 증착(CVD) 방법을 이용하여 1.0㎛ 정도의 두께를 갖도록 형성한다. 상기 보호층(110)은 후속 공정으로부터 액티브 매트릭스(100)에 내장된 트랜지스터가 손상되는 것을 방지한다.Referring to FIG. 6A, a protective layer 110 is formed on an active matrix 100 having M × N (M and N are integers) MOS transistors (not shown) and a drain pad 105 formed on one side thereof. To form. The active matrix 100 is made of a semiconductor such as silicon or an insulating material such as glass or alumina (Al 2 O 3 ). The protective layer 110 is formed of a silicate glass (PSG) to have a thickness of about 1.0㎛ using a chemical vapor deposition (CVD) method. The protective layer 110 prevents damage to the transistor embedded in the active matrix 100 from subsequent processing.

이어서, 상기 보호층(110) 상에 식각 방지층(115)을 형성한다. 상기 식각 방지층(115)은 질화물을 저압 화학 기상 증착(LPCVD) 방법을 이용하여 0.1∼1.0㎛ 정도의 두께를 갖도록 형성한다. 상기 식각 방지층(115)은 후속하는 식각 공정 동안에 보호층(110) 및 트랜지스터가 내장된 액티브 매트릭스(100)가 식각되는 것을 방지한다.Subsequently, an etch stop layer 115 is formed on the protective layer 110. The etch stop layer 115 is formed to have a thickness of about 0.1 μm to about 1.0 μm using low pressure chemical vapor deposition (LPCVD). The etch stop layer 115 prevents the protective layer 110 and the active matrix 100 having the transistor embedded therein from being etched during the subsequent etching process.

이어서, 상기 식각 방지층(115) 상에 희생층(도시되지 않음)을 형성한다. 상기 희생층은 인(P)의 농도가 높은 PSG를 대기압 화학 기상 증착(APCVD) 방법을 이용하여 1.0∼3.0㎛ 정도의 두께를 갖도록 형성한다. 이 경우, 희생층은 트랜지스터가 내장된 액티브 매트릭스(100)의 상부를 덮고 있으므로, 그 표면의 평탄도가 매우 불량하다. 따라서, 희생층의 표면을 스핀 온 글래스(SOG)를 사용하는 방법 또는 화학 기계적 연마(CMP) 방법을 이용하여 평탄화시킨다. 이어서, 상기 희생층 중 그 아래에 드레인 패드(105)가 형성되어 있는 부분을 식각하여 상기 식각 방지층(115)의 일부를 노출시킴으로써 액츄에이터의 지지부가 형성될 위치를 만든다.Subsequently, a sacrificial layer (not shown) is formed on the etch stop layer 115. The sacrificial layer is formed of a PSG having a high concentration of phosphorus (P) to have a thickness of about 1.0 to 3.0 μm using an atmospheric chemical vapor deposition (APCVD) method. In this case, since the sacrificial layer covers the upper portion of the active matrix 100 in which the transistor is embedded, the flatness of the surface is very poor. Thus, the surface of the sacrificial layer is planarized by using spin on glass (SOG) or chemical mechanical polishing (CMP). Subsequently, a portion of the sacrificial layer in which the drain pad 105 is formed is etched to expose a portion of the etch stop layer 115 to form a position where the support portion of the actuator is to be formed.

도 6b를 참조하면, 상기 노출된 식각 방지층(115) 및 희생층(도시되지 않음) 상에 0.1∼1.0㎛ 정도의 두께로 지지층(125)을 형성한다. 상기 지지층(125)은 질화물 또는 금속 등의 경질의 물질을 저압 화학 기상 증착(LPCVD) 방법을 이용하여 형성한다. 이때, 저압의 반응 용기 내에서 반응 가스의 비를 변화시키면서 지지층(125)을 형성함으로써, 지지층(125) 내의 응력을 조절한다.Referring to FIG. 6B, the support layer 125 may be formed on the exposed etch stop layer 115 and the sacrificial layer (not shown) to a thickness of about 0.1 μm to about 1.0 μm. The support layer 125 is formed of a hard material such as nitride or metal using low pressure chemical vapor deposition (LPCVD). At this time, by forming the support layer 125 while changing the ratio of the reaction gas in the reaction vessel of low pressure, the stress in the support layer 125 is adjusted.

이어서, 상기 지지층(125) 상에 제1 도전층(130a)으로 예컨대 탄탈륨(Ta)을 스퍼터링 방법에 의해 약 200Å의 두께로 증착하고 그 위에 제2 도전층(130b)으로 예컨대 백금(Pt)을 스퍼터링 방법에 의해 약 1000Å의 두께로 증착하여 하부 전극(130)을 형성한다. 신호 전극인 하부 전극(130)에는 외부로부터 제1 신호가 액티브 매트릭스(100)에 내장된 트랜지스터와 드레인 패드(105)를 통하여 인가된다. 계속해서, 상기 하부 전극(130)을 각 화소별로 단락시키는 "Iso-cut" 식각 공정을 실시하기 위하여 상기 하부 전극(130) 상에 포토레지스트층(131)을 형성한다.Subsequently, for example, tantalum (Ta) is deposited on the support layer 125 as a first conductive layer 130a by a sputtering method to a thickness of about 200 GPa, and platinum (Pt) is deposited on the second conductive layer 130b thereon. The lower electrode 130 is formed by depositing a thickness of about 1000 mW by a sputtering method. The first signal from the outside is applied to the lower electrode 130, which is a signal electrode, through the transistor and the drain pad 105 embedded in the active matrix 100. Subsequently, a photoresist layer 131 is formed on the lower electrode 130 to perform an “iso-cut” etching process in which the lower electrode 130 is shorted for each pixel.

도 6c를 참조하면, 상기 포토레지스트층(131)을 식각 마스크로 하는 EOP 식각 공정을 실시하여 상기 하부 전극의 백금층(130b)을 식각한다. 이때, 상기 백금층(130b)은 완전히 식각되지 않고 약간 남아있을 수 있다.Referring to FIG. 6C, the platinum layer 130b of the lower electrode is etched by performing an EOP etching process using the photoresist layer 131 as an etching mask. At this time, the platinum layer 130b may remain slightly without being completely etched.

도 6d를 참조하면, 상기 포토레지스트층(131)을 이온 주입 마스크로 하여 노출된 결과물의 표면에 산소(O2) 이온 주입을 실시한 후 열처리한다. 그 결과, 200Å 두께의 상기 탄탈륨층(130a)이 Ta-O의 절연체(155)가 됨으로써, 상기 하부 전극(130)이 각 화소별로 단락된다. 또한, 남아있는 약간의 백금층(130b)도 Pt-O의 절연체(155)가 될 수 있어서 상기 하부 전극(130)이 각 화소별로 단락된다.Referring to FIG. 6D, oxygen (O 2 ) ion implantation is performed on the exposed surface of the photoresist layer 131 as an ion implantation mask, followed by heat treatment. As a result, the tantalum layer 130a having a thickness of 200 가 becomes the insulator 155 of Ta-O, so that the lower electrode 130 is shorted for each pixel. In addition, the remaining platinum layer 130b may also be an insulator 155 of Pt-O, so that the lower electrode 130 is shorted for each pixel.

도 6e를 참조하면, 각 화소별로 단락된 상기 하부 전극(130) 상에 PZT 또는 PLZT 등의 압전 물질로 구성된 변형층(135)을 형성한다. 상기 변형층(135)은 졸-겔(sol-gel)법, 스퍼터링 방법 또는 화학 기상 증착(CVD) 방법을 이용하여 0.1∼1.0㎛, 바람직하게는 0.4㎛ 정도의 두께를 갖도록 형성한 후, 급속 열처리(RTA) 방법으로써 상변이시킨다. 상기 변형층(135)은 공통 전극인 상부 전극(140)과 신호 전극인 하부 전극(130) 사이에 발생하는 전기장에 의하여 변형을 일으키다.Referring to FIG. 6E, a strained layer 135 made of a piezoelectric material such as PZT or PLZT is formed on the lower electrode 130 shorted for each pixel. The strained layer 135 is formed to have a thickness of about 0.1 μm to about 1.0 μm, preferably about 0.4 μm by using a sol-gel method, a sputtering method, or a chemical vapor deposition (CVD) method. Phase change is performed by a heat treatment (RTA) method. The deformation layer 135 is deformed by an electric field generated between the upper electrode 140 which is a common electrode and the lower electrode 130 which is a signal electrode.

이어서, 상부 전극(140)을 변형층(135)의 일측 상부에 형성한다. 상기 상부 전극(140)은 알루미늄(Al), 은(Ag) 또는 백금(Pt) 등의 전기 전도성 및 반사성이 우수한 금속을 스퍼터링 방법을 이용하여 0.1∼1.0㎛ 정도의 두께를 갖도록 형성한다. 상부 전극(140)에는 외부로부터 공통 전극선(도시하지 않음)으로부터 제2 신호가 인가되며, 동시에 상부 전극(140)은 광원으로부터 입사되는 빛을 반사하는 거울의 기능도 함께 수행한다.Subsequently, the upper electrode 140 is formed on one side of the strained layer 135. The upper electrode 140 is formed of a metal having excellent electrical conductivity and reflectivity such as aluminum (Al), silver (Ag), or platinum (Pt) to have a thickness of about 0.1 μm to about 1.0 μm using a sputtering method. The second electrode is applied to the upper electrode 140 from a common electrode line (not shown) from the outside, and at the same time, the upper electrode 140 also functions as a mirror that reflects light incident from the light source.

다음에, 상기 상부 전극(140), 변형층(135) 및 하부 전극(130)을 순차적으로 소정의 화소 형상으로 패터닝한다. 즉, 상부 전극(140) 위에 식각될 재료에 대해서 내성을 갖는 포토레지스트층(도시되지 않음)을 형성한 후, 상기 상부 전극(140)을 패터닝한다. 이어서, 상기 패터닝된 상부 전극(140)과 변형층(135)의 상부에 다시 포토레지스트 보호층(도시되지 않음)을 형성한 후, 상기 변형층(135)을 소정의 화소 형상으로 패터닝한다. 이와 같은 방식으로 하부 전극(130) 역시 소정의 화소 형상으로 패터닝한다.Next, the upper electrode 140, the strain layer 135, and the lower electrode 130 are sequentially patterned into a predetermined pixel shape. That is, after forming a photoresist layer (not shown) resistant to the material to be etched on the upper electrode 140, the upper electrode 140 is patterned. Subsequently, a photoresist protective layer (not shown) is again formed on the patterned upper electrode 140 and the strained layer 135, and then the strained layer 135 is patterned into a predetermined pixel shape. In this manner, the lower electrode 130 is also patterned into a predetermined pixel shape.

계속하여, 사진 식각 공정을 이용하여 상기 변형층(135) 중에서 그 아래에 드레인 패드(105)가 형성되어 있는 부분으로부터 상기 드레인 패드(105)의 상부까지 변형층(135), 하부 전극(130), 지지층(125), 식각 방지층(115) 및 보호층(110)을 순차적으로 식각함으로써 비어 홀(145)을 형성한다. 이어서, 텅스텐(W), 백금(Pt) 또는 티타늄(Ti) 등의 금속을 증착하여 상기 드레인 패드(105)와 하부 전극(130)을 전기적으로 연결시키는 비어 컨택(150)을 형성한다. 따라서, 상기 비어 컨택(150)은 비어 홀(145) 내에서 하부 전극(130)으로부터 드레인 패드(105)의 상부까지 수직하게 형성된다. 그러므로, 외부로부터 인가된 제1 신호는 액티브 매트릭스(100)에 내장된 트랜지스터, 드레인 패드(105) 및 비어 컨택(150)을 통하여 하부 전극(130)에 인가된다.Subsequently, the strained layer 135 and the lower electrode 130 from the portion where the drain pad 105 is formed under the strain layer 135 under the photolithography process to an upper portion of the drain pad 105. The via hole 145 is formed by sequentially etching the support layer 125, the etch stop layer 115, and the protective layer 110. Subsequently, metal via tungsten (W), platinum (Pt), or titanium (Ti) is deposited to form a via contact 150 that electrically connects the drain pad 105 and the lower electrode 130. Accordingly, the via contact 150 is vertically formed from the lower electrode 130 to the top of the drain pad 105 in the via hole 145. Therefore, the first signal applied from the outside is applied to the lower electrode 130 through the transistor, the drain pad 105, and the via contact 150 embedded in the active matrix 100.

도 6f를 참조하면, 상기 상부 전극(140), 변형층(135) 및 하부 전극(130)의 노출된 표면을 덮도록 포토레지스트 보호층(도시되지 않음)을 형성한 후, 이를 식각 마스크로 하여 상기 지지층(125)을 소정의 화소 형상으로 식각한다.Referring to FIG. 6F, a photoresist protective layer (not shown) is formed to cover the exposed surfaces of the upper electrode 140, the strain layer 135, and the lower electrode 130, and then, as an etching mask. The support layer 125 is etched into a predetermined pixel shape.

계속해서, 상기 포토레지스트 보호층을 식각 마스크로 하여 상기 희생층(도시되지 않음)을 플루오르화 수소(HF) 증기를 이용하여 식각함으로써 에어 갭(도시되지 않음)을 형성한 후, 세정 및 건조하여 액츄에이터(200)를 형성한다. 이어서, 남아있는 식각 용액을 제거하기 위하여 헹굼 및 건조 처리를 수행하여 AMA 소자를 완성한다.Subsequently, the sacrificial layer (not shown) is etched using hydrogen fluoride (HF) vapor using the photoresist protective layer as an etching mask to form an air gap (not shown), followed by cleaning and drying. Actuator 200 is formed. Then, rinsing and drying are performed to remove the remaining etching solution to complete the AMA device.

상술한 바와 같이 M×N 개의 박막형 AMA 소자를 완성한 후, 크롬(Cr), 니켈(Ni) 또는 금(Au) 등의 금속을 스퍼터링 방법 또는 증착(evaporation) 방법에 의해 상기 액티브 매트릭스(100)의 하단에 증착하여 저항 컨택(ohmic contact)(도시되지 않음)을 형성한다. 다음에, 공통 전극인 상부 전극(140)에 제2 신호를 인가하고 신호 전극인 하부 전극(130)에 제1 신호를 인가하기 위한 TCP(tape carrier package)(도시되지 않음) 본딩을 대비하여 통상의 사진 식각 공정을 이용하여 상기 액티브 매트릭스(100)를 소정의 두께까지 절단한다. 계속해서, TCP 본딩을 대비해 AMA 패널의 패드(도시되지 않음)가 충분한 높이를 갖도록 하기 위하여 AMA 패널의 패드 상부에 포토레지스트층(도시되지 않음)을 형성한다. 이어서, 상기 포토레지스트층 중에서 그 아래에 패드가 형성되지 않은 부분을 패터닝하여 AMA 패널의 패드를 노출시킨다. 다음에, 상기 포토레지스트층을 식각하고, 상기 액티브 매트릭스(100)를 소정의 형상으로 완전히 절단한 후 AMA 패널의 패드와 TCP의 패드를 일방향 전도성 수지(anisotropic conductive film; ACF)(도시되지 않음)로 연결하여 박막형 AMA 모듈의 제조를 완성한다.As described above, after completing the M × N thin film type AMA devices, a metal such as chromium (Cr), nickel (Ni), or gold (Au) is sputtered or evaporated into the active matrix 100. Deposited at the bottom to form an ohmic contact (not shown). Next, in general, a tape carrier package (TCP) (not shown) for applying a second signal to the upper electrode 140 as the common electrode and the first signal to the lower electrode 130 as the signal electrode is usually prepared. The active matrix 100 is cut to a predetermined thickness using a photolithography process. Subsequently, a photoresist layer (not shown) is formed over the pad of the AMA panel so that the pad of the AMA panel (not shown) has a sufficient height in preparation for TCP bonding. Subsequently, a portion of the photoresist layer, in which no pad is formed, is patterned to expose the pad of the AMA panel. Next, the photoresist layer is etched, the active matrix 100 is completely cut into a predetermined shape, and then the pad of the AMA panel and the pad of the TCP are unidirectional conductive film (ACF) (not shown). To complete the manufacture of the thin film AMA module.

상술한 본 발명의 박막형 광로 조절 장치에 있어서, 외부로부터 TCP의 패드 및 AMA 패널의 패드를 통하여 전달된 제1 신호는 액티브 매트릭스(100)에 내장된 MOS 트랜지스터, 드레인 패드(105) 및 비어 컨택(150)을 통하여 신호 전극인 하부 전극(130)에 인가된다. 동시에, 외부로부터 공통 전극선을 통하여 상부 전극(140)에는 제2 신호가 인가되어 상부 전극(140)과 하부 전극(130) 사이에 전기장이 발생한다. 이 전기장에 의하여 상부 전극(140)과 하부 전극(130) 사이에 적층되어 있는 변형층(135)이 변형을 일으킨다. 상기 변형층(135)은 상기 전기장에 대하여 직교하는 방향으로 수축하며, 변형층(135)을 포함하는 액츄에이터(200)는 소정의 각도를 가지고 상방으로 휘어진다. 따라서, 상기 액츄에이터(200) 상부에서 거울의 기능도 수행하는 상부 전극(140)도 같은 방향으로 경사진다. 이에 따라, 광원으로부터 입사되는 빛은 경사진 상부 전극(140)에 의해 소정의 각도로 반사된 후, 슬릿을 통과하여 스크린에 투영됨으로써 화상을 맺게 된다.In the above-described thin film type optical path control device of the present invention, the first signal transmitted from the outside through the pad of the TCP and the pad of the AMA panel is the MOS transistor, the drain pad 105 and the via contact (built in the active matrix 100). It is applied to the lower electrode 130 which is a signal electrode through the 150. At the same time, a second signal is applied to the upper electrode 140 through the common electrode line from the outside to generate an electric field between the upper electrode 140 and the lower electrode 130. Due to this electric field, the strained layer 135 stacked between the upper electrode 140 and the lower electrode 130 causes deformation. The strained layer 135 contracts in a direction perpendicular to the electric field, and the actuator 200 including the strained layer 135 is bent upward at a predetermined angle. Therefore, the upper electrode 140 which also functions as a mirror on the actuator 200 is inclined in the same direction. Accordingly, the light incident from the light source is reflected by the inclined upper electrode 140 at a predetermined angle, and then passes through the slit to be projected onto the screen to form an image.

또한, 도시하지는 않았으나 상부 전극을 제2 신호가 인가되는 공통 전극으로만 사용하고 상기 상부 전극의 상부에 입사되는 빛을 반사시키기 위한 거울이 별도로 형성되는 박막형 광로 조절 장치에 본 발명을 적용할 수 있음은 물론이다. 이 경우, 상기 거울은 통상적으로 상기 상부 전극의 일측 상부에 접촉되는 지지부를 갖고 에어 갭을 개재하여 상기 상부 전극과 수평하게 '??'자 형상으로 형성된다.In addition, although not shown, the present invention may be applied to a thin film type optical path adjusting apparatus in which an upper electrode is used only as a common electrode to which a second signal is applied, and a mirror for reflecting light incident on the upper electrode is separately formed. Of course. In this case, the mirror is generally formed in a '??' shape horizontally with the upper electrode via the air gap having a support portion in contact with the upper side of the upper electrode.

상술한 바와 같이 본 발명에 따른 박막형 광로 조절 장치의 제조 방법에 의하면, 제1 도전층과 제2 도전층이 적층되어 이루어진 하부 전극을 각 화소별로 단락시키기 위한 "Iso-cut" 식각 공정시, 상기 하부 전극의 제2 도전층을 EOP 식각 공정으로 식각한 후 노출된 표면에 산소 이온 주입을 실시한다. 그 결과, 상기 제1 도전층이 절연체가 됨으로써 상기 하부 전극이 각각의 화소별로 단락된다. 또한, 상기 EOP 식각 공정시 식각되지 않고 남아 있는 약간의 제2 도전층도 예컨대 백금-산소(Pt-O)의 절연체가 될 수 있다.As described above, according to the manufacturing method of the thin film type optical path control apparatus according to the present invention, in the “Iso-cut” etching process for shorting the lower electrode formed by stacking the first conductive layer and the second conductive layer for each pixel, the The second conductive layer of the lower electrode is etched by an EOP etching process and then oxygen ions are implanted into the exposed surface. As a result, since the first conductive layer becomes an insulator, the lower electrode is shorted for each pixel. In addition, some of the second conductive layers that remain unetched during the EOP etching process may also be, for example, insulators of platinum-oxygen (Pt-O).

따라서, 본 발명은 "Iso-cut" 식각 공정시 과도 식각을 실시하지 않으므로, 과 식각에 의한 하부 전극 하부층(지지층)의 손상을 방지하면서 하부 전극을 각 화소별로 단락시킬 수 있다.Therefore, since the present invention does not perform excessive etching during the “Iso-cut” etching process, the lower electrode may be shorted for each pixel while preventing damage to the lower electrode underlayer (support layer) due to overetching.

상기에서는 본 발명의 바람직한 실시예를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.Although described above with reference to a preferred embodiment of the present invention, those skilled in the art will be variously modified and changed within the scope of the invention without departing from the spirit and scope of the invention described in the claims below I can understand that you can.

Claims (5)

그 일측 상부에 드레인 패드가 형성된 액티브 매트릭스를 제공하는 단계; 그리고Providing an active matrix having a drain pad formed on one side thereof; And 상기 액티브 매트릭스의 상부에, i) 상기 액티브 매트릭스의 상부에 일측이 접촉되며 타측이 에어 갭을 개재하여 상기 액티브 매트릭스와 평행하게 지지층을 형성하는 단계, ⅱ) 상기 지지층의 상부에 제1 도전층과 제2 도전층을 적층하여 하부 전극을 형성하는 단계, ⅲ) 상기 하부 전극의 제2 도전층을 식각한 후 산소(O2) 이온 주입을 실시함으로써, 상기 하부 전극의 제1 도전층의 노출부를 절연체로 만들어 상기 하부 전극을 각각의 화소별로 단락시키는 단계, ⅳ) 상기 하부 전극의 상부에 변형층을 형성하는 단계, 및 v) 상기 변형층의 상부에 상부 전극을 형성하는 단계를 갖는 액츄에이터를 형성하는 단계를 포함하는 박막형 광로 조절 장치의 제조 방법.I) forming a support layer on top of the active matrix, i) one side of which is in contact with the top of the active matrix and the other side parallel to the active matrix via an air gap, ii) a first conductive layer on top of the support layer; Forming a lower electrode by laminating a second conductive layer; i) implanting oxygen (O 2 ) ions after etching the second conductive layer of the lower electrode, thereby exposing the exposed portion of the first conductive layer of the lower electrode; Shorting the lower electrode by each pixel by making an insulator, i) forming an actuator on top of the lower electrode, and v) forming an upper electrode on top of the deformation layer. Method of manufacturing a thin film type optical path control device comprising the step. 제1항에 있어서, 상기 하부 전극의 제2 도전층은 식각 종료점을 이용한 식각 공정으로 식각하는 것을 특징으로 하는 박막형 광로 조절 장치의 제조 방법.The method of claim 1, wherein the second conductive layer of the lower electrode is etched by an etching process using an etching endpoint. 제1항에 있어서, 상기 제1 도전층은 탄탈륨(Ta)으로 형성하고 상기 제2 도전층은 백금(Pt)으로 형성하는 것을 특징으로 하는 박막형 광로 조절 장치의 제조 방법.The method of claim 1, wherein the first conductive layer is formed of tantalum (Ta) and the second conductive layer is formed of platinum (Pt). 제3항에 있어서, 상기 산소 이온 주입에 의해 노출된 상기 하부 전극의 제1 도전층은 탄탈륨-산소(Ta-O)의 절연체가 되는 것을 특징으로 하는 박막형 광로 조절 장치의 제조 방법.The method of claim 3, wherein the first conductive layer of the lower electrode exposed by the oxygen ion implantation is an insulator of tantalum-oxygen (Ta-O). 제1항에 있어서, 상기 액츄에이터를 형성하는 단계는, 상기 변형층의 상부에 상부 전극을 형성하는 단계 후, 상기 변형층 중에서 그 아래에 상기 드레인 패드가 형성되어 있는 부분으로부터 상기 변형층, 하부 전극 및 지지층을 식각함으로써 상기 드레인 패드를 노출시키는 비어 홀을 형성하는 단계; 및 상기 비어 홀의 내부에 금속을 증착하여 상기 드레인 패드와 하부 전극을 전기적으로 연결시키는 비어 컨택을 형성하는 단계를 더 포함하는 것을 특징으로 하는 박막형 광로 조절 장치의 제조 방법.The method of claim 1, wherein the forming of the actuator comprises: forming the upper electrode on an upper portion of the deforming layer, and then forming the lower electrode from the portion of the deforming layer where the drain pad is formed. And forming a via hole exposing the drain pad by etching the support layer. And depositing a metal in the via hole to form a via contact that electrically connects the drain pad and the lower electrode to the thin film type optical path control apparatus.
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