JPS626468A - Ｐｃｍ信号処理装置 - Google Patents
Ｐｃｍ信号処理装置Info
- Publication number
- JPS626468A JPS626468A JP14521085A JP14521085A JPS626468A JP S626468 A JPS626468 A JP S626468A JP 14521085 A JP14521085 A JP 14521085A JP 14521085 A JP14521085 A JP 14521085A JP S626468 A JPS626468 A JP S626468A
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- JP
- Japan
- Prior art keywords
- channel
- address
- block
- circuit
- segment
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はステレオ録音、再生、カラオケ録音。
再生等のマルチチャンネルの録音或いは記録を回転ヘッ
ド或いは固定ヘッドにより記録或いは再生するＰＣＭ信
号処理装置に関する。
ド或いは固定ヘッドにより記録或いは再生するＰＣＭ信
号処理装置に関する。
従来ＰＣＭ記録装置において複数のＰＣＭデータで構成
された１ブロック中にそのブロックのアドレスコードを
つけたものや、あるいは１セグメントのアドレスコード
をつけたものが発表されており、これらは記録情報デー
タを処理する上でのコントロール用、あるいはその保護
用のデータワードとしての機能を有していた。
された１ブロック中にそのブロックのアドレスコードを
つけたものや、あるいは１セグメントのアドレスコード
をつけたものが発表されており、これらは記録情報デー
タを処理する上でのコントロール用、あるいはその保護
用のデータワードとしての機能を有していた。
而して情報データとして２チャンネル以上を記録するマ
ルチチャンネル記録装置においては１セグメント中、多
チャンネルのデータが存在する。
ルチチャンネル記録装置においては１セグメント中、多
チャンネルのデータが存在する。
第２図はこのチャンネル数を４とした回転ヘッド方式の
テープの記録フォーマントの一例を示す。
テープの記録フォーマントの一例を示す。
この場合のトラック１．１．・・・・・・（セグメント
）構成は、１トランク完結形であり、１セグメント中に
４つのチャンネルデータが存在する。図において１は磁
気テープ、２〜５はチャンネル１からチャンネル４まで
の各チャンネルのデータの複数ブロックＢ、Ｂ・・・・
・・毎の格納領域である。
）構成は、１トランク完結形であり、１セグメント中に
４つのチャンネルデータが存在する。図において１は磁
気テープ、２〜５はチャンネル１からチャンネル４まで
の各チャンネルのデータの複数ブロックＢ、Ｂ・・・・
・・毎の格納領域である。
この様な構成で記録したデータを再生する時に、マルチ
チャンネル構成の性質上、再生回路はチャンネルごとに
独立に持ち、しかも再生ヘッドは１スキャン分は１つの
ヘッドで読みとる為、外乱による再生系でのチャンネル
認識エラーを生じることが考えられる。この時、ブロッ
ク単体としては・エラーが発生していないとすればその
ブロックば別チャンネルデータとして再生され、結果的
に異音となって出力される。又掻端な場合はチャンネル
エリアの総てのブロックが別チャンネルデータとして再
生されかねない。
チャンネル構成の性質上、再生回路はチャンネルごとに
独立に持ち、しかも再生ヘッドは１スキャン分は１つの
ヘッドで読みとる為、外乱による再生系でのチャンネル
認識エラーを生じることが考えられる。この時、ブロッ
ク単体としては・エラーが発生していないとすればその
ブロックば別チャンネルデータとして再生され、結果的
に異音となって出力される。又掻端な場合はチャンネル
エリアの総てのブロックが別チャンネルデータとして再
生されかねない。
かかる問題を解決するため情報データとして２チャンネ
ル以上を記録するマルチＰＣＭ記録装置においてその構
成単位としてのブロックとセグメントの中間にチャンネ
ルという考え方を導入すると都合がよく、このチャンネ
ル用のアドレスコードを１ブロック中のコントロールコ
ードに導入するとよいことが判明した。すなわち本発明
は、各ブロックに、このチャンネル用のアドレスコード
を付加し、これが正しいか否かの判定回路を有すること
で、このチャンネルの再生側回路での認識をより高め、
前記した様なチャンネル認識エラーによる異音の防止を
可能としたシステムを提供するものである。
ル以上を記録するマルチＰＣＭ記録装置においてその構
成単位としてのブロックとセグメントの中間にチャンネ
ルという考え方を導入すると都合がよく、このチャンネ
ル用のアドレスコードを１ブロック中のコントロールコ
ードに導入するとよいことが判明した。すなわち本発明
は、各ブロックに、このチャンネル用のアドレスコード
を付加し、これが正しいか否かの判定回路を有すること
で、このチャンネルの再生側回路での認識をより高め、
前記した様なチャンネル認識エラーによる異音の防止を
可能としたシステムを提供するものである。
以下本発明を説明すると複数のＰＣＭ信号によって１ブ
ロックＢが構成され、複数個のブロックＢによって１チ
ャンネルが構成され、さらに、複数個のチャンネルによ
って１セグメントｔ＋、ｔｇ・・・・・・が構成される
ＰＣＭマルチチャンネル記録再生装置において、上記１
ブロックあるいは１チャンネルごとに、チャンネルアド
レス８が付加され、再生側回路Ｐにおいてはそのチャン
ネルアドレス８が正しいかどうかを判定するエラー検出
回路１３を有する。
ロックＢが構成され、複数個のブロックＢによって１チ
ャンネルが構成され、さらに、複数個のチャンネルによ
って１セグメントｔ＋、ｔｇ・・・・・・が構成される
ＰＣＭマルチチャンネル記録再生装置において、上記１
ブロックあるいは１チャンネルごとに、チャンネルアド
レス８が付加され、再生側回路Ｐにおいてはそのチャン
ネルアドレス８が正しいかどうかを判定するエラー検出
回路１３を有する。
チャンネルアドレス８をセグメントｊｌ＋Ｆ・・・・・
・内の各チャンネル位置情報としてＰＣ？ｌ信号の処理
を行うものである。
・内の各チャンネル位置情報としてＰＣ？ｌ信号の処理
を行うものである。
本発明の実施例による各チャンネルの信号におけるブロ
ックＢの構成を第１図に示す。第１図において６はブロ
ックＢの先頭ワードで同期用信号・７と９は前記したセ
グメントアドレスとブロックアドレスである。８が本発
明によるチャンネルアドレスコードで、１０はこれらの
セグメントアドレス７、チャンネルアドレスコード８．
ブロックアドレス９までの３ワードに対するパリティ検
査ワード（ＣＲＣＣ）である、又１１はＰＣＭ情報デー
タとそのパリティを含むエリアである。チャンネルアド
レスコード８はせいぜい５ビットａ度（３２チャンネル
に対応）で良（，１ワードを８ビツトとした場合には残
りの３ビツトは他の目的で使用できる。
ックＢの構成を第１図に示す。第１図において６はブロ
ックＢの先頭ワードで同期用信号・７と９は前記したセ
グメントアドレスとブロックアドレスである。８が本発
明によるチャンネルアドレスコードで、１０はこれらの
セグメントアドレス７、チャンネルアドレスコード８．
ブロックアドレス９までの３ワードに対するパリティ検
査ワード（ＣＲＣＣ）である、又１１はＰＣＭ情報デー
タとそのパリティを含むエリアである。チャンネルアド
レスコード８はせいぜい５ビットａ度（３２チャンネル
に対応）で良（，１ワードを８ビツトとした場合には残
りの３ビツトは他の目的で使用できる。
第３図にこの場合の再生側回路Ｐにおけるエラー検出回
路と、チャンネルアドレスの保護回路を示す。図におい
て１２はコントロールワード入力端子、１３はパリティ
検査ワードによるエラー検出回路で次段チャンネル数設
定回路１４ヘエラーのときはエラー信号を、正しい時は
そのチャンネルアドレスを送り出す。１４はこのエラー
検出回路１３からの情報とデコーダー１７からの情報に
より実際のチャンネル数を決定し、チャンネル制御コン
トローラ１５へ出力する。１６はチャンネルデータホー
ルド回路で、１つ前のチャンネル数、あるいは複数個の
前のチャンネル数を記録しておき、次のチャンネル数が
何であるかの選択情報をデコーダー１７へ供給する。従
ってこのフィードバック保護回路により信頼性の高いチ
ャンネル数が再生側回路Ｐ中で認識できる。
路と、チャンネルアドレスの保護回路を示す。図におい
て１２はコントロールワード入力端子、１３はパリティ
検査ワードによるエラー検出回路で次段チャンネル数設
定回路１４ヘエラーのときはエラー信号を、正しい時は
そのチャンネルアドレスを送り出す。１４はこのエラー
検出回路１３からの情報とデコーダー１７からの情報に
より実際のチャンネル数を決定し、チャンネル制御コン
トローラ１５へ出力する。１６はチャンネルデータホー
ルド回路で、１つ前のチャンネル数、あるいは複数個の
前のチャンネル数を記録しておき、次のチャンネル数が
何であるかの選択情報をデコーダー１７へ供給する。従
ってこのフィードバック保護回路により信頼性の高いチ
ャンネル数が再生側回路Ｐ中で認識できる。
以上説明した様にこの実施例では各チャンネルの信号に
おける１ブロックＢにコントロールワードとして、チャ
ンネルアドレス８を付加し、これの正誤を判定するため
のエラー検出回路１３と、このチャンネルアドレスの保
護回路１４ 、１５ 、１６ 、１７を存することによ
りチャンネル認識エラーによる異音の発生を防止すると
ともに１つのチャンネルの独立した操作を容易に行うこ
とが可能になるという優れた効果がある。
おける１ブロックＢにコントロールワードとして、チャ
ンネルアドレス８を付加し、これの正誤を判定するため
のエラー検出回路１３と、このチャンネルアドレスの保
護回路１４ 、１５ 、１６ 、１７を存することによ
りチャンネル認識エラーによる異音の発生を防止すると
ともに１つのチャンネルの独立した操作を容易に行うこ
とが可能になるという優れた効果がある。
以上の実施例は回転ヘッドによる記録方式で説明したが
、本発明はこれに限らず、例えば第４図に示す固定ヘッ
ド方式におけるチャンネルスクランブルのテープフォー
マットの場合にも適用しうるものである。
、本発明はこれに限らず、例えば第４図に示す固定ヘッ
ド方式におけるチャンネルスクランブルのテープフォー
マットの場合にも適用しうるものである。
すなわち第４図示のように固定ヘッド方式でも各チャン
ネルの数ブロックＢ・・・・・・を各トラックＦ＋ｔ２
・・・・・・の格納領域２，３，４．５にスクランブル
にあるいはランダムに記録する。各ブロックＢには前記
のチャンネルアドレス８があり、前記したのと同様の効
果が達成できる。
ネルの数ブロックＢ・・・・・・を各トラックＦ＋ｔ２
・・・・・・の格納領域２，３，４．５にスクランブル
にあるいはランダムに記録する。各ブロックＢには前記
のチャンネルアドレス８があり、前記したのと同様の効
果が達成できる。
以上のように本発明によれば各チャンネルの信号におけ
る１ブロックＢにコントロールワードとして、チャンネ
ルアドレス８を付加し、これの正誤を判定するためのエ
ラー検出回路１３によってチャンネル認識エラーによる
異音の発生を防止するとともに１つのチャンネルの独立
した操作を容易に行うことが可能になるものである。
る１ブロックＢにコントロールワードとして、チャンネ
ルアドレス８を付加し、これの正誤を判定するためのエ
ラー検出回路１３によってチャンネル認識エラーによる
異音の発生を防止するとともに１つのチャンネルの独立
した操作を容易に行うことが可能になるものである。
第１図は本発明の一実施例の各チャンネルの信号におけ
るブロックの説明図、第２図はその回転ヘッドによるテ
ープの記録フォーマット、第３図はその再生側回路の要
部のブロック図、第４図は本発明の他の実施例の固定ヘ
ッドによるテープの記録フォーマットである。 Ｂはブロック、Ｆ＋Ｆ・・・・・・はセグメント、８は
チャンネルアドレス、Ｐは再生側回路、１３はエラー検
出回路である。
るブロックの説明図、第２図はその回転ヘッドによるテ
ープの記録フォーマット、第３図はその再生側回路の要
部のブロック図、第４図は本発明の他の実施例の固定ヘ
ッドによるテープの記録フォーマットである。 Ｂはブロック、Ｆ＋Ｆ・・・・・・はセグメント、８は
チャンネルアドレス、Ｐは再生側回路、１３はエラー検
出回路である。
Claims (1)
- 複数のＰＣＭ信号によって１ブロックが構成され、複数
個のブロックによって１チャンネルが構成され、さらに
、複数個のチャンネルによって１セグメントが構成され
るＰＣＭマルチチャンネル記録再生装置において、上記
１ブロックあるいは１チャンネルごとに、チャンネルア
ドレスが付加され、再生側回路においてはそのチャンネ
ルアドレスが正しいかどうかを判定する回路を有し、そ
のチャンネルアドレスをセグメント内の各チャンネル位
置情報としてＰＣＭ信号の処理を行うことを特徴とした
ＰＣＭ信号処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14521085A JPS626468A (ja) | 1985-07-01 | 1985-07-01 | Ｐｃｍ信号処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14521085A JPS626468A (ja) | 1985-07-01 | 1985-07-01 | Ｐｃｍ信号処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS626468A true JPS626468A (ja) | 1987-01-13 |
Family
ID=15379926
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14521085A Pending JPS626468A (ja) | 1985-07-01 | 1985-07-01 | Ｐｃｍ信号処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS626468A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1995008823A1 (fr) * | 1993-09-21 | 1995-03-30 | Sony Corporation | Procede et dispositif de transmission de donnees, decodeur de donnees et support d'enregistrement de donnees |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5755515A (en) * | 1980-09-20 | 1982-04-02 | Sony Corp | Recorder of digital signal |
-
1985
- 1985-07-01 JP JP14521085A patent/JPS626468A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5755515A (en) * | 1980-09-20 | 1982-04-02 | Sony Corp | Recorder of digital signal |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1995008823A1 (fr) * | 1993-09-21 | 1995-03-30 | Sony Corporation | Procede et dispositif de transmission de donnees, decodeur de donnees et support d'enregistrement de donnees |
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