JPS61270980A - Printer device for television receiver - Google Patents

Printer device for television receiver

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Publication number
JPS61270980A
JPS61270980A JP60112858A JP11285885A JPS61270980A JP S61270980 A JPS61270980 A JP S61270980A JP 60112858 A JP60112858 A JP 60112858A JP 11285885 A JP11285885 A JP 11285885A JP S61270980 A JPS61270980 A JP S61270980A
Authority
JP
Japan
Prior art keywords
signal
field
memory
gradation density
density signal
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP60112858A
Other languages
Japanese (ja)
Inventor
Shunichi Nakamura
俊一 中村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP60112858A priority Critical patent/JPS61270980A/en
Publication of JPS61270980A publication Critical patent/JPS61270980A/en
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00Details of television systems
    • H04N5/76Television signal recording

Abstract

PURPOSE:To improve a vertical resolution and obtain a clear print picture by dividing a gradation density signal of one frame every field to store in an image memory and printing out it. CONSTITUTION:An input video signal v is converted into a digital signal by an A/D converter 1 and a gradation density signal d1 is outputted to a shift register 2. The shift register 2 outputs the gradation density signal of 5 bits every 5 bits and supplies to a video memory 3. The accumulation of the data in the video memory 3 is controlled by a writing control circuit 4 and a field discriminating circuit 5 outputs a signal (f) for discriminating the field in which the data is written. In the video memory 3, the information of one frame divided every field is accumulated. When this writing is completed, a CPU6 gives a reading address (a) to the memory 3 and outputs a gradation densoty signal d3 to a printer 7 as the printing data d4.

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明け、テレビジョン受信機のプリンタ装置に関す
るものである。
DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a printer device for a television receiver.

〔従来の技術〕[Conventional technology]

一般にテレビジョン受信機において、例えば料理番組等
が放送されているような場合に、画面に映し出される献
立表や材料等を書き残しておきたいと思うことがあるか
、従来のテレビジョン受信機では視聴者がその都度画面
を見ながら献立表や材料等をメモしなければならず、大
変不便であった。また上記料理番組をVTFtに収碌し
ておけば、再度こhを再生できる訳であるが、その場合
にも必要な画面をサーチし、かつこれを静止再生等する
という操作が必要で煩雑であった。
Generally speaking, when a cooking program is being broadcast on a television receiver, for example, you may want to write down the menu list, ingredients, etc. that are displayed on the screen. This was extremely inconvenient as the person had to take notes on the menu list, ingredients, etc. while looking at the screen each time. Also, if the cooking program mentioned above is stored in VTFt, it can be played back again, but even in that case, it is necessary to search for the necessary screen and play it back statically, which is complicated. there were.

そこで本発明者はテレビ画面の映像の階調濃度信号をR
AMに書込み、その後これを読出すことにより、テレビ
画面の映像を自動的にハードコピーできるようにしたテ
レビジョン受信機のプリンタ装置を既に開発している。
Therefore, the inventor of the present invention has determined that the gradation density signal of the image on the television screen is R.
We have already developed a printer device for a television receiver that can automatically make a hard copy of television screen images by writing to AM and then reading it.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

しかしなから、従来の方式は1フイールドメモリを用い
て1フイ一ルド分の映像信8を記憶し、これをプリント
アウトするようにしており、このため映像1号の1フレ
ームデータに比べ垂直方向の解像度が悪いという欠点か
あった。
However, in the conventional method, one field memory is used to store one field of video signal 8, and this is printed out. The drawback was that the resolution was poor.

この発明は、以上のような従来の欠点を除去するために
なされたもので、垂直方向の解像度が向上し、鮮明なプ
リント画が得られるテレビジョン受信機のプリンタ装置
を提供することを目的としている。
This invention was made in order to eliminate the above-mentioned drawbacks of the conventional technology, and its purpose is to provide a printer device for a television receiver that can improve the vertical resolution and produce clear printed images. There is.

〔問題点を解決するための手段〕[Means for solving problems]

この発明に係るテレビジョン受信機のプリンタ装置け、
1フレーム分の階調濃度信8をフィールド毎に区分して
映像メモリへ記憶し、これをプリントアウトするように
したものである。
A printer device for a television receiver according to the present invention,
The gradation density signal 8 for one frame is divided into fields and stored in a video memory, and then printed out.

〔作用〕[Effect]

この発明においてば、1フレーム分の階調濃度信8を記
憶してプリントアウトするから、映像信号の垂直方向の
解像度と等しいプリント画が得られる。
According to the present invention, since one frame's worth of gradation density signals 8 are stored and printed out, a printed image equal to the vertical resolution of the video signal can be obtained.

〔実施例〕〔Example〕

まず、本発明の詳細な説明するにあたり、本発明の詳細
な説明する。
First, in explaining the present invention in detail, the present invention will be explained in detail.

1フイールドの情報量として、l走査線の画素数を64
0画素、該走査線の数を234木とすると、上記lフィ
ールドの情報量は、640 X 234−149760
となり、1フレームでは上記情報量の倍必要で299+
520ビツトとなる。又、上記1走査線の画素数が64
0画素ということは有効走査時間(8%)が52.77
8であるから、サンプリング速度け52.フ、l(S/
640に一180n8e(!となり、低コストのメモリ
で汀、これらをそのまま書込んで行(ことは速度的に無
理である。このような場合の書込み方法として、複数画
素分のデータをシフトレジスタに蓄え、これらを同時に
映像メモリに書込んで行く方法がある。これによれば、
サンプリング速度は該複数画素分遅くなり、低コストの
メモリが使用できる。
As the amount of information in one field, the number of pixels in one scanning line is 64.
If 0 pixel and the number of scanning lines are 234 trees, the amount of information in the above l field is 640 x 234-149760
Therefore, one frame requires twice the amount of information above, which is 299+
It becomes 520 bits. Also, the number of pixels in one scanning line is 64.
0 pixels means effective scanning time (8%) is 52.77
8, so the sampling rate is 52. F, l(S/
640 to 180n8e (!), and it is impossible to write these as they are in a low-cost memory (in terms of speed). In such a case, the writing method is to write data for multiple pixels into a shift register. There is a method of storing them and writing them to the video memory at the same time.According to this method,
The sampling speed is reduced by the number of pixels, and low-cost memory can be used.

そこで本発明の一実施例として、上記複数画素を5ビツ
トとすることにより、す/ブリング速度は、80nae
c X 5−400nsecとなり、またアドレス量け
299520 X 115鴫59904アドレスとなり
、低コストな64にビットのD−RAM (5個)が使
用できることとなる。そしてこの64にビットのD@R
AMのアドレス情報け16本必要であり、従って本実施
例では、この16木のアドレス情報の内、最上位ビット
t−使い分けて、奇数フィールドメモリと偶数フィール
ドメモリとに区分するようにしている。なお、1画素を
16階調の階調濃度信号とする場合、メモリは、64K
X5個×4個で構成されることとなる。
Therefore, as an embodiment of the present invention, by setting the plurality of pixels to 5 bits, the speed/bringing speed is 80 nae.
c x 5-400 nsec, the address size is 299,520 x 115 or 59,904 addresses, and low-cost 64-bit D-RAM (5 pieces) can be used. And this 64 bit D@R
Sixteen pieces of AM address information are required, and therefore, in this embodiment, the most significant bit t of these 16 trees of address information is used to divide the memory into odd field memory and even field memory. Note that when one pixel is a 16-level gradation density signal, the memory is 64K.
It will be composed of X5 pieces x 4 pieces.

第2図は映像メモリのメモリマツプで、アドレスooo
o〜’77FF (16進表示)までが奇数フィールド
メモリエリア、8000− IPF’FT (16進表
示)までか偶数フィールドメモリエリアとして使い分け
ている。
Figure 2 is a memory map of the video memory, with address ooo
The area from o to '77FF (in hexadecimal) is used as an odd field memory area, and the area up to 8000-IPF'FT (in hexadecimal) is used as an even field memory area.

次に本発明の一実施例によるテレビジョン受信機のプリ
ンタ装置のブロック図を4X1図に示す。
Next, a block diagram of a printer device for a television receiver according to an embodiment of the present invention is shown in a 4X1 diagram.

図において、1/riビデオ信号V t−A/D変換し
階調濃度信号d1を出力するの変換器、2け5ビツト分
の画素を蓄えるためのシフトレジスタ、3け上記階調濃
度−号d2を記憶する映像メモリ、4Iri後述するc
ptr aからの書込み指令C2に応じて上記映像メモ
リ3への書込み制御を行う書込み制御回路、5#:を奇
数フィールドか偶数フィールドかを識別し、識別値fを
上記映像メモリ3のアドレス情報最上位ビットに接続し
てメモリエリアを切換えるフィールド識別回路である。
In the figure, a converter for A/D converting a 1/ri video signal Vt and outputting a gradation density signal d1, a shift register for storing 2 to 5 bits worth of pixels, and a 3 digit gradation density signal for storing 5 bits worth of pixels. A video memory that stores d2, 4Iri c, which will be described later.
A write control circuit performs write control to the video memory 3 in response to a write command C2 from ptr a, identifies 5#: as an odd field or an even field, and sets the identification value f to the address information maximum of the video memory 3. This is a field identification circuit that connects to the upper bit and switches the memory area.

6けプリントキー8からのプリント指令C1に応じて上
記書込み制御回路番に書込み指令C2を与え、かつ映像
メモリ3に向けて読出しアドレスat−出力して映像メ
モリ3からの読出しデータd3を印字データd4として
出力するCPUである。ここで、読出しアドレスaの最
上位ヒツトがフィールド切換え情報となる。7ij読出
された印字データd4をプリントアウトするプリンタ、
9け上記a/b変換器1.書込み制御回路4゜フィール
ド識別回路5I及びシフトレジスタ2にりoツクパルス
Pを供給するクロックパルス発生回路、!91. EI
2けそ台ぞれ水平、垂直同期信号である。
In response to the print command C1 from the 6-digit print key 8, a write command C2 is given to the write control circuit number, and the read address at- is output to the video memory 3 to convert the read data d3 from the video memory 3 into print data. This is the CPU that outputs as d4. Here, the most significant hit of read address a becomes field switching information. 7ij A printer that prints out the read print data d4,
9 pieces above A/B converter 1. Write control circuit 4゜Clock pulse generation circuit that supplies clock pulse P to field identification circuit 5I and shift register 2,! 91. E.I.
These are horizontal and vertical synchronization signals for each of the two machines.

次に動作について説明する。Next, the operation will be explained.

A/’D変換器1r/′!クロックパルス発生回路9の
りロックパルスPを用いてビデオ信号Vをサンプリング
し1階調濃度信%、:uを出力する。シフトレジスタZ
 fl上Eクロックパルス9を用いて5ビット分の階調
濃度信号を蓄えるもので、蓄え7:#I”+けd2とし
て5ビツト毎に出力する。書込み制御回路4は、書込み
指令C2により上記階調濃度信号d2金上記クロックパ
ルスPのタイミングで映像メモリ3へ書込んでいく。こ
の書込み制御回路4は水平、垂直同期信号81.82’
jz用いて水平方向128゜垂直方向234ライン分の
アドレス情報を正しく映像メモリ3へ書込むように制御
を行う。なお、ここで水平方向のアドレスを128とし
ているのけ、640画素を5ビット分まとめて書込んで
行くため、アドレスとして灯、640÷5−128とな
るからである。
A/'D converter 1r/'! The clock pulse generation circuit 9 samples the video signal V using the lock pulse P and outputs a 1-gradation density signal %, :u. shift register Z
The gradation density signal for 5 bits is stored using the fl upper E clock pulse 9, and is output every 5 bits as storage 7: #I'' + d2.The write control circuit 4 uses the write command C2 to The gradation density signal d2 is written to the video memory 3 at the timing of the above clock pulse P. This write control circuit 4 receives horizontal and vertical synchronization signals 81.82'
Control is performed so that address information for 128 degrees in the horizontal direction and 234 lines in the vertical direction is correctly written into the video memory 3 by using the address information. Note that although the horizontal address is set to 128 here, 640 pixels are written in 5 bits at a time, so the address becomes 640÷5-128.

フィールド識別回路5け、水平及び垂直同期信号S1及
びS2を用いてフィール−を識別し、この結果である識
別値fを出力する。この識別値fけ映像メモリ3の書込
みアドレスの最上位ビットに接続されており、こねによ
り階調濃度信号は第2図のごとく奇数フィールドエリア
と偶数フィールドエリアとに分けて書込まれることとな
る。
Five field identification circuits identify fields using horizontal and vertical synchronizing signals S1 and S2, and output an identification value f as a result. This identification value f is connected to the most significant bit of the write address of the video memory 3, and by kneading, the gradation density signal is written separately into an odd field area and an even field area as shown in Figure 2. .

CPU 6けプリントキー8からの指令C1t−受ける
と、垂直同期信号S2と同期して、2垂直向期期間の時
間書込み指令C2を書込み制御回路4に向けて発し、こ
れにより映像メモリ3け1フレーム分の階調濃度信8を
蓄えることになる。映像メモリ3への書込みが終了する
と、C!PU aげ続出しアドレスaを映像メモリ3に
与え、階調濃度信号d3を印字データd4としてプリン
タ学に入力し、こねによりプリンタ7は1フレームの映
像信Ji+をプリントアウトする。この際、読出しアド
レスaの最上位ビット?奇数及び偶数フィールドエリア
の切換えとして使っている。
When the CPU receives the command C1t from the 6-digit print key 8, it issues a time write command C2 for 2 vertical synchronization periods to the write control circuit 4 in synchronization with the vertical synchronization signal S2. Gradation density signals 8 for frames are stored. When writing to the video memory 3 is completed, C! The PU ag continuous output address a is given to the video memory 3, the gradation density signal d3 is inputted to the printer as print data d4, and the printer 7 prints out one frame of video signal Ji+ by kneading. At this time, the most significant bit of read address a? It is used to switch between odd and even field areas.

このような木実織例装置でけ、1フレーム分の映[1!
5jを記憶できるメモリ回it用いたので、従来の1フ
イールドメモリを使用したプリンタ装置に比較して解像
度が向上し、こhにより鮮明なプリント画を得ることが
できる。また、1フレームメモリとして64にビットの
D−RAMtl−使用して構成したので、装置を安価な
ものとすることができる。
With this type of wood-weaving device, one frame of video [1!
Since a memory circuit capable of storing 5j is used, the resolution is improved compared to a conventional printer device using one field memory, and clearer printed images can be obtained. Furthermore, since the device is constructed using a 64-bit D-RAM as one frame memory, the device can be made inexpensive.

〔発明の効果〕 以上のように、本発明によhば、テレビジョン受信機の
映像をプリントアウトするプリンタ装置lごおいて、そ
の映像メモリとしてlフレームメモリを用い、lフレー
ムの映gI!信Ji+をプリントアウトするようにした
ので、映@信号の垂直方向の解像度と等しい鮮明なプリ
ント画か得られる効果がある。
[Effects of the Invention] As described above, according to the present invention, a printer device that prints out video from a television receiver uses a frame memory as its video memory, and prints a video of a frame! Since the signal Ji+ is printed out, it is possible to obtain a clear printed image equal to the vertical resolution of the video signal.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の一実権例によるテレビジョン受信機の
プリンタ装置のブロック構成図、第2図は該装置におけ
るメモリのマツプを示す図である。 3・・・映像メモリ、4・・・書込み制御回路、5・・
・フィールド識別回路、6・・・cpn、+7・・・プ
リンタ、8・・・プリントキー。
FIG. 1 is a block diagram of a printer device for a television receiver according to one example of the present invention, and FIG. 2 is a diagram showing a memory map in the device. 3... Video memory, 4... Write control circuit, 5...
-Field identification circuit, 6...cpn, +7...printer, 8...print key.

Claims (1)

【特許請求の範囲】[Claims] (1)テレビジョン受信機の映像をプリントアウトする
テレビジョン受信機のプリンタ装置であつて、1フレー
ム分の階調濃度信号を記憶する容量を有する映像メモリ
と、プリントキーからの指令に応じて上記映像メモリへ
上記階調濃度信号の書込み制御を行う書込み制御回路と
、1フレーム分の階調濃度信号がフィールド毎に区分さ
れて上記映像メモリへ書込まれるよう該階調濃度信号の
属するフィールドを識別するためのフィールド識別回路
と、上記プリントキーからの指令を受けて上記書込み制
御回路への書込み指令の出力及び上記映像メモリ内の階
調濃度信号の読出しを行う中央処理装置と、上記読出さ
れた階調濃度信号をプリントアウトするプリンタとを備
えたことを特徴とするテレビジョン受信機のプリンタ装
置。
(1) A printer device for a television receiver that prints out images from the television receiver, which includes a video memory having a capacity to store tone density signals for one frame, and a printer that prints out images from the television receiver in response to commands from a print key. a write control circuit that controls writing of the gradation density signal to the video memory, and a field to which the gradation density signal belongs so that the gradation density signal for one frame is divided into fields and written to the video memory; a field identification circuit for identifying the gradation density signal; a central processing unit configured to output a write command to the write control circuit in response to a command from the print key and read out a gradation density signal in the video memory; What is claimed is: 1. A printer for a television receiver, comprising: a printer that prints out a gradation density signal.
JP60112858A 1985-05-25 1985-05-25 Printer device for television receiver Pending JPS61270980A (en)

Priority Applications (1)

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JP60112858A JPS61270980A (en) 1985-05-25 1985-05-25 Printer device for television receiver

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JPS61270980A true JPS61270980A (en) 1986-12-01

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ID=14597293

Family Applications (1)

Application Number Title Priority Date Filing Date
JP60112858A Pending JPS61270980A (en) 1985-05-25 1985-05-25 Printer device for television receiver

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JP (1) JPS61270980A (en)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01235646A (en) * 1988-03-16 1989-09-20 Hitachi Ltd Memory control circuit of video printer
JPH0286450A (en) * 1988-09-22 1990-03-27 Victor Co Of Japan Ltd Video printer

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01235646A (en) * 1988-03-16 1989-09-20 Hitachi Ltd Memory control circuit of video printer
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