JPS59200327A - 周辺装置の制御方式 - Google Patents

周辺装置の制御方式

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JPS59200327A
JPS59200327A JP58073280A JP7328083A JPS59200327A JP S59200327 A JPS59200327 A JP S59200327A JP 58073280 A JP58073280 A JP 58073280A JP 7328083 A JP7328083 A JP 7328083A JP S59200327 A JPS59200327 A JP S59200327A
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JP
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signal line
circuit
clock signal
peripheral device
clock
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JPH0113573B2 (ja
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Kazuya Yonezu
米津　一弥
Keiji Matsumoto
恵治 松本
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NEC Corp
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NEC Corp
Nippon Electric Co Ltd
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    • G06F1/26—Power supply means, e.g. regulation thereof
    • G06F1/32—Means for saving power
    • G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
    • G06F1/3206—Monitoring of events, devices or parameters that trigger a change in power modality
    • G06F1/3228—Monitoring task completion, e.g. by use of idle timers, stop commands or wait commands

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明はホス）−プロセッサとともに使用される周辺装
置の制御方式に関するものである。
ＣＭＯＳプロセッサはＣＭＯ８ｇ造技術によシ作られた
プロセッサでアシ、低消費電力で動作することを特徴と
する。これらのＣＭＯＳプロセッサの中で、ＩＰ？拠ホ
ス）−プロセッサではよシ消９電力を低く抑えるために
、通常、ホスト・プロセッサが動作を停止している期間
はプロセッサ内に供給されるクロック信号を止めている
。この状態はスタンバイ・モードと呼ばれている。この
スタンバイ・モードは、通常、ホスト・プロセッサ自身
が内部の命令により設定し、外部からの割込み信号やリ
セット信号等によシ解除されるように構成されている。
しかしながら、周辺装置、すなわちホスト・プロセッサ
よシ指令を受けて動作するコントローラにハ、ホストｅ
プロセッサのスタンバイ・モードと等しい低消費電力化
が施こされているのが現状である。これはこのコントロ
ーラ自体がホスト・プロセッサのように自己自身を制御
する機能をもっているためである。従って、ホスト・プ
ロセッサの低消費電力化が達成できても、これと対に働
らく周辺装置の低消費電力化は満足できるものではなく
、システム全体の電力消費量はやはり多かった。
本発明はホスト・プロセッサとともに使用される周辺装
置に対してスタンバイ・モードを設定しかつこれを解除
する有効な方式を提供することにある。この目的を達成
するために本発明では、ポスト・プロセッサの指令にょ
シ処理を行なう周辺装置にクロック信号とシステム−リ
セット信号との入力端を設け、前記システム自リセット
信号によシ前記周辺装置への前記クロック信号の供給を
停止し、前記ホストゆプロセッサからの指令にょシ前記
クロック信号の供給を開始するようにしたととを特徴と
する。
本発明（（よれば周辺装置に対するクロック侶゛号の供
給をシステム・リセット信号によって停止し、かつこれ
をホスト拳プロ七ツサからの指令で解除するようにして
いるので、周辺装置自体がホスト・プロセッサのように
自己制御機能を有していなくても、ホスト−プロセッサ
におけるスタンバイ・モードと等しい状態を作ることが
でき、システム全体の低消費電力化を大きく向上するこ
とができる。
以下本発明の一実施例を図面を参照しながら説明する。
第１図は本発明を用いたシステムの構成例で、１はホス
ト・プロセッサ、２はＣＭＯＳペリフェラル・コントロ
ーラ、３はデータの読み書き等を制御する制御バス、４
はアドレスバス、５は指令やデータの情報が転送される
データ争バス、６はＣＭＯＳペリフェラル・コントロー
ラへの外部リセット８号ｆｍ、７はＣＭＯＳペリフェラ
ルｅコントローラを選探する選択信号線、８はＣＭＯＳ
ペリフェラル・コントローラへの指令やデータの書き込
み信号線、９はホスト・プロセッサより出力され、ＣＭ
ＯＳペリフェラル・コントローラへ入力されるクロック
信号線、１０はＣＭＯＳペリフェラル・コントローラの
中に設定され、そのスタンバイ曝モードの設定及び解除
の制御動作を行なう制御回路部である。
第２図は制御回路部１０を詳細に示した図で、１１はス
タンバイ・モードの設定時には活性になシ、解除時には
クロック信号がのる信号線、１２はホスト・プロセッサ
の指令により活性となる内部リセット信号線、１３は２
人力ＡＮＤ回路、１４および１５は２人力ＮＯＲ回路、
１６は２人力ＯＴＬ回路、１７は２人力ＡＮＤ回路を示
している。
第１図において、スタンバイΦモードの設定は外部リセ
ット信号６が活性になることによシ行なわれる。そして
スタンバイ・モードの解除は制御バス３の書き込み信号
線８及びアドレスバス４の選択信号線７によりホスト・
プロセッサｌからデータ１１ハス５ｔ−ｉてＣＭＯＳペ
リフェラル・コントローラ２へ指令が与えられた時に行
なわれる。この動作を第２図を参照して詳細に述べる。
まず、スタンバイＯモードの設定は次のように行なわれ
る。外部リセット信号線６が活性となることによシ、２
人力ＯＲ回路１６の出力が活性とガる。そして、２人力
ＮＯＲ回路１４の出力が不活性となることによシ、２人
力ＡＮＤ回路１３の出力は、クロック信号線９の状態に
関係なく不活性となり、信号線１１にクロック信号はの
らず、ＣＭＯＳペリ７エ２ル・コントローラ２内にクロ
ック信号は供給されない。この結果、スタンバイ・モー
ドが設定される。また、外部リセット信号線６の代シに
内部リセット信号線１２が活性になっても同様にしてス
タンバイ・モードが設定されるようにしてもよい。
一方、解除は次のように行なわれる。選択信号線７及び
書き込み信号線８が活性となることによシ、２人力ＡＮ
Ｄ回路１７の出力が活性となる。
そして２人力ＮＯＲ回路１５の出力が不活性とたること
により２人力Ｎ　ＯＩ（回路１４の出力は活性となり、
クロック信号線９のクロック信号は２人力ＡＮＤ回路１
３を経て信号線１１にのる。この結果クリック信号はＣ
ＭＯＳペリフェラル・コントロー２２内に供給されスタ
ンバイ・モードは解除され、ペリフェラル・コントロー
ラ２はホスト・プロセッサからの指令に基いて動作を実
行する。
以上のように、ＣＭＯＳペリフェラル・コントローラ２
内へのクロック信号の供給を制御することによシ、シス
テム全体の消費電力を大きく減らすことができる。
【図面の簡単な説明】
第１図は本発明の一実施例によるシステム構成ブロック
図、第２図はその制御回路部の回路ブロック図を示す。 ｌ・・・・・・ホスト・プロセッサ、２・・・・・・Ｃ
ＭＯＳ　ヘリフェ２ル・コントローラ、３・・・・・・
制御バス、４・・・・・・アドレスバス、５・・・・・
・データバス、６・・・・・・外部リセット信号線、７
・・・・・・選択信号線、８・・・・・・書き込み信号
線、９・・・・・・クロック信号線、１０・・・・・・
制御回路部、１１・・・・・・ＣＭＯＳペリフェラル拳
コントローラ内部ヘクロック信号を供給する信号線、１
２・・・・・・内部リセット信号線、１３・・・・・・
２人力ＡＮＤ回路、１４・・・・・・２人力ＮＯＲ回路
、１５・・・・・・２人力ＮＯ１’Ｌ回路、１６・・・
・・・２人力ＯＲ回路、１７・・・・・・２人力ＡＮＤ
回路。 、嬶　ｌ　図

Claims (1)

    【特許請求の範囲】
  1. ホスト嗜プロセッサの指令に基いて処理を行なう周辺装
    置にクロック信号とシステム・リセット信号との入力部
    を設け、前記システム・リセット信号を入力することに
    よって前記周辺装置への前記クロック信号の供給を停止
    し、前記ホスト・プロセッサからの指令によシ前記クロ
    ック信号の供給を開始するようにしたことを特徴とする
    周辺装置の制御方式。
JP58073280A 1983-04-26 1983-04-26 周辺装置の制御方式 Granted JPS59200327A (ja)

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JP58073280A JPS59200327A (ja) 1983-04-26 1983-04-26 周辺装置の制御方式
US06/604,274 US4841440A (en) 1983-04-26 1984-04-26 Control processor for controlling a peripheral unit

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JPS59200327A true JPS59200327A (ja) 1984-11-13
JPH0113573B2 JPH0113573B2 (ja) 1989-03-07

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