JPH0622199A - Moving quantity detector - Google Patents

Moving quantity detector

Info

Publication number
JPH0622199A
JPH0622199A JP3108886A JP10888691A JPH0622199A JP H0622199 A JPH0622199 A JP H0622199A JP 3108886 A JP3108886 A JP 3108886A JP 10888691 A JP10888691 A JP 10888691A JP H0622199 A JPH0622199 A JP H0622199A
Authority
JP
Japan
Prior art keywords
circuit
representative point
image signal
memory
arithmetic
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP3108886A
Other languages
Japanese (ja)
Other versions
JP2600514B2 (en
Inventor
Yoshiaki Hanashiro
吉昭 花城
Taro Watanabe
太郎 渡辺
Norihiro Aso
教博 阿蘇
Kenji Matsuoka
賢司 松岡
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Victor Company of Japan Ltd
Original Assignee
Victor Company of Japan Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Victor Company of Japan Ltd filed Critical Victor Company of Japan Ltd
Priority to JP3108886A priority Critical patent/JP2600514B2/en
Priority to DE69215733T priority patent/DE69215733T2/en
Priority to EP92106290A priority patent/EP0508476B1/en
Priority to US07/867,546 priority patent/US5253052A/en
Publication of JPH0622199A publication Critical patent/JPH0622199A/en
Application granted granted Critical
Publication of JP2600514B2 publication Critical patent/JP2600514B2/en
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Abstract

PURPOSE:To make the device small in size by storing the result of a 1st arithmetic operation circuit in a memory according to a high-order numerical value in the conversion to a binary method of a relative distance between a current picture signal and a representative point of one preceding field with a 2nd arithmetic operation circuit. CONSTITUTION:Arithmetic operation sections A, B of an arithmetic operation circuit I55 calculate a distance between a current picture signal incoming from an input circuit 50 and a picture signal of one preceding field at a representative point and the result is fed to a next-stage changeover circuit 59. Then the position of the current picture signal and position information corresponding to the representative pint of one preceding field fed from a representative point designation circuit 53 to the circuit I55 are fed to an arithmetic operation circuit 61. The position information of the current picture signal is converted into binary information and a switching signal in response to a numeral 1, 0 of a high-order digit of the binary number is fed to the circuit 59, the result by the circuit I55 is fed to a memory circuit 63 through the circuit 59 and stored based on an address signal. Thus, the stored information sets are sequentially compared and a minimum value is detected and a relevant motion is obtained by reading the address.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野本発明は小型化の進む
カメラ等に使用される画像ゆれを検出する動き量検出装
置に関する。 【0002】
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a motion amount detecting device for detecting image shake, which is used in cameras and the like which are becoming smaller. [0002]

【従来の技術】図8は特開平1−269371号公報に
示される従来の動き量検出装置のブロック図で、1はテ
レビジョン画像信号の入力回路、2は画像信号内の代表
点の信号を記憶する代表点メモリ回路、3は代表点メモ
リ回路2を制御するメモリ制御回路I、4は1フィール
ド以上前の代表点の信号である代表点メモリ回路2から
の読み出し信号と現在の画像信号である入力回路1の出
力信号とを演算する演算回路、5は演算回路4の出力信
号を記憶する検出メモリ回路、6は検出メモリ回路5を
制御するメモリ制御回路II、7は検出メモリ回路5から
の読み出し信号を用いて動き量を得る動き量演算回路、
8は代表点メモリ回路2に記憶する代表点の位置を決め
る代表点指定回路、9は代表点指定回路8及びメモリ制
御回路6を制御する演算制御回路、10は前記の回路群
を総合的に制御するシステム制御回路である。そして、
以下のような動作をする構成となっている。入力回路1
よりテレビジョン画像信号が入力され、代表点指定回路
8で指定された代表点の位置に対応する画像信号がメモ
リ制御回路13によって代表点メモリ回路2に書き込ま
れ、次のフレームにその値を出力する。そして、演算回
路4が現在の画像と代表点における1フレーム前の画像
とを演算し、その結果をメモリ制御回路II6によって検
出メモリ回路5に書き込む。この時画像信号と代表点の
位置関係が等しい時は同じメモリに加算していきすべて
の演算終了後に読み出し、その出力信号を用いて動き量
演算回路7が動き量を求める構成となっている。
2. Description of the Related Art FIG. 8 is a block diagram of a conventional motion amount detecting device disclosed in Japanese Patent Application Laid-Open No. 1-269371, where 1 is a television image signal input circuit and 2 is a signal of a representative point in the image signal. A representative point memory circuit for storing, 3 is a memory control circuit I for controlling the representative point memory circuit 2, and 4 is a read signal from the representative point memory circuit 2 which is a representative point signal one field or more before and a current image signal. An arithmetic circuit for operating the output signal of a certain input circuit 1, 5 is a detection memory circuit for storing the output signal of the arithmetic circuit 4, 6 is a memory control circuit II for controlling the detection memory circuit 5, and 7 is from the detection memory circuit 5. Motion amount calculation circuit for obtaining a motion amount using the read signal of
Reference numeral 8 is a representative point designating circuit for deciding the position of the representative point to be stored in the representative point memory circuit 2, 9 is an arithmetic control circuit for controlling the representative point designating circuit 8 and the memory control circuit 6, and 10 is the above circuit group as a whole. It is a system control circuit for controlling. And
The configuration is as follows. Input circuit 1
Further, the television image signal is input, the image signal corresponding to the position of the representative point designated by the representative point designating circuit 8 is written in the representative point memory circuit 2 by the memory control circuit 13, and the value is output in the next frame. To do. Then, the arithmetic circuit 4 calculates the current image and the image one frame before at the representative point, and the result is written in the detection memory circuit 5 by the memory control circuit II6. At this time, when the positional relationship between the image signal and the representative point is the same, they are added to the same memory and read after the completion of all calculations, and the motion amount calculation circuit 7 uses the output signal to calculate the motion amount.

【0003】[0003]

【発明が解決しようとする課題】ここで、前記装置の代
表点指定回路8及び演算制御回路9では図9に示すよう
に4個の代表点P0,P1,P2,P3を17の等間隔
で指定し、夫々の代表点からの検出範囲を水平方向に±
32づつ設けている。そして、1フィールド前の各代表
点と現在の画像信号の検出点との相対距離を代表点間隔
数で除した剰余数に応じてメモリ領域を定める構成とし
ている。従って、この下位側の数値(剰余数)に応じて
分割領域を定めているために相隣り合う検出点の画素が
連続していても、下位側の数値(剰余数)は同一となら
ず、煩雑にメモリ領域を変更する必要があり、その制御
が複雑となると共に、回路規模も大きくなってしまう等
の問題点を有するものであった。そこで、本発明は前記
欠点を除去した装置を提供することを目的とする。
Here, in the representative point designating circuit 8 and the arithmetic control circuit 9 of the device, as shown in FIG. 9, four representative points P0, P1, P2 and P3 are arranged at equal intervals of 17. The horizontal axis indicates the detection range from each representative point.
There are 32 each. The memory area is determined according to the number of remainders obtained by dividing the relative distance between each representative point one field before and the current detection point of the image signal by the number of representative point intervals. Therefore, since the divided area is defined according to the numerical value on the lower side (residual number), even if the pixels at adjacent detection points are continuous, the numerical value on the lower side (residual number) is not the same, There is a problem in that it is necessary to change the memory area intricately, the control becomes complicated, and the circuit scale becomes large. Therefore, it is an object of the present invention to provide a device that eliminates the above-mentioned drawbacks.

【0004】[0004]

【課題を解決するための手段】本発明は上記目的を達成
するために以下の1)及び2)の装置を提供しようとい
うものである。即ち、 1) 少なくとも、デジタル化された画像信号を入力す
る入力回路と、1フィールド領域に複数の代表点を指定
する代表点指定回路と、前記1フィールド以上前の代表
点の画像信号を記憶する代表点メモリ回路と、1フィー
ルド以上前の前記代表点の画像信号と現在の画像信号と
を演算する第1の演算回路と、前記代表点の画像信号と
前記現在の画像信号とに対応した位置情報とで演算する
第2の演算回路と、前記第1の演算回路からの演算結果
を記憶するメモリ回路とを具備し、前記演算結果を前記
第2の演算回路により現在の画像信号と1フィールド以
上前の代表点との相対距離を2進数に換算した際の上位
桁の数値に応じて前記メモリ回路内のメモリ領域を決定
して記憶させる構成としたことを特徴とする動き量検出
装置。 2) 少なくとも、デジタル化された画像信号を入力す
る入力回路と、1フィールド領域に複数の代表点を指定
する代表点指定回路と、1フィールド以上前の前記代表
点の画像信号を記憶する代表点メモリ回路と、前記1フ
ィールド以上前の代表点の画像信号と現在の画像信号と
を演算する第1の演算回路と、前記代表点の画像信号と
前記現在の画像信号とに対応した位置情報とで演算する
第2の演算回路と、前記第1の演算回路からの演算結果
を記憶するメモリ回路とを具備し、前記演算結果を前記
第2の演算回路により前記現在の画像信号の位置情報に
基づく数値を所定の整数で除した値の整数部に応じて前
記メモリ回路内のメモリ領域を決定して記憶させる構成
としたことを特徴とする動き量検出装置。
SUMMARY OF THE INVENTION The present invention is to provide the following devices 1) and 2) in order to achieve the above object. That is, 1) at least an input circuit for inputting a digitized image signal, a representative point designating circuit for designating a plurality of representative points in one field area, and an image signal of the representative point one field or more before. Representative point memory circuit, first computing circuit for computing the image signal of the representative point one field or more before and the current image signal, and a position corresponding to the image signal of the representative point and the current image signal A second arithmetic circuit for arithmetic operation with information and a memory circuit for storing the arithmetic result from the first arithmetic circuit, and the arithmetic result by the second arithmetic circuit for the current image signal and one field A motion amount detecting device characterized in that a memory area in the memory circuit is determined and stored according to a numerical value of an upper digit when the relative distance from the preceding representative point is converted into a binary number. 2) At least an input circuit for inputting a digitized image signal, a representative point designating circuit for designating a plurality of representative points in one field area, and a representative point for storing the image signal of the representative point one field or more before. A memory circuit; a first arithmetic circuit for arithmetically operating the image signal at the representative point one field or more before and the current image signal; and position information corresponding to the image signal at the representative point and the current image signal. And a memory circuit for storing a calculation result from the first calculation circuit, wherein the calculation result is converted into position information of the current image signal by the second calculation circuit. A motion amount detecting device characterized in that a memory area in the memory circuit is determined and stored according to an integer part of a value obtained by dividing a numerical value based on a predetermined integer.

【0005】[0005]

【作用】第1の演算回路で1フィールド以上前の代表点
の画像信号と現在の画像信号とを演算し、この演算結果
を第2の演算回路により現在の画像信号と1フィールド
以上前の代表点との相対距離を2進数に換算した際の上
位桁の数値に応じてメモリ回路内のメモリ領域を決定し
て記憶させる構成にしたり、現在の画像信号の位置情報
信号に基づく数値を所定の整数で除した値の整数部に応
じて、前記メモリ領域を決定して記憶させる構成にす
る。
The first arithmetic circuit calculates the image signal at the representative point one field or more before and the current image signal, and the calculation result is calculated by the second arithmetic circuit to the current image signal and the representative one field or more before. The memory area in the memory circuit is determined and stored according to the numerical value of the upper digit when the relative distance to the point is converted into a binary number, or the numerical value based on the position information signal of the current image signal is set to a predetermined value. The memory area is determined and stored according to the integer part of the value divided by an integer.

【0006】[0006]

【実施例】図1は本発明の一実施例に係る動き量検出装
置のブロック図を示したものである。同図において50
はデジタル化されたテレビジョン画像信号の入力回路、
51は前記画像信号の代表点の信号を記憶する代表点メ
モリ回路、52は代表点メモリ回路51を制御するメモ
リ制御回路、53は前記代表点メモリ回路51への代表
点を指定する為の代表点指定回路、55は1フィールド
以上前の代表点の信号である代表点メモリ回路51から
読み出された信号と入力回路50から入来する現在の画
像信号とを演算する第1の演算回路I、59は演算回路
II61の演算結果に基づく信号により第1の演算回路I
55の演算結果を切り換える切換回路、63は前記第1
の演算回路I55の演算結果を記憶するメモリ回路、6
5はメモリ回路63より演算回路II61からのアドレス
信号に基づいて読み出された信号の最小値を検出して動
き量を求める動き量検出回路、67は前記の回路群を総
合的に制御するシステム制御回路である。
1 is a block diagram of a motion amount detecting apparatus according to an embodiment of the present invention. 50 in the figure
Is an input circuit of the digitized television image signal,
Reference numeral 51 is a representative point memory circuit for storing the signal of the representative point of the image signal, 52 is a memory control circuit for controlling the representative point memory circuit 51, and 53 is a representative for designating the representative point to the representative point memory circuit 51. A point designation circuit 55 is a first arithmetic circuit I for arithmetically operating a signal read from the representative point memory circuit 51, which is a representative point signal one field or more before, and a current image signal coming from the input circuit 50. , 59 are arithmetic circuits
The first arithmetic circuit I is generated by the signal based on the arithmetic result of II61.
A switching circuit for switching the calculation result of 55, 63 is the first
A memory circuit for storing the calculation result of the calculation circuit I55, 6
Reference numeral 5 is a motion amount detection circuit for detecting the minimum value of the signal read from the memory circuit 63 based on the address signal from the arithmetic circuit II 61 to obtain the motion amount, and 67 is a system for comprehensively controlling the above circuit group. It is a control circuit.

【0007】以下、この構成による動作につき説明す
る。入力回路50よりデジタル化されたテレビジョン画
像信号が入力され、代表点指定回路53で指定された代
表点の位置に対応する画像がメモリ制御回路52によっ
て代表点メモリ回路51に書き込まれ、次フィールドで
その値を演算回路I55に出力する。この演算回路I5
5では入力回路50より入来する現在の画像信号と代表
点における1フィールド前の画像信号との相対距離が演
算部(A)及び(B)で演算され、この演算結果が次段
の切換回路59に供給される。同時に、代表点指定回路
53からは前記演算回路I55に供給されている1フィ
ールド前の代表点に対応した位置情報と現在の画像信号
の位置情報とが演算回路II61に供給されており、ここで
現在の画像信号の位置情報は2進数に換算されて読み取
られ、この2進数の上位桁の数値[1],[0]に応じ
た切換信号を切換回路59に供給し、この切換回路59
により第1の演算回路I55の演算結果をメモリ回路6
3のメモリ領域M0かM1のいずれかに供給すると共
に、アドレス信号に基づいて前記夫々のメモリ領域に記
憶する。この記憶領域M0,M1に記憶された情報は、
順次比較されて最小値が検出され、そのアドレスを読み
取ることにより、対応する動き量を得る。
The operation of this configuration will be described below. The digitized television image signal is input from the input circuit 50, the image corresponding to the position of the representative point designated by the representative point designating circuit 53 is written in the representative point memory circuit 51 by the memory control circuit 52, and the next field is written. Outputs the value to the arithmetic circuit I55. This arithmetic circuit I5
In 5, the relative distance between the current image signal coming from the input circuit 50 and the image signal one field before at the representative point is calculated by the calculation units (A) and (B), and the calculation result is the next stage switching circuit. It is supplied to 59. At the same time, the representative point designating circuit 53 supplies the arithmetic circuit II61 with the positional information corresponding to the representative point one field before supplied to the arithmetic circuit I55 and the positional information of the current image signal. The position information of the current image signal is read after being converted into a binary number, and a switching signal according to the upper digit values [1] and [0] of the binary number is supplied to the switching circuit 59, and this switching circuit 59 is supplied.
The calculation result of the first calculation circuit I55 by the memory circuit 6
It is supplied to one of the three memory areas M0 or M1 and stored in each of the memory areas based on an address signal. The information stored in these storage areas M0 and M1 is
The minimum value is detected by successive comparison, and the corresponding motion amount is obtained by reading the address.

【0008】図2(A)は図1に示した第1の演算回路
I55の回路構成例で、同図において、端子69より入
来する1フィールド前の代表点の信号と端子70より入
来する現在の入力画像信号とを減算回路72により減算
し、この差信号は絶対値回路74により絶対値が求めら
れ、次段のクリップ回路76において所定のビット数に
減じられる構成となっている。この第1の演算回路I5
5は、後述するように同時に複数の絶対値を得る必要が
あり、夫々二連(演算部A、B)づつ設けられている。
FIG. 2A shows an example of the circuit configuration of the first arithmetic circuit I55 shown in FIG. 1. In FIG. 2, the signal of the representative point one field before coming from the terminal 69 and the signal coming from the terminal 70 come in from the terminal 69. The subtraction circuit 72 subtracts the current input image signal, and the absolute value of the difference signal is obtained by the absolute value circuit 74. The clip circuit 76 at the next stage reduces the absolute value to a predetermined number of bits. This first arithmetic circuit I5
It is necessary to obtain a plurality of absolute values 5 at the same time, as will be described later, and two units (computation units A and B) are provided for each unit.

【0009】図2(B)は同じく図1に示した第2の演
算回路II61の回路構成例で、端子78より入来する
現在の画素番号と端子79より入来する代表点の画素番
号とを減算回路81により減算して相対値を得て、次段
の割振り器83に供給される。この割振り器83では、
入来する相対値は2進数に換算されて処理されており、
その上位桁の数値(1,0)に応じてメモリ回路59内
のメモリ領域(M0,M1)を決定する制御信号を出力する
構成となっている。そして、この第2の演算回路II6
1についても前記第1の演算回路I55と同様に二連づ
つ設けられている。
FIG. 2B is a circuit configuration example of the second arithmetic circuit II61 also shown in FIG. 1, in which the current pixel number coming from the terminal 78 and the pixel number of the representative point coming from the terminal 79 are shown. Is subtracted by the subtraction circuit 81 to obtain a relative value, and the relative value is supplied to the allocator 83 at the next stage. In this allocator 83,
Incoming relative values are converted into binary numbers and processed,
A control signal for determining the memory area (M0, M1) in the memory circuit 59 is output according to the numerical value (1, 0) of the upper digit. Then, this second arithmetic circuit II6
Similarly to the first arithmetic circuit I55, two units of 1 are provided.

【0010】図3は図1に示した代表点指定回路53が
指定する代表点の位置関係及び検出範囲を示す図で、同
図において所定水平ライン上に代表点D0,D1,D2
を8等間隔おきに設けると共に、これらの代表点D0,
D1,D2の水平走査方向のマイナス方向に8箇所、プ
ラス方向に7箇所の比較点を設けている。代表点D0の
比較範囲にはW00〜W015の計16箇所、代表点D
1の比較範囲にはW10〜W115の計16箇所、そし
て、代表点D2の比較範囲にはW20〜W215の計1
6箇所が夫々設定されている。
FIG. 3 is a diagram showing the positional relationship and the detection range of the representative points designated by the representative point designating circuit 53 shown in FIG. 1. In the figure, representative points D0, D1, D2 are shown on a predetermined horizontal line.
And the representative points D0,
Eight comparison points are provided in the negative direction of D1 and D2 in the horizontal scanning direction, and seven comparison points are provided in the positive direction. In the comparison range of the representative point D0, a total of 16 locations W00 to W015, the representative point D
The comparison range of 1 has 16 positions of W10 to W115 in total, and the comparison range of the representative point D2 has 1 of W20 to W215 in total.
Six locations are set respectively.

【0011】図4は検出メモリ回路59内のメモリ・ア
ドレスを示す。同図において、前記比較点は水平走査方
向の画素番号に対応して設けられており、画素番号
[5]に対応して[W00]、画素番号[6]に対応し
て[W01]、画素番号[7]に対応して[W02]…
…が順次設定されている。又、夫々の代表点D0(W0
8),D1(W18),D2(W28)のマイナス方向
側には[−1]乃至[−8]の相対距離を定め、プラス
方向側には[1]乃至[7]の相対距離を定めている。
この相対距離は説明の便宜上、10進法で示しているが
実際には左欄に示すように2進数に換算されて処理され
ている。そして、前記第2の演算回路II61の割振り
器83により、2進数で示される相対距離の最上位桁の
数値(1,0)に応じて、第2の演算回路II61の演
算結果をメモリ領域M0かM1かに振り分けて記憶させ
る構成としている。
FIG. 4 shows the memory address in the detection memory circuit 59. In the figure, the comparison points are provided in correspondence with the pixel numbers in the horizontal scanning direction, corresponding to pixel number [5] [W00], pixel number [6] [W01], pixel Corresponding to the number [7] [W02] ...
... are set sequentially. In addition, each representative point D0 (W0
8), D1 (W18), and D2 (W28) on the minus side, the relative distances of [-1] to [-8] are set, and on the plus side, the relative distances of [1] to [7] are set. ing.
Although this relative distance is shown in a decimal system for convenience of explanation, it is actually converted into a binary number and processed as shown in the left column. Then, the allocator 83 of the second arithmetic circuit II61 outputs the arithmetic result of the second arithmetic circuit II61 to the memory area M0 according to the numerical value (1,0) of the most significant digit of the relative distance represented by a binary number. It is configured such that it is sorted into M1 or M1 and stored.

【0012】図5はその検出回路59内のメモリ領域を
示す図で、同図も併せて参照するに、各代表点よりマイ
ナス方向にあって2進数で示される相対距離の最上位桁
の数値に着目すると、全てが[1]で表わされる。この
最上位桁の数値が[1]である場合にはメモリ領域M1
に記憶させるようにする。また、逆に各代表点よりプラ
ス方向にある相対距離の最上位桁の数値は、全べてが
[0]で表わされる。この[0]の数値である場合に
は、メモリ領域M0に記憶させるようにしている。そし
て、この規則に基づいてメモリ領域が決定され、演算結
果は各メモリ領域内の対応する番地(0〜7)に順次累
積値が記憶されることになる。この番地への累積は、既
述したように4ビット中下位の3ビットがアドレス信号
用に当てられる。その結果、プラス方向の相対距離
[0]が番地[0]へ、相対距離[1]が番地[1]へ
…、そして、マイナス方向の相対距離[−8]が番地
[0]へ、[−7]が番地[1]へと順次対応して累積
される。各番地への累積が終了すると、演算回路II6
1からのアドレス信号に基づいて各番地内の累積値が次
段の動き量検出回路65に読み出され、ここで、順次各
累積値が比較されて最小値が検出される。新豪雨各番地
内の値が順次比較され、最小値が検出される。例えば、
メモリ領域M0の[0]番地の累積値が最小であった場
合には、各代表点[W08],[W18],[W28]
には移動がなかったものとみなされる。又、メモリ領域
M0の[3]番地の累積値が最小であった場合には、各
代表点が夫々[W011],[W11],[W211]
の位置に移動し、この範囲の動き量があったものとみな
される。この最小値が検出されると、既述したように最
小値が記憶されている番地と相対位置とは予め対応がと
れており、この番地が読み取られることにより動き量が
得られる。この動き量は最終的には、図示しない公知の
画像補正回路に供給され、画面ゆれが補正される構成と
なっている。
FIG. 5 is a diagram showing a memory area in the detecting circuit 59. Referring to FIG. 5 as well, the numerical value of the most significant digit of the relative distance indicated by a binary number in the minus direction from each representative point. Focusing on, all are represented by [1]. If the value of the most significant digit is [1], the memory area M1
To be remembered. On the contrary, the numerical value of the most significant digit of the relative distance in the plus direction from each representative point is all represented by [0]. If the value is [0], it is stored in the memory area M0. Then, the memory area is determined based on this rule, and as the calculation result, the cumulative value is sequentially stored in the corresponding address (0 to 7) in each memory area. As for the accumulation to this address, as described above, the lower 3 bits of the 4 bits are applied for the address signal. As a result, the relative distance [0] in the plus direction to the address [0], the relative distance [1] to the address [1], ..., And the relative distance [-8] in the minus direction to the address [0], -7] is sequentially accumulated corresponding to the address [1]. When the accumulation to each address is completed, the arithmetic circuit II6
Based on the address signal from 1, the cumulative value in each address is read out to the motion amount detection circuit 65 in the next stage, where the cumulative values are sequentially compared and the minimum value is detected. The values within each address of the new heavy rain are sequentially compared and the minimum value is detected. For example,
When the cumulative value of the address [0] of the memory area M0 is the minimum, the representative points [W08], [W18], [W28]
Is considered to have not moved. When the cumulative value of the address [3] of the memory area M0 is the minimum, the representative points are [W011], [W11], and [W211], respectively.
It is considered that there was a movement amount within this range after moving to the position of. When this minimum value is detected, as described above, the address in which the minimum value is stored and the relative position are associated with each other in advance, and the amount of movement is obtained by reading this address. Finally, the amount of movement is supplied to a known image correction circuit (not shown) to correct the screen shake.

【0013】従って、前記実施例によれば相対比較距離
を2進数に換算して、この最上位桁の数値を検出してメ
モリ領域を決定する構成としているので、前記従来例の
ように下位桁の数値を検出するものに比べ、メモリ領域
を煩雑に振り分ける必要がなく制御が簡単なものとな
る。また、下位桁を各メモリ領域の共通番地としている
ので、この点についても制御が簡単なものとなり、しい
ては回路規模の小型化につながる。尚、本実施例では代
表点間隔値を[8]としているが、これに限らず必要に
応じて増減すればよい。又、本実施例では最上位桁の数
値のみを検出してメモリ領域を決定する構成にしている
が、代表点間隔を狭くしたり、各代表点を中心とする検
出範囲を広げることにより、最上位桁の数値のみではメ
モリ領域の振り分けが困難な場合には順次下位桁を利用
するようにすれば良い。
Therefore, according to the above-described embodiment, the relative comparison distance is converted into a binary number and the value of the most significant digit is detected to determine the memory area. Compared with the method of detecting the numerical value of, the control becomes simpler without the need for complicated allocation of the memory area. Further, since the lower digit is used as a common address for each memory area, the control is easy in this respect as well, which leads to downsizing of the circuit scale. Although the representative point interval value is set to [8] in this embodiment, it is not limited to this and may be increased or decreased as necessary. Further, in the present embodiment, the memory area is determined by detecting only the most significant digit, but the interval between the representative points is narrowed or the detection range centered on each representative point is widened, and If it is difficult to allocate the memory area only with the numerical value of the upper digit, the lower digit may be sequentially used.

【0014】図6は図3に対応した図で、相対距離の決
定方法の別実施例で、前記実施例と同様、代表点D0,
D1,D2間隔を8等間隔とし、水平方向の各比較点
[W00]〜[W015]、[W10]〜[W115]
及び[W20]〜[W215]に対応して夫々[0]〜
[15]の相対距離を設定している。
FIG. 6 is a view corresponding to FIG. 3, and shows another embodiment of the method for determining the relative distance. Similar to the above embodiment, the representative points D0,
The intervals D1 and D2 are set at 8 equal intervals, and the comparison points [W00] to [W015] and [W10] to [W115] in the horizontal direction are compared.
And [W20] to [W215], respectively, [0] to
The relative distance of [15] is set.

【0015】図7は図4に対応した図で、同図において
相対距離[0]〜[15]に対応して同欄左側に、相対
距離を所定の整数で除した値の整数が示されている。相
対距離[1]の場合を例にとれば、1(相対距離)÷8
(所定の整数)の商は0.12…であり、その整数部は
[0]となる。以下同様にして相対距離[7]までの範
囲は整数部が[0]で示され、相対距離[8]〜[1
5]の範囲では整数部が[1]で示されることになる。
本実施例では、この整数部の値を検出して、この値に応
じてメモリ領域を決定する構成としている。整数部が
[0]の場合にはメモリ領域M0へ、整数部が[1]の
場合にはメモリ領域M1へ記憶することになる。そし
て、演算結果の各番地への累積は、相対距離[0]〜
[7]を番地[0]から順次[7]へと対応させ、そし
て、相対距離[8]〜[15]を番地[0]から[7]
へと対応させて累積している。本実施例の場合も、前記
実施例と同様、メモリ領域を煩雑に振り分ける必要がな
く制御が簡単なものとなる。又、本実施例では、除する
整数を「8」の場合で例示したが、これに限らず他の整
数であっても差し支えない。尚、前記両実施例とも説明
の便宜上、代表点を水平方向にのみ設ける構成で説明し
たが、実際には垂直方向にも水平方向と同様に比較点が
設けられる構成となっている。又、代表点数についても
前記両実施例では一方向に3箇所設ける構成としている
が、必要に応じてその数を増加させ得ることは言うまで
もない。
FIG. 7 is a view corresponding to FIG. 4, and in the figure, corresponding to the relative distances [0] to [15], an integer of a value obtained by dividing the relative distance by a predetermined integer is shown on the left side of the same column. ing. Taking the case of the relative distance [1] as an example, 1 (relative distance) / 8
The quotient of (predetermined integer) is 0.12, and its integer part is [0]. Similarly, the integer part of the range up to the relative distance [7] is indicated by [0], and the relative distances [8] to [1]
In the range of [5], the integer part is represented by [1].
In the present embodiment, the value of the integer part is detected and the memory area is determined according to this value. When the integer part is [0], it is stored in the memory region M0, and when the integer part is [1], it is stored in the memory region M1. Then, the accumulation of the calculation result to each address is performed by the relative distance [0] to
[7] is sequentially associated with address [0] to [7], and relative distances [8] to [15] are assigned from addresses [0] to [7].
It has accumulated corresponding to. In the case of the present embodiment as well, similar to the above-described embodiments, it is not necessary to allocate memory areas intricately, and the control becomes simple. Further, in the present embodiment, the case where the integer to be divided is "8" is illustrated, but the present invention is not limited to this and other integers may be used. For the sake of convenience of description, both of the above-described embodiments have been described as having the configuration in which the representative points are provided only in the horizontal direction, but actually, the comparison points are provided in the vertical direction as in the horizontal direction. Also, regarding the representative points, in both of the above-mentioned embodiments, three representative points are provided in one direction, but it goes without saying that the number can be increased if necessary.

【0016】[0016]

【発明の効果】本発明によれば、画像信号に基づく演算
結果をメモリ回路内のメモリ領域に煩雑に振り分ける必
要がなく、制御がし易くなると共に回路の小規模化につ
ながる等の効果を奏する。
According to the present invention, it is not necessary to distribute the calculation result based on the image signal to the memory area in the memory circuit in a complicated manner, and the control is facilitated and the circuit is downsized. .

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の一実施例に係る動き量検出装置のブロ
ック図である。
FIG. 1 is a block diagram of a motion amount detecting device according to an embodiment of the present invention.

【図2】(A)は演算回路Iの回路構成例を示した図で
ある。(B)は演算回路IIの回路構成例を示した図で
ある。
FIG. 2A is a diagram showing a circuit configuration example of an arithmetic circuit I. FIG. 3B is a diagram showing a circuit configuration example of the arithmetic circuit II.

【図3】代表点指定回路が指定する代表点の位置関係及
び検出範囲を示す図である。
FIG. 3 is a diagram showing a positional relationship and a detection range of representative points designated by a representative point designation circuit.

【図4】検出メモリ回路内のメモリ・アドレスを示す図
である。
FIG. 4 is a diagram showing memory addresses in a detection memory circuit.

【図5】検出メモリ回路内のメモリ領域を示す図であ
る。
FIG. 5 is a diagram showing a memory area in a detection memory circuit.

【図6】他実施例に係る代表点指定回路が指定する代表
点の位置関係及び検出範囲を示す図である。
FIG. 6 is a diagram showing a positional relationship and a detection range of representative points designated by a representative point designation circuit according to another embodiment.

【図7】他実施例に係る検出メモリ回路内のメモリ・ア
ドレスを示す図である。
FIG. 7 is a diagram showing memory addresses in a detection memory circuit according to another embodiment.

【図8】従来の動き量検出装置のブロック図である。FIG. 8 is a block diagram of a conventional motion amount detecting device.

【図9】従来の動き量検出装置の代表点の配置図であ
る。
FIG. 9 is an arrangement diagram of representative points of a conventional motion amount detecting device.

【符号の説明】[Explanation of symbols]

50 入力回路 51 代表点メモリ回路 52 代表点指定回路 55 演算回路I 61 演算回路II 63 メモリ回路 65 動き量検出回路 67 システム制御回路 81 減算回路 83 割振り器 50 input circuit 51 representative point memory circuit 52 representative point designation circuit 55 arithmetic circuit I 61 arithmetic circuit II 63 memory circuit 65 motion amount detection circuit 67 system control circuit 81 subtraction circuit 83 allocator

─────────────────────────────────────────────────────
─────────────────────────────────────────────────── ───

【手続補正書】[Procedure amendment]

【提出日】平成5年5月19日[Submission date] May 19, 1993

【手続補正1】[Procedure Amendment 1]

【補正対象書類名】明細書[Document name to be amended] Statement

【補正対象項目名】請求項2[Name of item to be corrected] Claim 2

【補正方法】変更[Correction method] Change

【補正内容】[Correction content]

【手続補正2】[Procedure Amendment 2]

【補正対象書類名】明細書[Document name to be amended] Statement

【補正対象項目名】発明の詳細な説明[Name of item to be amended] Detailed explanation of the invention

【補正方法】変更[Correction method] Change

【補正内容】[Correction content]

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野本発明は小型化の進む
カメラ等に使用される画像ゆれを検出する動き量検出装
置に関する。 【0002】
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a motion amount detecting device for detecting image shake, which is used in cameras and the like which are becoming smaller. [0002]

【従来の技術】図8は特開平1−269371号公報に
示される従来の動き量検出装置のブロック図で、1はテ
レビジョン画像信号の入力回路、2は画像信号内の代表
点の信号を記憶する代表点メモリ回路、3は代表点メモ
リ回路2を制御するメモリ制御回路I、4は1フィール
ド以上前の代表点の信号である代表点メモリ回路2から
の読み出し信号と現在の画像信号である入力回路1の出
力信号とを演算する演算回路、5は演算回路4の出力信
号を記憶する検出メモリ回路、6は検出メモリ回路5を
制御するメモリ制御回路II、7は検出メモリ回路5か
らの読み出し信号を用いて動き量を得る動き量演算回
路、8は代表点メモリ回路2に記憶する代表点の位置を
決める代表点指定回路、9は代表点指定回路8及びメモ
リ制御回路6を制御する演算制御回路、10は前記の回
路群を総合的に制御するシステム制御回路である。そし
て、以下のような動作をする構成となっている。入力回
路1よりテレビジョン画像信号が入力され、代表点指定
回路8で指定された代表点の位置に対応する画像信号が
メモリ制御回路13によって代表点メモリ回路2に書き
込まれ、次のフレームにその値を出力する。そして、演
算回路4が現在の画像と代表点における1フレーム前の
画像とを演算し、その結果をメモリ制御回路II6によ
って検出メモリ回路5に書き込む。この時画像信号と代
表点の位置関係が等しい時は同じメモリに加算していき
すべての演算終了後に読み出し、その出力信号を用いて
動き量演算回路7が動き量を求める構成となっている。
2. Description of the Related Art FIG. 8 is a block diagram of a conventional motion amount detecting device disclosed in Japanese Patent Application Laid-Open No. 1-269371, where 1 is a television image signal input circuit and 2 is a signal of a representative point in the image signal. A representative point memory circuit for storing, 3 is a memory control circuit I for controlling the representative point memory circuit 2, and 4 is a read signal from the representative point memory circuit 2 which is a representative point signal one field or more before and a current image signal. An arithmetic circuit for arithmetically operating the output signal of a certain input circuit 1, 5 is a detection memory circuit for storing the output signal of the arithmetic circuit 4, 6 is a memory control circuit II for controlling the detection memory circuit 5, and 7 is from the detection memory circuit 5. A motion amount calculation circuit for obtaining a motion amount using the read signal of 8; a representative point designating circuit for deciding the position of the representative point to be stored in the representative point memory circuit 2; That the arithmetic control circuit, 10 is a system control circuit for comprehensively controlling the circuit group of said. Then, the following operation is performed. A television image signal is input from the input circuit 1, an image signal corresponding to the position of the representative point designated by the representative point designating circuit 8 is written in the representative point memory circuit 2 by the memory control circuit 13, and the image signal is written in the next frame. Output the value. Then, the arithmetic circuit 4 calculates the current image and the image one frame before at the representative point, and the result is written in the detection memory circuit 5 by the memory control circuit II6. At this time, when the positional relationship between the image signal and the representative point is the same, they are added to the same memory and read after the completion of all calculations, and the motion amount calculation circuit 7 uses the output signal to calculate the motion amount.

【0003】[0003]

【発明が解決しようとする課題】ここで、前記装置の代
表点指定回路8及び演算制御回路9では図9に示すよう
に4個の代表点P0,P1,P2,P3を17の等間隔
で指定し、夫々の代表点からの検出範囲を水平方向に±
32づつ設けている。そして、1フィールド前の各代表
点と現在の画像信号の検出点との相対距離を代表点間隔
数で除した剰余数に応じてメモリ領域を定める構成とし
ている。従って、この下位側の数値(剰余数)に応じて
分割領域を定めているために相隣り合う検出点の画素が
連続していても、下位側の数値(剰余数)は同一となら
ず、煩雑にメモリ領域を変更する必要があり、その制御
が複雑となると共に、回路規模も大きくなってしまう等
の問題点を有するものであった。そこで、本発明は前記
欠点を除去した装置を提供することを目的とする。
Here, in the representative point designating circuit 8 and the arithmetic control circuit 9 of the device, as shown in FIG. 9, four representative points P0, P1, P2 and P3 are arranged at equal intervals of 17. The horizontal axis indicates the detection range from each representative point.
There are 32 each. The memory area is determined according to the number of remainders obtained by dividing the relative distance between each representative point one field before and the current detection point of the image signal by the number of representative point intervals. Therefore, since the divided area is defined according to the numerical value on the lower side (residual number), even if the pixels at adjacent detection points are continuous, the numerical value on the lower side (residual number) is not the same, There is a problem in that it is necessary to change the memory area intricately, the control becomes complicated, and the circuit scale becomes large. Therefore, it is an object of the present invention to provide a device that eliminates the above-mentioned drawbacks.

【0004】[0004]

【課題を解決するための手段】本発明は上記目的を達成
するために以下の1)及び2)の装置を提供しようとい
うものである。即ち、 1) 少なくとも、デジタル化された画像信号を入力す
る入力回路と、1フィールド領域に複数の代表点を指定
する代表点指定回路と、前記1フィールド以上前の代表
点の画像信号を記憶する代表点メモリ回路と、1フィー
ルド以上前の前記代表点の画像信号と現在の画像信号と
を演算する第1の演算回路と、前記代表点の画像信号と
前記現在の画像信号とに対応した位置情報とで演算する
第2の演算回路と、前記第1の演算回路からの演算結果
を記憶するメモリ回路とを具備し、前記演算結果を前記
第2の演算回路により現在の画像信号と1フィールド以
上前の代表点との相対距離を2進数に換算した際の上位
桁の数値に応じて前記メモリ回路内のメモリ領域を決定
して記憶させる構成としたことを特徴とする動き量検出
装置。 2) 少なくとも、デジタル化された画像信号を入力す
る入力回路と、1フィールド領域に複数の代表点を指定
する代表点指定回路と、1フィールド以上前の前記代表
点の画像信号を記憶する代表点メモリ回路と、前記1フ
ィールド以上前の代表点の画像信号と現在の画像信号と
を演算する第1の演算回路と、前記代表点の画像信号と
前記現在の画像信号とに対応した位置情報とで演算する
第2の演算回路と、前記第1の演算回路からの演算結果
を記憶するメモリ回路とを具備し、前記演算結果を前記
第2の演算回路により前記現在の画像信号の位置情報に
基づく数値を所定の整数で除した値の整数部に応じて前
記メモリ回路内のメモリ領域を決定して記憶させる構成
としたことを特徴とする動き量検出装置。
SUMMARY OF THE INVENTION The present invention is to provide the following devices 1) and 2) in order to achieve the above object. That is, 1) at least an input circuit for inputting a digitized image signal, a representative point designating circuit for designating a plurality of representative points in one field area, and an image signal of the representative point one field or more before. Representative point memory circuit, first computing circuit for computing the image signal of the representative point one field or more before and the current image signal, and a position corresponding to the image signal of the representative point and the current image signal A second arithmetic circuit for arithmetic operation with information and a memory circuit for storing the arithmetic result from the first arithmetic circuit, and the arithmetic result by the second arithmetic circuit for the current image signal and one field A motion amount detecting device characterized in that a memory area in the memory circuit is determined and stored according to a numerical value of an upper digit when the relative distance from the preceding representative point is converted into a binary number. 2) At least an input circuit for inputting a digitized image signal, a representative point designating circuit for designating a plurality of representative points in one field area, and a representative point for storing the image signal of the representative point one field or more before. A memory circuit; a first arithmetic circuit for arithmetically operating the image signal at the representative point one field or more before and the current image signal; and position information corresponding to the image signal at the representative point and the current image signal. And a memory circuit for storing a calculation result from the first calculation circuit, wherein the calculation result is converted into position information of the current image signal by the second calculation circuit. A motion amount detecting device characterized in that a memory area in the memory circuit is determined and stored according to an integer part of a value obtained by dividing a numerical value based on a predetermined integer.

【0005】[0005]

【作用】第1の演算回路で1フィールド以上前の代表点
の画像信号と現在の画像信号とを演算し、この演算結果
を第2の演算回路により現在の画像信号と1フィールド
以上前の代表点との相対距離を2進数に換算した際の上
位桁の数値に応じてメモリ回路内のメモリ領域を決定し
て記憶させる構成にしたり、現在の画像信号の位置情報
信号に基づく数値を所定の整数で除した値の整数部に応
じて、前記メモリ領域を決定して記憶させる構成にす
る。
The first arithmetic circuit calculates the image signal at the representative point one field or more before and the current image signal, and the calculation result is calculated by the second arithmetic circuit to the current image signal and the representative one field or more before. The memory area in the memory circuit is determined and stored according to the numerical value of the upper digit when the relative distance to the point is converted into a binary number, or the numerical value based on the position information signal of the current image signal is set to a predetermined value. The memory area is determined and stored according to the integer part of the value divided by an integer.

【0006】[0006]

【実施例】図1は本発明の一実施例に係る動き量検出装
置のブロック図を示したものである。同図において50
はデジタル化されたテレビジョン画像信号の入力回路、
51は前記画像信号の代表点の信号を記憶する代表点メ
モリ回路、52は代表点メモリ回路51を制御するメモ
リ制御回路、53は前記代表点メモリ回路51への代表
点を指定する為の代表点指定回路、55は1フィールド
以上前の代表点の信号である代表点メモリ回路51から
読み出された信号と入力回路50から入来する現在の画
像信号とを演算する第1の演算回路I、59は演算回路
II61の演算結果に基づく信号により第1の演算回路
I55の演算結果を切り換える切換回路、63は前記第
1の演算回路I55の演算結果を記憶するメモリ回路、
65はメモリ回路63より演算回路II61からのアド
レス信号に基づいて読み出された信号の最小値を検出し
て動き量を求める動き量検出回路、67は前記の回路群
を総合的に制御するシステム制御回路である。
1 is a block diagram of a motion amount detecting apparatus according to an embodiment of the present invention. 50 in the figure
Is an input circuit of the digitized television image signal,
Reference numeral 51 is a representative point memory circuit for storing the signal of the representative point of the image signal, 52 is a memory control circuit for controlling the representative point memory circuit 51, and 53 is a representative for designating the representative point to the representative point memory circuit 51. A point designation circuit 55 is a first arithmetic circuit I for arithmetically operating a signal read from the representative point memory circuit 51, which is a representative point signal one field or more before, and a current image signal coming from the input circuit 50. , 59 is a switching circuit for switching the calculation result of the first calculation circuit I55 by a signal based on the calculation result of the calculation circuit II61, 63 is a memory circuit for storing the calculation result of the first calculation circuit I55,
Reference numeral 65 is a motion amount detection circuit for detecting the minimum value of the signal read from the memory circuit 63 based on the address signal from the arithmetic circuit II 61 to obtain the motion amount, and 67 is a system for comprehensively controlling the above circuit groups. It is a control circuit.

【0007】以下、この構成による動作につき説明す
る。入力回路50よりデジタル化されたテレビジョン画
像信号が入力され、代表点指定回路53で指定された代
表点の位置に対応する画像がメモリ制御回路52によっ
て代表点メモリ回路51に書き込まれ、次フィールドで
その値を演算回路I55に出力する。この演算回路I5
5では入力回路50より入来する現在の画像信号と代表
点における1フィールド前の画像信号との相対距離が演
算部(A)及び(B)で演算され、この演算結果が次段
の切換回路59に供給される。同時に、代表点指定回路
53からは前記演算回路I55に供給されている1フィ
ールド前の代表点に対応した位置情報と現在の画像信号
の位置情報とが演算回路II61に供給されており、こ
こで現在の画像信号の位置情報は2進数に換算されて読
み取られ、この2進数の上位桁の数値[1],[0]に
応じた切換信号を切換回路59に供給し、この切換回路
59により第1の演算回路I55の演算結果をメモリ回
路63のメモリ領域M0かM1のいずれかに供給すると
共に、アドレス信号に基づいて前記夫々のメモリ領域に
記憶する。この記憶領域M0,M1に記憶された情報
は、順次比較されて最小値が検出され、そのアドレスを
読み取ることにより、対応する動き量を得る。
The operation of this configuration will be described below. The digitized television image signal is input from the input circuit 50, the image corresponding to the position of the representative point designated by the representative point designating circuit 53 is written in the representative point memory circuit 51 by the memory control circuit 52, and the next field is written. Outputs the value to the arithmetic circuit I55. This arithmetic circuit I5
In 5, the relative distance between the current image signal coming from the input circuit 50 and the image signal one field before at the representative point is calculated by the calculation units (A) and (B), and the calculation result is the next stage switching circuit. It is supplied to 59. At the same time, the representative point designating circuit 53 supplies the arithmetic circuit II61 with the positional information corresponding to the representative point one field before supplied to the arithmetic circuit I55 and the positional information of the current image signal. The position information of the current image signal is converted into a binary number and read, and a switching signal corresponding to the numerical values [1] and [0] of the upper digit of the binary number is supplied to the switching circuit 59. The calculation result of the first calculation circuit I55 is supplied to either the memory area M0 or M1 of the memory circuit 63 and stored in each of the memory areas based on the address signal. The information stored in the storage areas M0 and M1 is sequentially compared to detect the minimum value, and the corresponding movement amount is obtained by reading the address.

【0008】図2(A)は図1に示した第1の演算回路
I55の回路構成例で、同図において、端子69より入
来する1フィールド前の代表点の信号と端子70より入
来する現在の入力画像信号とを減算回路72により減算
し、この差信号は絶対値回路74により絶対値が求めら
れ、次段のクリップ回路76において所定のビット数に
減じられる構成となっている。この第1の演算回路I5
5は、後述するように同時に複数の絶対値を得る必要が
あり、夫々二連(演算部A、B)づつ設けられている。
FIG. 2A shows an example of the circuit configuration of the first arithmetic circuit I55 shown in FIG. 1. In FIG. 2, the signal of the representative point one field before coming from the terminal 69 and the signal coming from the terminal 70 come in from the terminal 69. The subtraction circuit 72 subtracts the current input image signal, and the absolute value of the difference signal is obtained by the absolute value circuit 74. The clip circuit 76 at the next stage reduces the absolute value to a predetermined number of bits. This first arithmetic circuit I5
It is necessary to obtain a plurality of absolute values 5 at the same time, as will be described later, and two units (computation units A and B) are provided for each unit.

【0009】図2(B)は同じく図1に示した第2の演
算回路II61の回路構成例で、端子78より入来する
現在の画素番号と端子79より入来する代表点の画素番
号とを減算回路81により減算して相対値を得て、次段
の割振り器83に供給される。この割振り器83では、
入来する相対値は2進数に換算されて処理されており、
その上位桁の数値(1,0)に応じてメモリ回路59内
のメモリ領域(M0,M1)を決定する制御信号を出力
する構成となっている。そして、この第2の演算回路I
I61についても前記第1の演算回路I55と同様に二
連づつ設けられている。
FIG. 2B is a circuit configuration example of the second arithmetic circuit II61 also shown in FIG. 1, in which the current pixel number coming from the terminal 78 and the pixel number of the representative point coming from the terminal 79 are shown. Is subtracted by the subtraction circuit 81 to obtain a relative value, and the relative value is supplied to the allocator 83 at the next stage. In this allocator 83,
Incoming relative values are converted into binary numbers and processed,
The control signal for determining the memory area (M0, M1) in the memory circuit 59 is output according to the numerical value (1, 0) of the upper digit. Then, the second arithmetic circuit I
Similarly to the first arithmetic circuit I55, two I61 are provided.

【0010】図3は図1に示した代表点指定回路53が
指定する代表点の位置関係及び検出範囲を示す図で、同
図において所定水平ライン上に代表点D0,D1,D2
を8等間隔おきに設けると共に、これらの代表点D0,
D1,D2の水平走査方向のマイナス方向に8箇所、プ
ラス方向に7箇所の比較点を設けている。代表点D0の
比較範囲にはW00〜W015の計16箇所、代表点D
1の比較範囲にはW10〜W115の計16箇所、そし
て、代表点D2の比較範囲にはW20〜W215の計1
6箇所が夫々設定されている。
FIG. 3 is a diagram showing the positional relationship and the detection range of the representative points designated by the representative point designating circuit 53 shown in FIG. 1. In the figure, representative points D0, D1, D2 are shown on a predetermined horizontal line.
And the representative points D0,
Eight comparison points are provided in the negative direction of D1 and D2 in the horizontal scanning direction, and seven comparison points are provided in the positive direction. In the comparison range of the representative point D0, a total of 16 locations W00 to W015, the representative point D
The comparison range of 1 has 16 positions of W10 to W115 in total, and the comparison range of the representative point D2 has 1 of W20 to W215 in total.
Six locations are set respectively.

【0011】図4は検出メモリ回路59内のメモリ・ア
ドレスを示す。同図において、前記比較点は水平走査方
向の画素番号に対応して設けられており、画素番号
[5]に対応して[W00]、画素番号[6]に対応し
て[W01]、画素番号[7]に対応して[W02]…
…が順次設定されている。又、夫々の代表点D0(W0
8),D1(W18),D2(W28)のマイナス方向
側には[−1]乃至[−8]の相対距離を定め、プラス
方向側には[1]乃至[7]の相対距離を定めている。
この相対距離は説明の便宜上、10進法で示しているが
実際には左欄に示すように2進数に換算されて処理され
ている。そして、前記第2の演算回路II61の割振り
器83により、2進数で示される相対距離の最上位桁の
数値(1,0)に応じて、第2の演算回路II61の演
算結果をメモリ領域M0かM1かに振り分けて記憶させ
る構成としている。
FIG. 4 shows the memory address in the detection memory circuit 59. In the figure, the comparison points are provided in correspondence with the pixel numbers in the horizontal scanning direction, corresponding to pixel number [5] [W00], pixel number [6] [W01], pixel Corresponding to the number [7] [W02] ...
... are set sequentially. In addition, each representative point D0 (W0
8), D1 (W18), and D2 (W28) on the minus side, the relative distances of [-1] to [-8] are set, and on the plus side, the relative distances of [1] to [7] are set. ing.
Although this relative distance is shown in a decimal system for convenience of explanation, it is actually converted into a binary number and processed as shown in the left column. Then, the allocator 83 of the second arithmetic circuit II61 outputs the arithmetic result of the second arithmetic circuit II61 to the memory area M0 according to the numerical value (1,0) of the most significant digit of the relative distance represented by a binary number. It is configured such that it is sorted into M1 or M1 and stored.

【0012】図5はその検出回路59内のメモリ領域を
示す図で、同図も併せて参照するに、各代表点よりマイ
ナス方向にあって2進数で示される相対距離の最上位桁
の数値に着目すると、全てが[1]で表わされる。この
最上位桁の数値が[1]である場合にはメモリ領域M1
に記憶させるようにする。また、逆に各代表点よりプラ
ス方向にある相対距離の最上位桁の数値は、全べてが
[0]で表わされる。この[0]の数値である場合に
は、メモリ領域M0に記憶させるようにしている。そし
て、この規則に基づいてメモリ領域が決定され、演算結
果は各メモリ領域内の対応する番地(0〜7)に順次累
積値が記憶されることになる。この番地への累積は、既
述したように4ビット中下位の3ビットがアドレス信号
用に当てられる。その結果、プラス方向の相対距離
[0]が番地[0]へ、相対距離[1]が番地[1]へ
…、そして、マイナス方向の相対距離[−8]が番地
[0]へ、[−7]が番地[1]へと順次対応して累積
される。各番地への累積が終了すると、演算回路II6
1からのアドレス信号に基づいて各番地内の累積値が次
段の動き量検出回路65に読み出され、ここで、順次各
累積値が比較されて最小値が検出される。新豪雨各番地
内の値が順次比較され、最小値が検出される。例えば、
メモリ領域M0の[0]番地の累積値が最小であった場
合には、各代表点[W08],[W18],[W28]
には移動がなかったものとみなされる。又、メモリ領域
M0の[3]番地の累積値が最小であった場合には、各
代表点が夫々[W011],[W11],[W211]
の位置に移動し、この範囲の動き量があったものとみな
される。この最小値が検出されると、既述したように最
小値が記憶されている番地と相対位置とは予め対応がと
れており、この番地が読み取られることにより動き量が
得られる。この動き量は最終的には、図示しない公知の
画像補正回路に供給され、画面ゆれが補正される構成と
なっている。
FIG. 5 is a diagram showing a memory area in the detecting circuit 59. Referring to FIG. 5 as well, the numerical value of the most significant digit of the relative distance indicated by a binary number in the minus direction from each representative point. Focusing on, all are represented by [1]. If the value of the most significant digit is [1], the memory area M1
To be remembered. On the contrary, the numerical value of the most significant digit of the relative distance in the plus direction from each representative point is all represented by [0]. If the value is [0], it is stored in the memory area M0. Then, the memory area is determined based on this rule, and as the calculation result, the cumulative value is sequentially stored in the corresponding address (0 to 7) in each memory area. As for the accumulation to this address, as described above, the lower 3 bits of the 4 bits are applied for the address signal. As a result, the relative distance [0] in the plus direction to the address [0], the relative distance [1] to the address [1], ..., And the relative distance [-8] in the minus direction to the address [0], -7] is sequentially accumulated corresponding to the address [1]. When the accumulation to each address is completed, the arithmetic circuit II6
Based on the address signal from 1, the cumulative value in each address is read out to the motion amount detection circuit 65 in the next stage, where the cumulative values are sequentially compared and the minimum value is detected. The values within each address of the new heavy rain are sequentially compared and the minimum value is detected. For example,
When the cumulative value of the address [0] of the memory area M0 is the minimum, the representative points [W08], [W18], [W28]
Is considered to have not moved. When the cumulative value of the address [3] of the memory area M0 is the minimum, the representative points are [W011], [W11], and [W211], respectively.
It is considered that there was a movement amount within this range after moving to the position of. When this minimum value is detected, as described above, the address in which the minimum value is stored and the relative position are associated with each other in advance, and the amount of movement is obtained by reading this address. Finally, the amount of movement is supplied to a known image correction circuit (not shown) to correct the screen shake.

【0013】従って、前記実施例によれば相対比較距離
を2進数に換算して、この最上位桁の数値を検出してメ
モリ領域を決定する構成としているので、前記従来例の
ように下位桁の数値を検出するものに比べ、メモリ領域
を煩雑に振り分ける必要がなく制御が簡単なものとな
る。また、下位桁を各メモリ領域の共通番地としている
ので、この点についても制御が簡単なものとなり、しい
ては回路規模の小型化につながる。尚、本実施例では代
表点間隔値を[8]としているが、これに限らず必要に
応じて増減すればよい。又、本実施例では最上位桁の数
値のみを検出してメモリ領域を決定する構成にしている
が、代表点間隔を狭くしたり、各代表点を中心とする検
出範囲を広げることにより、最上位桁の数値のみではメ
モリ領域の振り分けが困難な場合には順次下位桁を利用
するようにすれば良い。
Therefore, according to the above-described embodiment, the relative comparison distance is converted into a binary number and the value of the most significant digit is detected to determine the memory area. Compared with the method of detecting the numerical value of, the control becomes simpler without the need for complicated allocation of the memory area. Further, since the lower digit is used as a common address for each memory area, the control is easy in this respect as well, which leads to downsizing of the circuit scale. Although the representative point interval value is set to [8] in this embodiment, it is not limited to this and may be increased or decreased as necessary. Further, in the present embodiment, the memory area is determined by detecting only the most significant digit, but the interval between the representative points is narrowed or the detection range centered on each representative point is widened, and If it is difficult to allocate the memory area only with the numerical value of the upper digit, the lower digit may be sequentially used.

【0014】図6は図3に対応した図で、相対距離の決
定方法の別実施例で、前記実施例と同様、代表点D0,
D1,D2間隔を8等間隔とし、水平方向の各比較点
[W00]〜[W015]、[W10]〜[W115]
及び[W20]〜[W215]に対応して夫々[0]〜
[15]の相対距離を設定している。
FIG. 6 is a view corresponding to FIG. 3, and shows another embodiment of the method for determining the relative distance. Similar to the above embodiment, the representative points D0,
The intervals D1 and D2 are set at 8 equal intervals, and the comparison points [W00] to [W015] and [W10] to [W115] in the horizontal direction are compared.
And [W20] to [W215], respectively, [0] to
The relative distance of [15] is set.

【0015】図7は図4に対応した図で、同図において
相対距離[0]〜[15]に対応して同欄左側に、相対
距離を所定の整数で除した値の整数が示されている。相
対距離[1]の場合を例にとれば、1(相対距離)÷8
(所定の整数)の商は0.12…であり、その整数部は
[0]となる。以下同様にして相対距離[7]までの範
囲は整数部が[0]で示され、相対距離[8]〜[1
5]の範囲では整数部が[1]で示されることになる。
本実施例では、この整数部の値を検出して、この値に応
じてメモリ領域を決定する構成としている。整数部が
[0]の場合にはメモリ領域M0へ、整数部が[1]の
場合にはメモリ領域M1へ記憶することになる。そし
て、演算結果の各番地への累積は、相対距離[0]〜
[7]を番地[0]から順次[7]へと対応させ、そし
て、相対距離[8]〜[15]を番地[0]から[7]
へと対応させて累積している。本実施例の場合も、前記
実施例と同様、メモリ領域を煩雑に振り分ける必要がな
く制御が簡単なものとなる。又、本実施例では、除する
整数を「8」の場合で例示したが、これに限らず他の整
数であっても差し支えない。尚、前記両実施例とも説明
の便宜上、代表点を水平方向にのみ設ける構成で説明し
たが、実際には垂直方向にも水平方向と同様に比較点が
設けられる構成となっている。又、代表点数についても
前記両実施例では一方向に3箇所設ける構成としている
が、必要に応じてその数を増加させ得ることは言うまで
もない。
FIG. 7 is a view corresponding to FIG. 4, and in the figure, corresponding to the relative distances [0] to [15], an integer of a value obtained by dividing the relative distance by a predetermined integer is shown on the left side of the same column. ing. Taking the case of the relative distance [1] as an example, 1 (relative distance) / 8
The quotient of (predetermined integer) is 0.12, and its integer part is [0]. Similarly, the integer part of the range up to the relative distance [7] is indicated by [0], and the relative distances [8] to [1]
In the range of [5], the integer part is represented by [1].
In the present embodiment, the value of the integer part is detected and the memory area is determined according to this value. When the integer part is [0], it is stored in the memory region M0, and when the integer part is [1], it is stored in the memory region M1. Then, the accumulation of the calculation result to each address is performed by the relative distance [0] to
[7] is sequentially associated with address [0] to [7], and relative distances [8] to [15] are assigned from addresses [0] to [7].
It has accumulated corresponding to. In the case of the present embodiment as well, similar to the above-described embodiments, it is not necessary to allocate memory areas intricately, and the control becomes simple. Further, in the present embodiment, the case where the integer to be divided is "8" is illustrated, but the present invention is not limited to this and other integers may be used. For the sake of convenience of description, both of the above-described embodiments have been described as having the configuration in which the representative points are provided only in the horizontal direction, but actually, the comparison points are provided in the vertical direction as in the horizontal direction. Also, regarding the representative points, in both of the above-mentioned embodiments, three representative points are provided in one direction, but it goes without saying that the number can be increased if necessary.

【0016】[0016]

【発明の効果】本発明によれば、画像信号に基づく演算
結果をメモリ回路内のメモリ領域に煩雑に振り分ける必
要がなく、制御がし易くなると共に回路の小規模化につ
ながる等の効果を奏する。
According to the present invention, it is not necessary to distribute the calculation result based on the image signal to the memory area in the memory circuit in a complicated manner, and the control is facilitated and the circuit is downsized. .

───────────────────────────────────────────────────── フロントページの続き (72)発明者 松岡 賢司 神奈川県横浜市神奈川区守屋町3丁目12番 地 日本ビクター株式会社内 ─────────────────────────────────────────────────── ─── Continuation of the front page (72) Inventor Kenji Matsuoka 3-12 Moriya-cho, Kanagawa-ku, Yokohama, Kanagawa Japan Victor Company of Japan, Ltd.

Claims (2)

【特許請求の範囲】[Claims] 【請求項1】 少なくとも、デジタル化された画像信号
を入力する入力回路と、1フィールド領域に複数の代表
点を指定する代表点指定回路と、1フィールド以上前の
前記代表点の画像信号を記憶する代表点メモリ回路と、
前記1フィールド以上前の代表点の画像信号と現在の画
像信号とを演算する第1の演算回路と、前記代表点の画
像信号と前記現在の画像信号とに対応した位置情報とで
演算する第2の演算回路と、前記第1の演算回路からの
演算結果を記憶するメモリ回路とを具備し、前記演算結
果を前記第2の演算回路により現在の画像信号と前記1
フィールド以上前の代表点との相対距離を2進数に換算
した際の上位桁の数値に応じて前記メモリ回路内のメモ
リ領域を決定して記憶させる構成としたことを特徴とす
る動き量検出装置。
1. An input circuit for inputting at least a digitized image signal, a representative point designating circuit for designating a plurality of representative points in one field area, and an image signal of the representative point one field or more before. Representative point memory circuit,
A first arithmetic circuit for calculating an image signal of a representative point one field or more before and a current image signal; and a first arithmetic circuit for calculating an image signal of the representative point and position information corresponding to the current image signal. 2 arithmetic circuit, and a memory circuit for storing the arithmetic result from the first arithmetic circuit, and the arithmetic result by the second arithmetic circuit and the current image signal and the 1
A motion amount detecting device characterized in that the memory area in the memory circuit is determined and stored in accordance with the numerical value of the upper digit when the relative distance from the representative point before the field is converted into a binary number. .
【請求項2】 少なくとも、デジタル化された画像信号
を入力する入力回路と、1フィールド領域に複数の代表
点を指定する代表点指定回路と、1フィールド以上前の
前記代表点の画像信号を記憶する代表点メモリ回路と、
前記1フィールド以上前の代表点の画像信号と現在の画
像信号とを演算する第1の演算回路と、前記代表点の画
像信号と前記現在の画像信号とに対応した位置情報とで
演算する第2の演算回路と、前記第1の演算回路からの
演算結果を記憶するメモリ回路とを具備し、前記演算結
果を前記第2の演算回路により前記現在の画像信号の位
置情報に基づく数値を所定の整数で除した値の整数部に
応じて前記メモリ回路内のメモリ領域を決定して記憶さ
せる構成としたことを特徴とする動き量検出装置。
2. An input circuit for inputting at least a digitized image signal, a representative point designating circuit for designating a plurality of representative points in one field area, and an image signal of the representative point one field or more before. Representative point memory circuit,
A first arithmetic circuit for calculating an image signal of a representative point one field or more before and a current image signal; and a first arithmetic circuit for calculating an image signal of the representative point and position information corresponding to the current image signal. A second arithmetic circuit, and a memory circuit for storing the arithmetic result from the first arithmetic circuit, and the arithmetic result is predetermined by the second arithmetic circuit based on the position information of the current image signal. A motion amount detecting device having a configuration in which a memory area in the memory circuit is determined and stored in accordance with an integer part of a value divided by the integer.
JP3108886A 1991-04-12 1991-04-12 Motion detector Expired - Lifetime JP2600514B2 (en)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP3108886A JP2600514B2 (en) 1991-04-12 1991-04-12 Motion detector
DE69215733T DE69215733T2 (en) 1991-04-12 1992-04-10 Device for detecting the relative movement between contents of successive fields of a video signal
EP92106290A EP0508476B1 (en) 1991-04-12 1992-04-10 Apparatus for detecting relative motion between contents of successive fields of a video signal
US07/867,546 US5253052A (en) 1991-04-12 1992-04-13 Apparatus for detecting relative motion between contents of successive fields of a video signal

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP3108886A JP2600514B2 (en) 1991-04-12 1991-04-12 Motion detector

Publications (2)

Publication Number Publication Date
JPH0622199A true JPH0622199A (en) 1994-01-28
JP2600514B2 JP2600514B2 (en) 1997-04-16

Family

ID=14496090

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3108886A Expired - Lifetime JP2600514B2 (en) 1991-04-12 1991-04-12 Motion detector

Country Status (1)

Country Link
JP (1) JP2600514B2 (en)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5650829A (en) * 1994-04-21 1997-07-22 Sanyo Electric Co., Ltd. Motion video coding systems with motion vector detection
US7790231B2 (en) 2003-07-10 2010-09-07 Brewer Science Inc. Automated process and apparatus for planarization of topographical surfaces

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01269371A (en) * 1988-04-21 1989-10-26 Matsushita Electric Ind Co Ltd Moving quantity detection device

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01269371A (en) * 1988-04-21 1989-10-26 Matsushita Electric Ind Co Ltd Moving quantity detection device

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5650829A (en) * 1994-04-21 1997-07-22 Sanyo Electric Co., Ltd. Motion video coding systems with motion vector detection
US5808700A (en) * 1994-04-21 1998-09-15 Sanyo Electric Co., Ltd. Motion video coding systems with motion vector detection
US7790231B2 (en) 2003-07-10 2010-09-07 Brewer Science Inc. Automated process and apparatus for planarization of topographical surfaces

Also Published As

Publication number Publication date
JP2600514B2 (en) 1997-04-16

Similar Documents

Publication Publication Date Title
US5210559A (en) Camera shake correcting device
US5387947A (en) Motion vector detecting method of a video signal
US4450482A (en) Digital real-time video image processing device
US4636862A (en) System for detecting vector of motion of moving objects on picture
WO2001010135A1 (en) Moving vector detecting method
JPH0591492A (en) Moving vector detector
KR930006866B1 (en) Circuit for detecting a movement
JPH0622199A (en) Moving quantity detector
JPH0287089A (en) Device for measuring contrast image of picture
JP2930675B2 (en) Motion vector detection method using initial displacement vector
JP3465264B2 (en) Apparatus and method for detecting motion of video data
KR100430572B1 (en) Method and device for correcting defective pixels of an image sensor
US6002431A (en) Video correction apparatus for camcorder
JP2643670B2 (en) Motion detector
JP2001025021A (en) Motion detection method and motion detector
JPH0993581A (en) Motion detector for moving image coder
US5345547A (en) Contour line characteristic point detecting apparatus
JP2885039B2 (en) Motion vector detection circuit
JPH0795469A (en) Picture compensation device of camcorder
JPH1075453A (en) Device and method for detecting motion vector
JPH0561975A (en) Signal matching device
JPH08237521A (en) Flaw correcting circuit for solid-state image pickup element
JPS6393273A (en) Coding device for image information
JPH06217266A (en) Motion vector detecting circuit
KR100267879B1 (en) A vision system of a equipment for manufacturing a semiconductor

Legal Events

Date Code Title Description
FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090129

Year of fee payment: 12

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090129

Year of fee payment: 12

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100129

Year of fee payment: 13

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110129

Year of fee payment: 14

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120129

Year of fee payment: 15

EXPY Cancellation because of completion of term
FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120129

Year of fee payment: 15