JP2712299B2 - High-efficiency code decoding device - Google Patents

High-efficiency code decoding device

Info

Publication number
JP2712299B2
JP2712299B2 JP13423988A JP13423988A JP2712299B2 JP 2712299 B2 JP2712299 B2 JP 2712299B2 JP 13423988 A JP13423988 A JP 13423988A JP 13423988 A JP13423988 A JP 13423988A JP 2712299 B2 JP2712299 B2 JP 2712299B2
Authority
JP
Japan
Prior art keywords
block
data
pixel data
circuit
interpolation
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP13423988A
Other languages
Japanese (ja)
Other versions
JPH01303887A (en
Inventor
哲二郎 近藤
健治 高橋
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sony Corp
Original Assignee
Sony Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Sony Corp filed Critical Sony Corp
Priority to JP13423988A priority Critical patent/JP2712299B2/en
Publication of JPH01303887A publication Critical patent/JPH01303887A/en
Application granted granted Critical
Publication of JP2712299B2 publication Critical patent/JP2712299B2/en
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Landscapes

  • Compression Or Coding Systems Of Tv Signals (AREA)

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、ディジタルテレビジョン信号等の画像デ
ータを伝送する場合に、サブサンプリングを行うと共
に、3次元ブロックの構成とし、このブロックの単位で
符号化を行い、更に静止ブロックに関しては、駒落とし
圧縮を行うことにより、伝送情報量を圧縮する高能率符
号の復号装置に関する。
DETAILED DESCRIPTION OF THE INVENTION [Industrial Application Field] The present invention performs subsampling when transmitting image data such as digital television signals, and has a three-dimensional block configuration. The present invention relates to a high-efficiency code decoding apparatus for compressing the amount of transmission information by performing encoding and further performing frame drop compression on still blocks.

〔従来の技術〕[Conventional technology]

テレビジョン信号等の画像信号の符号化方法として、
折り返し歪みの発生、誤りの伝播、ブロック歪みの発生
等の問題点が生じない高能率符号化装置が本願出願人に
より提案されている。例えば特願昭60−232789号明細書
に記載されているように、複数フレームに夫々含まれる
複数の領域から形成された3次元ブロックに関して、最
小値及び最小値と両者の差であるダイナミックレンジと
を求め、ダイナミックレンジに適応して画素データの符
号化を行う方法が提案されている。また、特願昭61−15
3330号明細書には、3次元ブロック毎に静止ブロック
(殆ど画像の動きが無いブロック)か動きブロックかを
判定し、静止ブロックの場合には、3次元ブロックを構
成するn個の同一位置の画素同士の平均値情報を伝送す
る所謂駒落としを行うことにより、伝送情報量を一層圧
縮する高能率符号化装置が提案されている。
As an encoding method of an image signal such as a television signal,
The present applicant has proposed a high-efficiency coding apparatus which does not cause problems such as generation of aliasing distortion, propagation of errors, and generation of block distortion. For example, as described in Japanese Patent Application No. 60-232789, with respect to a three-dimensional block formed from a plurality of regions respectively included in a plurality of frames, a minimum value and a dynamic range which is a difference between the minimum value and the two values are calculated. And a method of encoding pixel data in accordance with the dynamic range has been proposed. Also, Japanese Patent Application No. 61-15
In the specification of Japanese Patent No. 3330, it is determined for each three-dimensional block whether the block is a still block (a block with almost no image movement) or a motion block. In the case of a still block, n pieces of the same position constituting the three-dimensional block are determined. There has been proposed a high-efficiency encoding apparatus that further compresses the amount of transmitted information by performing so-called frame dropping that transmits average value information between pixels.

更に圧縮率を高めるために、上述の動き適応駒落とし
とサブサンプルとを組み合わせることが特願昭61−1794
83号明細書に示されている。この明細書では、3次元ブ
ロックがmフレームで構成されている時に、(1/m)で
間引くサンプリングを行うと共に、mフレーム毎にサン
プリング位相を順次シフトすることが開示されている。
例えば3次元ブロックが2フレームで構成される時に
は、2フレーム毎にサブサンプルの位相がシフトされ
る。このようなサブサンプルを用いると、受信側で静止
ブロックにおいて、異なるサンプリング位相のデータに
より、間引かれた画素データを補間することが可能とな
る。
In order to further increase the compression ratio, it is possible to combine the above-mentioned motion adaptive frame dropping and sub-sampling with Japanese Patent Application No. 61-1794.
No. 83. This specification discloses that when a three-dimensional block is composed of m frames, sampling is thinned out at (1 / m) and the sampling phase is sequentially shifted every m frames.
For example, when a three-dimensional block is composed of two frames, the phase of a subsample is shifted every two frames. By using such sub-samples, it is possible to interpolate thinned-out pixel data with data of different sampling phases in a stationary block on the receiving side.

駒落とし圧縮された画像データは、受信側において、
元の個数の画素データに補間される。この補間の結果、
ジャーキネスが発生することを防止するために、特願昭
61−153328号明細書或いは特願昭61−153329号明細書に
記載されているように、時間的に前のブロックの最後の
領域のデータと現在のブロックの先頭の領域のデータと
の平均値が形成され、この平均値が現在のブロックの先
頭の領域のデータとされる平滑化を行う高能率符号の復
号装置が提案されている。更に、大きい面積の物体が高
速で移動する時、シーイーンチェンジ等では、上記の平
滑化の処理を行うと、ボケが発生するので、特願昭62−
189856号明細書に記載されているように、平滑化を行う
ブロック間で画素単位で静止判定を行い、静止の画素に
関してのみ平滑化を行う技術が提案されている。
The image data that has been dropped and compressed is received on the receiving side.
Interpolated to the original number of pixel data. As a result of this interpolation,
In order to prevent jerkiness,
As described in the specification of Japanese Patent Application No. 61-153328 or Japanese Patent Application No. 61-153329, the average value of the data of the last area of the temporally previous block and the data of the first area of the current block. Is formed, and a decoding device for a high-efficiency code that performs smoothing in which the average value is used as data in the head area of the current block has been proposed. Further, when an object having a large area moves at a high speed, in the case of a sea-line change or the like, if the above-described smoothing processing is performed, blurring occurs.
As described in the specification of Japanese Patent No. 189856, there has been proposed a technique of performing stillness determination in units of pixels between blocks to be smoothed, and performing smoothing only on still pixels.

第11図乃至第13図を参照して、サブサンプリング、駒
落とし処理及び平滑化処理について説明する。第11図に
おいて、a〜hが原データを示す。これらの原データa
〜fは、第12図に示すように、時間的に連続するフレー
ムの夫々に含まれる空間的に対応する領域Ai,Bi,Ci,Di,
Ei,Fi内で同一の位置を占めるデータである。これらの
領域は、(4ライン×8画素)の大きさであり、サブサ
ンプリングにより、×で示す画素が間引かれ、(4×4
=16)個の画素データが各領域に含まれる。サブサンプ
リングの位相は、2フレーム毎にシフトされ、従って、
領域Ai及びBiのサブサンプリングのパターンと領域Ei及
びFiのサブサンプリングのパターンとが同一となる。3
次元ブロックは、二つの領域Ai及びBi(同様にCi及びD
i、Ei及びFi)により構成される。
With reference to FIGS. 11 to 13, the sub-sampling, the frame dropping process, and the smoothing process will be described. In FIG. 11, a to h indicate original data. These raw data a
To f are spatially corresponding regions Ai, Bi, Ci, Di, included in each of temporally continuous frames, as shown in FIG.
Data occupying the same position in Ei, Fi. These areas have a size of (4 lines × 8 pixels), and the pixels indicated by “x” are thinned out by sub-sampling, and (4 × 4
= 16) pixel data is included in each region. The sub-sampling phase is shifted every two frames, so
The sub-sampling pattern of the areas Ai and Bi is the same as the sub-sampling pattern of the areas Ei and Fi. 3
The dimensional block consists of two regions Ai and Bi (also Ci and D
i, Ei and Fi).

3次元ブロックが静止ブロックの場合には、駒落とし
処理がされる。即ち、ブロック内の同一位置を占めるデ
ータ同士の平均値(1/2(a+b),1/2(c+d),1/2
(e+f))が原データに代えて伝送される。この駒落
とし処理により、データ量が1/2に圧縮される。更に、
駒落とし処理されたデータがダイナミックレンジに適応
した符号化(ADRCと称する)処理を受け、伝送データ量
がより一層圧縮される。
If the three-dimensional block is a still block, a frame drop process is performed. That is, the average value of data occupying the same position in the block (1/2 (a + b), 1/2 (c + d), 1/2
(E + f)) is transmitted instead of the original data. The data amount is reduced to half by the frame drop processing. Furthermore,
The dropped data is subjected to an encoding (referred to as ADRC) process adapted to the dynamic range, and the transmission data amount is further compressed.

受信側では、ADRCの復号を行ってから、駒落としされ
ているデータの補間がされる。この補間は、1個の領域
分の平均値データを2個の領域のデータに変換する処理
である。ブロックの境界でジャーキネスが発生するの
で、後の静止ブロックの先頭の領域のデータが前のブロ
ックのデータとの平均値に置き換えられる平滑化の処理
がなされる。この平滑化の処理では、空間的に対応する
(サブサンプリングのパターンガ同一であることを意味
する)画素のデータが用いられるので、1/2(e+f)
が含まれるブロックの先頭の領域のデータは、1/4(a
+b+c+d)とされる。
On the receiving side, after decoding the ADRC, interpolation of the dropped data is performed. This interpolation is a process of converting the average value data of one region into data of two regions. Since jerkiness occurs at a block boundary, a smoothing process is performed in which the data in the head area of the subsequent still block is replaced with the average value of the data of the previous block. In this smoothing process, spatially corresponding pixel data (meaning that the sub-sampling patterns are the same) is used, so that 1/2 (e + f)
The data in the first area of the block containing
+ B + c + d).

〔発明が解決しようとする課題〕[Problems to be solved by the invention]

ここで、同一位置の画素のデータが第13図に示すよう
に時間(Tfは、1フレーム時間)と共に徐々に増大する
レベル変化を有する場合には、○で示す原データが2フ
レーム単位で駒落とし処理されると、△で示す平均値の
繰り返しとして復号される。第13図では、簡単のため
に、サブサンプリングにより生じた1画素分の位置のず
れが無視されている。上述の平滑化の処理により、□の
復号データが形成され、ジャーキネスの発生が防止され
る。平滑化の結果、第13図において、破線で示すよう
に、原データが正の傾斜を持つ場合には、負のオフセッ
トが発生する。このオフセットは、視覚的に殆ど識別で
きない程度のものである。
Here, if the data of the pixel at the same position has a level change that gradually increases with time (Tf is one frame time) as shown in FIG. When the drop processing is performed, it is decoded as a repetition of the average value indicated by △. In FIG. 13, for the sake of simplicity, the displacement of one pixel caused by the sub-sampling is ignored. By the above-described smoothing process, the decoded data of □ is formed, and the occurrence of jerkiness is prevented. As a result of the smoothing, as shown by the broken line in FIG. 13, when the original data has a positive slope, a negative offset occurs. This offset is almost indistinguishable visually.

しかしながら、静止ブロックのみに関して平滑化を行
うことが前提で、然も、この静止ブロック及び動きブロ
ックの判定は、しきい値判定を行う関係から、空間的に
隣接するブロックであっても、一方のブロックは、静止
ブロックとして扱われ、他方のブロッックが動きブロッ
クとして扱われることがある。例えば人の顔を含む画像
を低速でパンニングした時等で、上記の現象が生じるこ
とがある。従って、一方のブロックは静止ブロックとし
て処理されるために、オフセットを有し、他方のブロッ
クは、動きブロックとして処理されるために、オフセッ
トを有しないことになり、例えば顔の隣接した領域であ
るにもかかわらず、レベル差が生じ、その結果、ブロッ
ク歪みが生じる。人の顔のようなものでは、縦の縞が発
生する問題があった。
However, it is premised that smoothing is performed only with respect to a still block, and, of course, the determination of the still block and the motion block is performed based on the threshold value determination. A block may be treated as a stationary block and the other block may be treated as a motion block. For example, the above phenomenon may occur when an image including a human face is panned at a low speed. Thus, one block will have an offset to be processed as a still block and the other block will have no offset to be processed as a motion block, for example adjacent areas of the face Nevertheless, there is a level difference, resulting in block distortion. In the case of a person's face, there is a problem that vertical stripes are generated.

また、サブサンプリングがなされている時には、時間
的に4Tfとかなり離れたデータを使用して平滑化を行う
ために、良好な平滑化をできない問題があった。
Also, when sub-sampling is performed, there is a problem that good smoothing cannot be performed because smoothing is performed using data that is considerably distant from 4Tf in time.

従って、この発明の目的は、駒落とし処理されたブロ
ックを復元する時に、原データとの間にオフセットが発
生することが防止された高能率符号の復号装置を提供す
ることにある。
SUMMARY OF THE INVENTION It is therefore an object of the present invention to provide a high-efficiency code decoding apparatus in which an offset is prevented from occurring with original data when a block subjected to frame drop processing is restored.

〔課題を解決するための手段〕[Means for solving the problem]

この発明は、ディジタル画像信号の時間的に連続する
複数フレームの夫々に属し、且つ複数フレーム間で位置
的に対応する複数の領域の画素データによって構成され
る3次元ブロック構造に対し、各ブロック毎の静止判定
により静止ブロックと判定されたブロック内において空
間的に同一位置にある画素データを平均値に置き換える
と共に、各ブロックの夫々の画素数を(1/m)にサブサ
ンプルし、m個の時間的に連続するブロックに関して、
サブサンプルの位相を順次シフトし、置き換え及びサブ
サンプルによりデータ量を圧縮して伝送するような伝送
装置により伝送されたデータを復元する高能率符号の復
号装置において、 平均値に置き換えられた複数の領域の各領域の画素デ
ータを補間する場合、補間すべき画素データと空間的に
同一位置で、時間的に隣接する画素データを用い、補間
すべき画素データと空間的に同一位置で、時間的に隣接
する画素データとの時間方向の距離に逆比例した重み付
けを行う加重平均を行い、 加重平均により発生したデータによって複数の領域の
各領域の画素データを補間するようにしたことを特徴と
する高能率符号の復号装置である。
The present invention relates to a three-dimensional block structure constituted by pixel data of a plurality of regions belonging to a plurality of temporally continuous frames of a digital image signal and corresponding to positions among the plurality of frames. The pixel data at the same position spatially in the block determined as a still block by the stillness determination is replaced with an average value, and the number of pixels in each block is sub-sampled to (1 / m), and m For blocks that are consecutive in time,
In a high-efficiency code decoding device that sequentially shifts the phase of a sub-sample and restores data transmitted by a transmission device that transmits the data by compressing and replacing the sub-sample, a plurality of data replaced by an average value When interpolating pixel data of each region of the region, temporally adjacent pixel data is used at the same position spatially as the pixel data to be interpolated, and temporally adjacent at the same position as the pixel data to be interpolated. Performs weighted averaging to perform weighting inversely proportional to the distance in the time direction from pixel data adjacent to the pixel data, and interpolates pixel data of each of a plurality of regions by data generated by the weighted average. It is a high efficiency code decoding device.

〔作用〕[Action]

駒落とし処理の結果、1ブロックを構成する二つの領
域間の平均値が伝送される。原画素データのレベル変化
を考慮した場合、この平均値は、時間的に二つの領域の
中間で発生しているものと考えられる。補間しようとす
る画素データと空間的に対応し、時間的に前及び後の画
素の復号データを用いて、時間差に逆似例した加重平均
により画素データを補間する時に、時間差は、上述のよ
うに、平均値が二つの領域の中間で発生するものとして
求められる。この加重平均により、原データのレベル変
化とオフセットの無い補間を行うことができる。
As a result of the frame drop processing, the average value between the two areas constituting one block is transmitted. When the level change of the original pixel data is considered, this average value is considered to have occurred temporally between the two regions. When the pixel data to be interpolated spatially corresponds to the pixel data and the decoded data of the previous and subsequent pixels are used to interpolate the pixel data by a weighted average inversely similar to the time difference, the time difference is calculated as described above. In addition, the average value is determined as occurring in the middle between the two regions. With this weighted average, it is possible to perform interpolation without level change and offset of the original data.

〔実施例〕〔Example〕

以下、この発明の一実施例について説明する。この説
明は、下記の順序に従ってなされる。
Hereinafter, an embodiment of the present invention will be described. This description is made in the following order.

a.送信側の構成 b.補間方式 c.受信側の構成及び動作 d.変形例 a.送信側の構成 第1図は、この発明の一実施例における送信側(VTR
の場合では記録側)の構成を示す。1で示す入力端子に
例えば1サンプルが8ビットに量子化されたディジタル
ビデオ信号が入力される。このディジタルビデオ信号
は、テレビジョン信号と同様にフレームが連続するデー
タである。このディジタルビデオ信号がブロック化回路
2に供給される。
a. Configuration of transmitting side b. Interpolation method c. Configuration and operation of receiving side d. Modification a. Configuration of transmitting side FIG. 1 shows a transmitting side (VTR) according to an embodiment of the present invention.
In the case of (1), the configuration on the recording side is shown. For example, a digital video signal in which one sample is quantized to 8 bits is input to an input terminal indicated by 1. This digital video signal is data in which frames are continuous like a television signal. This digital video signal is supplied to the blocking circuit 2.

ブロック化回路2により、入力ディジタルビデオ信号
がブロックの順序に変換される。この一実施例では、時
間的に連続する2フレームに夫々属する2次元領域から
3次元的なブロックが形成される。各領域は、例えば
(4ライン×8画素)の大きさである。後述のサブサン
プリングにより、水平方向で1/2の間引きの処理がさ
れ、ADRCの符号化の単位となる1ブロックには、(4×
4×2=32)個の画素が含まれる。
The input digital video signal is converted by the blocking circuit 2 into a block order. In this embodiment, a three-dimensional block is formed from two-dimensional regions belonging to two temporally consecutive frames. Each area has a size of, for example, (4 lines × 8 pixels). By the sub-sampling described later, the process of thinning out 1/2 in the horizontal direction is performed, and one block serving as a unit of ADRC encoding includes (4 ×
4 × 2 = 32) pixels are included.

ブロック化回路2の出力信号が動き判定回路3に供給
される。動き判定回路3によりブロック毎に動きの有無
が判定される。動き判定回路3では、ブロックを構成す
る二つの領域の間で同一位置を占める画素データ同士の
差が検出され、この差の絶対値の最大値としきい値とが
比較され、差の絶対値がしきい値より大きい時は、動き
ブロックと判定され、差の絶対値がしきい値より小さい
時は、静止ブロックと判定される。この動き判定に限ら
ず、差の積分値としきい値とを比較する方法、ある程度
以上大きい差の総数としきい値とを比較する方法、差の
n乗和をしきい値と比較する方法等も用いることができ
る。動き判定回路3からは、動きの有無に応じた判定コ
ードSJが発生する。判定コードSJは、動きブロックに関
して“0"となり、静止ブロックに関して“1"となる信号
である。
The output signal of the blocking circuit 2 is supplied to the motion determination circuit 3. The motion determination circuit 3 determines the presence or absence of a motion for each block. The motion judging circuit 3 detects a difference between pixel data occupying the same position between two regions constituting the block, compares the maximum value of the absolute value of the difference with a threshold value, and calculates the absolute value of the difference. If the difference is larger than the threshold value, the block is determined to be a motion block. If the absolute value of the difference is smaller than the threshold value, the block is determined to be a still block. Not only this motion determination, but also a method of comparing the integrated value of the difference with the threshold value, a method of comparing the total number of differences larger than a certain value with the threshold value, a method of comparing the n-th sum of the difference with the threshold value, Can be used. The motion determination circuit 3 generates a determination code SJ according to the presence or absence of a motion. The determination code SJ is a signal that is “0” for a motion block and “1” for a still block.

ブロック化回路2からの入力ディジタルビデオ信号が
スイッチ回路4の一方の入力端子及びフレーム間平均値
形成回路5に供給される。フレーム間平均値形成回路5
は、ブロックを構成する2個の領域の間で同一の位置に
ある32個の画素同士の平均値を夫々算出し、この32個の
平均値をブロックの画素データに代えて出力する回路で
ある。フレーム間平均値形成回路5の出力信号がスイッ
チ回路4の他方の入力端子に供給される。判定コードSJ
が“1"の時、即ち、静止ブロックの時に、フレーム間平
均値形成回路5の出力信号がスイッチ回路4の出力端子
に選択的に得られる。判定コードが“0"の時、即ち、動
きが有るブロックの時に、ブロック化回路2からのディ
ジタルビデオ信号がスイッチ回路4の出力端子に選択的
に得られる。このスイッチ回路4の出力信号がサブサン
プリング回路6に供給される。
An input digital video signal from the blocking circuit 2 is supplied to one input terminal of the switch circuit 4 and an inter-frame average value forming circuit 5. Inter-frame average value forming circuit 5
Is a circuit that calculates an average value of each of 32 pixels located at the same position between two regions constituting a block, and outputs the 32 average values instead of the pixel data of the block. . The output signal of the inter-frame average value forming circuit 5 is supplied to the other input terminal of the switch circuit 4. Judgment code SJ
Is "1", that is, when the block is a static block, the output signal of the inter-frame average value forming circuit 5 is selectively obtained at the output terminal of the switch circuit 4. When the judgment code is “0”, that is, when the block has a motion, the digital video signal from the blocking circuit 2 is selectively obtained at the output terminal of the switch circuit 4. The output signal of the switch circuit 4 is supplied to the sub-sampling circuit 6.

サブサンプリング回路6は、各ブロックの画素を1/2
にするサブサンプリングを行う。7で示す入力端子に元
のサンプリング周波数の1/2の周波数のサンプリングパ
ルスが供給され、このサンプリングパルスとインバータ
10により反転されたサンプリングパルスとがスイッチ回
路9において選択される。スイッチ回路9は、端子11か
らのスイッチ制御パルスにより、3次元ブロックのフレ
ーム数m(この例では、m=2)毎に切り替えられる。
従って、第2図に示すように、時間的に連続する2フレ
ームに夫々含まれ、空間的に同一の位置を占める二つの
領域Ai及びBiでは、×印の画素が間引かれ、○印の画素
が出力されるサブサンプリングがされると、次の2フレ
ームに夫々含まれ、空間的に同一の位置を占める二つの
領域Ci及びDiでは、前の2フレームのサブサンプリング
と位相が1画素ずれたサブサンプリングがなされる。つ
まり、×印の画素が間引かれ、△印の画素のデータが出
力される。
The sub-sampling circuit 6 halves the pixels of each block.
Is performed. A sampling pulse having a frequency half of the original sampling frequency is supplied to an input terminal indicated by reference numeral 7, and this sampling pulse and an inverter
The sampling pulse inverted by 10 is selected in the switch circuit 9. The switch circuit 9 is switched by the switch control pulse from the terminal 11 every frame number m of the three-dimensional block (m = 2 in this example).
Therefore, as shown in FIG. 2, in the two regions Ai and Bi that are respectively included in two temporally consecutive frames and occupy the same position spatially, the pixels marked with x are thinned out and the pixels marked with o are skipped. When the sub-sampling for outputting the pixels is performed, in the two regions Ci and Di which are respectively included in the next two frames and occupy the same position, the sub-sampling of the previous two frames is shifted by one pixel. Sub-sampling is performed. That is, the pixels of the crosses are thinned out, and the data of the pixels of the crosses are output.

サブサンプリング回路6の出力信号がスイッチ回路12
に供給される。スイッチ回路4と同様にスイッチ回路12
が判定コードSJにより制御され、スイッチ回路12により
選択された静止ブロックのデータが2次元エンコーダ13
に供給され、スイッチ回路12により選択された動きブロ
ックのデータが3次元エンコーダ14に供給される。
The output signal of the sub-sampling circuit 6 is
Supplied to Switch circuit 12 as well as switch circuit 4
Is controlled by the judgment code SJ, and the data of the stationary block selected by the switch circuit 12 is transmitted to the two-dimensional encoder 13.
The data of the motion block selected by the switch circuit 12 is supplied to the three-dimensional encoder 14.

静止ブロックは、フレーム間平均値形成回路5及びサ
ブサンプリング回路6により、平均値が(4×4)に配
置された2次元ブロックの構成を有している。一方、動
きブロックは、(4×4×2)の3次元ブロックの構成
を有している。
The stationary block has a configuration of a two-dimensional block in which the average value is arranged at (4 × 4) by the inter-frame average value forming circuit 5 and the sub-sampling circuit 6. On the other hand, the motion block has a configuration of a (4 × 4 × 2) three-dimensional block.

2次元エンコーダ13及び3次元エンコーダ14では、ブ
ロック毎のダイナミックレンジに適応したビット数が可
変の符号化がなされる。これらのエンコーダ13及び14か
らは、ブロックのダイナミックレンジとブロックの最小
値と例えば0〜5ビットのコード信号とが発生する。
The two-dimensional encoder 13 and the three-dimensional encoder 14 perform encoding in which the number of bits is variable according to the dynamic range of each block. From these encoders 13 and 14, a dynamic range of the block, a minimum value of the block, and a code signal of, for example, 0 to 5 bits are generated.

2次元エンコーダ13及び3次元エンコーダ14の出力信
号がフレーム化回路15及び16に夫々供給されると共に、
遅延回路17を介して判定コードSJがフレーム化回路15及
び16に供給される。上述のエンコーダ13及び14の出力信
号と判定コードSJとがフレーム化回路15及び16によっ
て、送信データに変換される。フレーム化回路15及び16
の出力信号がORゲート18に供給され、ORゲート18の出力
端子19に送信データが取り出される。
Output signals of the two-dimensional encoder 13 and the three-dimensional encoder 14 are supplied to framing circuits 15 and 16, respectively.
The determination code SJ is supplied to the framing circuits 15 and 16 via the delay circuit 17. The output signals of the encoders 13 and 14 and the determination code SJ are converted into transmission data by the framing circuits 15 and 16. Framing circuits 15 and 16
Is supplied to the OR gate 18, and the transmission data is extracted from the output terminal 19 of the OR gate 18.

コード信号にのみ注目した場合、送信データは、第3
図に示すように、2フレーム分のデータの集合からな
る。例えば時間的に連続する2フレームの各フレームが
領域A1〜An及び領域B1〜Bnに夫々分割され、領域Ai及び
Bi(i=1〜n)により3次元ブロックが構成される。
上述のように、静止ブロックに関しては、駒落とし処理
がされる。第3図における最初の2フレーム分の送信デ
ータでは、領域A2及びB2からなるブロック、領域A3及び
B3からなるブロック、領域A4及びB4からなるブロックが
静止ブロックと判定され、駒落とし処理されている。
When focusing only on the code signal, the transmission data is
As shown in the figure, it consists of a set of data for two frames. For example, each of two temporally consecutive frames is divided into regions A1 to An and regions B1 to Bn, respectively, and the regions Ai and
Bi (i = 1 to n) forms a three-dimensional block.
As described above, a frame drop process is performed on a still block. In the transmission data for the first two frames in FIG. 3, a block composed of areas A2 and B2, an area A3 and
The block made up of B3 and the block made up of the areas A4 and B4 are determined to be still blocks and have been dropped.

b.補間方式 この一実施例の補間方式について以下に説明する。第
4図に示すように、連続するフレームの夫々に含まれ、
空間的に対応する位置の原データa〜jが夫々静止ブロ
ックに含まれる時には、駒落とし処理及びサブサンプリ
ング処理によって、データ量が1/4とされて伝送され
る。サブサンプリングの1画素分の位相のずれにより、
これらの画素データa〜jの位置は、○で示すa,b,e,f,
i,j画画面内で同一位置であり、△で示すc,d,g,hが画面
内で同一位置である。受信側では、静止ブロックの場合
には、平均値データを二つの領域のデータとして用いる
補間がなされる。
b. Interpolation method The interpolation method of this embodiment will be described below. As shown in FIG. 4, included in each successive frame,
When the original data a to j at spatially corresponding positions are respectively included in the still blocks, the data amount is reduced to に よ っ て by the frame drop processing and the sub-sampling processing and transmitted. Due to the phase shift of one pixel of sub-sampling,
The positions of these pixel data a to j are a, b, e, f,
The positions are the same in the i, j picture screen, and c, d, g, h indicated by △ are the same positions in the screen. On the receiving side, in the case of a stationary block, interpolation using the average value data as data of two regions is performed.

静止ブロックに含まれる画素データは、この画素デー
タと空間的に対応し、時間的に隣接する画素データを用
いた加重平均により補間される。例えば原画素データe
の時刻と時間的に前の平均値1/2(a+b)の時刻との
時間差は、平均値が画素データa及びbの中間の時刻に
発生するものと考えられるので、第5図から分るよう
に、3.5Tfであり、原画素データeの時刻と時間的に後
の平均値1/2(e+f)の時刻との時間差は、0.5Tfであ
る。この時間差に逆比例した加重平均により、原画素デ
ータeと対応する復号画素が求められる。即ち、この復
号画素のレベルは、 1/8(1/2(a+b)+7×1/2(e+f)) となる。同様に、原画素データfと対応する復号画素の
レベルは、 1/8(7×1/2(e+f)+1/2(i+j)) とされる。この補間を繰り返すことにより、第5図に示
すように、原画素データのレベル変化とオフセットが無
い補間を行うことができる。
The pixel data included in the still block spatially corresponds to the pixel data and is interpolated by a weighted average using temporally adjacent pixel data. For example, original pixel data e
The time difference between this time and the time of the previous average value 1/2 (a + b) is apparent from FIG. 5 because the average value is considered to occur at an intermediate time between the pixel data a and b. Thus, it is 3.5Tf, and the time difference between the time of the original pixel data e and the time of the average value 1/2 (e + f) after the time is 0.5Tf. The decoded pixel corresponding to the original pixel data e is obtained by the weighted average inversely proportional to the time difference. That is, the level of the decoded pixel is 1/8 (1/2 (a + b) + 7 × 1/2 (e + f)). Similarly, the level of the decoded pixel corresponding to the original pixel data f is set to 1/8 (7 × 1/2 (e + f) +1/2 (i + j)). By repeating this interpolation, as shown in FIG. 5, it is possible to perform interpolation without a level change and offset of the original pixel data.

第6図に示すように、動きブロックと静止ブロックと
が混在する時の補間について説明する。即ち、原画素デ
ータa及びbが含まれるブロックと原画素データi及び
jが含まれるブロックとが動きブロックであり、原画素
データc及びdが含まれるブロックと原画素データe及
びfが含まれるブロックと原画素データg及びhが含ま
れるブロックとが静止ブロックの場合である。動きブロ
ックについては、駒落とし処理がされない。
As shown in FIG. 6, a description will be given of interpolation when a motion block and a still block are mixed. That is, a block including the original pixel data a and b and a block including the original pixel data i and j are motion blocks, and include a block including the original pixel data c and d and original pixel data e and f. This is a case where the block and the block including the original pixel data g and h are still blocks. The motion block is not subjected to the frame drop processing.

第7図から分るように、原画素データeの時刻と時間
的に前の画素データbとの時間差が3Tfであり、原画素
データeと時間的に後の平均値1/2(e+f)との時間
差が0.5Tfである。この時間差と逆比例する加重平均が
なされ、画素データeと対応する復号画素の値が求めら
れる。即ち、この復号画素のレベルは、 1/7(b+6×1/2(e+f)) と算出される。同様に、原画素データfと対応する復号
画素のレベルは、 1/7(6×1/2(e+f)+i) と求められる。この補間により、駒落とし処理がされる
ブロックと動きブロックとが混在する場合でも、原画素
データのレベル変化とオフセットを持たない補間を行う
ことができる。
As can be seen from FIG. 7, the time difference between the time of the original pixel data e and the temporally preceding pixel data b is 3Tf, and the average value of the original pixel data e and the temporally subsequent time is 1/2 (e + f). Is 0.5 Tf. A weighted average inversely proportional to this time difference is made, and the value of the decoded pixel corresponding to the pixel data e is obtained. That is, the level of the decoded pixel is calculated as 1/7 (b + 6 × 1/2 (e + f)). Similarly, the level of the decoded pixel corresponding to the original pixel data f is obtained as 1/7 (6 × 1/2 (e + f) + i). By this interpolation, even when a block to be dropped and a motion block are mixed, it is possible to perform interpolation without a level change and an offset of the original pixel data.

c.受信側の構成及び動作 上述の加重平均の補間方式を用いるように構成された
受信側について第8図,第9図及び第10図を参照して説
明する。
c. Configuration and Operation of Reception Side The reception side configured to use the above-described weighted average interpolation method will be described with reference to FIGS. 8, 9, and 10.

第8図において、21で示す入力端子からの受信データ
は、判定コード分離回路22に供給され、判定コードSJが
分離される。判定コード以外の受信データがANDゲート2
3及び26に供給される。ANDゲート23の他の入力として判
定コードSJが供給され、ANDゲート26の他の入力として
判定コードSJの反転信号が供給される。
In FIG. 8, the received data from the input terminal indicated by 21 is supplied to a judgment code separation circuit 22, where the judgment code SJ is separated. Received data other than the judgment code is AND gate 2
3 and 26. The judgment code SJ is supplied as another input of the AND gate 23, and an inverted signal of the judgment code SJ is supplied as another input of the AND gate 26.

ANDゲート23により、静止ブロックのデータが分離さ
れ、静止ブロックのデータがフレーム分解回路24に供給
される。また、ANDゲート26により分離された動きが有
るブロックのデータがフレーム分解回路27に供給され
る。フレーム分解回路24及び27は、受信データをブロッ
ク毎の付加コード(ダイナミックレンジ及び最小値)と
画素毎のコード信号とに分解すると共に、エラー訂正の
処理を行う。フレーム分解回路24及び27からの付加コー
ド及びコード信号が2次元デコーダ25及び3次元デコー
ダ28に夫々供給される。
The data of the still block is separated by the AND gate 23, and the data of the still block is supplied to the frame decomposition circuit 24. The data of the moving block separated by the AND gate 26 is supplied to the frame decomposition circuit 27. The frame decomposing circuits 24 and 27 decompose the received data into an additional code (dynamic range and minimum value) for each block and a code signal for each pixel, and perform an error correction process. The additional codes and code signals from the frame decomposition circuits 24 and 27 are supplied to a two-dimensional decoder 25 and a three-dimensional decoder 28, respectively.

これらのデコーダ25及び28は、送信側のエンコーダ13
及び14と逆の処理を行う。即ち、最小値除去後のデータ
が代表レベルとして復元され、このデータと最小値とが
加算されることにより、元の画素データと対応する復元
レベルが得られる。デコーダ25及び28の出力データがバ
ッファメモリ29に供給される。バッファメモリ29は、遅
延回路30を介された判定コードSJbを参照して、駒落と
しされているデータを補間し、静止ブロックと動きブロ
ックとの間でデータ量を等しいものとする。
These decoders 25 and 28 are connected to the encoder 13 on the transmission side.
And 14 are reversed. That is, the data from which the minimum value has been removed is restored as the representative level, and this data and the minimum value are added to obtain a restoration level corresponding to the original pixel data. Output data of the decoders 25 and 28 is supplied to the buffer memory 29. The buffer memory 29 refers to the determination code SJb passed through the delay circuit 30, interpolates the dropped data, and makes the data amount equal between the still block and the motion block.

バッファメモリ29の出力データ及び判定コードSJが静
止ブロックに関する補間を行うために、4フレーム遅延
回路31及び33に供給される。4フレーム遅延回路31に対
して4フレーム遅延回路32が接続され、4フレーム遅延
回路33に対して4フレーム遅延回路34が接続されてい
る。一例として、バッファメモリ29から第9図Aに示す
データSaが発生し、遅延回路30から第9図Bに示す判定
コードSJbが発生する。第9図におけるBL1,BL2,BL3・・
・は、夫々ブロック期間を示す。また、第9図は、ブロ
ックを構成する領域を単位として、データの順序を示し
ており、画素の復号データは、各領域内に所定の順序で
含まれている。
The output data of the buffer memory 29 and the judgment code SJ are supplied to four-frame delay circuits 31 and 33 in order to perform interpolation on a still block. A four-frame delay circuit 32 is connected to the four-frame delay circuit 31, and a four-frame delay circuit 34 is connected to the four-frame delay circuit 33. As an example, the data Sa shown in FIG. 9A is generated from the buffer memory 29, and the judgment code SJb shown in FIG. 9B is generated from the delay circuit 30. BL1, BL2, BL3 in Fig. 9
* Indicates a block period. FIG. 9 shows the order of data in units of regions constituting a block, and decoded data of pixels is included in each region in a predetermined order.

また、4フレーム遅延回路31の途中から第9図Cに示
すように、データSaと1/2ブロックずれたデータScが取
り出され、4フレーム遅延回路31から第9図Dに示すデ
ータSdが現れる。4フレーム遅延回路33からの判定コー
ドSJe(第9図E)は、データSdと同期したものであ
る。更に、4フレーム遅延回路32から第9図Fに示すデ
ータSfが生じる。4フレーム遅延回路34からデータSfに
同期した判定コードSJg(第9図G)が現れる。4フレ
ーム遅延回路32の途中から第9図Hに示すように、デー
タSfに対して1/2ブロックずれたデータShが生じる。
Further, as shown in FIG. 9C, data Sc shifted by 1/2 block from the data Sa is taken out from the middle of the 4-frame delay circuit 31, and the data Sd shown in FIG. 9D appears from the 4-frame delay circuit 31. . The judgment code SJe (FIG. 9E) from the 4-frame delay circuit 33 is synchronized with the data Sd. Further, data Sf shown in FIG. 9F is generated from the 4-frame delay circuit 32. A judgment code SJg (FIG. 9G) synchronized with the data Sf appears from the 4-frame delay circuit 34. As shown in FIG. 9H, data Sh is shifted from the data Sf by half a block from the middle of the 4-frame delay circuit 32.

上述のデータScとデータSdとが加重平均回路35に供給
され、データSdとデータShとが加重平均回路36に供給さ
れる。加重平均回路35及び36は、判定コードSJb及びSJg
により、加重平均動作が切り替え可能な構成とされてい
る。判定コードSJb及びSJgは、静止ブロックで“1"とな
り、動きブロックで“0"となる信号である。加重平均回
路35は、判定コードSJbに応じて、下記の加重平均動作
を行う。
The above-described data Sc and data Sd are supplied to the weighted average circuit 35, and the data Sd and data Sh are supplied to the weighted average circuit 36. The weighted averaging circuits 35 and 36 determine the judgment codes SJb and SJg
Thus, the weighted average operation can be switched. The judgment codes SJb and SJg are signals that become “1” in a still block and “0” in a motion block. The weighted average circuit 35 performs the following weighted average operation according to the determination code SJb.

SJb=“1"の時 1/8(Sc+7Sd) SJb=“0"の時 1/7(Sc+6Sd) 加重平均回路36は、判定コードSJgに応じて、下記の
加重平均動作を行う。
When SJb = “1” 1/8 (Sc + 7Sd) When SJb = “0” 1/7 (Sc + 6Sd) The weighted average circuit 36 performs the following weighted average operation according to the determination code SJg.

SJg=“1"の時 1/8(Sh+7Sd) SJg=“0"の時 1/7(Sh+6Sd) 加重平均回路35及び36の夫々の出力信号がスイッチ回
路37の一方の入力端子38a及び他方の入力端子38bに供給
される。スイッチ回路37は、端子39からの1/2ブロック
期間毎に反転する制御信号により制御される。スイッチ
回路37の出力信号がスイッチ回路40の一方の入力端子41
bに供給される。スイッチ回路40の他方の入力端子41aに
は、4フレーム遅延回路31の出力データSdが供給され
る。スイッチ回路40は、切り替え信号発生回路42からの
切り替え信号Si(第9図I)により制御される。スイッ
チ回路40のから補間された出力信号Sj(第9図J)が得
られる。この出力信号がブロック分解回路43でブロック
の順序から走査の順序に変換される。
When SJg = "1" 1/8 (Sh + 7Sd) When SJg = "0" 1/7 (Sh + 6Sd) The output signals of the weighted averaging circuits 35 and 36 are connected to one input terminal 38a of the switch circuit 37 and the other. It is supplied to the input terminal 38b. The switch circuit 37 is controlled by a control signal from the terminal 39 which is inverted every half block period. The output signal of the switch circuit 37 is applied to one input terminal 41 of the switch circuit 40.
supplied to b. Output data Sd of the four-frame delay circuit 31 is supplied to the other input terminal 41a of the switch circuit 40. The switching circuit 40 is controlled by a switching signal Si (FIG. 9I) from a switching signal generating circuit 42. The interpolated output signal Sj (FIG. 9J) is obtained from the switch circuit 40. This output signal is converted by the block decomposition circuit 43 from the order of blocks to the order of scanning.

スイッチ回路40は、受信データと補間出力信号とを切
り替えるために設けられている。従って、動きブロック
の場合には、受信データを選択し、静止ブロックの場合
には、補間出力を選択するように動作する。このため、
切り替え信号発生回路42には、判定コードSJeが供給さ
れている。また、静止ブロックの場合でも、シーンチェ
ンジ等の場合には、空間的に対応しているデータが全く
異なるデータとなるので、補間出力を選択することを禁
止する必要がある。このために、比較回路45及び46の出
力信号が切り替え信号発生回路42に供給されている。
The switch circuit 40 is provided to switch between the reception data and the interpolation output signal. Therefore, it operates to select the received data in the case of a motion block, and to select the interpolation output in the case of a still block. For this reason,
The determination signal SJe is supplied to the switching signal generation circuit. Even in the case of a static block, in the case of a scene change or the like, spatially corresponding data becomes completely different data, so that it is necessary to prohibit selection of an interpolation output. For this purpose, the output signals of the comparison circuits 45 and 46 are supplied to the switching signal generation circuit 42.

比較回路45は、比較回路48の出力信号と端子47からの
しきい値とを比較し、比較回路46は、比較回路49の出力
信号と端子47からのしきい値とを比較する。比較回路48
は、データSa及びSdの対応する画素同士のレベル差の絶
対値を発生し、比較回路49は、データSd及びSfの対応す
る画素同士のレベル差の絶対値を発生する。これらのレ
ベル差の絶対値がしきい値を超える時には、補間出力を
選択することが禁止される。
The comparison circuit 45 compares the output signal of the comparison circuit 48 with the threshold value from the terminal 47, and the comparison circuit 46 compares the output signal of the comparison circuit 49 with the threshold value from the terminal 47. Comparison circuit 48
Generates the absolute value of the level difference between the corresponding pixels of the data Sa and Sd, and the comparison circuit 49 generates the absolute value of the level difference between the corresponding pixels of the data Sd and Sf. When the absolute value of these level differences exceeds the threshold value, selecting the interpolation output is prohibited.

ブロック分解回路43の出力信号が適応補間回路44に供
給される。適応補間回路44には、ブロック分解回路50に
より、走査順序に戻された判定コードSJeが供給され
る。適応補間回路44は、サブサンプリングにより間引か
れたデータを補間するために設けられている。適応補間
回路44は、時間方向補間と空間方向補間(フィールド内
補間又はフレーム内補間)との何れかを選択的に行う。
時間方向補間は、空間的に対応し、2フレーム離れたブ
ロックが共に静止ブロックの場合に、両ブロックの画素
を合成する補間である。この時間方向補間では、二つの
ブロック間でサンプリングパターンが1画素ずれている
ことが有効に利用される。空間方向補間は、補間しよう
とするブロックが動きブロックの場合に適用されるもの
で、補間画素と同一フレームの上下左右に位置する画素
データの平均値又は補間画素と同一ライン上の左右の画
素データの平均値により、補間がなされる。適応補間回
路44の出力端子51に復元データが得られる。
The output signal of the block decomposition circuit 43 is supplied to the adaptive interpolation circuit 44. The decision code SJe returned to the scanning order by the block decomposition circuit 50 is supplied to the adaptive interpolation circuit 44. The adaptive interpolation circuit 44 is provided to interpolate the data thinned out by sub-sampling. The adaptive interpolation circuit 44 selectively performs either temporal direction interpolation or spatial direction interpolation (intra-field interpolation or intra-frame interpolation).
Temporal interpolation is spatial interpolation, and when two blocks separated by two frames are both still blocks, interpolation for combining the pixels of both blocks. In this time direction interpolation, the fact that the sampling pattern is shifted by one pixel between the two blocks is effectively used. Spatial direction interpolation is applied when the block to be interpolated is a motion block, and is an average value of pixel data located at the top, bottom, left and right of the same frame as the interpolation pixel or left and right pixel data on the same line as the interpolation pixel. Is interpolated by the average value of. The restored data is obtained at the output terminal 51 of the adaptive interpolation circuit 44.

第9図のタイミングチャートにおいて、ブロック期間
BL2に注目して一実施例の動作について、第10図を参照
して詳述する。
In the timing chart of FIG.
Focusing on BL2, the operation of one embodiment will be described in detail with reference to FIG.

ブロック期間BL2では、(SJb=“1")であるため、加
重平均回路35は、1/8(Sc+7Sd)の出力信号を発生す
る。従って、加重平均回路35の出力信号は、第10図Aに
示すものとなる。また、(SJg=“0")であるため、加
重平均回路36は、1/7(Sh+6Sd)の出力信号を発生す
る。従って、加重平均回路36の出力信号は、第10図Bに
示すものとなる。加重平均回路35の出力信号の内で、補
間出力として有効な後半の出力信号と加重平均回路36の
出力信号の内で、補間出力として有効な前半の出力信号
とが第10図Cに示す制御信号で制御されるスイッチ回路
37により選択される。従って、スイッチ回路37の出力信
号は、第10図Dに示すものとなる。
In the block period BL2, since (SJb = “1”), the weighted averaging circuit 35 generates an output signal of 1/8 (Sc + 7Sd). Therefore, the output signal of the weighted average circuit 35 is as shown in FIG. 10A. Also, since (SJg = “0”), the weighted average circuit 36 generates a 1/7 (Sh + 6Sd) output signal. Accordingly, the output signal of the weighted average circuit 36 is as shown in FIG. 10B. Among the output signals of the weighted averaging circuit 35, the output signal of the latter half effective as an interpolation output and the output signal of the first half effective as an interpolation output among the output signals of the weighted averaging circuit 36 are controlled as shown in FIG. 10C. Switch circuit controlled by signal
Selected by 37. Therefore, the output signal of the switch circuit 37 is as shown in FIG. 10D.

ブロック期間BL2の後半の領域F2では、第4図及び第
5図に示すように、同一サンプリングパターンで、且つ
前のブロックが静止ブロックの場合の補間動作がされ、
前半の領域E2では、第7図及び第8図に示すような同一
サンプリングパターンで、且つ前のブロックが動きブロ
ックの場合の補間動作がされる。第9図及び第10図のタ
イミングチャートは、領域を単位とする信号処理を示す
が、加重平均の処理は、画素データ単位でなされる。ま
た、スイッチ回路40の動作も、画素単位でなされる。
In an area F2 in the latter half of the block period BL2, as shown in FIGS. 4 and 5, an interpolation operation is performed with the same sampling pattern and the previous block is a still block.
In the first half area E2, an interpolation operation is performed in the case where the previous block is a motion block with the same sampling pattern as shown in FIG. 7 and FIG. The timing charts of FIGS. 9 and 10 show signal processing in units of regions, but the weighted average processing is performed in units of pixel data. The operation of the switch circuit 40 is also performed on a pixel basis.

d.変形例 加重平均を行う場合、上述の実施例では、補間の対象
とする画素データと時間的に前の1個のデータと時間的
に後の1個のデータとを用いているが、2個以上のデー
タを使用し、時間差に逆比例した重みをつけて加重平均
を行うようにしても良い。
d. Modified Example When weighted averaging is performed, in the above-described embodiment, pixel data to be interpolated, one piece of data before and one piece of data after time are used. Weighted averaging may be performed by using two or more pieces of data and assigning weights that are inversely proportional to time differences.

また、2フレームに限らず、3個以上のフレームに含
まれる画素データにより3次元ブロックが構成されても
良い。
In addition, a three-dimensional block may be configured by pixel data included in not less than two frames but three or more frames.

〔発明の効果〕〔The invention's effect〕

この発明によれば、時間的に連続し、空間的に対応す
る元の画素データのレベル変化とオフセットの無い補間
が可能となり、ジャーキネスの防止と共に、動きブロッ
クと静止ブロックとが混在する時に、ブロック歪みが発
生することを防止することができる。このように復元画
質を向上することができるので、送信側で時間方向の冗
長度を大きく削ること、即ち、駒落としの割合を大きく
でき、圧縮率をより高くすることができる。
According to the present invention, it is possible to perform interpolation without any level change and offset of temporally continuous and spatially corresponding original pixel data, prevent jerkiness, and when motion blocks and still blocks are mixed, block It is possible to prevent distortion from occurring. Since the restored image quality can be improved in this way, the redundancy in the time direction can be largely reduced on the transmission side, that is, the rate of dropped frames can be increased, and the compression ratio can be further increased.

【図面の簡単な説明】[Brief description of the drawings]

第1図はこの発明を適用できる高能率符号化装置の送信
側の構成を示すブロック図、第2図はブロックの一例を
示す略線図、第3図は送信データの一例を示す略線図、
第4図及び第5図は補間の一例の説明に用いる略線図、
第6図及び第7図は補間の他の例の説明に用いる略線
図、第8図はこの発明が適用された受信側の構成を示す
ブロック図、第9図及び第10図は受信側の補間動作の説
明に用いるタイミングチャート、第11図、第12図及び第
13図は先に提案されている動き適応平滑処理の説明に用
いる略線図である。 図面における主要な符号の説明 3:動き判定回路、 5:フレーム間平均値形成回路、 25:2次元デコーダ、 28:3次元デコーダ、 31,32,33,34:4フレーム遅延回路、 35,36:加重平均回路。
FIG. 1 is a block diagram showing a configuration of a transmission side of a high efficiency coding apparatus to which the present invention can be applied, FIG. 2 is a schematic diagram showing an example of a block, and FIG. 3 is a schematic diagram showing an example of transmission data. ,
4 and 5 are schematic diagrams used to explain an example of interpolation,
6 and 7 are schematic diagrams used to explain another example of interpolation, FIG. 8 is a block diagram showing the configuration of the receiving side to which the present invention is applied, and FIGS. 9 and 10 are the receiving side. Timing charts used to explain the interpolation operation of FIG. 11, FIG. 12, and FIG.
FIG. 13 is a schematic diagram used for describing the previously proposed motion adaptive smoothing processing. Explanation of main reference numerals in the drawings 3: motion determination circuit, 5: inter-frame average value forming circuit, 25: two-dimensional decoder, 28: three-dimensional decoder, 31, 32, 33, 34: four-frame delay circuit, 35, 36 : Weighted average circuit.

Claims (1)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】ディジタル画像信号の時間的に連続する複
数フレームの夫々に属し、且つ上記複数フレーム間で位
置的に対応する複数の領域の画素データによって構成さ
れる3次元ブロック構造に対し、各ブロック毎の静止判
定により静止ブロックと判定されたブロック内において
空間的に同一位置にある画素データを平均値に置き換え
ると共に、上記各ブロックの夫々の画素数を(1/m)に
サブサンプルし、m個の時間的に連続するブロックに関
して、上記サブサンプルの位相を順次シフトし、上記置
き換え及びサブサンプルによりデータ量を圧縮して伝送
するような伝送装置により伝送されたデータを復元する
高能率符号の復号装置において、 上記平均値に置き換えられた上記複数の領域の各領域の
画素データを補間する場合、補間すべき画素データと空
間的に同一位置で、時間的に隣接する画素データを用
い、上記補間すべき画素データと上記空間的に同一位置
で、時間的に隣接する画素データとの時間方向の距離に
逆比例した重み付けを行う加重平均を行い、 上記加重平均により発生したデータによって上記複数の
領域の各領域の画素データを補間するようにしたことを
特徴とする高能率符号の復号装置。
1. A three-dimensional block structure comprising pixel data of a plurality of regions belonging to a plurality of temporally continuous frames of a digital image signal and corresponding to positions among the plurality of frames. Pixel data at the same position spatially in a block determined as a still block by the stillness determination for each block is replaced with an average value, and the number of pixels of each block is subsampled to (1 / m), A high-efficiency code for reconstructing data transmitted by a transmission apparatus that sequentially shifts the phase of the subsample for m temporally continuous blocks and compresses and transmits the data amount by the replacement and the subsample. When the pixel data of each of the plurality of regions replaced with the average value is interpolated by the decoding device, The pixel data to be interpolated at the same position spatially as the raw data and the temporally adjacent pixel data to the pixel data to be interpolated and the temporally adjacent pixel data at the spatially the same position are used. A high-efficiency code decoding apparatus, wherein a weighted average for performing proportional weighting is performed, and pixel data of each of the plurality of regions is interpolated by data generated by the weighted average.
JP13423988A 1988-05-31 1988-05-31 High-efficiency code decoding device Expired - Lifetime JP2712299B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP13423988A JP2712299B2 (en) 1988-05-31 1988-05-31 High-efficiency code decoding device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP13423988A JP2712299B2 (en) 1988-05-31 1988-05-31 High-efficiency code decoding device

Publications (2)

Publication Number Publication Date
JPH01303887A JPH01303887A (en) 1989-12-07
JP2712299B2 true JP2712299B2 (en) 1998-02-10

Family

ID=15123667

Family Applications (1)

Application Number Title Priority Date Filing Date
JP13423988A Expired - Lifetime JP2712299B2 (en) 1988-05-31 1988-05-31 High-efficiency code decoding device

Country Status (1)

Country Link
JP (1) JP2712299B2 (en)

Also Published As

Publication number Publication date
JPH01303887A (en) 1989-12-07

Similar Documents

Publication Publication Date Title
JP2540809B2 (en) High efficiency encoder
US5055927A (en) Dual channel video signal transmission system
JPH09172621A (en) Interpolation device and interpolation method for compressed high resolution video signal
JP2000036963A (en) Image coder, image coding method and image decoder
JP2712299B2 (en) High-efficiency code decoding device
JP2712298B2 (en) High-efficiency code decoding device
JP3906770B2 (en) Digital image signal processing apparatus and method
US6904093B1 (en) Horizontal/vertical scanning frequency converting apparatus in MPEG decoding block
JP2814482B2 (en) High efficiency code decoding apparatus and decoding method
JP3867697B2 (en) Image signal generation apparatus and generation method
JP2590865B2 (en) High-efficiency encoded image signal decoding apparatus
JP2798244B2 (en) High-efficiency code decoding device
JP2718034B2 (en) High-efficiency code decoding device
JP2832949B2 (en) High-efficiency code decoding device
JPH0374986A (en) Receiver for picture data
JP3480461B2 (en) Digital image signal processing apparatus and processing method
JP3617080B2 (en) Signal processing apparatus and signal processing method
JP2910110B2 (en) Apparatus and method for receiving image data
JP3746305B2 (en) Image signal generating apparatus and method, and digital image signal processing apparatus and method
JP3831960B2 (en) Interpolation apparatus and interpolation method for compressed high resolution video signal
JP2539786Y2 (en) Video signal transmission device
JPS63313978A (en) High efficient code decoder
JP3906832B2 (en) Image signal processing apparatus and processing method
JP2917436B2 (en) High-efficiency coding device for image signals
JPH012486A (en) High efficiency code decoding device

Legal Events

Date Code Title Description
EXPY Cancellation because of completion of term
FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20081031

Year of fee payment: 11