JP2601151B2 - Frame data multiplexing method - Google Patents
Frame data multiplexing methodInfo
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Description
【０００１】[0001]
【産業上の利用分野】本発明は、ホスト装置と複数の端
末装置間で、ＨＤＬＣ手順フレームにより、データ伝送
を行う多重方式に関し、特に複数の端末装置のフレーム
データを一本の伝送路を用いて、多重伝送するデータフ
レーム多重方式に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a multiplexing system for transmitting data between a host device and a plurality of terminal devices by using an HDLC procedure frame, and more particularly, to a method for transmitting frame data of a plurality of terminal devices using one transmission line. And a data frame multiplexing method for multiplex transmission.
【０００２】[0002]
【従来の技術】従来のフレームデータ多重方式は、複数
の端末装置のＨＤＬＣ情報を端末装置回線ごとに、フラ
グ付与／削除、０挿入／削除、およびＦＣＳ検査／付与
などの処理により終端するフレーム終端回路を設け、フ
レームのヘッド情報であるフレームアドレス情報を、端
末装置回線番号が付加されたフレームアドレス情報に付
替えることにより、データリンクレベルでフレーム多重
する方式と、ネットワークレベルで端末装置とホスト装
置間で論理コネクションを設定し、パケット多重する方
式である。2. Description of the Related Art In a conventional frame data multiplexing method, a frame termination is performed by terminating HDLC information of a plurality of terminal devices by processing such as flag addition / deletion, 0 insertion / deletion, and FCS inspection / attachment for each terminal device line. A circuit for multiplexing frames at a data link level by replacing frame address information, which is head information of a frame, with frame address information to which a terminal device line number is added, and a terminal device and a host device at a network level. In this method, a logical connection is set between packets, and packets are multiplexed.
【０００３】また、特開平３−７０２２１号公報は、陸
上移動通信における広帯域ＴＤＭＡ（時分割多重システ
ム）方式において、複数のブランチで受信したベースバ
ンド信号の中から最大レベルを有するブランチを選択
し、この選択したブランチのレベルから複数のブランチ
のＡＧＣゲインを決定するものであり、フェージングに
強いフレーム同期を行うものである。Japanese Patent Laid-Open Publication No. 3-70221 discloses a broadband TDMA (Time Division Multiplexing System) system for land mobile communication, which selects a branch having the maximum level from baseband signals received by a plurality of branches. The AGC gains of a plurality of branches are determined based on the level of the selected branch, and a frame synchronization resistant to fading is performed.
【０００４】しかし、ホスト装置と複数の端末装置間を
一本の伝送路で接続してデータを送受信する技術は開示
されてない。However, there is no disclosure of a technique for transmitting and receiving data by connecting a host device and a plurality of terminal devices via a single transmission line.
【０００５】[0005]
【発明が解決しようとする課題】しかしながら、従来の
フレームデータ多重方式は、端末回線ごとに、フレーム
終端回路を必要とするため、（Ａ）フレーム多重装置に
収容する端末装置の台数が多くなると、フレーム終端回
路のハードウエア規模が大きくなること、（Ｂ）データ
リンクレベルで多重する方式の場合のフレームアドレス
情報の付替え処理やネットワークレベルで多重する方式
の場合のパケット多重プロトコル処理を行うソフトウエ
ア負荷が大きくなること、などという問題があった。However, since the conventional frame data multiplexing method requires a frame termination circuit for each terminal line, (A) if the number of terminal devices accommodated in the frame multiplexing device increases, (B) software for performing frame address information replacement processing in the case of a multiplexing method at the data link level and packet multiplexing protocol processing in the case of a multiplexing method at the network level; There is a problem that the load increases.
【０００６】本発明は、このような問題を解決するもの
で、フレームデータ多重装置は一本の伝送路に、フレー
ムの終了を検出してフレームデータの送出に先立って、
回線識別固定データを送出することにより、一本の伝送
路でホスト装置との送信を可能にすることを目的とする
ものである。The present invention solves such a problem. A frame data multiplexing apparatus detects the end of a frame and transmits the frame data to a single transmission line before transmitting the frame data.
An object of the present invention is to enable transmission with a host device through a single transmission line by transmitting line identification fixed data.
【０００７】[0007]
【課題を解決するための手段】本発明に係るフレームデ
ータ多重方式は、複数の端末装置にそれぞれ端末装置回
線で接続し、ホスト装置に一本の伝送路で接続するフレ
ームデータ多重装置を設け、このフレームデータ多重装
置は、上記端末装置回線ごとにＨＤＬＣフレームの有無
を識別するためのフラグを検出する機能と、フラグの検
出により抽出されたフレームデータを端末装置回線ごと
に一時的にフレームバッファメモリ回路に蓄積する機能
と、フレームの終了を検出したとき、フレームデータの
送出に先立って、そのフレームデータに対応する回線識
別用アドレスを含む回線識別固定フレームデータを送信
する機能とを備えたものである。また、フレームデータ
多重装置は、複数の端末装置にそれぞれ端末装置回線で
接続し、ホスト装置に一本の伝送路で接続する時分割多
重分離回路と、マイクロプログラムにより各端末装置の
フレームを多重処理するフレームデータ処理を行うディ
ジタルシグナルプロセッサと、端末装置回線ごとのフレ
ームデータを一時的に蓄積するフレームバッファメモリ
回路とからなるものである。 A frame data multiplexing system according to the present invention is provided with a frame data multiplexing device connected to a plurality of terminal devices via terminal device lines and connected to a host device via a single transmission line. This frame data multiplexing device has a function of detecting a flag for identifying the presence or absence of an HDLC frame for each terminal device line, and temporarily stores frame data extracted by detection of the flag for each terminal device line in a frame buffer memory. It has a function of storing in a circuit, and a function of transmitting line identification fixed frame data including a line identification address corresponding to the frame data before transmitting the frame data when detecting the end of the frame. is there. Also, frame data
Multiplexers are connected to a plurality of terminal
Time division multiplexing to connect to a host device via a single transmission path.
A heavy separation circuit and a microprogram
A frame that performs frame data processing that multiplexes frames
Digital signal processor and the
Frame buffer memory for temporarily storing frame data
And a circuit.
【０００８】[0008]
【作用】本発明はホスト装置と複数の端末装置間の伝送
路コストを削減することができ、しかも、ソフトウエア
に負荷をかけずに、ハードウエアを経済的に構築するこ
とができる。According to the present invention, the cost of a transmission line between a host device and a plurality of terminal devices can be reduced, and hardware can be economically constructed without imposing a load on software.
【０００９】[0009]
【実施例】図１は本発明に係るフレームデータ多重方式
の一実施例を示すブロック図である。同図において、１
ａ，１ｂ，〜１ｎはそれぞれ端末装置であり、一例とし
て、この端末装置１ａおよび１ｂはそれぞれ端末装置回
線２ａおよび２ｂにフレームデータ３ａおよび３ｂを出
力する。FIG. 1 is a block diagram showing an embodiment of a frame data multiplexing method according to the present invention. In the figure, 1
Reference numerals a, 1b, to 1n denote terminal devices, respectively. As an example, the terminal devices 1a and 1b output frame data 3a and 3b to terminal device lines 2a and 2b, respectively.
【００１０】４は時分割多重分離回路であり、この時分
割多重分離回路４は、複数の端末装置回線２ａ，２ｂ，
〜２ｎを１本のハイウェイインタフェースに変換する。
５はディジタルシグナルプロセッサであり、このディジ
タルシグナルプロセッサ５はそのマイクロプログラムに
より、複数の端末装置１ａ，１ｂ，〜１ｎのフレームを
多重処理するフレームデータ処理を行う。Reference numeral 4 denotes a time division multiplexing / demultiplexing circuit. The time division multiplexing / demultiplexing circuit 4 includes a plurality of terminal device lines 2a, 2b,
２2n is converted into one highway interface.
Reference numeral 5 denotes a digital signal processor, which performs frame data processing for multiplexing frames of a plurality of terminal devices 1a, 1b,...
【００１１】６はフレームバッファメモリ回路であり、
このフレームバッファメモリ回路６は端末装置回線２ａ
〜２ｎごとのフレームデータを一時的に蓄積する。７は
フレームデータ多重装置であり、このフレームデータ多
重装置７は上記の時分割多重分離回路４、ディジタルシ
グナルプロセッサ５、およびフレームバッファメモリ回
路６から構成し、回線識別固定フレームデータ８ａおよ
びフレームデータ９ａ、回線識別固定フレームデータ８
ｂおよびフレームデータ９ｂの順に送出する。Reference numeral 6 denotes a frame buffer memory circuit,
This frame buffer memory circuit 6 is connected to the terminal device line 2a.
２2n are temporarily stored. Reference numeral 7 denotes a frame data multiplexing device. The frame data multiplexing device 7 comprises the above-described time division multiplexing / demultiplexing circuit 4, digital signal processor 5, and frame buffer memory circuit 6, and includes line identification fixed frame data 8a and frame data 9a. , Line identification fixed frame data 8
b and the frame data 9b in this order.
【００１２】１０は１本の伝送路、１１はホスト装置で
あり、このホスト装置１１はこの１本の伝送路１０によ
って上記フレームデータ多重装置７に接続し、複数の端
末装置１ａ，１ｂ，〜１ｎ間で、ＨＤＬＣ手順フレーム
によってデータ通信を行う。Reference numeral 10 denotes one transmission line, and 11 denotes a host device. The host device 11 is connected to the frame data multiplexing device 7 by the one transmission line 10, and a plurality of terminal devices 1a, 1b,. Data communication is performed between 1n using the HDLC procedure frame.
【００１３】次に、上記構成によるフレームデータ多重
方式の動作について、例えば端末装置１ａのフレームデ
ータ３ａと端末装置１ｂのフレームデータ３ｂがフレー
ムデータ多重装置７によって多重化されて、伝送路１０
を介してホスト装置１１へ伝送する動作について説明す
る。Next, with respect to the operation of the frame data multiplexing system having the above configuration, for example, the frame data 3a of the terminal device 1a and the frame data 3b of the terminal device 1b are multiplexed by the frame data multiplexing device 7, and
The operation of transmitting data to the host device 11 via the.
【００１４】まず、端末装置１ａおよび端末装置１ｂ
は、それぞれフレームデータ３ａおよび３ｂをフレーム
データ多重装置７の時分割多重分離回路４に出力する。
そこで、ディジタルシグナルプロセッサ５は周期プログ
ラム処理により、時分割多重分離回路４を制御し、時分
割ハイウェイで入力するフレームデータ３ａおよび３ｂ
の有無を識別するためにフラグの検出を行う。First, the terminal device 1a and the terminal device 1b
Output the frame data 3a and 3b to the time division demultiplexing circuit 4 of the frame data multiplexer 7.
Therefore, the digital signal processor 5 controls the time division multiplexing / demultiplexing circuit 4 by the periodic program processing, and the frame data 3a and 3b input on the time division highway
Flag is detected to identify the presence or absence of
【００１５】そして、フレームの始まりを検出したと
き、ＨＤＬＣフレーム受信終端処理である０削除やＦＣ
Ｓ検査を行わず、トランスペアレントにフレームバッフ
ァメモリ回路６の各端末装置回線ごとに割り当てられた
エリアへ順次蓄積する。When the start of the frame is detected, 0 is deleted or the FC
The S test is not performed, and the data is successively stored in an area of the frame buffer memory circuit 6 which is allocated to each terminal device line.
【００１６】そして、このディジタルシグナルプロセッ
サ５は、フレームの終了を検出したとき、端末装置回線
ごとに割り当てられた回線識別用アドレスを含む回線識
別固定フレームデータ８ａを送出したのち、フレームバ
ッファメモリ回路６に蓄積されているフレームデータ９
ａを伝送路１０に送出する。そして、同様に、回線識別
固定データ１０ｂおよびフレームデータ１１ｂを伝送路
１０に送出する。When the digital signal processor 5 detects the end of the frame, the digital signal processor 5 sends out the line identification fixed frame data 8a including the line identification address assigned to each terminal device line, and then sends the frame buffer memory circuit 6 Frame data 9 stored in
a to the transmission line 10. Then, similarly, the line identification fixed data 10b and the frame data 11b are transmitted to the transmission line 10.
【００１７】このように、ホスト装置１１へ送られるフ
レーム伝送は、ディジタルシグナルプロセッサ５でフレ
ーム終了が検出されたフレーム順に行われる。そして、
ホスト装置１１は伝送されてきた回線識別固定フレーム
データ８ａによりフレームデータ９ａが端末装置１ａの
フレームデータであることを認識することができる。As described above, the transmission of the frame sent to the host device 11 is performed in the order of the frames in which the digital signal processor 5 detects the end of the frame. And
The host device 11 can recognize from the transmitted line identification fixed frame data 8a that the frame data 9a is the frame data of the terminal device 1a.
【００１８】同様に、回線識別固定フレームデータ８ｂ
によりフレームデータ９ｂが端末装置１ｂのフレームデ
ータであることを認識することができる。なお、ホスト
装置１１から各端末装置１ａ，１ｂ，〜１ｎのフレーム
データを伝送する場合も同様に、回線識別固定フレーム
データを送信したのち、そのフレームデータを送信す
る。Similarly, the line identification fixed frame data 8b
Thus, it can be recognized that the frame data 9b is the frame data of the terminal device 1b. When transmitting frame data of each of the terminal devices 1a, 1b, to 1n from the host device 11, similarly, after transmitting the line identification fixed frame data, the frame data is transmitted.
【００１９】このため、ディジタルシグナルプロセッサ
５にて、各端末装置回線ごとにフレームバッファメモリ
回路６へ一時蓄積し、フレーム分離されて各端末装置１
ａ，１ｂ，〜１ｎへフレームデータを伝送することがで
きる。For this reason, the digital signal processor 5 temporarily stores the data in the frame buffer memory circuit 6 for each terminal device line, separates the frames, and stores each terminal device 1
a, 1b,... 1n.
【００２０】[0020]
【発明の効果】以上、詳細に説明したように、本発明に
係るフレームデータ多重方式によれば、複数の端末装置
にそれぞれ端末装置回線で接続し、ホスト装置に１本の
伝送路で接続するフレームデータ多重装置を設けるよう
にしたので、ホスト装置と端末装置間の伝送路コストを
削減することができる。しかも、ホスト装置側ＨＤＬＣ
終端回路を削減できるので、経済的なハードウエアで、
ソフトウエアに負荷をかけずに構築することができる効
果がある。As described in detail above, according to the frame data multiplexing method of the present invention, a plurality of terminal devices are connected to each other via a terminal device line, and connected to a host device via a single transmission line. Since the frame data multiplexing device is provided, the transmission path cost between the host device and the terminal device can be reduced. Moreover, the HDLC on the host device side
Since the number of termination circuits can be reduced, economical hardware
There is an effect that the software can be constructed without putting a load on the software.
【図１】本発明に係るフレームデータ多重方式の一実施
例を示すブロック図である。FIG. 1 is a block diagram showing one embodiment of a frame data multiplexing method according to the present invention.
１ａ，１ｂ，〜１ｎ 端末装置 ４ 時分割多重分離回路 ５ ディジタルシグナルプロセッサ ６ フレームバッファメモリ回路 ７ フレームデータ多重装置 １０ １本の伝送路 １１ ホスト装置 1a, 1b, ~ 1n Terminal device 4 Time division multiplexing / demultiplexing circuit 5 Digital signal processor 6 Frame buffer memory circuit 7 Frame data multiplexing device 10 One transmission line 11 Host device
Claims (2)
ＬＣ手順フレームによりデータ伝送を行うフレームデー
タ多重方式において、 上記複数の端末装置にそれぞれ端末装置回線で接続し、
ホスト装置に一本の伝送路で接続するフレームデータ多
重装置を設け、このフレームデータ多重装置は、上記端
末装置回線ごとのＨＤＬＣフレームの有無を識別するた
めのフラグを検出する機能と、フラグの検出により抽出
されたフレームデータを端末装置回線ごとに一時的にフ
レームバッファメモリ回路に蓄積する機能と、フレーム
の終了を検出したとき、フレームデータの送出に先立っ
て、そのフレームデータに対応する回線識別用アドレス
を含む回線識別固定フレームデータを送信する機能とを
備えたことを特徴とするフレームデータ多重方式。An HD between a host device and a plurality of terminal devices.
In a frame data multiplexing method for performing data transmission by an LC procedure frame, each of the plurality of terminal devices is connected to a terminal device line,
A frame data multiplexing device connected to the host device through a single transmission line; the frame data multiplexing device has a function of detecting a flag for identifying the presence or absence of an HDLC frame for each terminal device line; And a function for temporarily storing the extracted frame data in a frame buffer memory circuit for each terminal device line, and for detecting a line end corresponding to the frame data before transmitting the frame data when detecting the end of the frame. A function of transmitting line identification fixed frame data including an address.
ぞれ端末装置回線で接続し、ホスト装置に一本の伝送路
で接続する時分割多重分離回路と、マイクロプログラム
により各端末装置のフレームを多重処理するフレームデ
ータ処理を行うディジタルシグナルプロセッサと、端末
装置回線ごとのフレームデータを一時的に蓄積するフレ
ームバッファメモリ回路とからなることを特徴とするフ
レームデータ多重方式。 2. The apparatus according to claim 1, wherein said frame data multiplexing device is provided to a plurality of terminal devices.
Each is connected by a terminal device line, and one transmission line is connected to the host device.
Time division demultiplexing circuit connected by
Frame data that multiplexes the frames of each terminal device
Digital signal processor for data processing and terminal
Frame that temporarily stores frame data for each device line
A frame buffer memory circuit.
Frame data multiplexing method.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5232216A JP2601151B2 (en) | 1993-08-26 | 1993-08-26 | Frame data multiplexing method |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5232216A JP2601151B2 (en) | 1993-08-26 | 1993-08-26 | Frame data multiplexing method |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0766848A JPH0766848A (en) | 1995-03-10 |
| JP2601151B2 true JP2601151B2 (en) | 1997-04-16 |
Family
ID=16935806
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5232216A Expired - Lifetime JP2601151B2 (en) | 1993-08-26 | 1993-08-26 | Frame data multiplexing method |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2601151B2 (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2969336B1 (en) * | 2010-12-17 | 2013-01-04 | Sagem Defense Securite | MULTIPLE ETHERNET CONNECTION DEVICE WITH COMPUTER UNIT AND COMPUTER UNIT ASSEMBLY AND RELATED EQUIPMENT TOGETHER |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57170647A (en) * | 1981-04-13 | 1982-10-20 | Toshiba Corp | Branch control system in data transmission system |
| JPS6297449A (en) * | 1985-10-23 | 1987-05-06 | Fujitsu Ltd | Data branching system |
| JPS62135043A (en) * | 1985-12-06 | 1987-06-18 | Nec Eng Ltd | Line changeover circuit |
-
1993
- 1993-08-26 JP JP5232216A patent/JP2601151B2/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0766848A (en) | 1995-03-10 |
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