JP2007141984A - Manufacturing method of circuit board - Google Patents
Manufacturing method of circuit board Download PDFInfo
- Publication number
- JP2007141984A JP2007141984A JP2005331011A JP2005331011A JP2007141984A JP 2007141984 A JP2007141984 A JP 2007141984A JP 2005331011 A JP2005331011 A JP 2005331011A JP 2005331011 A JP2005331011 A JP 2005331011A JP 2007141984 A JP2007141984 A JP 2007141984A
- Authority
- JP
- Japan
- Prior art keywords
- groove
- substrate
- silicon substrate
- glass
- circuit board
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Withdrawn
Links
Images
Landscapes
- Non-Metallic Protective Coatings For Printed Circuits (AREA)
- Manufacturing Of Printed Circuit Boards (AREA)
- Element Separation (AREA)
Abstract
Description
本発明は、回路基板の製造方法に関する。 The present invention relates to a circuit board manufacturing method.
マイクロマシンセンサやアクチュエータなどのマイクロデバイス用の微細なパターン形成が必要な回路基板の製造方法として、例えば特許文献1に記載されている方法がある。この方法は、図2に示すような工程により行われる。すなわち、図2(a)に示すシリコンウエハ101上にエッチング領域以外の領域にニッケル層102を形成してマスクとし(図2(b))、シリコンウエハ101の露出部分を反応性イオンエッチング(RIE)して、図2(c)に示すように、溝103を形成してニッケル層102を除去する。次いで、図2(d)に示すように、溝103に溶融したガラス104を流し込んで充填する。その後、図2(e)に示すように、両面を研磨処理して回路基板を得る。
しかしながら、上記特許文献1に記載されている方法においては、厚さ約1mmのシリコンウエハに対して半分以上をRIEで溝形成するので、非常に時間がかかり生産性が非常に悪いという問題がある。 However, in the method described in Patent Document 1, more than half of the silicon wafer having a thickness of about 1 mm is formed by RIE, so that there is a problem that it takes a very long time and productivity is very poor. .
本発明はかかる点に鑑みてなされたものであり、短時間で効率良く回路基板を得ることができる回路基板の製造方法を提供することを目的とする。 This invention is made | formed in view of this point, and it aims at providing the manufacturing method of the circuit board which can obtain a circuit board efficiently in a short time.
本発明の回路基板の製造方法は、一対の主面を有する基板の一方の主面側からドライエッチングを施して第1溝を形成する工程と、前記一方の主面側の前記第1溝に、前記基板を構成する材料と異なる材料を埋め込む工程と、前記基板の他方の主面側からダイシングを行って前記層に達する第2溝を形成する工程と、前記第1溝に埋め込んだ材料と略同じ材料を前記第2溝に埋め込む工程と、を具備することを特徴とする。 The method of manufacturing a circuit board according to the present invention includes a step of dry etching from one main surface side of a substrate having a pair of main surfaces to form a first groove, and a step of forming the first groove on the one main surface side. A step of embedding a material different from the material constituting the substrate, a step of dicing from the other main surface side of the substrate to form a second groove reaching the layer, and a material embedded in the first groove And embedding substantially the same material in the second groove.
この方法によれば、基板に貫通部材を埋め込む際に、ドライエッチングとダイシングを用いて基板に貫通部材を構成する材料を埋め込んでいる。処理時間の短いダイシングを用いることにより、相対的に時間がかかるドライエッチングの時間を短縮することができ、その結果効率良く回路基板を製造することができる。 According to this method, when the penetrating member is embedded in the substrate, the material constituting the penetrating member is embedded in the substrate using dry etching and dicing. By using dicing with a short processing time, it is possible to shorten the time for dry etching, which takes a relatively long time, and as a result, a circuit board can be manufactured efficiently.
本発明の回路基板の製造方法においては、前記第1溝の深さを前記第2溝の深さよりも浅くすることが好ましい。 In the circuit board manufacturing method of the present invention, it is preferable that the depth of the first groove is shallower than the depth of the second groove.
本発明の回路基板の製造方法においては、前記基板がシリコン基板であり、前記第1及び第2溝に埋め込む材料がガラスであることが好ましい。 In the circuit board manufacturing method of the present invention, it is preferable that the substrate is a silicon substrate and the material embedded in the first and second grooves is glass.
本発明の回路基板の製造方法においては、前記溝を埋め込む工程は、前記シリコン基板の一方の主面側にガラス基板を当接させて、前記シリコン基板を前記ガラス基板に加熱下で押圧して、前記溝にガラスを充填させる工程と、前記シリコン基板が露出するまでガラス基板を研磨する工程と、を有することが好ましい。 In the method of manufacturing a circuit board according to the present invention, the step of embedding the groove includes bringing a glass substrate into contact with one main surface side of the silicon substrate and pressing the silicon substrate against the glass substrate under heating. Preferably, the method includes a step of filling the groove with glass and a step of polishing the glass substrate until the silicon substrate is exposed.
本発明の回路基板の製造方法においては、前記ガラス基板と前記シリコン基板とを陽極接合することが好ましい。この方法によれば、ガラス基板とシリコン基板との間の密着性を向上させることができる。 In the circuit board manufacturing method of the present invention, it is preferable that the glass substrate and the silicon substrate are anodically bonded. According to this method, the adhesion between the glass substrate and the silicon substrate can be improved.
本発明によれば、一対の主面を有する基板の一方の主面側からドライエッチングを施して第1溝を形成する工程と、前記一方の主面側の前記第1溝に、前記基板を構成する材料と異なる材料を埋め込む工程と、前記基板の他方の主面側からダイシングを行って前記層に達する第2溝を形成する工程と、前記第1溝に埋め込んだ材料と略同じ材料を前記第2溝に埋め込む工程と、を具備するので、短時間で効率良く回路基板を得ることができる回路基板の製造方法を提供することができる。 According to the present invention, the first groove is formed by dry etching from one main surface side of the substrate having a pair of main surfaces, and the substrate is placed in the first groove on the one main surface side. A step of embedding a material different from the constituent material, a step of dicing from the other main surface side of the substrate to form a second groove reaching the layer, and a material substantially the same as the material embedded in the first groove. And the step of embedding in the second groove, it is possible to provide a circuit board manufacturing method capable of efficiently obtaining a circuit board in a short time.
以下、本発明の実施の形態について添付図面を参照して詳細に説明する。
本発明に係る回路基板の製造方法においては、一対の主面を有する基板の一方の主面側からドライエッチングを施して第1溝を形成し、前記一方の主面側の前記第1溝に、前記基板を構成する材料と異なる材料を埋め込み、前記基板の他方の主面側からダイシングを行って前記層に達する第2溝を形成し、前記第1溝に埋め込んだ材料と略同じ材料を前記第2溝に埋め込んで回路基板を得る。
Hereinafter, embodiments of the present invention will be described in detail with reference to the accompanying drawings.
In the method for manufacturing a circuit board according to the present invention, dry etching is performed from one main surface side of a substrate having a pair of main surfaces to form a first groove, and the first groove on the one main surface side is formed. A material different from the material constituting the substrate is buried, dicing is performed from the other main surface side of the substrate to form a second groove reaching the layer, and substantially the same material as the material buried in the first groove is formed. A circuit board is obtained by embedding in the second groove.
基板については、シリコン基板であることが好ましく。第1及び第2溝に埋め込む材料については、ガラスであることが好ましい。ここでは、基板がシリコン基板であり、溝に埋め込む材料がパイレックス(登録商標)ガラスである場合について説明する。この回路基板は図1(f)に示すような構成を有する。 The substrate is preferably a silicon substrate. The material embedded in the first and second grooves is preferably glass. Here, a case where the substrate is a silicon substrate and the material embedded in the groove is Pyrex (registered trademark) glass will be described. This circuit board has a configuration as shown in FIG.
図1(f)中11はシリコン基板を示す。シリコン基板11は、相互に対向する一対の主面11a,11bを有する。このシリコン基板11には、貫通部材が埋め込まれている。この貫通部材は、シリコン基板11の主面11a側から埋め込まれたガラス14aと、シリコン基板11の主面11b側から埋め込まれたガラス16とで構成されている。ガラス14aとガラス16とは、シリコン基板11内で当接している。
In FIG. 1 (f),
シリコン基板11の主面11a及び/又は11b側から形成した溝にガラス14a,16を埋め込む場合、シリコン基板11の主面にガラス基板を当接させて、シリコン基板11をガラス基板に加熱下で押圧して、溝にガラスを充填させ、その後シリコン基板11が露出するまでガラス基板を研磨する。なお、研磨処理においては、例えば研削処理を施して厚さを薄くした後に、ラッピング処理を施して表面を鏡面仕上げする。
When the
また、この場合、ガラス基板とシリコン基板11とを陽極接合することが好ましい。これにより、ガラスとシリコンとの間の界面における密着性が向上する。ここで、陽極接合処理とは、所定の温度(例えば400℃以下)で所定の電圧(例えば300V〜1kV)を印加することにより、シリコンとガラスとの間に大きな静電引力が発生して、接触したガラス−シリコン界面で酸素を介した化学結合を形成させる、もしくは、酸素の放出による共有結合を形成させる処理をいう。この界面での共有結合は、シリコンのSi原子とガラスに含まれるSi原子との間のSi−Si結合又はSi−O結合である。したがって、このSi−Si結合又はSi−O結合により、シリコンとガラスとが強固に接合して、両者間の界面で非常に高い密着性を発揮する。このような陽極接合を効率良く行うために、ガラス基板11のガラス材料としては、ナトリウムなどのアルカリ金属を含むガラス材料(例えばパイレックス(登録商標)ガラス)であることが好ましい。
In this case, the glass substrate and the
シリコン基板11に施すドライエッチングとしては、例えば反応性イオンエッチングなどを用いることができる。ドライエッチングして形成する溝の深さは、処理時間などを考慮すると、約100μm程度であることが好ましい。また、ダイシングについては、通常用いられる装置や研削液を用い、通常の条件で行われる。なお、ダイシングにおいて、ダイシング加工する幅はダイシングブレードの幅を選択することにより調整する。
As dry etching performed on the
本発明に係る方法においては、シリコン基板に貫通部材を埋め込む際に、ドライエッチングとダイシングを用いてシリコン基板に貫通部材を構成する材料を埋め込んでいる。処理時間の短いダイシングを用いることにより、相対的に時間がかかるドライエッチングの時間を短縮することができ、その結果効率良く回路基板を製造することができる。さらに、ドライエッチングで形成する溝の深さをダイシングで形成する溝の深さよりも浅くする、すなわち、主面11a側の第1溝の深さを主面11b側の第2溝の深さよりも浅くすることにより、処理時間の短いダイシングで形成する溝の深さを深くすることができ、より効率良く回路基板を製造することができる。
In the method according to the present invention, when the penetrating member is embedded in the silicon substrate, the material constituting the penetrating member is embedded in the silicon substrate using dry etching and dicing. By using dicing with a short processing time, it is possible to shorten the time for dry etching, which takes a relatively long time, and as a result, a circuit board can be manufactured efficiently. Furthermore, the depth of the groove formed by dry etching is made shallower than the depth of the groove formed by dicing, that is, the depth of the first groove on the
図1(a)〜(f)は、本発明の実施の形態に係る回路基板の製造方法を説明するための断面図である。 1A to 1F are cross-sectional views for explaining a circuit board manufacturing method according to an embodiment of the present invention.
図1(a)に示すように、このシリコン基板11の一方の主面11a上にレジスト膜12を形成し、溝部形成領域以外の領域にレジスト膜12が残るように、そのレジスト膜12をパターニング(フォトリソグラフィー)し、そのレジスト膜12をマスクとしてシリコン基板11をRIEなどによりドライエッチングし、その後残存したレジスト膜12を除去する。このようにして、図1(b)に示すように、シリコン基板11の主面11a側に第1溝である溝部13を設ける。
As shown in FIG. 1A, a
次いで、溝部13を形成したシリコン基板11上に、溝部13がガラス基板14と当接するようにしてガラス基板14を置く。さらに、真空下で、このシリコン基板11及びガラス基板14を加熱し、シリコン基板11をガラス基板14に押圧して溝部13にガラス基板14を押し込んで、図1(c)に示すように、シリコン基板11とガラス基板14とを接合する。このときの温度は、シリコンの融点以下であって、ガラスが変形可能である温度(例えば、ガラスの軟化点温度以下)が好ましい。例えば加熱温度は約800℃である。これにより、ガラス基板14のガラスが溶融してシリコン基板11の溝部13に流れ込んで溝部13を充填する。
Next, the
さらに、シリコン基板11とガラス基板14との界面での密着性をより高めるために、陽極接合処理をすることが好ましい。この場合、シリコン基板11及びガラス基板14にそれぞれ電極をつけて、約400℃以下の加熱下で約300V〜1kVの電圧を印加することにより行う。これにより両者の界面での密着性がより高くなる。
Furthermore, in order to further improve the adhesion at the interface between the
次いで、図1(d)に示すように、ガラス基板14のシリコン基板11と反対側を研磨処理して、シリコン基板11を露出させる。これにより、溝部13にガラス14aが埋め込まれた構造となる。次いで、図1(e)に示すように、シリコン基板11の主面11b側をダイシングして溝部15を形成する。なお、ダイシングを開始する前に、ダイシング用のアライメントマークを形成しておくことが望ましい。このようなダイシングによって、溝部15においてガラス14aを露出させる。すなわち、ガラス14aの位置までダイシングして溝部15を形成する。
Next, as shown in FIG. 1D, the opposite side of the
次いで、溝部15を形成したシリコン基板11上に、溝部15がガラス基板と当接するようにしてガラス基板を置く。さらに、真空下で、このシリコン基板11及びガラス基板を加熱し、シリコン基板11をガラス基板に押圧して溝部15にガラス基板を押し込んで、シリコン基板11とガラス基板とを接合する。このときの温度は、シリコンの融点以下であって、ガラスが変形可能である温度(例えば、ガラスの軟化点温度以下)が好ましい。例えば加熱温度は約800℃である。これにより、ガラス基板のガラスが溶融してシリコン基板11の溝部15に流れ込んで溝部15を充填する。
Next, the glass substrate is placed on the
さらに、シリコン基板11とガラス基板との界面での密着性をより高めるために、上記と同様に陽極接合処理をすることが好ましい。この場合、シリコン基板11及びガラス基板にそれぞれ電極をつけて、約400℃以下の加熱下で約300V〜1kVの電圧を印加することにより行う。これにより両者の界面での密着性がより高くなる。
Furthermore, in order to further improve the adhesion at the interface between the
次いで、図1(f)に示すように、ガラス基板のシリコン基板11と反対側を研磨処理して、シリコン基板11を露出させる。これにより、溝部15にガラス16が埋め込まれた構造となる。したがって、シリコン基板11の溝部13にガラス14aが埋め込まれ、シリコン基板11の溝部15にガラス16が埋め込まれて、ガラス14aとガラス16とがシリコン基板11内で当接し、貫通部材を構成している。このようにして、回路基板を製造することができる。
Next, as shown in FIG. 1 (f), the opposite side of the glass substrate from the
このような回路基板の製造方法においては、シリコン基板にガラスを埋め込む際に、ドライエッチングとダイシングを用いてシリコン基板にガラスを埋め込んでいる。処理時間の短いダイシングを用いることにより、微細なパターン形成には有効だが相対的に時間がかかるドライエッチングの時間を短縮することができ、その結果効率良く微細なパターンを有する回路基板を製造することができる。 In such a circuit board manufacturing method, when glass is embedded in a silicon substrate, glass is embedded in the silicon substrate using dry etching and dicing. By using dicing with a short processing time, the dry etching time that is effective for forming a fine pattern but takes a relatively long time can be reduced. As a result, a circuit board having a fine pattern can be efficiently manufactured. Can do.
本発明は上記実施の形態に限定されず、種々変更して実施することが可能である。例えば、上記実施の形態で説明した数値や材質については特に制限はない。また、上記実施の形態で説明したプロセスについてはこれに限定されず、工程間の適宜順序を変えて実施しても良い。例えば、上記実施の形態においては、シリコン基板とガラス基板との間で陽極接合した場合について説明しているが、本発明においては陽極接合をせずに接合しても良い。その他、本発明の目的の範囲を逸脱しない限りにおいて適宜変更することが可能である。 The present invention is not limited to the embodiment described above, and can be implemented with various modifications. For example, the numerical values and materials described in the above embodiments are not particularly limited. Further, the process described in the above embodiment is not limited to this, and the process may be performed by changing the order as appropriate. For example, although the case where anodic bonding is performed between a silicon substrate and a glass substrate has been described in the above embodiment, bonding may be performed without performing anodic bonding in the present invention. Other modifications may be made as appropriate without departing from the scope of the object of the present invention.
本発明は、マイクロマシンセンサ、アクチュエータ、静電容量型圧力センサなどのマイクロデバイスに適用することができる。 The present invention can be applied to micro devices such as micro machine sensors, actuators, and capacitive pressure sensors.
11 シリコン基板
11a,11b 主面
12 レジスト膜
13,15 溝部
14 ガラス基板
14a,16 ガラス
DESCRIPTION OF
Claims (5)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005331011A JP2007141984A (en) | 2005-11-16 | 2005-11-16 | Manufacturing method of circuit board |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005331011A JP2007141984A (en) | 2005-11-16 | 2005-11-16 | Manufacturing method of circuit board |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2007141984A true JP2007141984A (en) | 2007-06-07 |
Family
ID=38204530
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2005331011A Withdrawn JP2007141984A (en) | 2005-11-16 | 2005-11-16 | Manufacturing method of circuit board |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2007141984A (en) |
-
2005
- 2005-11-16 JP JP2005331011A patent/JP2007141984A/en not_active Withdrawn
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US7364930B2 (en) | Method for producing micromechanical and micro-optic components consisting of glass-type materials | |
JP4585426B2 (en) | Capacitive pressure sensor | |
JP4800593B2 (en) | Manufacturing method of heterogeneous structure | |
JP4528124B2 (en) | Planar substrate structuring method, planar substrate manufacturing method, method of electrically contacting parts | |
JP4480939B2 (en) | Method for structuring a flat substrate made of a glass-based material | |
US9981844B2 (en) | Method of manufacturing semiconductor device with glass pieces | |
JP5195074B2 (en) | Mold | |
TW201741232A (en) | MEMS gap control structures | |
US8288841B2 (en) | Handle wafer having viewing windows | |
CN104249992B (en) | Alignment methods between wafer and wafer | |
JP2008039593A (en) | Capacitance type acceleration sensor | |
JP2007141984A (en) | Manufacturing method of circuit board | |
JP4515207B2 (en) | Mold manufacturing method and parts manufactured using the mold | |
JP2007127440A (en) | Capacitive pressure sensor | |
JP5319910B2 (en) | Method of embedding conductive pattern, method of manufacturing laminated substrate, and method of manufacturing fine channel structure | |
JP5089107B2 (en) | Manufacturing method of fine parts | |
JP2005039078A (en) | Wafer substrate for sheet substrate structure formation, method for manufacturing the same, and method for manufacturing mems element | |
JP7242220B2 (en) | Bonded wafer, manufacturing method thereof, and through-hole forming method | |
JP2007163456A (en) | Capacitive pressure sensor | |
JP2009160673A (en) | Manufacturing method of micro device | |
JP2017030258A (en) | Method of processing silicon substrate | |
JP2011114282A (en) | Soi substrate and method of manufacturing the same | |
JP2001007005A (en) | Aperture for electron beam lithography, mask holder, and electron beam exposure mask using them | |
JP2007155542A (en) | Capacitive pressure sensor | |
JP2006047300A (en) | Glass substrate and electrostatic capacity type pressure sensor using the same |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Effective date: 20070926 Free format text: JAPANESE INTERMEDIATE CODE: A621 |
|
RD03 | Notification of appointment of power of attorney |
Effective date: 20090415 Free format text: JAPANESE INTERMEDIATE CODE: A7423 |
|
A761 | Written withdrawal of application |
Free format text: JAPANESE INTERMEDIATE CODE: A761 Effective date: 20090709 |