CH631561A5 - Support d'information portatif pour la memorisation et le traitement d'informations. - Google Patents

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CH631561A5
CH631561A5 CH849178A CH849178A CH631561A5 CH 631561 A5 CH631561 A5 CH 631561A5 CH 849178 A CH849178 A CH 849178A CH 849178 A CH849178 A CH 849178A CH 631561 A5 CH631561 A5 CH 631561A5
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CH
Switzerland
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information
memory
medium
key
reading
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Application number
CH849178A
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Michel Ugon
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Cii Honeywell Bull
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Publication date
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Description

La présente invention concerne un support d'information portatif ^imlta^VeS'
pour la mémorisation et le traitement d'informations confidentielles borne (5) permet de synchroniser les différentes actions ou non, à la fois facilement manipulable et transportable. 45 bernes du dispositif vis-à-vis du milieu extérieur. La tension
On connaît déjà plusieurs modes de réalisation de support correspondante est impulsionnelle et peut avoir une fréquence de d'informations confidentielles réalisés soit sous forme de cartes 1 ordre de 0,5 à 5 MHz.
magnétiques, soit sous forme de cartes contenant des circuits La borne (6) constitue le seul accès au dispositif pour les intégrés. informations entrantes et sortantes et le microprocesseur gère le
Aussi élaboré que soit ce type de support d'information, il so dialogue en sérialisant ou désérialisant les informations, suivant le présente l'inconvénient majeur d'utiliser des circuits électroniques sens transfert.
spécifiques à structure figée remplissant une fonction unique détermi- Le microprocesseur (1) contrôle entièrement la mémoire (2) par née par l'usage auquel il est destiné. l'intermédiaire;
L'accès à l'information est généralement obtenu à l'aide d'une clé — d'un bus d'adresse (3),
située dans le support d'information et seule connue de son proprié- 55 — d'un bus de données (4).
taire. Il est donc prévu à l'intérieur même du support des sécurités Si une demande de lecture parvient au microprocesseur par la qui interdisent l'accès au support d'information lorsqu'une tentative borne (6), l'accès est autorisé après les contrôles décrits ci-dessus,
d'accès est effectuée à l'aide d'une clé fausse. Toutefois l'introduction Dans la phase de lecture proprement dite, l'adresse est présentée sur de ces sécurités à l'intérieur des supports d'information confidentielle le bus (3) et la donnée est lue sur le bus (4).
connus jusqu'alors aboutissent généralement à des dialogues diffé- 60 Si une demande d'écriture parvient au dispositif par la borne (6),
rents, fonctions du type bon ou mauvais de la clé utilisée, entre le l'accès est autorisé après contrôle. L'adresse est présentée sur le bus support d'information et l'appareil d'exploitation qui lui est con- (3) et la donnée sur le bus (4). L'ordre d'écriture est envoyé à la necté, si bien qu'un fraudeur averti a toutes possibilités pour se livrer mémoire (2) par la ligne (10) en simultanéité avec la tension
à des tests sur les lignes d'informations reliant le support à l'appareil d'écriture sur la borne (8).
d'exploitation pour découvrir les clés d'accès audit support d'infor- «s La fig. 2 donne un deuxième mode de réalisation des circuits mation. électroniques.
Un premier but de l'invention est de créer un support d'informa- Le microprocesseur comprend une mémoire morte permanente tion à structure électronique programmable, apte à remplir une interne (2). Cette mémoire est divisée en deux zones (20) et (21).
3
631 561
La zone (20) supporte le programme de fonctionnement du microprocesseur. La zone (21) est utilisée pour le stockage des informations.
Dans le mode de réalisation, les tensions d'alimentations sont appliquées au microprocesseur, ainsi que la tension d'horloge (5).
Les bus (3) et (4) précédemment décrits sont internes.
Sur la fig. 3, on a montré une réalisation vue en coupe du support d'informations selon l'invention. Dans une fenêtre pratiquée dans une plaque C2 de polychlorure de vinyle, et reposant sur une échancrure prévue sur la périphérie de la fenêtre, sont appliquées deux autres plaques de polychlorure de vinyle C„ et C3 recouvrant toute la surface de ladite fenêtre.
Dans l'espace compris entre les deux plaques Q et C3, laissé libre par l'échancrure, est interposée une couche de résine époxy C4 dans laquelle deux lumières sont pratiquées pour loger deux boîtiers de semi-conducteur constitué, dans un logement, par le boîtier microprocesseur C7 et, dans l'autre, par la mémoire morte programmable C8.
Les conducteurs Lj à L4, reliant les deux boîtiers de semiconducteur aux fils conducteurs C9, Cj „ et Q j plaqués sur la résine époxy, sont maintenus sur une extrémité par la plaque de polyvinyle Ci, la face des boîtiers opposés à celle d'où partent les conducteurs étant appliquée sur la plaque époxy C3. On trouvera un exemple de réalisation des connexions du support d'information à l'appareil d'exploitation externe dans la demande de brevet français N° 75.40361.
La fig. 4A représente un schéma d'organisation du contenu informatique d'un support d'informations selon l'invention. De façon à rendre le support d'informations apte à tous usages, il est prévu deux types d'organisation de la mémoire du microprocesseur.
La première organisation correspond à l'organisation physique de la mémoire, et est seule connue du microprocesseur.
La deuxième organisation correspond à l'organisation logique de la mémoire et répond aux besoins de l'exploitation du support d'information.
Le microprocesseur se charge d'effectuer les correspondances entre ces deux types d'organisation.
La mémoire physique comprend en travail normal trois parties.
La partie zéro commence à l'adresse ADO et se termine à l'adresse ADT-1. Elle correspond à la partie secrète de la mémoire pour laquelle toutes écritures et toutes lectures externes sont interdites, et où seule une lecture/écriture interne est autorisée.
La partie 1 commence à l'adresse ADT et se termine à l'adresse ADL-1. Elle sert de mémoire de travail pour le microprocesseur et toutes les opérations d'écriture et de lecture internes ou externes sont autorisées.
La partie 2 commence à l'adresse ADL et se termine à l'adresse ADF. Dans cette partie de mémoire, toute écriture interne et externe se trouve interdite; par contre, une lecture externe ou interne est autorisée.
La mémoire logique se subdivise en une mémoire de création et une mémoire d'utilisation.
Pour être opérationnel, le support d'information doit contenir, au moment de sa diffusion, des informations permettant de l'identifier. Ces informations sont contenues dans la mémoire de création qui est organisée en plusieurs zones commençant à l'adresse ADF et qui permettent d'identifier le fabricant du support d'information, son numéro de série, une zone LOCKF de validation du contenu de la mémoire de création et pour autoriser des écritures à l'intérieur. La zone LOCKF pourra, par exemple, être dimensionnée sur 2 bits et l'on pourra utiliser le code suivant. Si LOCKF =11, toutes lectures et écritures seront possibles à l'intérieur de la zone de création; par contre, si LOCK ^ 11, le contenu de la zone de création sera validé et toute opération d'écriture sera interdite.
La mémoire d'utilisation est spécifique de l'usage que l'utilisateur du support d'information compte faire. Cependant, quel que soit l'usage envisagé, cette mémoire se divise elle-même en deux parties, appelées l'une mémoire de définition et l'autre mémoire d'application.
La dimension de ces zones dépendra naturellement de l'usage envisagé. La mémoire de définition commence à l'adresse ADO. Elle comprend:
— une zone LOCK à plusieurs bits interdisant les accès externes à la mémoire de définition et validant son contenu;
— une zone PARAM dont la longueur dépend du type de support d'information et qui contient les paramètres nécessaires au fonctionnement du support d'information;
— une zone TYPE pour définir la fonction du support d'information qui peut être utilisée comme support comptable, ticket de restaurant, timbre électronique, clé d'accès dans les hôtels, fichiers, etc.
La mémoire d'application est constituée des zones restantes. Elle est utilisable en mémoire banalisée, mais les conditions d'accès aux parties de la mémoire physique doivent être respectées. En conséquence, quelles que soient les applications que peut recevoir le support d'information de l'invention, les informations secrètes seront toujours localisées en partie 0, les informations ne devant qu'être lues seront localisées en partie 2, les informations à mémoriser au cours de l'exploitation normale du support d'information seront en partie 1. Le format utilisé pour les informations logiques à mémoriser dans la mémoire d'application pourra naturellement être quelconque.
On va maintenant donner un exemple de découpage de la mémoire logique dans le cadre d'une application financière en faisant référence à la fig. 4B.
Dans ce cadre, l'accès au support d'information nécessitera la présence d'au moins deux clés. S'il s'agit d'opérations bancaires, une clé N° 1 identifiera le banquier et une clé N° 2 identifiera le client. La mémoire de définition comprendra alors une zone type avec un code pour désigner l'application financière du support d'information. Une zone PARAM comprenant la zone LOCK à 2 bits, si LOCK =11, l'accès en écriture dans toutes les parties de mémoire n'est autorisée que si la clé 1 est présente. Si LOCK 11, le contenu des parties 0 et 2 de la mémoire physique est validé, l'accès en partie 0 et l'écriture en partie 2 de la mémoire physique sans la clé N° 2 sont interdits. Pour créditer la carte, la clé N° 1 est nécessaire si LOCK # 11, le contenu de la mémoire de définition est validé.
La zone LP contient 2 bits.
Si LP = 11, la lecture n'est pas protégée, elle est autorisée dans les parties 1 et 2 sans clé (mémoire d'accès inexistante).
Si LP 11, la lecture est protégée et une clé est obligatoire pour lire les parties 1 et 2. Ce sera le cas de la plupart des opérations bancaires. (Toute lecture s'accompagne obligatoirement d'un bit d'accès pendant du bit d'erreur; cela afin de rendre symétrique le fonctionnement du support d'information.)
La zone EP contient 2 bits.
Si EP = 11, l'écriture n'est pas protégée. Dans ce cas, la mémoire est utilisée comme moyen de stockage sans protection. Ce cas est, par exemple, celui où la mémoire est vierge avant la création du support d'enregistrement.
Si EP # 11, une clé est obligatoire pour écrire dans la partie 1 de la mémoire physique.
La mémoire d'application est composée de la mémoire d'identification et de la mémoire financière. Les informations de la mémoire d'identification se répartissent dans les parties 0 et 2. La mémoire d'identification en partie 0 se compose essentiellement d'une mémoire d'erreur et d'une mémoire d'accès. La mémoire d'erreur mémorise un bit d'erreur chaque fois qu'une mise en fonctionnement du support d'information est réalisée avec une clé fausse. Les bits d'erreur sont inscrits aux adresses croissantes à partir de l'adresse ADE. Lorsque la zone de débordement DEBE est inscrite, le support d'information est invalidé.
La mémoire d'accès n'existe pas si la lecture du support d'information est protégée (LP # 11), ce qui sera le cas dans la plupart des applications bancaires. A chaque lecture accompagnée d'une clé bonne, le microprocesseur inscrit un bit d'accès après le précédent. Les bits d'accès sont inscrits à partir de l'adresse ADA. Lorsque la
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zone DEB A est atteinte, le support d'information est invalidé et aucune lecture ne peut avoir lieu.
La mémoire d'identification peut contenir en outre les zones suivantes:
— une zone Plein indiquant que la carte est pleine et qu'aucune écriture n'est possible;
— une zone Clés contenant le code de la clé du banquier et celui du client; la clé N° 1 est, par exemple, attribuée au banquier alors que la clé N° 2 est attribuée au client;
— une zone VALC 1 permettant de définir la validité de la clé N° 1 ; si VALC 1 ^ 11, la clé est valide;
— une zone VALC 2 permettant de définir la validité de la clé N° 2; si VALC 2 11, la clé est valide.
Dans le cas où LOCK # 11, la clé N° 1 permet seule l'écriture de toute information pouvant augmenter la capacité d'achat du support d'information, en particulier toute forme de crédit. Par contre, la clé N° 2 est utilisée par le propriétaire du support d'information pour valider les opérations de débit (lectures ou écritures protégées).
La mémoire d'identification en partie 2 de la mémoire physique commence immédiatement avant la mémoire de définition (zone type) dans le sens des adresses décroissantes. Cette zone de longueur variable permet de stocker des informations de façon permanente.
Elle comprend:
— une zone Adresse contenant le pointeur ADT qui contient l'adresse de départ de la zone de travail et le pointeur ADL qui contient l'adresse de la zone de lecture;
— une zone RIB correspondant au relevé d'identité bancaire et la date d'émission du support d'enregistrement;
— une zone NOM correspondant au nom du titulaire du support d'enregistrement ;
— une zone Montant à n bits;
— une zone unité Uj permettant, avec la zone Montant, de connaître le montant initial du support d'enregistrement. Par exemple si la zone unité vaut 500 F, le montant initial que pourra contenir le support d'enregistrement sera de (2n— 1) • 500 F.
La mémoire financière est implantée en zone de travail dans la partie 1 de la mémoire physique, entre les adresses ADT et ADL. Les débits s'inscrivent directement à partir de l'adresse ADT dans le sens des adresses croissantes. Les crédits s'inscrivent à partir de l'adresse ADL dans le sens des adresses décroissantes; ainsi, débits et crédits remplissent la mémoire au fur et à mesure, en progressant l'un vers l'autre.
La fig. 5 représente sous forme détaillée les circuits représentés aux fig. 1 et 2. Sur cette figure, les informations entrantes ou sortantes apparaissent sous forme binaire sur la borne 6 du support d'information. Elles entrent dans le support d'information par la porte 25 et sont mémorisées dans le registre à décalage T 24, la porte 25 étant commandée par le signal transitant sur la ligne 36 reliant la porte 25 à la logique de commande 16. Les informations sortent du support d'information par la porte 26, elle-même commandée par le signal présent sur la liaison 36 reliant la porte 26 à la logique de commande. L'information contenue dans le registre T 24 sert ensuite de premier opérande pour une opération arithmétique/logique effectuée dans l'unité arithmétique/logique 23 commandée par le signal de commande émis par la logique de commande 16 sur la liaison 37. Le deuxième opérande est trouvé dans un des registres A, B, C, D du banc de registres 19 adressé par le sélecteur d'adresses 22, lequel est commandé par la logique de commande 16 à l'aide de la liaison 29. Le résultat d'une opération effectuée par l'unité arithmétique/logique est transmis soit dans le registre A du banc de registre 19, soit vers la borne 6 du support d'information au travers de la porte 26. Les registres A, B, C, D peuvent aussi être chargés à partir du bus de données et d'adresses 34 par la liaison 41 sous la commande de la logique de commande 16 par la liaison 46. Le bus 34 est aussi relié par la laison bidirectionnelle 33 au registre à décalage T 24 qui est alors chargé ou lu sur ses entrées/sorties parallèles. La logique de commande 16 retransmet les micro-instructions adressées par le sélecteur d'adresses PC 13 dans la mémoire de commande 20 du type R0M et lues dans le registre RM 14 par la liaison 48.
La mémoire 21 est une mémoire non volatile, elle est adressée par le registre d'adresses 11 chargé par le bus 34 et la liaison 3. Le registre 5 d'adresses 11 pointe les mots d'information dans la mémoire 21. Il est commandé par le signal de commande émis sur la liaison 38 reliant la logique de commande 16 au registre d'adresses 11. L'adresse contenue dans le registre 11 peut être incrémentée ou décrémentée automatiquement par l'horloge et mise sur la borne 5 du support io d'information sous le contrôle de la logique de commande 16. Les données lues en mémoire 21 sont transmises sur le bus 34 par l'intermédiaire du registre de données 12 sous le contrôle de la logique de commande 16 sur la liaison 42. Tous les éléments pris isolément de la fig. 5 sont bien connus de l'homme de l'art; il est donc 15 inutile de donner ici plus de détails.
Compte tenu des applications envisagées, les fonctionnalités du dispositif représenté sur la fig. 5 peuvent se résumer ainsi :
— lecture et écriture séquentielles de la mémoire 21 dans les zones autorisées à partir d'une adresse donnée;
20 — acquisition et contrôle d'une clé d'habilitation par comparaison avec un mot inaccessible extérieurement au support d'information et écrit en zone secrète de la mémoire d'application;
— autorisation ou interdiction des lectures et des écritures;
— autocontrôle systématique des écritures dans la mémoire; 25 — commande de mémorisation interne des erreurs et/ou des réussites d'accès;
— mise hors service des fonctions précédentes par un nombre d'erreurs fixé dans la partie 0.
Les fig. 6 et 7 illustrent le fonctionnement en mode de lecture 30 mémoire. Sur le diagramme de la fig. 6, le signal RAZ initialise la logique de commande 16 qui autorise le transfert du message arrivant sur la ligne 1/0 dans le registre T.
L'ordre de lecture se présente sous la forme d'un signal SYNC qui précède le code opération CODOP et les bits d'adresse AD. Les 35 codes utilisés sont naturellement à définir pour chaque application. L'ordre CODOP et l'adresse sont reçus par l'unité de traitement qui doit reconnaître, par un test sur le mot CODOP et les bits LP, s'il s'agit d'une opération de lecture et si la lecture est protégée ou simplement autorisée. Sur le diagramme de la fig. 7, l'acquisition du 40 message CODOP + AD figure à l'étape 501 et le test a lieu aux étapes 502 et 504. S'il s'agit d'une opération de lecture non protégée, le registre 11 de la fig. 4 est chargé à l'étape 510 par le mot d'adresse qui suit l'envoi de CODOP sur la ligne 1/0 puis, à l'étape 511, des tests sont effectués pour vérifier que l'adresse de lecture se trouve 45 bien dans la zone de mémoire autorisée. En particulier, le microprogramme inscrit dans la mémoire de commande 20 viendra vérifier que le mot d'adresse reçu est plus grand que l'adresse AD, puisque seule une lecture externe est autorisée dans les parties 1 et 2 de la mémoire physique. Si l'adresse est plus grande que l'adresse ADT, la jo donnée est alors lue dans la mémoire 21, puis chargée dans le registre 12 pour être ensuite transmise par l'intermédiaire du bus 34 sur la ligne 1/0 de sortie. Le registre d'adresses est ensuite incrémenté ou décrémenté d'une unité suivant le contenu du code CODOP, par rebouclage du microprogramme à l'étape 510. Si l'adresse AD est 55 plus petite que l'adresse ADT (adresse dans la partie 0), le registre d'adresse 11 est incrémenté d'une unité jusqu'à ce que son contenu atteigne la valeur ADT. De cette façon, toute la mémoire, sauf la partie 0, peut être lue par un appareil connecté au support d'information dans le sens croissant ou décroissant des adresses.
60 Si la lecture est protégée, les tests effectués sur le CODOP et les bits LP doivent coïncider et, dans ce cas, l'acquisition d'une clé à l'étape 506 est nécessaire. Dans le cas d'ime application où deux clés sont nécessaires, le contenu du code CODOP spécifie le type de clé qui doit être utilisé pour que l'opération de lecture puisse se réaliser. 65 La clé reçue sur la ligne 1/0 est alors comparée à l'une des deux clés contenues dans la mémoire d'identification. S'il y a coïncidencence, la clé transmise est bonne et un bit est alors inscrit dans la mémoire d'accès (étape 507); un contrôle sur l'écriture de ce bit est ensuite
effectué à l'étape 508 et un retour à l'étape 507 est nécessaire si le bit n'est pas écrit. Dès que l'écriture a effectivement eu lieu, des tests sur les zones DEBAC, Erreur et PLEIN sont effectués à l'étape 509 pour vérifier que le support d'information est toujours valide. Dans le cas où le support d'information ne serait pas valide, une émission d'un code 000 aura lieu sur la ligne 1 /0. Si le support est reconnu par le microprogramme, l'adresse AD est forcée dans le registre d'adresses 1 et les étapes 510 et 513 sont exécutées.
Dans le cas où, à l'étape 506, la clé reçue sur la ligne 1/0 se révèle fausse, un bit d'erreur est alors mémorisé dans la mémoire d'erreur (étape 514). Lorsque le bit d'erreur est inscrit, un test a lieu à l'étape 515 pour vérifier si le nombre d'erreurs enregistré n'est pas supérieur au nombre N d'erreurs autorisé. Si le nombre est inférieur, le message FFF est alors émis sur la ligne 1 /0; par contre, s'il est supérieur, le message 000 sera alors émis sur la ligne 1/0 et le support d'information sera invalidé.
Par le processus de lecture du support d'information qui vient d'être décrit, on voit que l'utilisateur perçoit toujours un fonctionnement du support d'information constant, quel que soit l'usage, bon ou mauvais, de la clé d'accès. D'autre part, l'écriture d'un bit d'accès ou d'un bit d'erreur dans la mémoire, dans chacune des éventualités clé bonne ou mauvaise, se traduit toujours par une même consommation du courant électrique par le support d'information; de ce fait, un fraudeur qui contrôlerait l'intensité de courant de la carte verra toujours une consommation constante, quel que soit l'usage d'une clé bonne ou mauvaise.
Les fig. 8 et 9 illustrent le fonctionnement du support d'information en mode écriture mémoire. Sur le diagramme de la fig. 8, le signal de RAZ initialise la logique de commande 16 et le transfert dans le registre T 24 des informations présentes sur la ligne 1/0. L'ordre d'écriture se présente sous la forme d'un signal SYNC précédant un code opération CODOP, suivi des bits d'adresse AD de donnée, et d'une clé, si l'écriture est protégée. Le signal VP est ensuite transmis pour permettre l'écriture de la donnée dans la mémoire 21 du support d'information. Pour que l'utilisateur ait la certitude que la donnée transmise sur la ligne 1/0 a bien été inscrite dans le support d'information, la donnée inscrite en mémoire est relue et réémise à destination de l'utilisateur sur la ligne 1/0. Le code CODOP est naturellement spécifique de chaque application. Sur l'organipro-gramme de la fig. 9, l'ordre CODOP et l'adresse AD suivi ou non d'une clé sont reconnus par le support d'information par un test qui a lieu aux étapes 702 et 703. A l'étape 704, un test de validité du support d'information est effectué sur les zones DEBE, DEBAC et PLEIN. Si le support d'information est reconnu valide, l'acquisition de la donnée a lieu à l'étape 705.
S'il s'agit d'une écriture protégée l'usage d'une clé est nécessaire et un test sur la clé est effectué à l'étape 707. Si la clé est fausse", un bit d'erreur est écrit dans la mémoire d'erreurs (étape 708), puis un test est effectué à l'étape 709 pour vérifier s'il n'y a pas débordement de la zone d'erreurs. Dans le cas où il y a débordement, le support d'information émet sur la ligne 1/0 le code 000, signalant que la carte est invalide (étape 710). Dans le cas où il n'y a pas débordement, le
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support d'information émet le message FFF sur la ligne 1/0 (étape 711), signalant que la donnée n'a pas été écrite.
Si la clé est bonne, un bit de validation est mémorisé à l'étape 712 et l'adresse reçue est chargée dans le registre d'adresses 11 à l'étape 713. Un contrôle a alors lieu à l'étape 714 pour vérifier que l'adresse reçue est bien dans les limites autorisées de la mémoire physique, c'est-à-dire entre les adresses ADL et ADT. Si tel n'est pas le cas, le code FFF est émis sur la ligne 1/0 (étape 711), signalant que la donnée n'a pas été inscrite en mémoire. Dans le cas où l'adresse est autorisé, la donnée reçue sur la ligne 1/0 est transmise dans le registre 12 pour être écrite dans la partie 1 de la mémoire 21 (étape 715). Une vérification a lieu aux étapes 716, 717 et 718 pour vérifier que la donnée est bien écrite en mémoire. Un bit de validation est inscrit en mémoire une fois que la donnée est écrite à l'étape 719, puis la donnée écrite est ensuite réémise sur la ligne 1/0 à l'étape 720.
Bien que l'on ait décrit dans ce qui précède et représenté sur les dessins les caractéristiques essentielles de l'invention appliquées à un mode de réalisation préféré de celle-ci, il est évident que l'homme de l'art pourra y apporter toutes les modifications qui lui sembleront utiles sans pour autant sortir du cadre de la présente invention.
En résumé, le support d'information selon l'invention est formé d'un objet portatif de faible dimension associé à un dispositif électronique comprenant un microprocesseur à mémoire comprenant trois zones:
— une zone secrète où seule une lecture/écriture interne par les circuits du support d'information est autorisée;
— une zone de travail dans laquelle toutes les opérations d'écriture et de lecture sont autorisées, et
— une zone de lecture où seules les opérations de lecture commandées par les dispositifs électroniques internes ou externes au support d'information sont autorisées.
Ladite mémoire comprend en outre, dans la zone secrète, une zone d'erreurs et une zone d'accès pour l'accès aux informations strictement confidentielles nécessitant l'usage d'une clé et dans lequelles le microprogramme peut mémoriser un bit respectivement dans chacune des zones chaque fois qu'un accès au support d'information est demandé.
Il est donc possible, avec le dispositif de l'invention, de réaliser des fonctions d'écriture et de lecture dans des zones prédéterminées de la mémoire dans la mesure où l'on introduit, à l'intérieur du dispositif, un code secret qui sera reconnu par le dispositif lui-même.
Les opérations à exécuter seront alors contrôlées et traitées de façon interne et permanente à l'aide d'un microprogramme inscrit dans la mémoire du microprocesseur et spécifique de chaque application. Le traitement en interne retire donc à un fraudeur toute possibilité de s'informer sur la nature des informations nécessaires à l'usage du support d'information.
Les facultés de l'ensemble peuvent être utilisées notamment pour:
— le stockage et le traitement de données financières évolutives;
— le contrôle d'accès à des paramètres secrets ou protégés;
— la construction d'un fichier portatif confidentiel ou non avec possibilités de tris internes ou de traitements divers.
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    REVENDICATIONS multitude de fonctions sans qu'il soit nécessaire de lui conférer des structures électroniques particulières.
    1. Support d'information portatif pour la mémorisation et le Un deuxième but de l'invention est de créer un support d'infor-traitement d'informations, caractérisé en ce qu'il comprend un mation personnalisé ou non, pouvant à la fois contenir des microprocesseur (1) associé à au moins une mémoire morte program- 5 informations d'ordre général et des informations d'ordre confidentiel mable, le microprocesseur comprenant des organes d'écriture et de et comprenant des organes de traitement pour la gestion des lecture dans des parties de la mémoire morte programmable ainsi que informations contenues dans le support d'information et pour la des organes de réception ou d'émission des informations à écrire ou à gestion externe des échanges d'information avec l'appareil d'exploi-lire dans la mémoire morte programmable dudit support d'informa- tation audit support.
    tion. io Selon l'invention, ces buts sont réalisés par un support d'informa-
  2. 2. Support d'information selon la revendication 1, caractérisé en tion portatif pour la mémorisation et le traitement d'information tel ce que la mémoire morte programmable dudit support d'information qu'il est défini dans la revendication 1.
    s comprend : Selon une modalité, le fonctionnement externe des échanges avec
    — une première zone où tout accès par des informations externes au l'appareil reste le même en cas d'anomalie ou de fraude, que la clé support d'informations est interdite, seul l'accès par des informa- 15 soit bonne ou mauvaise.
    tions internes audit support étant autorisé; Les caractéristiques et avantages de l'invention ressortiront
    — une deuxième zone dans laquelle toutes les opérations d'écriture clairement de la description qui suit, faite en référence aux dessins et de lecture commandées par des organes internes et par des annexés.
    informations externes audit support sont autorisées; Les fig. 1 et 2 donnent chacune un exemple de réalisation des
    — une troisième zone de lecture où seule les opérations de lecture 20 circuits électroniques du support d'information selon l'invention, commandées par des organes internes et par des informations La fig. 3 est une vue en coupe du support d'information de externes audit support sont autorisées. l'invention.
  3. 3. Support d'information selon l'une des revendications 1 ou 2, Les fig. 4A et 4B représentent une organisation du contenu caractérisé en ce que les organes de lecture comprenant des premiers informatique du support d'information de l'invention.
    moyens de reconnaissance d'une clé d'habilitation associés à des 25 La fig. 5 représente sous forme détaillée les circuits représentés deuxièmes moyens pour mémoriser dans une zone de la mémoire aux fig. 1 et 2.
    morte programmable un bit d'erreur lorsque la clé est fausse et Les fig. 6 et 7 illustrent le fonctionnement dudit support en mode associés à des troisièmes moyens pour mémoriser un bit d'accès dans lecture mémoire.
    une autre zone de la mémoire morte programmable lorsque la clé est Les fig. 8 et 9 illustrent le fonctionnement en mode écriture reconnue bonne. 30 mémoire.
  4. 4. Support d'information selon l'une des revendications 1 ou 2, La fig. 1 donne un premier exemple de réalisation des circuits caractérisé en ce que les organes d'écriture comprennent des premiers électroniques.
    moyens de reconnaissance d'une clé d'habilitation associés à des Le microprocesseur (1) est alimenté entre la masse (9) et la borne deuxièmes moyens pour mémoriser un bit d'erreur lorsque la clé est (7) par une tension régulée provenant de l'extérieur.
    fausse dans une zone de la mémoire morte programmable associé à 35 La mémoire morte programmable électriquement (2) type des troisièmes moyens pour mémoriser un bit de validation dans une PR0M est alimenté entrç la masse (9) et la borne (8).
    autre zone de la mémoire morte programmable lorsque la clé est „ .. ,, , ,,, .
    , Cette disposition permet d appliquer la tension d écriture sur la reconnue bonne. . ,
    borne (8) tandis que la borne (7) reste a un potentiel constant pour
    40 alimenter le microprocesseur. La capacité de la mémoire (2) peut être comprise entre 4096 et 8192 positions binaires, ce qui est suffisant pour les applications envisagées. Ces capacités ne sont cependant pas
CH849178A 1977-08-26 1978-08-10 Support d'information portatif pour la memorisation et le traitement d'informations. CH631561A5 (fr)

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