SU845160A1 - Вычислитель суммы координат с величи-НАМи, пРОпОРциОНАльНыМи EE пРОизВОдНыМ - Google Patents
Вычислитель суммы координат с величи-НАМи, пРОпОРциОНАльНыМи EE пРОизВОдНыМ Download PDFInfo
- Publication number
- SU845160A1 SU845160A1 SU792757031A SU2757031A SU845160A1 SU 845160 A1 SU845160 A1 SU 845160A1 SU 792757031 A SU792757031 A SU 792757031A SU 2757031 A SU2757031 A SU 2757031A SU 845160 A1 SU845160 A1 SU 845160A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- inputs
- register
- blocks
- calculator
- outputs
- Prior art date
Links
Landscapes
- Complex Calculations (AREA)
Description
Поэтому предельным вариантом усовершенствовани вычислител на известных пока алгоритмических принципах вл етс использование табличного способа умножени при выполнении операции ЗЗ- В этом случае сокращаетс , врем выполнени вычислений, а в состав вычислител , согласно соответствующим известным схемным реализаци м , вводитс ЗУ, в котором запсана полна таблица произведений чисел . При этом коды сомножителей вл ютс ,адресами хранимых произведений .
Такой вариант выполнени известного вычислител с цифровым дифферециатором и использованием табличног способа умножени вл етс наиболее близким по технической сущности к изобретению.
Недостаток прототипа заключаетс в большой емкости ЗУ (так, например дл 10-разр дных сомножителей потребуетс более чем 10 чеек пам ти), а также сравнительно низкое быстродействие, ограниченное многократным последовательным обращением к таблице произведений.
Цель изоб зетени заключаетс в увеличении быстродействи , а также в сокращении оборудовани емкости ЗУ) .
Цели изобретени достигаетс тем что вычислительсуммы координаты с величинами, пропорциональными ее производным, содержащий К регистров К блоков пам ти, коммутатор, накапливающий сумматор и блок синхронизации , содержит К блоков пам ти, причем выходы младших и старших разр дов М-го (, К-1) регистра соединены с соответствующими входами 1.М+1)-го регистра и входами соответственно (2М-1)-го и 2М-ГО блоко пам ти, выходы которых соединены со входами коммутатора, выход которого подключен ко входу накапливающего сумматора. Управл ющие входы коммутатора , накапливающего сумматора и входы записи регистров соединены . соответственно с первым, вторым и третьим выходами блока синхронизаци а входы первого регистра вл ютс входами вычислител .
На фиг.1 изображена структурна схема предлагаемого устройства; на фиг.2 - график, иллюстрирующий св зь меходу в исходной координатой X, ее ординатой h и приращением ординаты Д h.
Предлагаемый вычислитель содержит последовательно соединенные регистры 1 по числу точек интерпол ции , вход первого из которых подключен к цифровому измерителю координаты (вход устройства). Выходы регистров 1 через соответствующие каждому регистру блоки пам ти 2 подключены к входам коммутатора 3.
Выход последнего соединен с входом накапливающего сумматора 4. При этом управл ющие входы коммутатора сумматора 4 и входы записи регистров 1 подключены к выходам блока синхронизации 5.
Вычислитель работает следующим образом.
За основу его принципа действи вз т известный метод численного диференцировани , заключающийс в получении производной п-го пор дка в точке m за счет сложени координаты функции в данной точке и m предшествующих, вз тых с посто нными коэффициентами
).,XCt.,)+.... ....tVCi)4oX(o). ()
Дл нагл дности дальнейших по снений обобщим зависимость (1)
U(t)(t)+fi,X(t.)4 . ...+ (i,X(S)+fic,X(to), (2)
где ( 0,l,2...m) посто нные коэффициенты.
Это выражение (2) и реализует предложенный вычислитель.
Claims (3)
- Дл этого предварительно в блоки 2 записаны таблицы произведений piXCt) причем произведение вычил етс как сумма ординаты (см.фиг. записанной в секции старших разр д блоков 2 и приращени д h, хран щегос в секции младших разр дов. Соответственно этим секци м каждый входной регистр также разделен на секции старших и младших разр дов. Старшие адресуют ординаты, младшие приращени .. Поступающие в дискретные моменты времени t- коды координат от цифрового измерител по сигналам блока синхронизации переписываютс из каждого предыдущего в последующий входной регистр. В результате в момент времени t (см. фиг . 2, , соответствующий началу вычислени функции и (t) , в регистра 1 наход тс значение координаты x(tyn) и m предшествующих значений {t ft, ) , X (t. .... X U с,) . Коды .старших и младших разр дов регистров 1 одновременно поступают на адресные входы соответственно секций старших и младших разр дов блоков 2. На выходах секций ординат всех блоков черезврем выборки из пам ти формируютс коды ординат, н выходах других секций - коды приращений . По сигналам блока синхронизации 5 коммутатор 3 последовательно подключает выход каждой секции блока, пам ти к входу сумматора 4. После 2(|Т1+1) суммирований на выходе последнего формируетс значение искомой функции и (t,). В результате вычисление U (ty) занимает врем , определ емое суммой времени однократного обращени к блоку пам ти и 2(т+1) значений времени суммировани на накапливающем сумматоре. При этом необходима дл работы вычислител емкость блока пам ти по каждой точке интерпол ции мала. Например, дл 10-разр дных кодов координат она составл ет по 32 чейки в каждой секции. Таким образом, простыми средствами не только повышено быстродействие но и значительно уменьшена необходима емкость.блоков пам ти в специализированном вычислителе дл определени суммы координаты с величинами , пропорциональными ее производным что особенно важно дл использовани данного вычислител в системах автоматического управлени с переменной структурой. Формула изобретени Вычислитель суммы координат с величинами, пропорциональными ее производным, содержащий К регистров К блоков пам ти, коммутатор, накапливающий сумматор и блок синхронизации , отличающийс тем, что, с целью повышени быстродействи и сокращени количества оборудовани , он содержит К блоков пам ти, причем выходы младших и старших разр дов М-го (М 1,К-1) регистра соединены с соответствующими входами М+1-го регистра .и входами соответственно 2М-1-ГО и 2М-ГО блоков пам ти, выходы которых соединены со входами коммутатора, выход которого подключен ко входу накапливающего сумматора , управл ющие входы коммутатора, накапливающего сумматора и входы записи регистров соединены соответ- . ственно с первым, вторым и третьим выходами блока синхронизации, а входы первого регистра вл ютс входами вычислител . Источники информации, прин тые во внимание при экспертизе 1.Авторское свидетельство СССР 283354, кл. G 06 В 17/00, 1970.
- 2.Авторское свидетельство СССР № 543000, кл. G 043 1/02, 1977.
- 3.Левандовский Р. Ключ к успешному .применению микропроцессоров. Электроника, Ю 6, 1975 (прототип).fffff цуфро6ог0 уз еруогемKOOpSy/ffffff /0if./Л9-Х
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU792757031A SU845160A1 (ru) | 1979-04-23 | 1979-04-23 | Вычислитель суммы координат с величи-НАМи, пРОпОРциОНАльНыМи EE пРОизВОдНыМ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU792757031A SU845160A1 (ru) | 1979-04-23 | 1979-04-23 | Вычислитель суммы координат с величи-НАМи, пРОпОРциОНАльНыМи EE пРОизВОдНыМ |
Publications (1)
Publication Number | Publication Date |
---|---|
SU845160A1 true SU845160A1 (ru) | 1981-07-07 |
Family
ID=20823822
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU792757031A SU845160A1 (ru) | 1979-04-23 | 1979-04-23 | Вычислитель суммы координат с величи-НАМи, пРОпОРциОНАльНыМи EE пРОизВОдНыМ |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU845160A1 (ru) |
-
1979
- 1979-04-23 SU SU792757031A patent/SU845160A1/ru active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US3789203A (en) | Function generation by approximation employing interative interpolation | |
US3633017A (en) | Digital waveform generator | |
US3829785A (en) | Circuit arrangement for digital frequency measurement | |
GB1516220A (en) | Apparatus for verifying a signature | |
US3033453A (en) | Computers | |
US3247365A (en) | Digital function generator including simultaneous multiplication and division | |
US4164022A (en) | Electronic digital arctangent computational apparatus | |
US4225933A (en) | Exponential function computing apparatus | |
GB1071726A (en) | Improvements in or relating to calculating apparatus | |
US3576983A (en) | Digital calculator system for computing square roots | |
US3813529A (en) | Digital high order interpolator | |
US6711596B1 (en) | Method and apparatus for determining the approximate valve of a logarithmic function | |
SU845160A1 (ru) | Вычислитель суммы координат с величи-НАМи, пРОпОРциОНАльНыМи EE пРОизВОдНыМ | |
US5272659A (en) | Engine control with fixed point digital overflow prevention | |
US3973243A (en) | Digital image processor | |
US3330943A (en) | Digital computer checking means for analog computer | |
EP0606775A1 (en) | System and method for approximating nonlinear functions | |
US4011439A (en) | Modular apparatus for accelerated generation of a quotient of two binary numbers | |
US4775951A (en) | Correlation function computing device | |
SE429080B (sv) | Digital filteranordning for olikformigt kvantiserade pulskodmodulerade signaler | |
US4760549A (en) | In line testing device for a circuit calculating the discrete Fourier transform and a circuit comprising such a device | |
US3039688A (en) | Digital incremental computer | |
US5886911A (en) | Fast calculation method and its hardware apparatus using a linear interpolation operation | |
US3798434A (en) | Electronic device for quintupling a binary-coded decimal number | |
US3257548A (en) | Division techniques |