PT101296B - Circuito lógico digital para um traçador visual do gráfico do partograma usado nas maternidades - Google Patents

Description

CIRCUITO LÓGICO DIGITAL PARA UM TRAÇADOR ELECTRÓNICO VISUAL DO GRÁFICO DO PARTOGRAMA USADO NAS MATERNIDADES

SUMÁRIO DA INVENÇÃO

A invenção refere-se a ura circuito lógico digital para um traçador electrónico, visual, do gráfico do partograma usado nas maternidades. Numa mulher grávida em perspectiva de parto recém chegada à maternidade, os obstetras medem a intervalos regulares a dilatação do colo do útero e através de um gráfico padrão analisam se o parto da parturiente é normal e, caso não seja, procuram uma alternativa que pode ser, por exemplo, uma cesariana. Com o intuito de eliminar o trabalho de rotina provocado pela constante análise da dilatação do colo do útero e a grande atenção que esta análise exige da parte do obstetra, concebeu-se um dispositivo (traçador) no qual, através de teclas, são introduzidos os dados necesários ao traçado do gráfico do partograma. 0 resultado do processamento destes dados é visualizado numa matriz de díodos emissores de luz (LED'S) . Esta matriz tem uma zona de côr verdepartos sem risco de côr de laranja- partos com perspectivas de risco e de côr vermelha- partos com risco.

DESCRIÇÃO DAS FIGURAS

FIGURA 1- Mostra a matriz de díodos emissores de luz (LED'S) onde são visualidados todos os dados introduzidos e processados comandados pelo descodificador BCD-Decimal com as saídas complementadas pelas memórias tampão (Buffers) A2, e reduzida a corrente pelas resistências de Rl a R8. A fila inferior da matriz indica em que célula da memória serão endereçados os dados referentes à dilatação do colo do útero e aos planos. 0 circuito

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LLgUTsL·-^ - d ostra a assoe iaçao de circuitos 3i- estáveis (Flip-Flop) do tipo D de Α3 a Ail de modo a armazenar e apresentar os dados introduzidos no teclado.

Figura 3 - Também mostra uma assoeiaçao como a Figura 2, embora o controlo da amostragem dos dados que estão armazenados e dos que virão a estar sejam controlados de uma forma complementar, utilizando para o efeito os circuitos de A14 a A22.

Figura 4 - Mostra a tecla S13 que em conjunto com o circuito Bi- estável (Flip-Flop) FF5 produz impulsos bem definidos para os contadores/descodificadores 3CD-Decimal A27 e A29 através das portas ?2 e ?3 que permitem seleccionar as células de endereço. Temos ainda nesta figura as memórias tarapao (Buífers) A2S e A28 que ao interromperem a transferência de dados contidos nas saídas dos contadores/descodificadores 3CD-Decimal A27 e A29, na entrada de controlo da junção 3, permitem, por estarem conectados através da junção J1 aos circuitos A3 a All e de A14 a A22, a memorização dos dados contidos na saída do codificador Decimal-3CD A30 na célula onde os circuitos A27 e A29 tiverem o estado lógico zero.

£Ligura_5. ~ Apresenta-se nesta figura o gráfico do partograma onde os partos ocorridos acima da fase latente e da fase activa sao normais iluminando-se para o efeito os díodos emissores de luz (LED'S) verdes correspondentes a cada rectãnguio, os partos ocorridos na zona de acçao tendem a provocar riscos iluminando-se assim os díodos emissores de luz (DFD'3) alaranjados correspondentes a cada rectãnguio, e abaixo da zona de acçao iluminam-se os díodos emissores de luz (LED'3) vermelhos que

65811 demonstram a existência de perigo.

Figura 6- Mostra o teclado de SI a S10 que através da junção J6 liga ao codificador Decimal-BCD A30 e este através da junção J2 endereça os dados aos circuitos Biestáveis (Flip-Flop's) de A3 a All e de A14 a A22 que são circuitos utilizados para a memorização da dilatação do colo do útero e dos planos respectivamente.

Temos ainda os transístores de TI a T8 controlados pelo circuito Bi-estável (Flip-Flop) FF6 e PIO que em funcionamento conjunto fazem a transferência da prioridade de endereço da célula compreendida entre A3 e All para a recta padrão do partograma.

Nesta mesma figura existem os contadores/codificadores BCD-Decimal A31 e A32 que, auxiliados pelas portas P4 e P5, geram uma sequência de estado lógico 1 nas suas saídas com uma frequência de 1 Khz, o que permite uma multiplexagem na matriz dos dados memorizados em A3 a All e A14 a A22, sendo a junção J3 a intermediária da operação.

DESCRIÇÃO DA INVENÇÃO

Os obstetras que utilizam o método gráfico do partograma para analisar a evolução de um parto necessitam, em função do gráfico de partograma, conhecer:

- Dilatação do colo do útero.

- Planos (altura da descida da apresentação).

- Tempo de permanência da parturiente na maternidade em perspectiva de parto.

Para evitar as anotações escritas na forma como até agora o diagrama tem sido utilizado, o dispositivo da invenção possue uma matriz de díodos emissores de luz (LED'S) de Dl '30 JÍlH.Wtf

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D130 or.de será visualizado rodo o processamento dos dados introduz idos segundo o método do partograma.

Os dados:

- Dilataçao do colo do útero,

- Planos sao introduzidos utilizando as teclas de SI a S10 que servem ao mesmo tempo para a introdução dos referidos dados e para memorizar os planos, bastando para isso premir a tecla S12, iluminando-se assim o díodo emissor de luz (LED) D181 que está conectado à saída Q do contador binário FF3, limitada a sua corrente pela resistência R12.

Os dados introduzidos no teclado de 10 teclas sao codificados para BCD pelo codificador Decimal-3CD A30 que recebe dados decimais do teclado através da junção J6. As resistências de R22 a R31 garantem o nível lógico ura nas entradas do codificador enquanto nao fôr premida nenhuma tecla, tendo era conta que o comum das referidas resistências estão ligadas a +· 5 Volts. As saídas do codificador A30 estão ligadas às entradas D dos circuitos Bi-estáveis (FlipFlop’s) de A3 a A1I e de A14 a A22 através das memórias tampao (Buffers) A13 e A24 respectivamente, sendo estas duas controladas pelo contador binário FF3 que com as suas saídas complementares seleccionam o endereço dos dados .

ijma vez premida uma das teclas de Sl a S10, a porta AND ?8 indentifica a tecia premida e nesse momento a saída da referida porta transita do estado lógico um para zero, arrasado o impulso peia montagem constituída por ?7, P5, Rl3 e C3. A saída da porta NAND ?5 produz um impulso com um atraso em reiaçao ao rerapo de pressão da tecla e este impulso através da ligaçao 3 liga às entradas ie controlo das memórias tampao (Puffersi A26 e A23 as quais controlam a transferência dos dados contidos no codificador A30 , cuja transferência tem prioridade, para a célula que tiver a saída dos circuitos A27 e A29 era estado lógico zero, que é a ordem de tempo de permanência da parturiente na maternidade em perspectiva de parto, tempo este que é introduzido sequencialmente pela tecla S13.

Para que os dados introduzidos (dilataçao do colo do útero) na segunda medição, caso ultrapassem ou sejam iguais a 3 cm, sejam transferidos para a recta padrao do partograma, a porta PIO detecta a pressão de uma das referidas teclas de Sl a S8 e, complementada pela porta NOT ?9, ataca a entrada P do circuito bi-estável (Flip-Flop) FF6 que, se for a segunda medição identificada pela entrada S da ligaçao 2 da junção J4, o transístor correspondente, de TI a T8. à tecla premida dará prioridade à transferência de dados para a recta padrao utilizando a junção J4 com os pontos de ligaçao de 8a 15.

deslocamento gerado pelos circuitos integrados A31 e A32, transmitidos através da junção J3, distribuem a sua geraçao cora uma frequência de 1 Khz à matriz de díodos emissores de luz (LFD'S) de Dl a D180. e também para os controles de saida dos circuitos bi-estáveis (FLIP-FLOP) de A3 a Ail e de A14 a A22, possibilitando uma multiplexagera dos dados na matriz e na apresentaçao dos dados memorizados e processados pelos circuitos atrás referidos.

Para exisnir uma diferença na matriz entre os dados memorizados referentes à dilataçao do colo e dos planos, as memórias tampao (Puffers) A24 têm a sua enmrada de controlo ligada ao oscilador de muito baixa frequência através da

Ô 0 3 L L jur. ;··?.<.ι I, o que ?ermi“e usna insarmizãnc ia na aore:ser.taçao dos dauo s dos planos polo facbo da sua apreser.saçao ser ir.oerrompida por uma frequência de 2 Hersz.

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Claims (9)

1° - Circuito lógico digital para um traçador electrónico visual do gráfico do partograma usado nas maternidades, em que a partir das medições feitas pelo obstetra da dilatação do colo do útero da parturiente em intervalos regulares e dos planos feitos para o nascimento, se traça um gráfico que permite avaliar do risco envolvido no parto, caracterizado por os dados (dilatação e planos) serem introduzidos através das teclas SI a S10, e a memorização dos dados ser feita premindo a tecla SI2, sendo esses dados codificados pelo codificador BCD (A30), estando as saídas deste codificador ligadas às entradas D dos circuitos bi-estáveis (flip-flop’s) de A3 a Al 1 e de A14 a A22, através de memórias tampão (Buffers) A13 e A24 respectivamente, sendo estas duas controladas pelo contador binário FF3 que com as suas saídas complementares seleccionam o endereço dos dados, e também por possuir circuitos integrados A3 1 e A32 e uma matriz de díodos emissores de luz (LED’S), tendo esta matriz uma zona de cor verde para partos sem risco, laranja para partos com perspectiva de risco e, vermelha para partos de risco.

2^a - Circuito Lógico Digital de acordo com a primeira reivindicação caracterizado por possuir um circuito bi-estável (flip-flop) FF1 que recebe através da junção 16 impulsos de tecla S10 para introduzir os 10 cm., tendo em conta que o descodificador Al tem permanentemente na saída o algarismo zero no último estágio de contagem e desse modo impossibilita a marcação de uma décima tecla.

3^a - Circuito Lógico Digital de acordo com a reivindicação anterior caracterizado por possuir um oscilador constituído por uma resistência R9, um condensador Cl e uma porta disparador (SCHMITT-TRIGGER) PI que dá impulsos com uma frequência de doisHerts para sinalizar de uma forma intermitente para que célula da memória, correspondente ao tempo de permanência da parturiente na maternidade em perspectiva de parto, estão a ser endereçados os dados referentes á dilatação do colo e os planos, utilizando para a memorização os circuitos integrados contendo circuitos bi-estáveis (flip-flop’s) de A3 a Al 1, para a dilatação do colo, e de A14 a A22, para os planos.

4^a - Circuito Lógico Digital de acordo com a 3^a reivindicação caracterizado por possuir memórias tampão (Buffers) A13 que, pressionando a tecla SI2, seleccionam a entrada de dados para os circuitos de A3 a Al 1, cuja selecção é visualizada no díodo emissor de luz (LED) D181 que recebe tensão da saída Q do circuito bi-estável (flip-flop) FF3 e limita a corrente pela resistência RI2.

5^a - Circuito Lógico Digital de acordo com reivindicação anterior caracterizado por possuir um circuito bi-estável (flip-flop) FF4 que recebe impulsos da conecção E dá prioridade ao acesso alternado das saídas do circuito de A3 a Al l e de A14 a A22 para o descodifícadorBCD-Decimal que alimenta a matriz.

6^a - Circuito Lógico Digital de acordo com a 5^a reivindicação caracterizado por possuir um registo de deslocamento accionado pelos circuitos integrados A27, A29, P2 e P3, estes dois últimos funcionando em conjunto permitem o funcionamento alternado dos circuitos A27 e A29.

7^a - Circuito Lógico Digital de acordo com a 6^a reivindicação caracterizado por possuir memórias tampão (Buffers) A26 e A28 que recebem impulsos através da ligação B após a pressão de uma das teclas de SI a S10 e que pelo facto das saídas dos circuitos A27 e A29 serem de colector aberto e os circuitos de A3 a AU e de A14 a A22 serem disparados no flanco ascendente, recebem um impulso de relógio na saída de A26 e A28, permitindo assim a memorização dos dados contidos na saída do descodificador decimal BCD A30.

8^a - Circuito Lógico Digital de acordo com a reivindicação anterior caracterizado por possuir uma porta NAND PIO que detecta a pressão de uma tecla referente à dilatação do colo, superior ou igual a 3cm., e, uma vez invertida a sua saída com a porta P9 que activa a entrada R do circuito bi-estável (flip-flop) e a FF6 que detecta se é ou não a segunda medição do colo, e caso sejam reconhecidas as duas condições citadas anteriormente e pelo facto de a saída Q do circuito bi-estável (flip-flop) FF6 estar ligada ao comum das resistências de polarização dos transístores de Tl a T8, há uma transferência dos dados referentes à tecla premida num determinado tempo (matriz) para a recta padrão do partograma (Método de transferência do partograma).

9^a - Circuito Lógico Digital de acordo com reivindicação anterior caracterizado por possuir dois contadores/descodificadoresBCD-Decimal A31 e A32, montados de maneira especial, de modo a fazerem o papel de registo de deslocamento, visto que a porta P4 impossibilita o circuito A32 de funcionar sem que a última saída de A31 transite para o estado lógico zero.