NL8801481A - Schakelstelsel voor het doorschakelen van zowel pakket-georienteerde data als circuit-georienteerde data. - Google Patents
Schakelstelsel voor het doorschakelen van zowel pakket-georienteerde data als circuit-georienteerde data. Download PDFInfo
- Publication number
- NL8801481A NL8801481A NL8801481A NL8801481A NL8801481A NL 8801481 A NL8801481 A NL 8801481A NL 8801481 A NL8801481 A NL 8801481A NL 8801481 A NL8801481 A NL 8801481A NL 8801481 A NL8801481 A NL 8801481A
- Authority
- NL
- Netherlands
- Prior art keywords
- data
- input
- packet
- memory
- address
- Prior art date
Links
- 230000004044 response Effects 0.000 claims description 4
- 238000001514 detection method Methods 0.000 claims description 2
- 230000000903 blocking effect Effects 0.000 description 5
- 238000006243 chemical reaction Methods 0.000 description 2
- 239000004020 conductor Substances 0.000 description 2
- 125000004122 cyclic group Chemical group 0.000 description 2
- 230000006870 function Effects 0.000 description 2
- 238000012544 monitoring process Methods 0.000 description 1
- 230000032258 transport Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/64—Hybrid switching systems
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/10—Packet switching elements characterised by the switching fabric construction
- H04L49/103—Packet switching elements characterised by the switching fabric construction using a shared central buffer; using a shared memory
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04J—MULTIPLEX COMMUNICATION
- H04J2203/00—Aspects of optical multiplex systems other than those covered by H04J14/05 and H04J14/07
- H04J2203/0001—Provisions for broadband connections in integrated services digital network using frames of the Optical Transport Network [OTN] or using synchronous transfer mode [STM], e.g. SONET, SDH
- H04J2203/0003—Switching fabrics, e.g. transport network, control network
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/25—Routing or path finding in a switch fabric
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/30—Peripheral units, e.g. input or output ports
- H04L49/3027—Output queuing
Description
AT&T en Philips Telecommunicatiebedrijven B.V.
Schakelstelsel voor het doorschakelen van zowel pakket-georiënteerde data als circuit-georiënteerde data.
De uitvinding betreft een schakelstelsel voor het doorschakelen van zowel pakket-georiënteerde data als circuit-georiënteerde data.
Een dergelijk schakelstelsel is bekend uit de internationale octrooiaanvrage nr. WO 84/01246.
Het in deze octrooiaanvrage beschreven schakelstelsel voor telecommunicatie doeleinden dient zowel pakket-georiënteerde data (bijvoorbeeld data die getransporteerd wordt tussen computers onderling) als circuit-georiënteerde data (bijvoorbeeld spraak in telefonieverbindingen) te kunnen doorschakelen. Daartoe is dit schakelstelsel voorzien van zowel een pakket-schakelaar als een circuit-schakelaar. De pakket-schakelaar dient voor het doorschakelen van de pakket-georiënteerde data, terwijl de circuit-schakelaar dient voor het doorschakelen van de circuit-georiënteerde data. De pakket-schakelaar omvat een eerste schakeling ("packet access circuit") die bestemd is voor het doorlaten van de pakket-georiënteerde data en het blokkeren van de circuit-georiënteerde data. De circuit-schakelaar omvat een tijdtrap ("TSI") en een tweede schakeling ("port data store") die bestemd is voor het doorlaten van de circuit-georiënteerde data en het blokkeren van de pakket-georiënteerde data. Beide schakelaars zijn aangesloten op een databus die zowel de pakket-georiênteerde data als de circuit-georiënteerde data transporteert. De pakket-georiënteerde data en de circuit-georiënteerde data worden dus via twee volledig gescheiden schakelaars doorgeschakeld.
De uitvinding beoogt een schakelstelsel te verschaffen waarin de pakket-schakelfunctie en de circuit-schakelfunctie met elkaar geïntegreerd zijn.
Daartoe is de uitvinding gekenmerkt, doordat dit schakelstelsel tenminste één ingangstijdtrap omvat voor het doorschakelen van circuit-georiënteerde data, welke ingangstijdtrap is voorzien van: * een datageheugen dat in de controlled output mode bedreven wordt, welk datageheugen is voorzien van - een data-ingang die is aangesloten op een inkomende pakketbus via overdrachtsmiddelen voor het onvertraagd na ontvangst doorgeven van een pakket, - een data-uitgang en - een adresingang; * een adresseerinrichting voor het genereren van inschrijfadressen die bestemd zijn voor het datageheugen en een centrale besturingseenheid, welke adresseerinrichting is voorzien van - een data-uitgang die is aangesloten op de adresingang van het datageheugen en die aansluitbaar is op de centrale besturingseenheid en - een stuuringang die is ingericht voor het ontvangen van een pakketsignaal voor het in responsie op het detecteren van een pakket genereren van een inschrijvingsadres; * een VCI-buffer voor het aan de centrale besturingseenheid toevoeren van een bij een pakket behorende virtuele circuit identificatie, verder te noemen VCI, welk VCI-buffer is voorzien van - een ingang die is aangesloten op de inkomende pakketbus en - een uitgang die aansluitbaar is op de centrale besturingseenheid; en * een routeringsgeheugen voor het per uit te lezen pakket genereren van het betreffende datageheugenadres, welk routeringsgeheugen is voorzien van - een data-uitgang die is aangesloten op de adresingang van het datageheugen, - een data-ingang die aansluitbaar is op de centrale besturingseenheid en - een adresingang die naar keuze aansluitbaar is op een teller of op de centrale besturingseenheid, waarbij de adresingang van het datageheugen naar keuze verbonden wordt met de data-uitgang van de adresseerinrichting of met de data-uitgang van het routeringsgeheugen.
Eén gedeelte van het datageheugen is bestemd voor circuit-georiënteerde data. Een ander gedeelte is bestemd voor pakket-georiënteerde data. In dit laatste gedeelte van het datageheugen wordt een pakket ingeschreven op een plaats met een datageheugenadres dat door de adresseerinrichting wordt verschaft. Zowel dit bij het pakket behorende datageheugenadres als de virtuele circuit identificatie van het pakket (verder te noemen VCI)f welk VCI opgeslagen is in het VCI-buffer, worden naar de centrale besturingseenheid toegezonden. üitlezing van een datapakket uit het datageheugen vindt plaats onder besturing van het routeringsgeheugen, waarbij het volgnummer van de uitleestijdsleuf gelijk is aan het datageheugenadres. Deze gelijkheid wordt gerealiseerd door als het adres van het routeringsgeheugen het gewenste tijdsleufnummer te kiezen en de betreffende geheugenplaats te voorzien van het datageheugenadres van het in die tijdsleuf uit te lezen pakket. De toevoeging van het tijdsleufnummer aan het datageheugenadres wordt door de centrale besturingseenheid uitgevoerd door middel van een op zichzelf bekend niet van de uitvinding deel uitmakend routeringsalgoritme.
Een schakelstelsel zoals hiervoor beschreven heeft het additionele voordeel dat de grens in het datageheugen tussen pakket-georiênteerde data en circuit-georiënteerde data verplaatsbaar kan worden gemaakt. Hierdoor kan in geval van een meer dan gemiddeld aanbod van pakket-georiënteerde data een groter gedeelte van het datageheugen hiervoor worden gereserveerd. Omgekeerd kan bij een meer dan gemiddeld aanbod van circuit-georiënteerde data een groter gedeelte van het datageheugen voor circuit-georiënteerde data worden gereserveerd.
Een voorkeursuitvoering van het schakelstelsel volgens de uitvinding is gekenmerkt, doordat de adresseerinrichting een geheugen van het eerst in-eerst uit type (FIFO = First in-First Out) omvat dat is voorzien van: * een data-uitgang die de data-uitgang van de adresseerinrichting vormt; * een stuuringang die de stuuringang van de adresseerinrichting vormt en * een data-ingang die is aangesloten op de data-uitgang van het routeringsgeheugen.
Het FIFO-geheugen wordt bij het in werking treden van het schakelstelsel geladen met datageheugenadressen van vrije plaatsen van het datageheugen, dus met alle adressen van het pakketgedeelte van het datageheugen. De adresseerinrichting die door het FIFO-geheugen wordt gevormd verschaft per in te schrijven pakket een datageheugenadres van een vrije geheugenplaats. Indien er voor de inkomende pakketten geen datageheugenadres van een vrije geheugenplaats meer beschikbaar is, is het FIFO-geheugen leeg. De adresseerinrichting genereert dan geen datageheugenadressen meer. Door toepassing van het FIFO-geheugen is dus een vol-bewaking van het datageheugen mogelijk geworden. Daarmee wordt bereikt dat, indien het 'datageheugen vol dreigt te raken, het FIFO-geheugen een alarmsignaal afgeeft. In responsie hierop kunnen dan passende maatregelen worden genomen zoals beperking van het aangeboden verkeer of het doen verloren gaan van pakketten.
De uitvinding zal nader worden toegelicht aan de hand van een in de figuren weergegeven uitvoeringsvoorbeeld. Daarbij toont:
Figuur 1 een bekend schakelstelsel van het TST-type (Time Space Time), en
Figuur 2 een ingangstijdtrap volgens de uitvinding.
Het in figuur 1 weergegeven schakelstelsel omvat n ingangstijdtrappen 1-1 tot en met 1-n (in het algemeen 1-i), een ruimteschakeltrap 2 en n uitgangstijdtrappen 3-1 tot en met 3-n (in het algemeen (3-j). De uitgang van elke ingangstrap 1-i is verbonden met een eigen ingang van de ruimteschakeltrap 2. De ingang van elke uitgangstijdtrap 3-j is verbonden met een eigen uitgang van de ruimtetrap 2.
In een ingangstijdtrap 1-i inkomende informatie is reeds over tijdsloten verdeeld en wordt door ingangstijdtrap 1-i over de tijdsloten herverdeeld en vervolgens doorgestuurd naar de ruimteschakeltrap 2. De ruimteschakeltrap 2 verbindt de ingang waarop deze informatie wordt aangeboden met één van zijn uitgangen.
Vervolgens wordt de informatie doorgestuurd naar de bijbehorende uitgangstijdtrap 3-j en wordt de informatie door deze uitgangstijdtrap 3-j naar de juiste tijdsleuf doorgeschakeld.
De in figuur 2 weergegeven ingangstijdtrap omvat een parallelle inkomende bus 19 voor circuit verkeer die is verbonden met de data-ingang 36 van datageheugen 33. De ingangstijdtrap omvat verder een seriële inkomende pakketbus 20 die is verbonden met overdrachtsmiddelen, die in dit uitvoeringsvoorbeeld worden gevormd door een serie-parallelomzetter 21. Hiervan is de parallelle uitgang verbonden met de data-ingang van datageheugen 33 evenals de inkomende circuitbus 19. De inkomende pakketbus 20 is bovendien verbonden met de ingang van VCI-buffer 22, dat verder is aangesloten op pakketpulsgeleider 23 en bitklokgeleider 24.
Uitgang 25 van VCI-buffer 22 is verbonden met een ingang 27 van comparator 26 en via blokkeringsschakelaar 29 met de centrale besturingseenheid. Een andere ingang 28 van comparator 26 is voorzien van een codewoord voorstellende een Empty Packet Gode (EPC). De uitgang van comparator 26 is verbonden met de stuuringang van blokkeerschakelaar 29 en met een stuuringang van adresseerinrichting 31.
Adresseerinrichting 31 is in dit uitvoeringsvoorbeeld uitgevoerd als een geheugen van het eerst in-eerst-uit type (FIFO =
First In-First Out). Data-uitgang 32 van FIFO 31 is verbonden met adresingang 34 van datageheugen 33 en met de centrale besturingseenheid. Data-ingang 40 van FIFO 31 is verbonden met data-uitgang 52 van routeringsgeheugen 50. Deze data-uitgang 52 is evenals data-uitgang 32 verbonden met adresingang 34 van datageheugen 33. Hiervan is data-uitgang 37 verbonden met de ingang van parallel-serieomzetter 38, waarvan uitgang 39 de uitgaande bus vormt. Deze bus is in figuur 1 weergegeven door de geleider die ingangstijdtrap 1-i en ruimteschakeltrap 2 met elkaar verbindt.
Van routeringsgeheugen 50 is data-ingang 51 verbonden met de centrale besturingseenheid en is adresingang 53 zowel verbonden met de centrale besturingseenheid als met uitgang 56 van cyclische teller 55.
Datageheugen 33 kan verdeeld worden gedacht in twee gedeelten. Eén gedeelte is bestemd voor circuit-georiênteerde data, terwijl het andere gedeelte bestemd is voor pakket-georiënteerde data.
Datageheugen 33 wordt bedreven in de controlled output mode. Dit wil zeggen dat inkomende pakketten worden ingeschreven op opvolgend vrije plaatsen. De uitlezing van de pakketten daarentegen vindt plaats volgens door de centrale besturingseenheid gespecificeerde adressen, waarvan de volgorde wordt bepaald door de volgorde van de uitgaande tijdsleuven waarin de betreffende pakketten dienen te worden geplaatst.
Een via pakketbus 20 inkomend pakket wordt toegevoerd aan serie-parallelomzetter 21, waar het pakket parallel aan de uitgang verschijnt. Deze serie-parallelomzetting van het pakket kan in één bewerking plaatsvinden, zodat het gehele pakket in parallelle vorm op de parallelle uitgang verschijnt. Voor lange pakketten (bijvoorbeeld met een lengte van 512 bits) is het mogelijk om het inkomende pakket eerst te verdelen in deelpakketten die daarna achtereenvolgens aan de serie- parallelomzetting worden onderworpen, waarna deze deelpakketten op bij elkaar behorende geheugenplaatsen van datageheugen 33 worden ingeschreven. Tegelijkertijd wordt de virtuele circuit identificatie van het pakket, verder te noemen VCI (Virtual Circuit Identifier) toegevoerd aan het VCI-buffer 22, waar het VCI parallel op de uitgang 25 verschijnt. Vanuit uitgang 25 wordt het VCI toegevoerd aan ingang 27 van comparator 26. Hier wordt het VCI vergeleken met de op de andere ingang 28 aanwezige Empty Packet Code (EPC).
Gelijkheid van het VCI en de EPC indiceert een leeg pakket. De comparator 26 geeft dan een uitgangssignaal aan blokkeringsschakelaar 29 af in responsie waarop blokkeringsschakelaar 29 blokkeert: het VCI wordt niet toegevoerd aan de centrale besturingseenheid.
In het geval het aankomende pakket met informatie gevuld is, wordt het bijbehorende VCI wel toegevoerd aan de centrale besturingseenheid. Bovendien, verschaft in dit geval FIFO 31 onder besturing van het uitgangssignaal van comparator 26 een inschrijfadres van een vrije geheugenplaats aan adresingang 34 van datageheugen 33. Op deze plaats wordt het pakket dan ingeschreven in het datageheugen.
Samen met het VCI wordt het adres van deze plaats aan de centrale besturingseenheid toegevoerd.
De centrale besturingseenheid krijgt dus van elk inkomend niet-leeg pakket het VCI toegevoerd en eveneens het adres waar het pakket in het datageheugen 33 is opgeslagen. Om een aldus opgeslagen pakket in een gewenste tijdsleuf te kunnen uitlezen genereert de centrale besturingseenheid door middel van een op zichzelf bekend niet tot de uitvinding behorend routeringsalgoritme een bij die tijdsleuf behorend uitleesadres van datageheugen 33. Het dit adres representerende codewoord wordt toegevoerd aan data-ingang 51 van routeringsgeheugen 50, op het moment dat een vrije route voor dat pakket beschikbaar is. Tegelijkertijd voert de centrale besturingseenheid een bij dit codewoord behorend adres aan adresingang 53 van routeringsgeheugen 50 toe welk adres de plaats in dit routeringsgeheugen 50 aangeeft waar het betreffende uitleesadres is opgeslagen.
Tijdens uitleescycli van routeringsgeheugen 50 verschaft cyclische teller 55 op zijn uitgang 56 een adres dat wordt toegevoerd aan adresingang 53 van routeringsgeheugen 50. De op deze plaats in routeringsgeheugen 50 aanwezige data (zijnde het adres van het uit te lezen pakket (in datageheugen 33)) verschijnt dan aan data-uitgang 52 van routeringsgeheugen 50. Dit uitleesadres wordt toegevoerd aan adresingang 34 van datageheugen 33 en het op deze plaats aanwezige pakket wordt uitgelezen. Via data-uitgang 37 wordt dit pakket toegevoerd aan parallel-serie omzetter 38. Het pakket verlaat vervolgens de ingangstijdtrap via bus 39.
Data-uitgang 32 van FIFO 31 en data-uitgang 52 van routeringsgeheugen 50 worden beiden verbonden met adresingang 34 van datageheugen 33. Dit geschiedt bijvoorbeeld door een op zichzelf bekend, niet in de figuur weergegeven onschakelniddel dat adresingang 34 naar keuze verbindt met data-uitgang 32 of data-uitgang 52. Ook is het mogelijk datageheugen 33 te voorzien van zowel een inschrijfadresingang als een uitleesadresingang. In dit geval dient data-uitgang 32 verbonden te worden met de inschrijfadresingang en dient data-uitgang 52 verbonden te worden met de uitleesadresingang.
Eenzelfde realisatie is mogelijk bij adresingang 53 van routeringsgeheugen 50.
Claims (2)
1. Schakelstelsel voor het doorschakelen van zowel pakket- georiënteerde data als circuit-georiënteerde data, met het kenmerk, dat dit schakelstelsel tenminste één ingangstijdtrap omvat voor het doorschakelen van circuit-georiënteerde data, welke ingangstijdtrap is voorzien van: * een datageheugen dat in de controlled output mode bedreven wordt, welk datageheugen is voorzien van - een data-ingang die is aangesloten op een inkomende pakketbus via overdrachtsmiddelen voor het onvertraagd na ontvangst doorgeven van een pakket, - een data-uitgang en - een adresingang; * een adresseerinrichting voor het genereren van inschrijfadressen die bestemd zijn voor het datageheugen en een centrale besturingseenheid, welke adresseerinrichting is voorzien van - een data-uitgang die is aangesloten op de adresingang van het datageheugen en die aansluitbaar is op de centrale besturingseenheid en - een stuuringang die is ingericht voor het ontvangen van een pakketsignaal voor het in responsie op het detecteren van een pakket genereren van een inschrijvingsadres; * een VCI-buffer voor het aan de centrale besturingseenheid toevoeren van een bij een pakket behorende virtuele circuit identificatie, verder te noemen VCI, welk VCI-buffer is voorzien van - een ingang die is aangesloten op de inkomende pakketbus en - een uitgang die aansluitbaar is op de centrale besturingseenheid; en * een routeringsgeheugen voor het per uit te lezen pakket genereren van het betreffende datageheugenadres, welk routeringsgeheugen is voorzien van - een data-uitgang die is aangesloten op de adresingang van het datageheugen, - een data-ingang die aansluitbaar is op de centrale besturingseenheid en - een adresingang die naar keuze aansluitbaar is op een teller of op de centrale besturingseenheid, waarbij de adresingang van het datageheugen naar keuze verbonden wordt met de data-uitgang van de adresseerinrichting of met de data-uitgang van het routeringsgeheugen.
2. Schakelstelsel volgens conclusie 1, met het kenmerk, dat de adresseerinrichting een geheugen van het eerst in-eerst uit type (FIFO = First in-First Out) omvat dat is voorzien van: * een data-uitgang die de data-uitgang van de adresseerinrichting vormt; * een stuuringang die de stuuringang van de adresseerinrichting vormt en * een data-ingang die is aangesloten op de data-uitgang van het routeringsgeheugen.
Priority Applications (6)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
NL8801481A NL8801481A (nl) | 1988-06-09 | 1988-06-09 | Schakelstelsel voor het doorschakelen van zowel pakket-georienteerde data als circuit-georienteerde data. |
US07/360,496 US4962499A (en) | 1988-06-09 | 1989-06-02 | Switching system for switching packet oriented data as well as circuit oriented data |
EP89201424A EP0345891B1 (en) | 1988-06-09 | 1989-06-05 | Switching system for switching packet oriented data as well as circuit oriented data |
DE89201424T DE68909117T2 (de) | 1988-06-09 | 1989-06-05 | Vermittlungssystem zum Vermitteln von sowohl paketorientierten Daten als auch von durchschaltorientierten Daten. |
CA000601889A CA1314611C (en) | 1988-06-09 | 1989-06-06 | Switching system for switching packet oriented data as well as circuit oriented data |
JP1143920A JPH0232645A (ja) | 1988-06-09 | 1989-06-06 | 交換装置 |
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
NL8801481 | 1988-06-09 | ||
NL8801481A NL8801481A (nl) | 1988-06-09 | 1988-06-09 | Schakelstelsel voor het doorschakelen van zowel pakket-georienteerde data als circuit-georienteerde data. |
Publications (1)
Publication Number | Publication Date |
---|---|
NL8801481A true NL8801481A (nl) | 1990-01-02 |
Family
ID=19852437
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
NL8801481A NL8801481A (nl) | 1988-06-09 | 1988-06-09 | Schakelstelsel voor het doorschakelen van zowel pakket-georienteerde data als circuit-georienteerde data. |
Country Status (6)
Country | Link |
---|---|
US (1) | US4962499A (nl) |
EP (1) | EP0345891B1 (nl) |
JP (1) | JPH0232645A (nl) |
CA (1) | CA1314611C (nl) |
DE (1) | DE68909117T2 (nl) |
NL (1) | NL8801481A (nl) |
Families Citing this family (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5475708A (en) * | 1989-09-25 | 1995-12-12 | Siemens Aktiengesellschaft | Circuit arrangement with at least one input and at least one output for forwarding an input signal that can be filtered, parallelized and digitized |
US5144619A (en) * | 1991-01-11 | 1992-09-01 | Northern Telecom Limited | Common memory switch for routing data signals comprising ATM and STM cells |
US5274642A (en) * | 1992-06-05 | 1993-12-28 | Indra Widjaja | Output buffered packet switch with a flexible buffer management scheme |
CA2105268C (en) * | 1992-12-28 | 1999-07-13 | Shahrukh S. Merchant | Resynchronization of asynchronous transfer mode (atm) switch fabric |
US6128282A (en) * | 1997-12-18 | 2000-10-03 | Sicom, Inc. | Network node controller and method for combining circuit and packet data |
US6278706B1 (en) * | 1998-04-03 | 2001-08-21 | Opuswave Networks, Inc. | Wireless packet data communication apparatus and method |
US6404735B1 (en) | 1998-04-30 | 2002-06-11 | Nortel Networks Limited | Methods and apparatus for distributed control of a multi-class network |
US6667956B2 (en) | 1998-05-01 | 2003-12-23 | Nortel Networks Limited | Multi-class network |
US6594238B1 (en) * | 1998-06-19 | 2003-07-15 | Telefonaktiebolaget Lm Ericsson (Publ) | Method and apparatus for dynamically adapting a connection state in a mobile communications system |
US6580721B1 (en) | 1998-08-11 | 2003-06-17 | Nortel Networks Limited | Routing and rate control in a universal transfer mode network |
US6707825B1 (en) | 1998-12-08 | 2004-03-16 | Salix Technologies, Inc. | Signal processing system |
EP1255385A3 (en) * | 1998-12-08 | 2002-11-13 | Tellabs Operations, Inc. | Signal processing system and hybrid switching |
US6931002B1 (en) | 1998-12-08 | 2005-08-16 | Daniel S. Simpkins | Hybrid switching |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
FR2538976A1 (fr) * | 1982-12-29 | 1984-07-06 | Servel Michel | Systeme de commutation de paquets synchrones de longueur fixe |
US4521880A (en) * | 1983-12-06 | 1985-06-04 | At&T Bell Laboratories | Time-slot interchanger for fast circuit switching |
CA1292053C (en) * | 1986-09-16 | 1991-11-12 | Yoshito Sakurai | Time-division channel arrangement |
-
1988
- 1988-06-09 NL NL8801481A patent/NL8801481A/nl not_active Application Discontinuation
-
1989
- 1989-06-02 US US07/360,496 patent/US4962499A/en not_active Expired - Lifetime
- 1989-06-05 DE DE89201424T patent/DE68909117T2/de not_active Expired - Fee Related
- 1989-06-05 EP EP89201424A patent/EP0345891B1/en not_active Expired - Lifetime
- 1989-06-06 CA CA000601889A patent/CA1314611C/en not_active Expired - Fee Related
- 1989-06-06 JP JP1143920A patent/JPH0232645A/ja active Pending
Also Published As
Publication number | Publication date |
---|---|
US4962499A (en) | 1990-10-09 |
EP0345891A1 (en) | 1989-12-13 |
DE68909117T2 (de) | 1994-04-21 |
CA1314611C (en) | 1993-03-16 |
EP0345891B1 (en) | 1993-09-15 |
DE68909117D1 (de) | 1993-10-21 |
JPH0232645A (ja) | 1990-02-02 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US4885744A (en) | Apparatus for reconstructing and multiplexing frames of various origins made up of a variable number of packets of fixed length | |
EP1013132B1 (en) | Switch arrangement | |
EP0405042B1 (en) | High speed digital packet switching system | |
CA2022798C (en) | Communication switching element and method for transmitting variable length cells | |
US4797880A (en) | Non-blocking, self-routing packet switch | |
EP0418813A2 (en) | Routing method and routing system for switching system having a plurality of paths | |
NL8801481A (nl) | Schakelstelsel voor het doorschakelen van zowel pakket-georienteerde data als circuit-georienteerde data. | |
JP2915323B2 (ja) | パケット交換機およびその拡張モジュール | |
EP0256526A2 (en) | Packet-switched communications network for efficiently switching non-burst signals | |
CA2383458C (en) | Method and apparatus for an interleaved non-blocking packet buffer | |
EP0256701A2 (en) | Crosspoint circuitry for data packet space division switches | |
WO1999000819A3 (en) | Packet routing switch for controlling access at different data rates to a shared memory | |
US4612636A (en) | Multiple channel depacketizer | |
US5513174A (en) | Telecommunication system with detection and control of packet collisions | |
CA2071583C (en) | System for converting synchronous time-division signals into asynchronous time-division data packets | |
US6434148B1 (en) | Data packet re-sequencer | |
US5247514A (en) | Multiple channel transit call control apparatus | |
US6301259B1 (en) | Switch and switching method | |
US6931020B1 (en) | Method and device for switching a plurality of packet-oriented signals | |
CA1230402A (en) | Multiple channel depacketizer | |
US20040090961A1 (en) | Parallel processing routing device | |
HU205511B (en) | Method for processing data packets in the information systems | |
JP2003509907A (ja) | 複数のパケット信号伝送装置用競合解決要素 | |
JP3203226B2 (ja) | バースト回線交換網 | |
JPH04504339A (ja) | 高速データパケットスイッチング回路および方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A1B | A search report has been drawn up | ||
BV | The patent application has lapsed |