KR950003028B1 - Video scrambling system by spectrum rotation - Google Patents
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Abstract
Description
제1도는 종래의 비디오 스크램블링 블록도.1 is a conventional video scrambling block diagram.
제2도는 (a)의 제1도에서 A/D변환기에 입력되는 복합영상신호의 파형도이고, (b)는 제1도에서 D/A변환기에 출력되는 스크램블링된 복합영상신호의 파형도.FIG. 2 is a waveform diagram of a composite video signal input to an A / D converter in FIG. 1A, and (B) is a waveform diagram of a scrambled composite video signal output to the D / A converter in FIG.
제3도는 본 발명 스펙트럼 로테이션에 의한 비디오 스크램블링 시스템의 구성도.3 is a block diagram of a video scrambling system using spectral rotation according to the present invention.
제4도는 (a) 내지 (d)는 본 발명을 설명하기 위한 제3도 각부의 출력 스펙트럼도.4 is an output spectrum diagram of each part of FIG. 3 for explaining the present invention.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
11 : 버퍼 15,16 : 평형변조기11:
12,13,18 : 저역여파기 OP11 : 연산증폭기12,13,18: Low pass filter OP11: Operational amplifier
14,17 : 대역여파기 R11-R13 : 저항14,17: bandpass filter R11-R13: resistance
본 발명은 아날로그 비디오신호의 스크램블링(Scrambling)에 관한 것으로, 특히 복합영상신호의 스펙트럼을 저역필터와 대역필터를 이용하여 2개의 세그먼트로 분리한다음 그 분리된 신호를 교환시켜 스크램블링 거는데 적당하도록 한 스펙트럼 로테이션에 의한 비디오 스크램블링 시스템에 관한 것이다.BACKGROUND OF THE
제1도는 종래의 비디오 스크램블링 블록도로서 이에 도시한 바와같이, 제2도의 (a)와 같은 아날로그의 복합영상신호(CVS)가 아날로그(A)/디지탈(D)변환기(1)에 입력되어 디지탈 비디오 신호로 변환된 후, 그 디지탈 비디오 신호중 1라인의 신호가 라인메모리(2)에 저장된다.FIG. 1 is a conventional video scrambling block diagram. As shown in FIG. 2, an analog composite video signal CVS such as (a) of FIG. 2 is input to an analog (A) / digital (D)
한편, 어드레스제어부(6)는 랜덤발진부(5)로부터 입력되는 데이타를 커팅 포인트 데이타로 하여 이 포인트를 중심으로 상기 라인메모리(2)에 저장된 1라인신호를 2개의 세그먼트로 분리한 다음 그 분리된 2개의 세그먼트를 서로 교환하여 새로운 라인메모리(3)에 저장하고, 상기 라인메모리(3)에 저장된 디지탈 세그먼트가 D/A변환기(4)에서 다시 아날로그신호로 변환되어 제2도의 (b)와같일 스크램블링 영상신호로 출력되게 되어 있었다.Meanwhile, the address controller 6 divides one line signal stored in the
그러나 이와같이 종래의 시스템은 A/D변환기 및 D/A변환기, 라인메모리를 구성요소로 함으로 시스템의 원가를 상승시켜 사용자에게 경제적인 부담을 주게되는 문제점이 있었다.However, such a conventional system has a problem in that an economic burden is placed on the user by raising the cost of the system by using the A / D converter, the D / A converter, and the line memory as components.
본 발명은 이와같은 종래의 문제점을 해결하기 위하여 고가의 A/D변환기 및 D/A변환기, 라인메모리를 사용하지 않고 필터를 이용하여 복합영상신호에 스크램블링을 걸수 있는 시스템을 창안한 것으로 이를 첨부한 도면에 의하여 상세히 설명한다.In order to solve such a conventional problem, the present invention has devised a system capable of scrambling a complex video signal using a filter without using an expensive A / D converter, a D / A converter, and a line memory. It demonstrates in detail by drawing.
제3도는 본 발명 스펙트럼 로테이션에 의한 비디오 스크램블링 시스템의 구성도로서 이에 도시한 바와같이 아날로그의 복합영상신호(CVS)를 입력하여 버퍼링하는 버퍼(11)와, 상기 버퍼(11)로 부터 입력되는 신호중에서 필요로하는 신호의 대역까지만 통과시키는 저역여파기(12)와, 상기 저역여파기(12)에서 출력되는 영상스펙트럼을 0부터 1/2fsc까지오프하여 하나의 세그먼트로하는 저역여파기(13)와, 상기 저역여파기(12)로부터 출력되는 영상스펙트럼을 1/2fsc∼6MHz까지 필터링하여 또다른 세그먼트로하는 대역여파기(14)와, 상기 저역여파기(13)에 출력되는 영상스펙트럼을 fsc∼6MHz까지 시스팅시키는 평형변조기(15)와, 상기 대역여파기(14)에 출력되는 영상스펙트럼을 0∼1/2fsc까지 시프팅시키는 평형건조기(16)와, 상기 평형건조기(15)의 출력 스펙트럼을 fsc∼6MHz까지 대역여파하는 대역여파기(17)와, 상기 평형건조기(16)의 출력 스펙트럼을 1/2fsc까지오프하는 저역여파기(18)와, 상기 대역여파기(17) 및 저역여파기(18)의 출력스펙트럼을 가산하여 스크램플된 비디오 신호를 출력하는 연산증폭기(OP11)로 구성한 것으로 이와같이 구성된 본 발명의 작용 효과를 제4도를 참조하여 상세히 설명하면 다음과 같다.3 is a configuration diagram of a video scrambling system using spectrum rotation according to the present invention. As shown therein, a buffer 11 for inputting and buffering an analog composite video signal CVS and a signal input from the buffer 11 are shown.
버퍼(11)에서 버퍼링되어 출력되는 신호가 제4도의 (a)와 같은 복합영상신호(CVS)라고 할때, 상기 복합영상신호(CVS)의 스펙트럼 밴드폭이 6HMz임을 감안하여 그 이상을 점유하고 있는 잡음이나 인접채널의 스펙트럼을 저역여파기(12)를 통해오프한다.When the signal buffered and output from the buffer 11 is a composite video signal CVS as shown in (a) of FIG. 4, the composite video signal CVS occupies more than that in consideration of the spectral bandwidth of 6HMz. Through the
또한 상기 저역여파기(12)의 출력 스펙트럼은 제4도(a)의 A와같이 저역여파기(13)에서 1/2fsc까지오프되어 하나의 세그먼트로 됨과 아울러 대역여파기(14)에 입력되어서는 제4도 (a)의 B와 같이 1/2fsc∼6MHz까지 여파되어 또다른 세그먼트로 된다.In addition, the output spectrum of the
이어서 상기 저역여파기(13)의 출력 스펙트럼은 평형변조기(15)에 입력되어 제4도의 (b)와 같이 0∼1/2fsc까지의 비디오 스펙트럼이 fsc∼6MHz까지 시프팅되고, 이때 대역여파기(17)는 상기 평형변조기로부터 입력되는 스펙트럼중에서 fsc∼6MHz까지의 스펙트럼을 대역여파한다.Subsequently, the output spectrum of the
한편, 상기 대역여파기(14)에 출력되는 1/2fsc∼6MHz까지의 스펙트럼은 평형건조기(16)에 입력되어 0∼1/2fsc까지 시프팅되므로 결국 제4도의 (c)와같이 되고, 이때 저역파기(18)는 fsc까지오프한다.On the other hand, the spectrum from 1 / 2fsc to 6MHz output to the
이와같은 과정을 통해 출력되는 상기 대역여파기(17) 및 저역여파기(18)의 출력 스펙트럼은 연산증폭기(OP11)에서 가산되어 최종적으로 제4도의 (d)와 같이 스크램블된 신호(SS)로 출력되게 된다.The output spectrums of the
이상에서 상세히 설명한 바와같이 본 발명은 여파기 및 평형변조기등을 이용하여 스크램블링회로를 구성함으로써 제품의 원가를 절감할 수 있는 이점이 있다.As described in detail above, the present invention has the advantage of reducing the cost of the product by configuring a scrambling circuit using a filter and a balance modulator.
Claims (1)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019890018563A KR950003028B1 (en) | 1989-12-14 | 1989-12-14 | Video scrambling system by spectrum rotation |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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KR1019890018563A KR950003028B1 (en) | 1989-12-14 | 1989-12-14 | Video scrambling system by spectrum rotation |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
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KR2019890017300 Division | 1989-11-22 |
Publications (2)
Publication Number | Publication Date |
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KR910011005A KR910011005A (en) | 1991-06-29 |
KR950003028B1 true KR950003028B1 (en) | 1995-03-29 |
Family
ID=19292897
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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KR1019890018563A KR950003028B1 (en) | 1989-12-14 | 1989-12-14 | Video scrambling system by spectrum rotation |
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Country | Link |
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KR (1) | KR950003028B1 (en) |
-
1989
- 1989-12-14 KR KR1019890018563A patent/KR950003028B1/en not_active IP Right Cessation
Also Published As
Publication number | Publication date |
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KR910011005A (en) | 1991-06-29 |
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