KR930007190Y1 - De-emphasis for multi-sound broadcasting system - Google Patents

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Abstract

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Description

다방송 수신 시스템의 공용 디엠파 시스 회로Common DMP System of Multi-Broadcast Reception System

제1도는 종래의 회로도.1 is a conventional circuit diagram.

제2도는 본 고안의 회로도.2 is a circuit diagram of the present invention.

* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings

1 : 공용 디엠파 시스 회로부 2 : 음성 검파 ICDESCRIPTION OF SYMBOLS 1: Common DMPA sheath circuit part 2: Voice detection IC

본 고안은 다방송방식 수신 시스템의 음성신호 처리계통에서 TV 방송 방식별로 특별히 요구되는 디엠파시스(De-emphasis) 시정수값을 회로적으로 간단히 스위칭 시켜 줌으로써, 양질의 음성 출력을 얻을 수 있도록 설계된 다방송 수신 시스템의 공용 디엠파 시스 회로에 관한 것이다.The present invention is designed to obtain high-quality audio output by simply switching the De-emphasis time constant that is specially required for each TV broadcasting system in the voice signal processing system of the multi-broadcast reception system. It relates to a common DMP system circuit of a broadcast receiving system.

TV 세트에서의 음성 수신은, 튜너로부터 출력되는 영상 중간 주파 신호를 4.5MH2검파단에서 검파하여 4.5MHz의 음성중간 주파 신호를 얻고, 이러한 4.5MH2의 음성중간 주파 신호를 FM 검사한 후 저주파 증폭하여 출력하는 계통을 갖는다.The audio reception in the TV set detects the video intermediate frequency signal output from the tuner at the 4.5MH 2 detector to obtain a 4.5MHz audio medium frequency signal, and then performs the FM test of the 4.5MH 2 audio medium frequency signal to low frequency. Has a system to amplify and output.

이때, 음성중간 주파 신호를 FM 검파하고 증폭하는 FM검파 및 저주파 증폭단은 제1도에서 보이고 있는 바와 같이 음성 검파 IC(2)를 이용하는 것이 일반화되어 있다.At this time, the FM detection and low frequency amplifying stage for FM detecting and amplifying the voice intermediate frequency signal is generally used as the voice detection IC 2 as shown in FIG.

그런데, 방송국 측에서는 TV 방송신호를 송출할때 고역 부근에서의 감쇄를 보상하기 위해서 방송신호에 프리엠파 시스를 걸어주게 되게 되므로, 수신측에서는 이러한 방송신호를 본래의 주파수 특성을 갖는 음성신호로 복원시켜 주기 위해 디엠파 시스 회로부(1')가 필요하게 된다.On the other hand, when a broadcasting station transmits a TV broadcast signal, a preemphasis is applied to the broadcast signal to compensate for attenuation in the vicinity of the high range. Therefore, the receiving side restores the broadcast signal to an audio signal having original frequency characteristics. In order to achieve this, the DMPA sheath circuit 1 'is required.

이러한 디엠파 시스 회로부(1')는 커패시터(C1)와 저항(R)으로 구성되며, 여기에서 결정되는 CR 시정수값으로 음성검파 IC(2) 내의 FM 검파단에서 출력되는 음성검파 신호에 디엠파시스가 걸리게 된다.The DMPA sheath circuit part 1 ′ is composed of a capacitor C 1 and a resistor R, and the DM time is determined by the CR time constant value. It takes a parsesis.

상기 디엠파 시스 회로부(1')의 CR 시정수 값은 방송방식마다 각기 다른 값을 가지게 되는데, 일예로 NTSC방송 방식의 경우 그 CR 시정수값은 75μsec이고 팔 및 세캄방송 방식의 경우 그 CR 시정수값은 50μsec이다.The CR time constant of the DMPA circuit 1 'has a different value for each broadcasting method. For example, the NTSC broadcasting method has a CR time constant of 75 μsec, and the arm and secam broadcasting method has a CR time constant. Is 50 μsec.

따라서 하나의 고정된 CR 시정수 값을 갖는 디엠파 시스회로를 통하여 여러방식의 TV 방송 신호를 수신하는 경우, 해당 방송방식에 따른 디엠파 시스시정수값이 일치하는 경우에는 음성수신상에 문제가 없으나, 그 시정수값이 다른 경우에는 TV 음성신호에 많은 잡음이 삽입되게 된다.Therefore, when receiving TV broadcast signals of various methods through a DMPA system having a fixed CR time constant value, there is no problem in voice reception when the DMMP system time constants according to the corresponding broadcasting method are identical. However, when the time constant is different, a lot of noise is inserted into the TV audio signal.

그러므로 지금까지는 다방송 방식 수신 시스템의 음성 검파 IC에 다수의 CR 시정수 값을 갖는 디엠파 시스회로를 마련하고 이를 기계적인 스위치 조작을 통하여 방송방식에 따른 디엠파 시스 시정수 값을 일치시켜 주고 있었다.Therefore, up to now, the DMP system having a large number of CR time constants is provided in the voice detection IC of the multi-broadcast reception system, and the DMP system time constants according to the broadcasting method are matched by mechanical switch operation. .

그러나 이와같은 기존의 음성 검파 IC용 디엠파 시스 회로에서는 수신 방송 방식의 절환시마다 다엠파시스 시정수값을 변경시켜 주기 위한 수조작이 요구된다는 불편이 따른다.However, such a conventional DM detector system for voice detection IC is inconvenient because a manual operation is required to change the multi-emphasis time constant value at each switching of the reception broadcast method.

본 고안의 목적은 상기와 같은 기존의 디엠파시스 시정수 절환 방식으로부터 벗어나 수신방송 방식 선택시 발생하는 조직 레벨을 이용하여 해당 수신 방송에 적합한 디엠파 시스 시정수값을 얻을 수 있는 다방송 수신 시스템의 공용 디엠파 시스 회로를 제공하는데 있다.An object of the present invention is to provide a demultiplexing time constant value suitable for a corresponding broadcast by using a tissue level generated when the receiving broadcast method is selected from the existing deemphasis time constant switching method as described above. It is to provide a common DMPA sheath circuit.

이하 첨부된 도면에 기초하여 본 고안을 설명하며 다음과 같다.Hereinafter, the present invention will be described based on the accompanying drawings.

제2도는 본 고안의 회로 구성도로써, 튜너의 영상 중간 주파 신호를 받아 4.5MH2의 음성 중간 주파 신호를 출력하는 4.5MHZ검파단(도시생략)의 음성 중간 주파 신호가 음성 검파 IC(2) 내의 FM 검파단 및 저주파 증폭단에서 검파 및 증폭되어 음성신호로 출력되게 구성하고, 상기 음성검파 IC(2)의 FM 검파 신호는 공용디엠파 시스 회로부(1)에 의해 디엠파 시스되게 구성한다.Second turn as a circuit configuration of the subject innovation, the received image intermediate frequency signal of a tuner, an audio intermediate frequency signal of the detected Z 4.5MH stage (not shown) for outputting the audio intermediate frequency signal of the second voice detection 4.5MH IC (2 Is detected and amplified by the FM detection stage and the low frequency amplification stage in the circuit), and outputted as a voice signal, and the FM detection signal of the voice detection IC 2 is configured to be deemphasized by the common DMPA circuit 1.

상기 공용 디엠파 시스회로부(1)는 제1커패시터(C1) 및 저항(R)의 CR 병렬회로로 구성되는 제1CR 시정수 회로부와, 상기 제1CR 시정수 회로에 제2커패시터(C2)가 병렬로 더 연결되는 제2CR 시정수 회로에 포함되는 제2커패시터(C2)는 에미터 측이 그라운드된 NPN 타입 트랜지스터(Q)의 온에 의해서 상기 제1커패시터(C1)에 병렬로 연결되게 구성하고, 상기 트랜지스터(Q1)는 방송방식 선택에 따라 발생되는 선택신호(S)의 로직에 의해 제어되게 구성한다.The common DMPA sheath circuit part 1 includes a first CR time constant circuit part including a first parallel capacitor C 1 and a CR parallel circuit of a resistor R, and a second capacitor C 2 connected to the first CR time constant circuit. a second capacitor (C 2) is connected in parallel to the first capacitor (C 1) by one of the emitter NPN-type transistor (Q) the side ground contained in the 2CR be circuit time constant is further connected in parallel The transistor Q 1 is configured to be controlled by the logic of the selection signal S generated according to the broadcast method selection.

상기 트랜지스터(Q)의 콜렉터 측에는 회로전압(B+)이 인가되게 구성한다.The circuit voltage B + is applied to the collector side of the transistor Q.

이와 같이 구성된 본 고안의 작용 및 효과를 설명하면 다음과 같다.Referring to the operation and effects of the present invention configured as described above are as follows.

먼저 음성검파 IC(2)에 입력되는 4.5MHZ의 음성 중간 주파 신호는 상기 음성검파 IC(2)내의 FM 검파단과 저주파 증폭단을 거쳐 검파 및 증폭된 음성 신호로 출력된다.First, the 4.5 MH Z voice intermediate frequency signal input to the voice detection IC 2 is output as a voice signal that has been detected and amplified through the FM detector and the low frequency amplifier in the voice detector IC 2.

이때 상기 음성 검파 IC(2)의 FM 검파단에서 검파된 음성 신호에는 공용 디엠파 시스 회로부(1)에 의한 디엠파시스가 걸리게 되는데, 튜너에서 선택한 방송방식이 세캄 또는 팔 방식인 경우에는, 트랜지스터(Q)의 베이스축으로 인가되는 선택신호(S)의 레벨이 로우 레벨로 되도록 설계되므로 상기 트랜지스터(Q)는 오프상태가 된다.In this case, the voice signal detected by the FM detector of the voice detection IC 2 is subjected to deemphasis by the common DMPA circuit 1, and when the broadcast method selected by the tuner is the secam or arm method, the transistor Since the level of the selection signal S applied to the base axis of (Q) is designed to be at a low level, the transistor Q is turned off.

이에 따라 공용 디엠파 시스 회로부(1)의 디엠파시스 CR 시정수값은 제1캐패시터(C1)와 저항(R)의 병렬회로에 의한 제1CR 시정수 회로에 의해 결정되므로, 선택한 방송 방식(세캄 또는 팔 방식)에 해당하는 50μsec의 값으로 정해지게 된다.Accordingly, the value of the de-emphasis CR time constant of the common de-emphasis circuit unit 1 is determined by the 1CR time-constant circuit by the parallel circuit of the first capacitor C 1 and the resistor R. Or arm type).

한편 튜너에서 선택한 방송 방식이 NTSC 방식인 경우에는, 트랜지스터(Q)의 베이스측으로 인가되는 선택신호(S) 레벨이 하이레벨로 되도록 설계되므로 상기 트랜지스터(Q)가 온되어 제2커패시터(C2)의 한쪽이 그라운드 된다.On the other hand, when the broadcast method selected by the tuner is the NTSC method, the selection signal S applied to the base side of the transistor Q is designed to be at a high level, so that the transistor Q is turned on and the second capacitor C 2 is turned on. One side of is grounded.

이에 따라 상기 제1CR 시정수 회로를 구성하는 제1커패시터(C1)에 상기 제2커패시터(C2)가 병렬로 연결되어져, 상기 제1,2 커패시터(C1,C2)의 병렬합성용량과 저항(R2)에 의한 제2시정수 회로에 의해 75μsec의 디엠파시스 CR 시정수 값이 얻어지게 된다.Accordingly, the second capacitor C 2 is connected in parallel to the first capacitor C 1 constituting the first CR time constant circuit, so that the parallel synthesized capacitance of the first and second capacitors C 1 and C 2 is achieved. By the second time constant circuit due to the resistance R 2 , a value of the de-emphasis CR time constant of 75 μsec is obtained.

이상에서 설명한 바와 같은 본 고안은 음성 중간 주파신호를 처리하는 음성검파 IC의 외부 CR 디엠파시스회로에 CR 시정수 변경용 보조커패시터를 병렬로 더 마련하고, 이 보조 커패시터는 방송방식 선택 신호에 따라 제어되는 트랜지스터에 의해 선택되게 함으로써, 다방송 수신 시스템의 수신 방송 방식별로 적절히 디엠파 시스된 양질의 음성 출력을 얻을 수 있게 된다.As described above, the present invention further provides an auxiliary capacitor for changing a CR time constant in parallel in an external CR de-emphasis circuit of a voice detection IC that processes a voice intermediate frequency signal. By being selected by the transistor to be controlled, it is possible to obtain a quality sound output that is appropriately deemphasized according to the reception broadcast method of the multicast reception system.

Claims (1)

영상중간 주파 신호에서 검파된 음성중간 주파 입력 신호를 FM 검파 하고 저주파 증폭하여 음성신호를 출력하는 음성검파 IC(2)의 FM 검파 출력 검파 출력단에 마련되는 공용 디엠파 시스 회로에 있어서, 상기 공용 디엠파 시스회로(1)는 제1커패시터(C1) 및 저항(R)으로 형성되어 제1CR 시정수회로와 방송방식 선택신호(S)에 따라 스위칭 제어되는 트랜지스터(Q)를 통하여 상기 제1CR 시정수 회로에 병렬로 연결되어 제2CR시정수 회로를 형성하는 제2커패시터(C2)로 구성된 것을 특징으로 하는 다방송 수신 시스템의 공용 디엠파 시스회로.In the common DM system circuit provided in the FM detection output detection output stage of the voice detection IC (2) for outputting a voice signal by FM detection and low frequency amplification of the voice intermediate frequency input signal detected from the video intermediate frequency signal. The pass circuit 1 is formed of a first capacitor C 1 and a resistor R, and the first CR time is corrected through a transistor Q that is switched and controlled according to a first CR time constant circuit and a broadcast mode selection signal S. And a second capacitor (C 2 ) connected in parallel to the male circuit to form a second CR time constant circuit.
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