KR930005170Y1 - A/d 변환기 칩 누설전류 보상회로 - Google Patents
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Abstract
내용 없음.
Description
제1도는 종래 아날로그 입력단의 회로도.
제2도는 본 고안의 누설전류 보상회로 부가된 아날로그 입력단의 회로도.
* 도면의 주요부분에 대한 부호의 설명
1 : 평활회로 2 : A/D
본 고안의 반도체 칩 누설전류 보상회로에 관한 것으로서, 특히 디지털멀티미터(DVM)에 내장되는 A/D변환기에 적당하도록 한 칩 누설전류 보상회로에 관한 것이다.
종래에는 제1도에서 보인바와 같이, 아날로그 입력이 평활회로(1)를 통하여 A/D변환기의 인하이(IN high)단자와 인로우(INLOW) 단자에 연결된다. 아날로그 신호가 입력되지 않으면, A/D변환기(2)의 IN High 단자와 IN LOW 단자 사이의 전압이 제로 볼트가 되어서, 디지탈 값으로 변환된 A/D 변환기(2)의 출력전압값도00…0로 되어야 하지만, 실제 경우에는 평활회로(1)로 아날로그 신호가 입력되지 않더라도 A/D변환기(2)의 IN High 단자와 IN Low 단자 사이에 누설 전류(ILEAK)가 발생하여 실제로 제로 암페어가 되지 않게 되고 디지털 출력값도 제로볼트가 되지 않게된다.
즉, A/D변환기(2)로 입력되는 전압(Vin)은 Vin=(RT+Rin)·ILEAK로 발생하게 된다.
따라서, 상기 전압(Vin)은 A/D 변환기(2)에 의해 디지털 값으로 변환되므로 디스플레이 되는 값도 00……0로 출력되지 않는다.
즉, A/D/변환기(2)의 IN High 단자와 IN LOW 단자 사이에 누설전류(ILEAK)가 발생하면, 누설전류로 인해 상기 식에서 보는 바와 같이 전압(Vin)이 캐페시터(Cin)에 충전되게 되며, 상기 충전된 전압이 A/D/변환기(2)에 의해 디지털 값으로 변환되어 출력되므로, 출력되는 디지털 값이 정확하지 않게된다는 문제점이 발생하였다.
본 고안은 이와 같은 종래의 문제점을 시정, 보완하기 위해 안출된 것으로 발생하는 누설 전류량에 따라 저항값을 변환하여 누설전류의 영향을 소거하도록 하는 누설전류 보상회로를 구비하여 출력되는 디지털 값을 정확하도록 한 것으로서, 첨부한 제2도면에 의거해서 상세히 설명하면 다음과 같다.
본 고안은 누설전류가 인하이 단자와 인로우 단자사이의 전압에 영향을 주지 아니하도록 발생하는 누설전류량만큼 인로우와 디지털 그라운드 단자 사이에 저항 및 가변저항을 이용하여 보상해 주도록 궤환저항과 스위치 및 가변저항으로 누설전류 보상회로를 구성한 것이다.
이와 같이 된 본 고안의 작용, 효과는 다음과 같다. 평활회로(1)로 아날로그 신호가 입력되지 않았을 경우, 즉 제로볼트가 입력된 경우 A/D변환기(2)의 IN High 단자와 IN LOW 단자 사이의 전압은 제로볼트가 되나, 실제적으로는 누설전류(ILEAK)가 발생하므로, 상기 IN High 단자와 IN LOW 단자 사이에 미세한 전압이 발생하게 되므로, 이때 발생된 누설 전류(ILEAK)가 저항(RF) 및 가변저항(RV)을 통하여 디지털 접지(Digital GND)로 흐르도록 하여 평활회로(1)의 캐패시터(Cin)에 충전된 전압을 상쇄 함으로써 A/D변환기(2)의 IN High 단자와 IN LOW 단자 사이에 전압이 발생되지 않게 된다.
이때, 영점을 맞추기 위해 스위치와 가변저항을 조작한다. 그래서, 아날로그 신호가 입력되지 않을 경우 발생된 누설전류가 누설전류 보상회로에 의해 소거됨으로써 A/D변환기로 입력되는 전압이 누설 전류에 의해 영향을 받지 않게 되어 A/D 변환기로부터 디지털 값이 정확하게 출력되는 효과가 있다.
Claims (1)
- 아날로그 신호를 입력받아 디지털 신호로 변환시키는 A/D변환기의 인하이단자와 인로우단자 및 아날로그 그라운드 단자 사이의 누설전류 영향을 제거하기 위한 칩 누설전류 보상회로에 있어서, 인하이 단자와 아날로그 그라운드 사이에 평활회로를 접속하고 아날로그 접지단자와 인로우 단자 사이에 가변저항과 스위치를 병렬로 접속하며, 인로우단자와 디지털 그라운드 사이에 궤환저항을 연결하여 누설전류의 영향을 상쇄시키도록 구성한 것이 특징인 A/D 변환기 칩 누설전류 보상회로.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR2019910015052U KR930005170Y1 (ko) | 1991-09-16 | 1991-09-16 | A/d 변환기 칩 누설전류 보상회로 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR2019910015052U KR930005170Y1 (ko) | 1991-09-16 | 1991-09-16 | A/d 변환기 칩 누설전류 보상회로 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR930007690U KR930007690U (ko) | 1993-04-26 |
KR930005170Y1 true KR930005170Y1 (ko) | 1993-08-09 |
Family
ID=19319320
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR2019910015052U KR930005170Y1 (ko) | 1991-09-16 | 1991-09-16 | A/d 변환기 칩 누설전류 보상회로 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR930005170Y1 (ko) |
-
1991
- 1991-09-16 KR KR2019910015052U patent/KR930005170Y1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR930007690U (ko) | 1993-04-26 |
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